arch/arm/include/asm/arch-sc8830/chip_x20/__regs_aon_clk.h

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   8  *
   9  */
  10
  11 #ifndef __REGS_AON_CLK_H__
  12 #define __REGS_AON_CLK_H__
  13
  14 #define REGS_AON_CLK
  15
  16 /* registers definitions for controller REGS_AON_CLK */
  17 #define REG_AON_CLK_PUB_AHB_CFG         SCI_ADDR(REGS_AON_CLK_BASE, 0x0020)
  18 #define REG_AON_CLK_EMC_CFG             SCI_ADDR(REGS_AON_CLK_BASE, 0x0024)
  19 #define REG_AON_CLK_AON_APB_CFG         SCI_ADDR(REGS_AON_CLK_BASE, 0x0028)
  20 #define REG_AON_CLK_AUDIF_CFG           SCI_ADDR(REGS_AON_CLK_BASE, 0x002c)
  21 #define REG_AON_CLK_FM_CFG              SCI_ADDR(REGS_AON_CLK_BASE, 0x0030)
  22 #define REG_AON_CLK_ADI_CFG             SCI_ADDR(REGS_AON_CLK_BASE, 0x0034)
  23 #define REG_AON_CLK_PWM0_CFG            SCI_ADDR(REGS_AON_CLK_BASE, 0x0038)
  24 #define REG_AON_CLK_PWM1_CFG            SCI_ADDR(REGS_AON_CLK_BASE, 0x003c)
  25 #define REG_AON_CLK_PWM2_CFG            SCI_ADDR(REGS_AON_CLK_BASE, 0x0040)
  26 #define REG_AON_CLK_PWM3_CFG            SCI_ADDR(REGS_AON_CLK_BASE, 0x0044)
  27 #define REG_AON_CLK_THM_CFG            SCI_ADDR(REGS_AON_CLK_BASE, 0x0048)
  28 #define REG_AON_CLK_CA7_DAP_CFG         SCI_ADDR(REGS_AON_CLK_BASE, 0x004C)
  29 #define REG_AON_CLK_CA7_TS_CFG          SCI_ADDR(REGS_AON_CLK_BASE, 0x0050)
  30 #define REG_AON_CLK_MSPI_CFG            SCI_ADDR(REGS_AON_CLK_BASE, 0x0054)
  31 #define REG_AON_CLK_I2C_CFG             SCI_ADDR(REGS_AON_CLK_BASE, 0x0058)
  32 #define REG_AON_CLK_RFTI_SBI_CFG        SCI_ADDR(REGS_AON_CLK_BASE, 0x005C)
  33 #define REG_AON_CLK_AVS0_CFG            SCI_ADDR(REGS_AON_CLK_BASE, 0x0060)
  34 #define REG_AON_CLK_AVS1_CFG            SCI_ADDR(REGS_AON_CLK_BASE, 0x0064)
  35 #define REG_AON_CLK_DJTAG_TCK_CFG       SCI_ADDR(REGS_AON_CLK_BASE, 0x0068)
  36
  37 /* vars definitions for controller REGS_AON_CLK */
  38 #define PUB_AHB_CLK_SEL_SHIFT           (0x0)
  39 #define PUB_AHB_CLK_SEL_MASK            (0x3 << PUB_AHB_CLK_SEL_SHIFT)
  40
  41 #define PUB_APB_CLK_SEL_SHIFT           (0x0)
  42 #define PUB_APB_CLK_SEL_MASK            (0x3 << PUB_AHB_CLK_SEL_SHIFT)
  43
  44 #define BIT_CLK_FM_SEL                  (0x1)
  45 #define BIT_CLK_FM_PAD_SEL              (0x1 << 16)
  46
  47 #endif //__REGS_AON_CLK_H__