include/configs/Alaska8220.h

   1 /*
   2  * (C) Copyright 2004
   3  * TsiChung Liew, Freescale Software Engineering, Tsi-Chung.Liew@freescale.
   4  *
   5  * See file CREDITS for list of people who contributed to this
   6  * project.
   7  *
   8  * This program is free software; you can redistribute it and/or
   9  * modify it under the terms of the GNU General Public License as
  10  * published by the Free Software Foundation; either version 2 of
  11  * the License, or (at your option) any later version.
  12  *
  13  * This program is distributed in the hope that it will be useful,
  14  * but WITHOUT ANY WARRANTY; without even the implied warranty of
  15  * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
  16  * GNU General Public License for more details.
  17  *
  18  * You should have received a copy of the GNU General Public License
  19  * along with this program; if not, write to the Free Software
  20  * Foundation, Inc., 59 Temple Place, Suite 330, Boston,
  21  * MA 02111-1307 USA
  22  */
  23
  24 #ifndef __CONFIG_H
  25 #define __CONFIG_H
  26
  27 /*
  28  * High Level Configuration Options
  29  * (easy to change)
  30  */
  31 #define CONFIG_MPC8220          1
  32 #define CONFIG_ALASKA8220       1       /* ... on Alaska board  */
  33
  34 #define CONFIG_SYS_TEXT_BASE    0xfff00000
  35
  36 #define CONFIG_BAT_RW           1       /* Use common BAT rw code */
  37 #define CONFIG_HIGH_BATS        1       /* High BATs supported */
  38
  39 /* Input clock running at 30Mhz, read Hid1 for the CPU multiplier to
  40    determine the CPU speed. */
  41 #define CONFIG_SYS_MPC8220_CLKIN        30000000/* ... running at 30MHz */
  42 #define CONFIG_SYS_MPC8220_SYSPLL_VCO_MULTIPLIER 16 /* VCO multiplier can't be read from any register */
  43
  44 #define BOOTFLAG_COLD           0x01    /* Normal Power-On: Boot from FLASH */
  45 #define BOOTFLAG_WARM           0x02    /* Software reboot      */
  46
  47 /*
  48  * Serial console configuration
  49  */
  50
  51 /* Define this for PSC console
  52 #define CONFIG_PSC_CONSOLE      1
  53 */
  54
  55 #define CONFIG_EXTUART_CONSOLE  1
  56
  57 #ifdef CONFIG_EXTUART_CONSOLE
  58 #   define CONFIG_CONS_INDEX    1
  59 #   define CONFIG_SYS_NS16550_SERIAL
  60 #   define CONFIG_SYS_NS16550
  61 #   define CONFIG_SYS_NS16550_REG_SIZE 1
  62 #   define CONFIG_SYS_NS16550_COM1      (CONFIG_SYS_CPLD_BASE + 0x1008)
  63 #   define CONFIG_SYS_NS16550_CLK       18432000
  64 #endif
  65
  66 #define CONFIG_BAUDRATE         115200      /* ... at 115200 bps */
  67
  68 #define CONFIG_SYS_BAUDRATE_TABLE       { 9600, 19200, 38400, 57600, 115200, 230400 }
  69
  70 #define CONFIG_TIMESTAMP                        /* Print image info with timestamp */
  71
  72
  73 /*
  74  * BOOTP options
  75  */
  76 #define CONFIG_BOOTP_BOOTFILESIZE
  77 #define CONFIG_BOOTP_BOOTPATH
  78 #define CONFIG_BOOTP_GATEWAY
  79 #define CONFIG_BOOTP_HOSTNAME
  80
  81
  82 /*
  83  * Command line configuration.
  84  */
  85 #include <config_cmd_default.h>
  86
  87 #define CONFIG_CMD_BOOTD
  88 #define CONFIG_CMD_CACHE
  89 #define CONFIG_CMD_DHCP
  90 #define CONFIG_CMD_DIAG
  91 #define CONFIG_CMD_EEPROM
  92 #define CONFIG_CMD_ELF
  93 #define CONFIG_CMD_I2C
  94 #define CONFIG_CMD_NET
  95 #define CONFIG_CMD_NFS
  96 #define CONFIG_CMD_PCI
  97 #define CONFIG_CMD_PING
  98 #define CONFIG_CMD_REGINFO
  99 #define CONFIG_CMD_SDRAM
 100 #define CONFIG_CMD_SNTP
 101
 102
 103 #define CONFIG_NET_MULTI
 104 #define CONFIG_MII
 105
 106 /*
 107  * Autobooting
 108  */
 109 #define CONFIG_BOOTDELAY        5    /* autoboot after 5 seconds */
 110 #define CONFIG_BOOTARGS         "root=/dev/ram rw"
 111 #define CONFIG_ETHADDR          00:e0:0c:bc:e0:60
 112 #define CONFIG_HAS_ETH1
 113 #define CONFIG_ETH1ADDR         00:e0:0c:bc:e0:61
 114 #define CONFIG_IPADDR           192.162.1.2
 115 #define CONFIG_NETMASK          255.255.255.0
 116 #define CONFIG_SERVERIP         192.162.1.1
 117 #define CONFIG_GATEWAYIP        192.162.1.1
 118 #define CONFIG_HOSTNAME         Alaska
 119 #define CONFIG_OVERWRITE_ETHADDR_ONCE
 120
 121
 122 /*
 123  * I2C configuration
 124  */
 125 #define CONFIG_HARD_I2C         1
 126 #define CONFIG_SYS_I2C_MODULE           1
 127
 128 #define CONFIG_SYS_I2C_SPEED            100000 /* 100 kHz */
 129 #define CONFIG_SYS_I2C_SLAVE            0x7F
 130
 131 /*
 132  * EEPROM configuration
 133  */
 134 #define CONFIG_SYS_I2C_EEPROM_ADDR              0x52    /* 1011000xb */
 135 #define CONFIG_SYS_I2C_EEPROM_ADDR_LEN          1
 136 #define CONFIG_SYS_EEPROM_PAGE_WRITE_BITS       3
 137 #define CONFIG_SYS_EEPROM_PAGE_WRITE_DELAY_MS   70
 138 /*
 139 #define CONFIG_ENV_IS_IN_EEPROM 1
 140 #define CONFIG_ENV_OFFSET               0
 141 #define CONFIG_ENV_SIZE         256
 142 */
 143
 144 /* If CONFIG_SYS_AMD_BOOT is defined, the the system will boot from AMD.
 145    else undefined it will boot from Intel Strata flash */
 146 #define CONFIG_SYS_AMD_BOOT             1
 147
 148 /*
 149  * Flexbus Chipselect configuration
 150  */
 151 #if defined (CONFIG_SYS_AMD_BOOT)
 152 #define CONFIG_SYS_CS0_BASE             0xfff0
 153 #define CONFIG_SYS_CS0_MASK             0x00080000  /* 512 KB */
 154 #define CONFIG_SYS_CS0_CTRL             0x003f0d40
 155
 156 #define CONFIG_SYS_CS1_BASE             0xfe00
 157 #define CONFIG_SYS_CS1_MASK             0x01000000  /* 16 MB */
 158 #define CONFIG_SYS_CS1_CTRL             0x003f1540
 159 #else
 160 #define CONFIG_SYS_CS0_BASE             0xff00
 161 #define CONFIG_SYS_CS0_MASK             0x01000000  /* 16 MB */
 162 #define CONFIG_SYS_CS0_CTRL             0x003f1540
 163
 164 #define CONFIG_SYS_CS1_BASE             0xfe08
 165 #define CONFIG_SYS_CS1_MASK             0x00080000  /* 512 KB */
 166 #define CONFIG_SYS_CS1_CTRL             0x003f0d40
 167 #endif
 168
 169 #define CONFIG_SYS_CS2_BASE             0xf100
 170 #define CONFIG_SYS_CS2_MASK             0x00040000
 171 #define CONFIG_SYS_CS2_CTRL             0x003f1140
 172
 173 #define CONFIG_SYS_CS3_BASE             0xf200
 174 #define CONFIG_SYS_CS3_MASK             0x00040000
 175 #define CONFIG_SYS_CS3_CTRL             0x003f1100
 176
 177
 178 #define CONFIG_SYS_FLASH0_BASE          (CONFIG_SYS_CS0_BASE << 16)
 179 #define CONFIG_SYS_FLASH1_BASE          (CONFIG_SYS_CS1_BASE << 16)
 180
 181 #if defined (CONFIG_SYS_AMD_BOOT)
 182 #define CONFIG_SYS_AMD_BASE             CONFIG_SYS_FLASH0_BASE
 183 #define CONFIG_SYS_INTEL_BASE           CONFIG_SYS_FLASH1_BASE + 0xf00000
 184 #define CONFIG_SYS_FLASH_BASE           CONFIG_SYS_AMD_BASE
 185 #else
 186 #define CONFIG_SYS_INTEL_BASE           CONFIG_SYS_FLASH0_BASE + 0xf00000
 187 #define CONFIG_SYS_AMD_BASE             CONFIG_SYS_FLASH1_BASE
 188 #define CONFIG_SYS_FLASH_BASE           CONFIG_SYS_INTEL_BASE
 189 #endif
 190
 191 #define CONFIG_SYS_CPLD_BASE            (CONFIG_SYS_CS2_BASE << 16)
 192 #define CONFIG_SYS_FPGA_BASE            (CONFIG_SYS_CS3_BASE << 16)
 193
 194
 195 #define CONFIG_SYS_MAX_FLASH_BANKS      4       /* max num of memory banks      */
 196 #define CONFIG_SYS_MAX_FLASH_SECT       128     /* max num of sects on one chip */
 197
 198 #define CONFIG_SYS_FLASH_ERASE_TOUT     240000  /* Flash Erase Timeout (in ms)  */
 199 #define CONFIG_SYS_FLASH_WRITE_TOUT     500     /* Flash Write Timeout (in ms)  */
 200 #define CONFIG_SYS_FLASH_LOCK_TOUT      5       /* Timeout for Flash Set Lock Bit (in ms) */
 201 #define CONFIG_SYS_FLASH_UNLOCK_TOUT    10000   /* Timeout for Flash Clear Lock Bits (in ms) */
 202 #define CONFIG_SYS_FLASH_PROTECTION             /* "Real" (hardware) sectors protection */
 203
 204 #define PHYS_AMD_SECT_SIZE      0x00010000 /*  64 KB sectors (x2) */
 205 #define PHYS_INTEL_SECT_SIZE    0x00020000 /* 128 KB sectors (x2) */
 206
 207 #define CONFIG_SYS_FLASH_CHECKSUM
 208 /*
 209  * Environment settings
 210  */
 211 #define CONFIG_ENV_IS_IN_FLASH  1
 212 #if defined (CONFIG_SYS_AMD_BOOT)
 213 #define CONFIG_ENV_ADDR         (CONFIG_SYS_FLASH0_BASE + CONFIG_SYS_CS0_MASK - PHYS_AMD_SECT_SIZE)
 214 #define CONFIG_ENV_SIZE         PHYS_AMD_SECT_SIZE
 215 #define CONFIG_ENV_SECT_SIZE    PHYS_AMD_SECT_SIZE
 216 #define CONFIG_ENV1_ADDR                (CONFIG_SYS_FLASH1_BASE + CONFIG_SYS_CS1_MASK - PHYS_INTEL_SECT_SIZE)
 217 #define CONFIG_ENV1_SIZE                PHYS_INTEL_SECT_SIZE
 218 #define CONFIG_ENV1_SECT_SIZE   PHYS_INTEL_SECT_SIZE
 219 #else
 220 #define CONFIG_ENV_ADDR         (CONFIG_SYS_FLASH0_BASE + CONFIG_SYS_CS0_MASK - PHYS_INTEL_SECT_SIZE)
 221 #define CONFIG_ENV_SIZE         PHYS_INTEL_SECT_SIZE
 222 #define CONFIG_ENV_SECT_SIZE    PHYS_INTEL_SECT_SIZE
 223 #define CONFIG_ENV1_ADDR                (CONFIG_SYS_FLASH1_BASE + CONFIG_SYS_CS1_MASK - PHYS_AMD_SECT_SIZE)
 224 #define CONFIG_ENV1_SIZE                PHYS_AMD_SECT_SIZE
 225 #define CONFIG_ENV1_SECT_SIZE   PHYS_AMD_SECT_SIZE
 226 #endif
 227
 228 #define CONFIG_ENV_OVERWRITE    1
 229
 230 #if defined CONFIG_ENV_IS_IN_FLASH
 231 #undef CONFIG_ENV_IS_IN_NVRAM
 232 #undef CONFIG_ENV_IS_IN_EEPROM
 233 #elif defined CONFIG_ENV_IS_IN_NVRAM
 234 #undef CONFIG_ENV_IS_IN_FLASH
 235 #undef CONFIG_ENV_IS_IN_EEPROM
 236 #elif defined CONFIG_ENV_IS_IN_EEPROM
 237 #undef CONFIG_ENV_IS_IN_NVRAM
 238 #undef CONFIG_ENV_IS_IN_FLASH
 239 #endif
 240
 241 /*
 242  * Memory map
 243  */
 244 #define CONFIG_SYS_MBAR         0xF0000000
 245 #define CONFIG_SYS_SDRAM_BASE           0x00000000
 246 #define CONFIG_SYS_DEFAULT_MBAR 0x80000000
 247 #define CONFIG_SYS_SRAM_BASE            (CONFIG_SYS_MBAR + 0x20000)
 248 #define CONFIG_SYS_SRAM_SIZE            0x8000
 249
 250 /* Use SRAM until RAM will be available */
 251 #define CONFIG_SYS_INIT_RAM_ADDR        (CONFIG_SYS_MBAR + 0x20000)
 252 #define CONFIG_SYS_INIT_RAM_END 0x8000  /* End of used area in DPRAM */
 253
 254 #define CONFIG_SYS_GBL_DATA_SIZE        128     /* size in bytes reserved for initial data */
 255 #define CONFIG_SYS_GBL_DATA_OFFSET      (CONFIG_SYS_INIT_RAM_END - CONFIG_SYS_GBL_DATA_SIZE)
 256 #define CONFIG_SYS_INIT_SP_OFFSET       CONFIG_SYS_GBL_DATA_OFFSET
 257
 258 #define CONFIG_SYS_MONITOR_BASE CONFIG_SYS_TEXT_BASE
 259 #if (CONFIG_SYS_MONITOR_BASE < CONFIG_SYS_FLASH_BASE)
 260 #   define CONFIG_SYS_RAMBOOT           1
 261 #endif
 262
 263 #define CONFIG_SYS_MONITOR_LEN          (256 << 10) /* Reserve 256 kB for Monitor   */
 264 #define CONFIG_SYS_MALLOC_LEN           (128 << 10) /* Reserve 128 kB for malloc()  */
 265 #define CONFIG_SYS_BOOTMAPSZ            (8 << 20)   /* Initial Memory map for Linux */
 266
 267 /* SDRAM configuration */
 268 #define CONFIG_SYS_SDRAM_TOTAL_BANKS            2
 269 #define CONFIG_SYS_SDRAM_SPD_I2C_ADDR           0x51            /* 7bit */
 270 #define CONFIG_SYS_SDRAM_SPD_SIZE               0x40
 271 #define CONFIG_SYS_SDRAM_CAS_LATENCY            4               /* (CL=2)x2 */
 272
 273 /* SDRAM drive strength register */
 274 #define CONFIG_SYS_SDRAM_DRIVE_STRENGTH ((DRIVE_STRENGTH_LOW  << SDRAMDS_SBE_SHIFT) | \
 275                                          (DRIVE_STRENGTH_HIGH << SDRAMDS_SBC_SHIFT) | \
 276                                          (DRIVE_STRENGTH_LOW  << SDRAMDS_SBA_SHIFT) | \
 277                                          (DRIVE_STRENGTH_OFF  << SDRAMDS_SBS_SHIFT) | \
 278                                          (DRIVE_STRENGTH_LOW  << SDRAMDS_SBD_SHIFT))
 279
 280 /*
 281  * Ethernet configuration
 282  */
 283 #define CONFIG_MPC8220_FEC      1
 284 #define CONFIG_FEC_10MBIT       1 /* Workaround for FEC 100Mbit problem */
 285 #define CONFIG_PHY_ADDR         0x18
 286
 287
 288 /*
 289  * Miscellaneous configurable options
 290  */
 291 #define CONFIG_SYS_LONGHELP                         /* undef to save memory     */
 292 #define CONFIG_SYS_PROMPT               "=> "       /* Monitor Command Prompt   */
 293 #if defined(CONFIG_CMD_KGDB)
 294 #define CONFIG_SYS_CBSIZE               1024        /* Console I/O Buffer Size  */
 295 #else
 296 #define CONFIG_SYS_CBSIZE               256         /* Console I/O Buffer Size  */
 297 #endif
 298 #define CONFIG_SYS_PBSIZE (CONFIG_SYS_CBSIZE+sizeof(CONFIG_SYS_PROMPT)+16)      /* Print Buffer Size */
 299 #define CONFIG_SYS_MAXARGS              16          /* max number of command args   */
 300 #define CONFIG_SYS_BARGSIZE             CONFIG_SYS_CBSIZE  /* Boot Argument Buffer Size    */
 301
 302 #define CONFIG_SYS_MEMTEST_START        0x00100000  /* memtest works on */
 303 #define CONFIG_SYS_MEMTEST_END          0x00f00000  /* 1 ... 15 MB in DRAM  */
 304
 305 #define CONFIG_SYS_LOAD_ADDR            0x100000    /* default load address */
 306
 307 #define CONFIG_SYS_HZ                   1000        /* decrementer freq: 1 ms ticks */
 308
 309 #define CONFIG_SYS_CACHELINE_SIZE       32      /* For MPC8220 CPUs */
 310 #if defined(CONFIG_CMD_KGDB)
 311 #  define CONFIG_SYS_CACHELINE_SHIFT    5   /* log base 2 of the above value */
 312 #endif
 313
 314 /*
 315  * Various low-level settings
 316  */
 317 #define CONFIG_SYS_HID0_INIT            HID0_ICE | HID0_ICFI
 318 #define CONFIG_SYS_HID0_FINAL           HID0_ICE
 319
 320 /*
 321  * JFFS2 partitions
 322  */
 323
 324 /* No command line, one static partition */
 325 /*
 326 #undef CONFIG_CMD_MTDPARTS
 327 #define CONFIG_JFFS2_DEV                "nor0"
 328 #define CONFIG_JFFS2_PART_SIZE          0x00400000
 329 #define CONFIG_JFFS2_PART_OFFSET        0x00000000
 330 */
 331
 332 /* mtdparts command line support */
 333 /*
 334 #define CONFIG_CMD_MTDPARTS
 335 #define MTDIDS_DEFAULT          "nor0=alaska-0"
 336 #define MTDPARTS_DEFAULT        "mtdparts=alaska-0:4m(user)"
 337 */
 338
 339 #endif /* __CONFIG_H */