[AArch64] Print spaces after commas in addresses
authorRichard Sandiford <richard.sandiford@arm.com>
Wed, 21 Sep 2016 16:11:52 +0000 (17:11 +0100)
committerRichard Sandiford <richard.sandiford@arm.com>
Wed, 21 Sep 2016 16:11:52 +0000 (17:11 +0100)
I got an off-list request to make the AArch64 disassembler print
spaces after commas in addresses.  This patch does that.

The same code is used to print operands in "did you mean" errors,
so to keep things consistent, the patch also prints spaces between
operands in those messages.

opcodes/
* aarch64-opc.c (print_immediate_offset_address): Print spaces
after commas in addresses.
(aarch64_print_operand): Likewise.

gas/
* config/tc-aarch64.c (print_operands): Print spaces between
operands.
* testsuite/gas/aarch64/ilp32-basic.d: Expect spaces after ","
in addresses.
* testsuite/gas/aarch64/ldst-reg-imm-post-ind.d: Likewise.
* testsuite/gas/aarch64/ldst-reg-imm-pre-ind.d: Likewise.
* testsuite/gas/aarch64/ldst-reg-pair.d: Likewise.
* testsuite/gas/aarch64/ldst-reg-reg-offset.d: Likewise.
* testsuite/gas/aarch64/ldst-reg-uns-imm.d: Likewise.
* testsuite/gas/aarch64/ldst-reg-unscaled-imm.d: Likewise.
* testsuite/gas/aarch64/reloc-insn.d: Likewise.
* testsuite/gas/aarch64/sve.d: Likewise.
* testsuite/gas/aarch64/symbol.d: Likewise.
* testsuite/gas/aarch64/system.d: Likewise.
* testsuite/gas/aarch64/tls-desc.d: Likewise.
* testsuite/gas/aarch64/sve-invalid.l: Expect spaces after ","
in suggested alternatives.
* testsuite/gas/aarch64/verbose-error.l: Likewise.

ld/
* testsuite/ld-aarch64/emit-relocs-28.d: Expect spaces after ","
in addresses.
* testsuite/ld-aarch64/emit-relocs-301-be.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-301.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-302-be.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-302.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-310-be.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-310.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-313.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-515-be.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-515.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-516-be.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-516.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-531.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-532.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-533.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-534.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-535.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-536.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-537.d: Likewise.
* testsuite/ld-aarch64/emit-relocs-538.d: Likewise.
* testsuite/ld-aarch64/erratum835769.d: Likewise.
* testsuite/ld-aarch64/erratum843419.d: Likewise.
* testsuite/ld-aarch64/farcall-b-plt.d: Likewise.
* testsuite/ld-aarch64/farcall-bl-plt.d: Likewise.
* testsuite/ld-aarch64/gc-plt-relocs.d: Likewise.
* testsuite/ld-aarch64/ifunc-21.d: Likewise.
* testsuite/ld-aarch64/ifunc-7c.d: Likewise.
* testsuite/ld-aarch64/tls-desc-ie.d: Likewise.
* testsuite/ld-aarch64/tls-large-desc-be.d: Likewise.
* testsuite/ld-aarch64/tls-large-desc.d: Likewise.
* testsuite/ld-aarch64/tls-large-ie-be.d: Likewise.
* testsuite/ld-aarch64/tls-large-ie.d: Likewise.
* testsuite/ld-aarch64/tls-relax-all.d: Likewise.
* testsuite/ld-aarch64/tls-relax-gd-ie.d: Likewise.
* testsuite/ld-aarch64/tls-relax-gdesc-ie-2.d: Likewise.
* testsuite/ld-aarch64/tls-relax-gdesc-ie.d: Likewise.
* testsuite/ld-aarch64/tls-relax-large-desc-ie-be.d: Likewise.
* testsuite/ld-aarch64/tls-relax-large-desc-ie.d: Likewise.
* testsuite/ld-aarch64/tls-tiny-desc.d: Likewise.
* testsuite/ld-aarch64/tls-tiny-gd.d: Likewise.

59 files changed:
gas/ChangeLog
gas/config/tc-aarch64.c
gas/testsuite/gas/aarch64/ilp32-basic.d
gas/testsuite/gas/aarch64/ldst-reg-imm-post-ind.d
gas/testsuite/gas/aarch64/ldst-reg-imm-pre-ind.d
gas/testsuite/gas/aarch64/ldst-reg-pair.d
gas/testsuite/gas/aarch64/ldst-reg-reg-offset.d
gas/testsuite/gas/aarch64/ldst-reg-uns-imm.d
gas/testsuite/gas/aarch64/ldst-reg-unscaled-imm.d
gas/testsuite/gas/aarch64/reloc-insn.d
gas/testsuite/gas/aarch64/sve-invalid.l
gas/testsuite/gas/aarch64/sve.d
gas/testsuite/gas/aarch64/symbol.d
gas/testsuite/gas/aarch64/system.d
gas/testsuite/gas/aarch64/tls-desc.d
gas/testsuite/gas/aarch64/verbose-error.l
ld/ChangeLog
ld/testsuite/ld-aarch64/emit-relocs-28.d
ld/testsuite/ld-aarch64/emit-relocs-301-be.d
ld/testsuite/ld-aarch64/emit-relocs-301.d
ld/testsuite/ld-aarch64/emit-relocs-302-be.d
ld/testsuite/ld-aarch64/emit-relocs-302.d
ld/testsuite/ld-aarch64/emit-relocs-310-be.d
ld/testsuite/ld-aarch64/emit-relocs-310.d
ld/testsuite/ld-aarch64/emit-relocs-313.d
ld/testsuite/ld-aarch64/emit-relocs-515-be.d
ld/testsuite/ld-aarch64/emit-relocs-515.d
ld/testsuite/ld-aarch64/emit-relocs-516-be.d
ld/testsuite/ld-aarch64/emit-relocs-516.d
ld/testsuite/ld-aarch64/emit-relocs-531.d
ld/testsuite/ld-aarch64/emit-relocs-532.d
ld/testsuite/ld-aarch64/emit-relocs-533.d
ld/testsuite/ld-aarch64/emit-relocs-534.d
ld/testsuite/ld-aarch64/emit-relocs-535.d
ld/testsuite/ld-aarch64/emit-relocs-536.d
ld/testsuite/ld-aarch64/emit-relocs-537.d
ld/testsuite/ld-aarch64/emit-relocs-538.d
ld/testsuite/ld-aarch64/erratum835769.d
ld/testsuite/ld-aarch64/erratum843419.d
ld/testsuite/ld-aarch64/farcall-b-plt.d
ld/testsuite/ld-aarch64/farcall-bl-plt.d
ld/testsuite/ld-aarch64/gc-plt-relocs.d
ld/testsuite/ld-aarch64/ifunc-21.d
ld/testsuite/ld-aarch64/ifunc-7c.d
ld/testsuite/ld-aarch64/tls-desc-ie.d
ld/testsuite/ld-aarch64/tls-large-desc-be.d
ld/testsuite/ld-aarch64/tls-large-desc.d
ld/testsuite/ld-aarch64/tls-large-ie-be.d
ld/testsuite/ld-aarch64/tls-large-ie.d
ld/testsuite/ld-aarch64/tls-relax-all.d
ld/testsuite/ld-aarch64/tls-relax-gd-ie.d
ld/testsuite/ld-aarch64/tls-relax-gdesc-ie-2.d
ld/testsuite/ld-aarch64/tls-relax-gdesc-ie.d
ld/testsuite/ld-aarch64/tls-relax-large-desc-ie-be.d
ld/testsuite/ld-aarch64/tls-relax-large-desc-ie.d
ld/testsuite/ld-aarch64/tls-tiny-desc.d
ld/testsuite/ld-aarch64/tls-tiny-gd.d
opcodes/ChangeLog
opcodes/aarch64-opc.c

index 1830ea2..e4ebf0e 100644 (file)
@@ -1,5 +1,26 @@
 2016-09-21  Richard Sandiford  <richard.sandiford@arm.com>
 
+       * config/tc-aarch64.c (print_operands): Print spaces between
+       operands.
+       * testsuite/gas/aarch64/ilp32-basic.d: Expect spaces after ","
+       in addresses.
+       * testsuite/gas/aarch64/ldst-reg-imm-post-ind.d: Likewise.
+       * testsuite/gas/aarch64/ldst-reg-imm-pre-ind.d: Likewise.
+       * testsuite/gas/aarch64/ldst-reg-pair.d: Likewise.
+       * testsuite/gas/aarch64/ldst-reg-reg-offset.d: Likewise.
+       * testsuite/gas/aarch64/ldst-reg-uns-imm.d: Likewise.
+       * testsuite/gas/aarch64/ldst-reg-unscaled-imm.d: Likewise.
+       * testsuite/gas/aarch64/reloc-insn.d: Likewise.
+       * testsuite/gas/aarch64/sve.d: Likewise.
+       * testsuite/gas/aarch64/symbol.d: Likewise.
+       * testsuite/gas/aarch64/system.d: Likewise.
+       * testsuite/gas/aarch64/tls-desc.d: Likewise.
+       * testsuite/gas/aarch64/sve-invalid.l: Expect spaces after ","
+       in suggested alternatives.
+       * testsuite/gas/aarch64/verbose-error.l: Likewise.
+
+2016-09-21  Richard Sandiford  <richard.sandiford@arm.com>
+
        * config/tc-aarch64.c (output_operand_error_record): Use "must be"
        rather than "should be" or "expected to be" in error messages.
        (parse_operands): Likewise.
index 9963c61..5d53064 100644 (file)
@@ -4478,7 +4478,7 @@ print_operands (char *buf, const aarch64_opcode *opcode,
 
       /* Delimiter.  */
       if (str[0] != '\0')
-       strcat (buf, i == 0 ? " " : ",");
+       strcat (buf, i == 0 ? " " : ", ");
 
       /* Append the operand string.  */
       strcat (buf, str);
index 3caef3e..876f28c 100644 (file)
@@ -13,8 +13,8 @@ Disassembly of section \.text:
                        4: R_AARCH64_P32_ADD_ABS_LO12_NC        ptrs
    8:  b9000080        str     w0, \[x4\]
                        8: R_AARCH64_P32_LDST32_ABS_LO12_NC     ptrs
-   c:  b9000461        str     w1, \[x3,#4\]
-  10:  b9000862        str     w2, \[x3,#8\]
+   c:  b9000461        str     w1, \[x3, #4\]
+  10:  b9000862        str     w2, \[x3, #8\]
   14:  90000004        adrp    x4, c <.*>
                        14: R_AARCH64_P32_ADR_GOT_PAGE  ptrs
   18:  f9400083        ldr     x3, \[x4\]
index 37c8cb9..1c611bb 100644 (file)
 Disassembly of section \.text:
 
 0000000000000000 <.*>:
-   0:  3c1007e7        str     b7, \[sp\],#-256
-   4:  3c1557e7        str     b7, \[sp\],#-171
-   8:  3c0007e7        str     b7, \[sp\],#0
-   c:  3c0027e7        str     b7, \[sp\],#2
-  10:  3c0047e7        str     b7, \[sp\],#4
-  14:  3c0087e7        str     b7, \[sp\],#8
-  18:  3c0107e7        str     b7, \[sp\],#16
-  1c:  3c0557e7        str     b7, \[sp\],#85
-  20:  3c0ff7e7        str     b7, \[sp\],#255
-  24:  7c1007e7        str     h7, \[sp\],#-256
-  28:  7c1557e7        str     h7, \[sp\],#-171
-  2c:  7c0007e7        str     h7, \[sp\],#0
-  30:  7c0027e7        str     h7, \[sp\],#2
-  34:  7c0047e7        str     h7, \[sp\],#4
-  38:  7c0087e7        str     h7, \[sp\],#8
-  3c:  7c0107e7        str     h7, \[sp\],#16
-  40:  7c0557e7        str     h7, \[sp\],#85
-  44:  7c0ff7e7        str     h7, \[sp\],#255
-  48:  bc1007e7        str     s7, \[sp\],#-256
-  4c:  bc1557e7        str     s7, \[sp\],#-171
-  50:  bc0007e7        str     s7, \[sp\],#0
-  54:  bc0027e7        str     s7, \[sp\],#2
-  58:  bc0047e7        str     s7, \[sp\],#4
-  5c:  bc0087e7        str     s7, \[sp\],#8
-  60:  bc0107e7        str     s7, \[sp\],#16
-  64:  bc0557e7        str     s7, \[sp\],#85
-  68:  bc0ff7e7        str     s7, \[sp\],#255
-  6c:  fc1007e7        str     d7, \[sp\],#-256
-  70:  fc1557e7        str     d7, \[sp\],#-171
-  74:  fc0007e7        str     d7, \[sp\],#0
-  78:  fc0027e7        str     d7, \[sp\],#2
-  7c:  fc0047e7        str     d7, \[sp\],#4
-  80:  fc0087e7        str     d7, \[sp\],#8
-  84:  fc0107e7        str     d7, \[sp\],#16
-  88:  fc0557e7        str     d7, \[sp\],#85
-  8c:  fc0ff7e7        str     d7, \[sp\],#255
-  90:  3c9007e7        str     q7, \[sp\],#-256
-  94:  3c9557e7        str     q7, \[sp\],#-171
-  98:  3c8007e7        str     q7, \[sp\],#0
-  9c:  3c8027e7        str     q7, \[sp\],#2
-  a0:  3c8047e7        str     q7, \[sp\],#4
-  a4:  3c8087e7        str     q7, \[sp\],#8
-  a8:  3c8107e7        str     q7, \[sp\],#16
-  ac:  3c8557e7        str     q7, \[sp\],#85
-  b0:  3c8ff7e7        str     q7, \[sp\],#255
-  b4:  3c5007e7        ldr     b7, \[sp\],#-256
-  b8:  3c5557e7        ldr     b7, \[sp\],#-171
-  bc:  3c4007e7        ldr     b7, \[sp\],#0
-  c0:  3c4027e7        ldr     b7, \[sp\],#2
-  c4:  3c4047e7        ldr     b7, \[sp\],#4
-  c8:  3c4087e7        ldr     b7, \[sp\],#8
-  cc:  3c4107e7        ldr     b7, \[sp\],#16
-  d0:  3c4557e7        ldr     b7, \[sp\],#85
-  d4:  3c4ff7e7        ldr     b7, \[sp\],#255
-  d8:  7c5007e7        ldr     h7, \[sp\],#-256
-  dc:  7c5557e7        ldr     h7, \[sp\],#-171
-  e0:  7c4007e7        ldr     h7, \[sp\],#0
-  e4:  7c4027e7        ldr     h7, \[sp\],#2
-  e8:  7c4047e7        ldr     h7, \[sp\],#4
-  ec:  7c4087e7        ldr     h7, \[sp\],#8
-  f0:  7c4107e7        ldr     h7, \[sp\],#16
-  f4:  7c4557e7        ldr     h7, \[sp\],#85
-  f8:  7c4ff7e7        ldr     h7, \[sp\],#255
-  fc:  bc5007e7        ldr     s7, \[sp\],#-256
- 100:  bc5557e7        ldr     s7, \[sp\],#-171
- 104:  bc4007e7        ldr     s7, \[sp\],#0
- 108:  bc4027e7        ldr     s7, \[sp\],#2
- 10c:  bc4047e7        ldr     s7, \[sp\],#4
- 110:  bc4087e7        ldr     s7, \[sp\],#8
- 114:  bc4107e7        ldr     s7, \[sp\],#16
- 118:  bc4557e7        ldr     s7, \[sp\],#85
- 11c:  bc4ff7e7        ldr     s7, \[sp\],#255
- 120:  fc5007e7        ldr     d7, \[sp\],#-256
- 124:  fc5557e7        ldr     d7, \[sp\],#-171
- 128:  fc4007e7        ldr     d7, \[sp\],#0
- 12c:  fc4027e7        ldr     d7, \[sp\],#2
- 130:  fc4047e7        ldr     d7, \[sp\],#4
- 134:  fc4087e7        ldr     d7, \[sp\],#8
- 138:  fc4107e7        ldr     d7, \[sp\],#16
- 13c:  fc4557e7        ldr     d7, \[sp\],#85
- 140:  fc4ff7e7        ldr     d7, \[sp\],#255
- 144:  3cd007e7        ldr     q7, \[sp\],#-256
- 148:  3cd557e7        ldr     q7, \[sp\],#-171
- 14c:  3cc007e7        ldr     q7, \[sp\],#0
- 150:  3cc027e7        ldr     q7, \[sp\],#2
- 154:  3cc047e7        ldr     q7, \[sp\],#4
- 158:  3cc087e7        ldr     q7, \[sp\],#8
- 15c:  3cc107e7        ldr     q7, \[sp\],#16
- 160:  3cc557e7        ldr     q7, \[sp\],#85
- 164:  3ccff7e7        ldr     q7, \[sp\],#255
- 168:  381007e7        strb    w7, \[sp\],#-256
- 16c:  381557e7        strb    w7, \[sp\],#-171
- 170:  380007e7        strb    w7, \[sp\],#0
- 174:  380027e7        strb    w7, \[sp\],#2
- 178:  380047e7        strb    w7, \[sp\],#4
- 17c:  380087e7        strb    w7, \[sp\],#8
- 180:  380107e7        strb    w7, \[sp\],#16
- 184:  380557e7        strb    w7, \[sp\],#85
- 188:  380ff7e7        strb    w7, \[sp\],#255
- 18c:  781007e7        strh    w7, \[sp\],#-256
- 190:  781557e7        strh    w7, \[sp\],#-171
- 194:  780007e7        strh    w7, \[sp\],#0
- 198:  780027e7        strh    w7, \[sp\],#2
- 19c:  780047e7        strh    w7, \[sp\],#4
- 1a0:  780087e7        strh    w7, \[sp\],#8
- 1a4:  780107e7        strh    w7, \[sp\],#16
- 1a8:  780557e7        strh    w7, \[sp\],#85
- 1ac:  780ff7e7        strh    w7, \[sp\],#255
- 1b0:  b81007e7        str     w7, \[sp\],#-256
- 1b4:  b81557e7        str     w7, \[sp\],#-171
- 1b8:  b80007e7        str     w7, \[sp\],#0
- 1bc:  b80027e7        str     w7, \[sp\],#2
- 1c0:  b80047e7        str     w7, \[sp\],#4
- 1c4:  b80087e7        str     w7, \[sp\],#8
- 1c8:  b80107e7        str     w7, \[sp\],#16
- 1cc:  b80557e7        str     w7, \[sp\],#85
- 1d0:  b80ff7e7        str     w7, \[sp\],#255
- 1d4:  f81007e7        str     x7, \[sp\],#-256
- 1d8:  f81557e7        str     x7, \[sp\],#-171
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- 29c:  2d9fbfe7        stp     s7, s15, \[sp,#252\]!
- 2a0:  2de03fe7        ldp     s7, s15, \[sp,#-256\]!
- 2a4:  2df0bfe7        ldp     s7, s15, \[sp,#-124\]!
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- 2ac:  2dc03fe7        ldp     s7, s15, \[sp,#0\]!
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- 2b4:  2ddfbfe7        ldp     s7, s15, \[sp,#252\]!
- 2b8:  6da03fe7        stp     d7, d15, \[sp,#-512\]!
- 2bc:  6db0bfe7        stp     d7, d15, \[sp,#-248\]!
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index f3382fb..90dae35 100644 (file)
@@ -102,7 +102,7 @@ Disassembly of section \.text:
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                        ec: R_AARCH64_LDST8_ABS_LO12_NC xdata\+0xff8
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                        f8: R_AARCH64_TSTBR14   xlab
@@ -137,10 +137,10 @@ Disassembly of section \.text:
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  15c:  d13ffc00        sub     x0, x0, #0xfff
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                        174: R_AARCH64_LDST16_ABS_LO12_NC       \.text\+0x19c
  178:  b9400021        ldr     w1, \[x1\]
index 5ecb993..58739b3 100644 (file)
 .*: Error: operand 2 must be an SVE predicate register -- `fmov z1,z2'
 .*: Error: operand mismatch -- `fmov z1,#1\.0'
 .*: Info:    did you mean this\?
-.*: Info:      fmov z1\.s,#1\.000000000000000000e\+00
+.*: Info:      fmov z1\.s, #1\.000000000000000000e\+00
 .*: Info:    other valid variant\(s\):
-.*: Info:      fmov z1\.d,#1\.000000000000000000e\+00
+.*: Info:      fmov z1\.d, #1\.000000000000000000e\+00
 .*: Error: operand mismatch -- `fmov z1,#0\.0'
 .*: Info:    did you mean this\?
-.*: Info:      fmov z1\.s,#0\.0
+.*: Info:      fmov z1\.s, #0\.0
 .*: Info:    other valid variant\(s\):
-.*: Info:      fmov z1\.d,#0\.0
+.*: Info:      fmov z1\.d, #0\.0
 .*: Error: missing predication type at operand 2 -- `not z0\.s,p1/'
 .*: Error: missing predication type at operand 2 -- `not z0\.s,p1/,z2\.s'
 .*: Error: unexpected character `c' in predication type at operand 2 -- `not z0\.s,p1/c,z2\.s'
 .*: Error: operand mismatch -- `movprfx z0\.h,z1\.h'
 .*: Info:    did you mean this\?
-.*: Info:      movprfx z0,z1
+.*: Info:      movprfx z0, z1
 .*: Error: operand mismatch -- `movprfx z0,z1\.h'
 .*: Info:    did you mean this\?
-.*: Info:      movprfx z0,z1
+.*: Info:      movprfx z0, z1
 .*: Error: operand mismatch -- `movprfx z0\.h,z1'
 .*: Info:    did you mean this\?
-.*: Info:      movprfx z0,z1
+.*: Info:      movprfx z0, z1
 .*: Error: operand mismatch -- `movprfx z0\.h,z1\.s'
 .*: Info:    did you mean this\?
-.*: Info:      movprfx z0,z1
+.*: Info:      movprfx z0, z1
 .*: Error: operand mismatch -- `movprfx z0,p1/m,z1'
 .*: Info:    did you mean this\?
-.*: Info:      movprfx z0\.b,p1/m,z1\.b
+.*: Info:      movprfx z0\.b, p1/m, z1\.b
 .*: Info:    other valid variant\(s\):
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-.*: Info:      movprfx z0\.h,p1/z,z1\.h
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+.*: Info:      movprfx z0\.d, p1/m, z1\.d
 .*: Error: operand mismatch -- `movprfx z0,p1/z,z1'
 .*: Info:    did you mean this\?
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+.*: Info:      movprfx z0\.d, p1/m, z1\.d
 .*: Error: operand mismatch -- `movprfx z0\.b,p1/m,z1'
 .*: Info:    did you mean this\?
-.*: Info:      movprfx z0\.b,p1/m,z1\.b
+.*: Info:      movprfx z0\.b, p1/m, z1\.b
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+.*: Info:      movprfx z0\.d, p1/m, z1\.d
 .*: Error: operand mismatch -- `movprfx z0\.b,p1/z,z1'
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+.*: Info:      movprfx z0\.h, p1/m, z1\.h
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+.*: Info:      movprfx z0\.d, p1/m, z1\.d
 .*: Error: operand mismatch -- `movprfx z0,p1/m,z1\.b'
 .*: Info:    did you mean this\?
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 .*: Error: operand mismatch -- `movprfx z0,p1/z,z1\.b'
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 .*: Error: operand mismatch -- `movprfx z0\.h,p1/m,z1\.b'
 .*: Info:    did you mean this\?
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 .*: Info:    other valid variant\(s\):
-.*: Info:      movprfx z0\.b,p1/z,z1\.b
-.*: Info:      movprfx z0\.h,p1/z,z1\.h
-.*: Info:      movprfx z0\.h,p1/m,z1\.h
-.*: Info:      movprfx z0\.s,p1/z,z1\.s
-.*: Info:      movprfx z0\.s,p1/m,z1\.s
-.*: Info:      movprfx z0\.d,p1/z,z1\.d
-.*: Info:      movprfx z0\.d,p1/m,z1\.d
+.*: Info:      movprfx z0\.b, p1/z, z1\.b
+.*: Info:      movprfx z0\.h, p1/z, z1\.h
+.*: Info:      movprfx z0\.h, p1/m, z1\.h
+.*: Info:      movprfx z0\.s, p1/z, z1\.s
+.*: Info:      movprfx z0\.s, p1/m, z1\.s
+.*: Info:      movprfx z0\.d, p1/z, z1\.d
+.*: Info:      movprfx z0\.d, p1/m, z1\.d
 .*: Error: operand mismatch -- `movprfx z0\.h,p1/z,z1\.b'
 .*: Info:    did you mean this\?
-.*: Info:      movprfx z0\.b,p1/z,z1\.b
+.*: Info:      movprfx z0\.b, p1/z, z1\.b
 .*: Info:    other valid variant\(s\):
-.*: Info:      movprfx z0\.b,p1/m,z1\.b
-.*: Info:      movprfx z0\.h,p1/z,z1\.h
-.*: Info:      movprfx z0\.h,p1/m,z1\.h
-.*: Info:      movprfx z0\.s,p1/z,z1\.s
-.*: Info:      movprfx z0\.s,p1/m,z1\.s
-.*: Info:      movprfx z0\.d,p1/z,z1\.d
-.*: Info:      movprfx z0\.d,p1/m,z1\.d
+.*: Info:      movprfx z0\.b, p1/m, z1\.b
+.*: Info:      movprfx z0\.h, p1/z, z1\.h
+.*: Info:      movprfx z0\.h, p1/m, z1\.h
+.*: Info:      movprfx z0\.s, p1/z, z1\.s
+.*: Info:      movprfx z0\.s, p1/m, z1\.s
+.*: Info:      movprfx z0\.d, p1/z, z1\.d
+.*: Info:      movprfx z0\.d, p1/m, z1\.d
 .*: Error: operand mismatch -- `movprfx z0\.b,p1,z1\.b'
 .*: Info:    did you mean this\?
-.*: Info:      movprfx z0\.b,p1/z,z1\.b
+.*: Info:      movprfx z0\.b, p1/z, z1\.b
 .*: Info:    other valid variant\(s\):
-.*: Info:      movprfx z0\.b,p1/m,z1\.b
-.*: Info:      movprfx z0\.h,p1/z,z1\.h
-.*: Info:      movprfx z0\.h,p1/m,z1\.h
-.*: Info:      movprfx z0\.s,p1/z,z1\.s
-.*: Info:      movprfx z0\.s,p1/m,z1\.s
-.*: Info:      movprfx z0\.d,p1/z,z1\.d
-.*: Info:      movprfx z0\.d,p1/m,z1\.d
+.*: Info:      movprfx z0\.b, p1/m, z1\.b
+.*: Info:      movprfx z0\.h, p1/z, z1\.h
+.*: Info:      movprfx z0\.h, p1/m, z1\.h
+.*: Info:      movprfx z0\.s, p1/z, z1\.s
+.*: Info:      movprfx z0\.s, p1/m, z1\.s
+.*: Info:      movprfx z0\.d, p1/z, z1\.d
+.*: Info:      movprfx z0\.d, p1/m, z1\.d
 .*: Error: operand 1 must be an SVE vector register -- `movprfx p0,p1'
 .*: Error: operand mismatch -- `ldr p0\.b,\[x1\]'
 .*: Info:    did you mean this\?
-.*: Info:      ldr p0,\[x1\]
+.*: Info:      ldr p0, \[x1\]
 .*: Error: operand mismatch -- `ldr z0\.b,\[x1\]'
 .*: Info:    did you mean this\?
-.*: Info:      ldr z0,\[x1\]
+.*: Info:      ldr z0, \[x1\]
 .*: Error: operand mismatch -- `str p0\.b,\[x1\]'
 .*: Info:    did you mean this\?
-.*: Info:      str p0,\[x1\]
+.*: Info:      str p0, \[x1\]
 .*: Error: operand mismatch -- `str z0\.b,\[x1\]'
 .*: Info:    did you mean this\?
-.*: Info:      str z0,\[x1\]
+.*: Info:      str z0, \[x1\]
 .*: Error: operand mismatch -- `mov z0,b0'
 .*: Info:    did you mean this\?
-.*: Info:      mov z0\.b,b0
+.*: Info:      mov z0\.b, b0
 .*: Info:    other valid variant\(s\):
-.*: Info:      mov z0\.h,h0
-.*: Info:      mov z0\.s,s0
-.*: Info:      mov z0\.d,d0
+.*: Info:      mov z0\.h, h0
+.*: Info:      mov z0\.s, s0
+.*: Info:      mov z0\.d, d0
 .*: Error: operand mismatch -- `mov z0,z1'
 .*: Info:    did you mean this\?
-.*: Info:      mov z0\.d,z1\.d
+.*: Info:      mov z0\.d, z1\.d
 .*: Error: operand mismatch -- `mov p0,p1'
 .*: Info:    did you mean this\?
-.*: Info:      mov p0\.b,p1\.b
+.*: Info:      mov p0\.b, p1\.b
 .*: Error: operand mismatch -- `add z0,z0,z2'
 .*: Info:    did you mean this\?
-.*: Info:      add z0\.b,z0\.b,z2\.b
+.*: Info:      add z0\.b, z0\.b, z2\.b
 .*: Info:    other valid variant\(s\):
-.*: Info:      add z0\.h,z0\.h,z2\.h
-.*: Info:      add z0\.s,z0\.s,z2\.s
-.*: Info:      add z0\.d,z0\.d,z2\.d
+.*: Info:      add z0\.h, z0\.h, z2\.h
+.*: Info:      add z0\.s, z0\.s, z2\.s
+.*: Info:      add z0\.d, z0\.d, z2\.d
 .*: Error: operand mismatch -- `add z0,z0,#2'
 .*: Info:    did you mean this\?
-.*: Info:      add z0\.b,z0\.b,#2
+.*: Info:      add z0\.b, z0\.b, #2
 .*: Info:    other valid variant\(s\):
-.*: Info:      add z0\.h,z0\.h,#2
-.*: Info:      add z0\.s,z0\.s,#2
-.*: Info:      add z0\.d,z0\.d,#2
+.*: Info:      add z0\.h, z0\.h, #2
+.*: Info:      add z0\.s, z0\.s, #2
+.*: Info:      add z0\.d, z0\.d, #2
 .*: Error: operand mismatch -- `add z0,z1,z2'
 .*: Info:    did you mean this\?
-.*: Info:      add z0\.b,z1\.b,z2\.b
+.*: Info:      add z0\.b, z1\.b, z2\.b
 .*: Info:    other valid variant\(s\):
-.*: Info:      add z0\.h,z1\.h,z2\.h
-.*: Info:      add z0\.s,z1\.s,z2\.s
-.*: Info:      add z0\.d,z1\.d,z2\.d
+.*: Info:      add z0\.h, z1\.h, z2\.h
+.*: Info:      add z0\.s, z1\.s, z2\.s
+.*: Info:      add z0\.d, z1\.d, z2\.d
 .*: Error: operand 2 must be the same register as operand 1 -- `add z0,z1,#1'
 .*: Error: operand 2 must be the same register as operand 1 -- `add z0\.b,z1\.b,#1'
 .*: Error: operand mismatch -- `add z0\.b,z0\.h,#1'
 .*: Info:    did you mean this\?
-.*: Info:      add z0\.b,z0\.b,#1
+.*: Info:      add z0\.b, z0\.b, #1
 .*: Info:    other valid variant\(s\):
-.*: Info:      add z0\.h,z0\.h,#1
-.*: Info:      add z0\.s,z0\.s,#1
-.*: Info:      add z0\.d,z0\.d,#1
+.*: Info:      add z0\.h, z0\.h, #1
+.*: Info:      add z0\.s, z0\.s, #1
+.*: Info:      add z0\.d, z0\.d, #1
 .*: Error: constant expression required at operand 2 -- `mov z0\.b,z32\.b'
 .*: Error: operand 2 must be an SVE predicate register -- `mov p0\.b,p16\.b'
 .*: Error: p0-p7 expected at operand 2 -- `cmpeq p0\.b,p8/z,z1\.b,z2\.b'
 .*: Error: p0-p7 expected at operand 2 -- `cmpeq p0\.b,p15/z,z1\.b,z2\.b'
 .*: Error: operand mismatch -- `ld1w z0\.s,p0,\[x0\]'
 .*: Info:    did you mean this\?
-.*: Info:      ld1w \{z0\.s\},p0/z,\[x0\]
+.*: Info:      ld1w \{z0\.s\}, p0/z, \[x0\]
 .*: Error: operand mismatch -- `ld1w z0\.s,p0/m,\[x0\]'
 .*: Info:    did you mean this\?
-.*: Info:      ld1w \{z0\.s\},p0/z,\[x0\]
+.*: Info:      ld1w \{z0\.s\}, p0/z, \[x0\]
 .*: Error: operand mismatch -- `cmpeq p0\.b,p0,z1\.b,z2\.b'
 .*: Info:    did you mean this\?
-.*: Info:      cmpeq p0\.b,p0/z,z1\.b,z2\.b
+.*: Info:      cmpeq p0\.b, p0/z, z1\.b, z2\.b
 .*: Info:    other valid variant\(s\):
-.*: Info:      cmpeq p0\.h,p0/z,z1\.h,z2\.h
-.*: Info:      cmpeq p0\.s,p0/z,z1\.s,z2\.s
-.*: Info:      cmpeq p0\.d,p0/z,z1\.d,z2\.d
+.*: Info:      cmpeq p0\.h, p0/z, z1\.h, z2\.h
+.*: Info:      cmpeq p0\.s, p0/z, z1\.s, z2\.s
+.*: Info:      cmpeq p0\.d, p0/z, z1\.d, z2\.d
 .*: Error: operand mismatch -- `cmpeq p0\.b,p0/m,z1\.b,z2\.b'
 .*: Info:    did you mean this\?
-.*: Info:      cmpeq p0\.b,p0/z,z1\.b,z2\.b
+.*: Info:      cmpeq p0\.b, p0/z, z1\.b, z2\.b
 .*: Info:    other valid variant\(s\):
-.*: Info:      cmpeq p0\.h,p0/z,z1\.h,z2\.h
-.*: Info:      cmpeq p0\.s,p0/z,z1\.s,z2\.s
-.*: Info:      cmpeq p0\.d,p0/z,z1\.d,z2\.d
+.*: Info:      cmpeq p0\.h, p0/z, z1\.h, z2\.h
+.*: Info:      cmpeq p0\.s, p0/z, z1\.s, z2\.s
+.*: Info:      cmpeq p0\.d, p0/z, z1\.d, z2\.d
 .*: Error: operand mismatch -- `add z0\.s,p0,z0\.s,z1\.s'
 .*: Info:    did you mean this\?
-.*: Info:      add z0\.s,p0/m,z0\.s,z1\.s
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 .*: Info:    other valid variant\(s\):
-.*: Info:      add z0\.b,p0/m,z0\.b,z1\.b
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+.*: Info:      add z0\.d, p0/m, z0\.d, z1\.d
 .*: Error: operand mismatch -- `add z0\.s,p0/z,z0\.s,z1\.s'
 .*: Info:    did you mean this\?
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 .*: Error: operand mismatch -- `st1w z0\.s,p0/z,\[x0\]'
 .*: Info:    did you mean this\?
-.*: Info:      st1w \{z0\.s\},p0,\[x0\]
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 .*: Error: missing type suffix at operand 1 -- `ld1b z0,p1/z,\[x1\]'
 .*: Error: missing type suffix at operand 1 -- `ld1h z0,p1/z,\[x1\]'
 .*: Error: missing type suffix at operand 1 -- `ld1w z0,p1/z,\[x1\]'
index e8068c8..b8492e5 100644 (file)
@@ -1421,258 +1421,258 @@ Disassembly of section .*:
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-.*:    0420a41f        adr     z31\.d, \[z0\.d,z0\.d,sxtw #1\]
-.*:    0420a41f        adr     z31\.d, \[z0\.d,z0\.d,sxtw #1\]
-.*:    0420a440        adr     z0\.d, \[z2\.d,z0\.d,sxtw #1\]
-.*:    0420a440        adr     z0\.d, \[z2\.d,z0\.d,sxtw #1\]
-.*:    0420a7e0        adr     z0\.d, \[z31\.d,z0\.d,sxtw #1\]
-.*:    0420a7e0        adr     z0\.d, \[z31\.d,z0\.d,sxtw #1\]
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-.*:    0420a801        adr     z1\.d, \[z0\.d,z0\.d,sxtw #2\]
-.*:    0420a801        adr     z1\.d, \[z0\.d,z0\.d,sxtw #2\]
-.*:    0420a81f        adr     z31\.d, \[z0\.d,z0\.d,sxtw #2\]
-.*:    0420a81f        adr     z31\.d, \[z0\.d,z0\.d,sxtw #2\]
-.*:    0420a840        adr     z0\.d, \[z2\.d,z0\.d,sxtw #2\]
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-.*:    0420abe0        adr     z0\.d, \[z31\.d,z0\.d,sxtw #2\]
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-.*:    0423a800        adr     z0\.d, \[z0\.d,z3\.d,sxtw #2\]
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-.*:    0420ac00        adr     z0\.d, \[z0\.d,z0\.d,sxtw #3\]
-.*:    0420ac01        adr     z1\.d, \[z0\.d,z0\.d,sxtw #3\]
-.*:    0420ac01        adr     z1\.d, \[z0\.d,z0\.d,sxtw #3\]
-.*:    0420ac1f        adr     z31\.d, \[z0\.d,z0\.d,sxtw #3\]
-.*:    0420ac1f        adr     z31\.d, \[z0\.d,z0\.d,sxtw #3\]
-.*:    0420ac40        adr     z0\.d, \[z2\.d,z0\.d,sxtw #3\]
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@@ -12566,14 +12566,14 @@ Disassembly of section .*:
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@@ -12605,14 +12605,14 @@ Disassembly of section .*:
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@@ -12637,188 +12637,188 @@ Disassembly of section .*:
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@@ -13232,14 +13232,14 @@ Disassembly of section .*:
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@@ -13381,14 +13381,14 @@ Disassembly of section .*:
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@@ -13413,14 +13413,14 @@ Disassembly of section .*:
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@@ -13445,14 +13445,14 @@ Disassembly of section .*:
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@@ -13477,14 +13477,14 @@ Disassembly of section .*:
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@@ -13509,14 +13509,14 @@ Disassembly of section .*:
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-.*:    847fe000        ld1rb   \{z0\.d\}, p0/z, \[x0,#63\]
+.*:    845fe000        ld1rb   \{z0\.d\}, p0/z, \[x0, #31\]
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@@ -13797,14 +13797,14 @@ Disassembly of section .*:
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@@ -14282,14 +14282,14 @@ Disassembly of section .*:
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@@ -14314,311 +14314,311 @@ Disassembly of section .*:
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@@ -15534,44 +15534,44 @@ Disassembly of section .*:
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@@ -18083,188 +18083,188 @@ Disassembly of section .*:
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@@ -18689,14 +18689,14 @@ Disassembly of section .*:
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@@ -18767,14 +18767,14 @@ Disassembly of section .*:
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@@ -18806,14 +18806,14 @@ Disassembly of section .*:
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@@ -18845,14 +18845,14 @@ Disassembly of section .*:
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@@ -18884,14 +18884,14 @@ Disassembly of section .*:
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@@ -18923,14 +18923,14 @@ Disassembly of section .*:
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@@ -18962,14 +18962,14 @@ Disassembly of section .*:
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-.*:    a4f8a000        ldnf1h  \{z0\.d\}, p0/z, \[x0,#-8,mul vl\]
-.*:    a4f9a000        ldnf1h  \{z0\.d\}, p0/z, \[x0,#-7,mul vl\]
-.*:    a4f9a000        ldnf1h  \{z0\.d\}, p0/z, \[x0,#-7,mul vl\]
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@@ -19118,14 +19118,14 @@ Disassembly of section .*:
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@@ -19157,14 +19157,14 @@ Disassembly of section .*:
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@@ -19196,14 +19196,14 @@ Disassembly of section .*:
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@@ -19235,14 +19235,14 @@ Disassembly of section .*:
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@@ -19274,44 +19274,44 @@ Disassembly of section .*:
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-.*:    a578a000        ldnf1w  \{z0\.d\}, p0/z, \[x0,#-8,mul vl\]
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-.*:    a579a000        ldnf1w  \{z0\.d\}, p0/z, \[x0,#-7,mul vl\]
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+.*:    84601c00        prfb    pldl1keep, p7, \[x0, z0\.s, sxtw\]
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+.*:    84600060        prfb    pldl1keep, p0, \[x3, z0\.s, sxtw\]
+.*:    84600060        prfb    pldl1keep, p0, \[x3, z0\.s, sxtw\]
+.*:    846003e0        prfb    pldl1keep, p0, \[sp, z0\.s, sxtw\]
+.*:    846003e0        prfb    pldl1keep, p0, \[sp, z0\.s, sxtw\]
+.*:    846003e0        prfb    pldl1keep, p0, \[sp, z0\.s, sxtw\]
+.*:    84640000        prfb    pldl1keep, p0, \[x0, z4\.s, sxtw\]
+.*:    84640000        prfb    pldl1keep, p0, \[x0, z4\.s, sxtw\]
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@@ -22530,14 +22530,14 @@ Disassembly of section .*:
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@@ -23086,278 +23086,278 @@ Disassembly of section .*:
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+.*:    c58fe000        prfd    pldl1keep, p0, \[z0\.d, #120\]
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+.*:    c59fe000        prfd    pldl1keep, p0, \[z0\.d, #248\]
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+.*:    84202000        prfh    pldl1keep, p0, \[x0, z0\.s, uxtw #1\]
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+.*:    c420200e        prfh    #14, p0, \[x0, z0\.d, uxtw #1\]
+.*:    c420200f        prfh    #15, p0, \[x0, z0\.d, uxtw #1\]
+.*:    c420200f        prfh    #15, p0, \[x0, z0\.d, uxtw #1\]
+.*:    c4202800        prfh    pldl1keep, p2, \[x0, z0\.d, uxtw #1\]
+.*:    c4202800        prfh    pldl1keep, p2, \[x0, z0\.d, uxtw #1\]
+.*:    c4203c00        prfh    pldl1keep, p7, \[x0, z0\.d, uxtw #1\]
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+.*:    c4202060        prfh    pldl1keep, p0, \[x3, z0\.d, uxtw #1\]
+.*:    c4202060        prfh    pldl1keep, p0, \[x3, z0\.d, uxtw #1\]
+.*:    c42023e0        prfh    pldl1keep, p0, \[sp, z0\.d, uxtw #1\]
+.*:    c42023e0        prfh    pldl1keep, p0, \[sp, z0\.d, uxtw #1\]
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+.*:    c43f2000        prfh    pldl1keep, p0, \[x0, z31\.d, uxtw #1\]
+.*:    c43f2000        prfh    pldl1keep, p0, \[x0, z31\.d, uxtw #1\]
+.*:    c4602000        prfh    pldl1keep, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602000        prfh    pldl1keep, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602001        prfh    pldl1strm, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602001        prfh    pldl1strm, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602002        prfh    pldl2keep, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602002        prfh    pldl2keep, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602003        prfh    pldl2strm, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602003        prfh    pldl2strm, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602004        prfh    pldl3keep, p0, \[x0, z0\.d, sxtw #1\]
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+.*:    c4602005        prfh    pldl3strm, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602006        prfh    #6, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602006        prfh    #6, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602007        prfh    #7, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602007        prfh    #7, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602008        prfh    pstl1keep, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602008        prfh    pstl1keep, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602009        prfh    pstl1strm, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c4602009        prfh    pstl1strm, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c460200a        prfh    pstl2keep, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c460200a        prfh    pstl2keep, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c460200b        prfh    pstl2strm, p0, \[x0, z0\.d, sxtw #1\]
+.*:    c460200b        prfh    pstl2strm, p0, \[x0, z0\.d, sxtw #1\]
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+.*:    c47fa000        prfh    pldl1keep, p0, \[x0, z31\.d, lsl #1\]
 .*:    8480e000        prfh    pldl1keep, p0, \[z0\.s\]
 .*:    8480e000        prfh    pldl1keep, p0, \[z0\.s\]
 .*:    8480e000        prfh    pldl1keep, p0, \[z0\.s\]
@@ -23418,14 +23418,14 @@ Disassembly of section .*:
 .*:    8480e3e0        prfh    pldl1keep, p0, \[z31\.s\]
 .*:    8480e3e0        prfh    pldl1keep, p0, \[z31\.s\]
 .*:    8480e3e0        prfh    pldl1keep, p0, \[z31\.s\]
-.*:    848fe000        prfh    pldl1keep, p0, \[z0\.s,#30\]
-.*:    848fe000        prfh    pldl1keep, p0, \[z0\.s,#30\]
-.*:    8490e000        prfh    pldl1keep, p0, \[z0\.s,#32\]
-.*:    8490e000        prfh    pldl1keep, p0, \[z0\.s,#32\]
-.*:    8491e000        prfh    pldl1keep, p0, \[z0\.s,#34\]
-.*:    8491e000        prfh    pldl1keep, p0, \[z0\.s,#34\]
-.*:    849fe000        prfh    pldl1keep, p0, \[z0\.s,#62\]
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+.*:    848fe000        prfh    pldl1keep, p0, \[z0\.s, #30\]
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+.*:    8490e000        prfh    pldl1keep, p0, \[z0\.s, #32\]
+.*:    8491e000        prfh    pldl1keep, p0, \[z0\.s, #34\]
+.*:    8491e000        prfh    pldl1keep, p0, \[z0\.s, #34\]
+.*:    849fe000        prfh    pldl1keep, p0, \[z0\.s, #62\]
+.*:    849fe000        prfh    pldl1keep, p0, \[z0\.s, #62\]
 .*:    85c02000        prfh    pldl1keep, p0, \[x0\]
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@@ -23506,14 +23506,14 @@ Disassembly of section .*:
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-.*:    85e02000        prfh    pldl1keep, p0, \[x0,#-32,mul vl\]
-.*:    85e02000        prfh    pldl1keep, p0, \[x0,#-32,mul vl\]
-.*:    85e12000        prfh    pldl1keep, p0, \[x0,#-31,mul vl\]
-.*:    85e12000        prfh    pldl1keep, p0, \[x0,#-31,mul vl\]
-.*:    85ff2000        prfh    pldl1keep, p0, \[x0,#-1,mul vl\]
-.*:    85ff2000        prfh    pldl1keep, p0, \[x0,#-1,mul vl\]
+.*:    85df2000        prfh    pldl1keep, p0, \[x0, #31, mul vl\]
+.*:    85df2000        prfh    pldl1keep, p0, \[x0, #31, mul vl\]
+.*:    85e02000        prfh    pldl1keep, p0, \[x0, #-32, mul vl\]
+.*:    85e02000        prfh    pldl1keep, p0, \[x0, #-32, mul vl\]
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 .*:    c480e000        prfh    pldl1keep, p0, \[z0\.d\]
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@@ -23574,278 +23574,278 @@ Disassembly of section .*:
 .*:    c480e3e0        prfh    pldl1keep, p0, \[z31\.d\]
 .*:    c480e3e0        prfh    pldl1keep, p0, \[z31\.d\]
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-.*:    c48fe000        prfh    pldl1keep, p0, \[z0\.d,#30\]
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-.*:    c491e000        prfh    pldl1keep, p0, \[z0\.d,#34\]
-.*:    c49fe000        prfh    pldl1keep, p0, \[z0\.d,#62\]
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-.*:    84204000        prfw    pldl1keep, p0, \[x0,z0\.s,uxtw #2\]
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-.*:    84204007        prfw    #7, p0, \[x0,z0\.s,uxtw #2\]
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-.*:    8420400f        prfw    #15, p0, \[x0,z0\.s,uxtw #2\]
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+.*:    8500c060        prfw    pldl1keep, p0, \[x3, x0, lsl #2\]
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@@ -29251,14 +29251,14 @@ Disassembly of section .*:
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@@ -29283,14 +29283,14 @@ Disassembly of section .*:
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@@ -29322,188 +29322,188 @@ Disassembly of section .*:
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@@ -29528,14 +29528,14 @@ Disassembly of section .*:
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@@ -29567,332 +29567,332 @@ Disassembly of section .*:
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+.*:    e4e04800        st1h    \{z0\.d\}, p2, \[x0, x0, lsl #1\]
+.*:    e4e04800        st1h    \{z0\.d\}, p2, \[x0, x0, lsl #1\]
+.*:    e4e05c00        st1h    \{z0\.d\}, p7, \[x0, x0, lsl #1\]
+.*:    e4e05c00        st1h    \{z0\.d\}, p7, \[x0, x0, lsl #1\]
+.*:    e4e04060        st1h    \{z0\.d\}, p0, \[x3, x0, lsl #1\]
+.*:    e4e04060        st1h    \{z0\.d\}, p0, \[x3, x0, lsl #1\]
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+.*:    e4e043e0        st1h    \{z0\.d\}, p0, \[sp, x0, lsl #1\]
+.*:    e4e44000        st1h    \{z0\.d\}, p0, \[x0, x4, lsl #1\]
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@@ -29924,14 +29924,14 @@ Disassembly of section .*:
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 .*:    e4a0e3e0        st1h    \{z0\.h\}, p0, \[sp\]
 .*:    e4a0e3e0        st1h    \{z0\.h\}, p0, \[sp\]
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-.*:    e4a8e000        st1h    \{z0\.h\}, p0, \[x0,#-8,mul vl\]
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@@ -29956,14 +29956,14 @@ Disassembly of section .*:
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-.*:    e4d0a000        st1h    \{z0\.d\}, p0, \[z0\.d,#32\]
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-.*:    e4d1a000        st1h    \{z0\.d\}, p0, \[z0\.d,#34\]
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-.*:    e4dfa000        st1h    \{z0\.d\}, p0, \[z0\.d,#62\]
+.*:    e4cfa000        st1h    \{z0\.d\}, p0, \[z0\.d, #30\]
+.*:    e4cfa000        st1h    \{z0\.d\}, p0, \[z0\.d, #30\]
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+.*:    e4dfa000        st1h    \{z0\.d\}, p0, \[z0\.d, #62\]
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@@ -29995,14 +29995,14 @@ Disassembly of section .*:
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 .*:    e4c0e3e0        st1h    \{z0\.s\}, p0, \[sp\]
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-.*:    e4c8e000        st1h    \{z0\.s\}, p0, \[x0,#-8,mul vl\]
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+.*:    e4c8e000        st1h    \{z0\.s\}, p0, \[x0, #-8, mul vl\]
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+.*:    e4cfe000        st1h    \{z0\.s\}, p0, \[x0, #-1, mul vl\]
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 .*:    e4e0a000        st1h    \{z0\.s\}, p0, \[z0\.s\]
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@@ -30027,14 +30027,14 @@ Disassembly of section .*:
 .*:    e4e0a3e0        st1h    \{z0\.s\}, p0, \[z31\.s\]
 .*:    e4e0a3e0        st1h    \{z0\.s\}, p0, \[z31\.s\]
 .*:    e4e0a3e0        st1h    \{z0\.s\}, p0, \[z31\.s\]
-.*:    e4efa000        st1h    \{z0\.s\}, p0, \[z0\.s,#30\]
-.*:    e4efa000        st1h    \{z0\.s\}, p0, \[z0\.s,#30\]
-.*:    e4f0a000        st1h    \{z0\.s\}, p0, \[z0\.s,#32\]
-.*:    e4f0a000        st1h    \{z0\.s\}, p0, \[z0\.s,#32\]
-.*:    e4f1a000        st1h    \{z0\.s\}, p0, \[z0\.s,#34\]
-.*:    e4f1a000        st1h    \{z0\.s\}, p0, \[z0\.s,#34\]
-.*:    e4ffa000        st1h    \{z0\.s\}, p0, \[z0\.s,#62\]
-.*:    e4ffa000        st1h    \{z0\.s\}, p0, \[z0\.s,#62\]
+.*:    e4efa000        st1h    \{z0\.s\}, p0, \[z0\.s, #30\]
+.*:    e4efa000        st1h    \{z0\.s\}, p0, \[z0\.s, #30\]
+.*:    e4f0a000        st1h    \{z0\.s\}, p0, \[z0\.s, #32\]
+.*:    e4f0a000        st1h    \{z0\.s\}, p0, \[z0\.s, #32\]
+.*:    e4f1a000        st1h    \{z0\.s\}, p0, \[z0\.s, #34\]
+.*:    e4f1a000        st1h    \{z0\.s\}, p0, \[z0\.s, #34\]
+.*:    e4ffa000        st1h    \{z0\.s\}, p0, \[z0\.s, #62\]
+.*:    e4ffa000        st1h    \{z0\.s\}, p0, \[z0\.s, #62\]
 .*:    e4e0e000        st1h    \{z0\.d\}, p0, \[x0\]
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 .*:    e4e0e000        st1h    \{z0\.d\}, p0, \[x0\]
@@ -30066,311 +30066,311 @@ Disassembly of section .*:
 .*:    e4e0e3e0        st1h    \{z0\.d\}, p0, \[sp\]
 .*:    e4e0e3e0        st1h    \{z0\.d\}, p0, \[sp\]
 .*:    e4e0e3e0        st1h    \{z0\.d\}, p0, \[sp\]
-.*:    e4e7e000        st1h    \{z0\.d\}, p0, \[x0,#7,mul vl\]
-.*:    e4e7e000        st1h    \{z0\.d\}, p0, \[x0,#7,mul vl\]
-.*:    e4e8e000        st1h    \{z0\.d\}, p0, \[x0,#-8,mul vl\]
-.*:    e4e8e000        st1h    \{z0\.d\}, p0, \[x0,#-8,mul vl\]
-.*:    e4e9e000        st1h    \{z0\.d\}, p0, \[x0,#-7,mul vl\]
-.*:    e4e9e000        st1h    \{z0\.d\}, p0, \[x0,#-7,mul vl\]
-.*:    e4efe000        st1h    \{z0\.d\}, p0, \[x0,#-1,mul vl\]
-.*:    e4efe000        st1h    \{z0\.d\}, p0, \[x0,#-1,mul vl\]
-.*:    e5008000        st1w    \{z0\.d\}, p0, \[x0,z0\.d,uxtw\]
-.*:    e5008000        st1w    \{z0\.d\}, p0, \[x0,z0\.d,uxtw\]
-.*:    e5008000        st1w    \{z0\.d\}, p0, \[x0,z0\.d,uxtw\]
-.*:    e5008000        st1w    \{z0\.d\}, p0, \[x0,z0\.d,uxtw\]
-.*:    e5008001        st1w    \{z1\.d\}, p0, \[x0,z0\.d,uxtw\]
-.*:    e5008001        st1w    \{z1\.d\}, p0, \[x0,z0\.d,uxtw\]
-.*:    e5008001        st1w    \{z1\.d\}, p0, \[x0,z0\.d,uxtw\]
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-.*:    e500801f        st1w    \{z31\.d\}, p0, \[x0,z0\.d,uxtw\]
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-.*:    e5009c00        st1w    \{z0\.d\}, p7, \[x0,z0\.d,uxtw\]
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-.*:    e5008060        st1w    \{z0\.d\}, p0, \[x3,z0\.d,uxtw\]
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-.*:    e50083e0        st1w    \{z0\.d\}, p0, \[sp,z0\.d,uxtw\]
-.*:    e50083e0        st1w    \{z0\.d\}, p0, \[sp,z0\.d,uxtw\]
-.*:    e50083e0        st1w    \{z0\.d\}, p0, \[sp,z0\.d,uxtw\]
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@@ -30395,14 +30395,14 @@ Disassembly of section .*:
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@@ -30434,14 +30434,14 @@ Disassembly of section .*:
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@@ -30466,14 +30466,14 @@ Disassembly of section .*:
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@@ -30505,57 +30505,57 @@ Disassembly of section .*:
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@@ -30955,44 +30955,44 @@ Disassembly of section .*:
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@@ -31039,44 +31039,44 @@ Disassembly of section .*:
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  4b4:  d800001d        prfm    #0x1d, 0 <LABEL1>
                        4b4: R_AARCH64_LD_PREL_LO19     LABEL1
- 4b8:  f8af6bfd        prfm    #0x1d, \[sp,x15\]
- 4bc:  f8be58fd        prfm    #0x1d, \[x7,w30,uxtw #3\]
- 4c0:  f9800c7d        prfm    #0x1d, \[x3,#24\]
+ 4b8:  f8af6bfd        prfm    #0x1d, \[sp, x15\]
+ 4bc:  f8be58fd        prfm    #0x1d, \[x7, w30, uxtw #3\]
+ 4c0:  f9800c7d        prfm    #0x1d, \[x3, #24\]
  4c4:  d800001e        prfm    #0x1e, 0 <LABEL1>
                        4c4: R_AARCH64_LD_PREL_LO19     LABEL1
- 4c8:  f8af6bfe        prfm    #0x1e, \[sp,x15\]
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  4d4:  d800001f        prfm    #0x1f, 0 <LABEL1>
                        4d4: R_AARCH64_LD_PREL_LO19     LABEL1
- 4d8:  f8af6bff        prfm    #0x1f, \[sp,x15\]
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- 4fc:  f9800c68        prfm    plil1keep, \[x3,#24\]
- 500:  f9800c69        prfm    plil1strm, \[x3,#24\]
- 504:  f9800c6a        prfm    plil2keep, \[x3,#24\]
- 508:  f9800c6b        prfm    plil2strm, \[x3,#24\]
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- 510:  f9800c6d        prfm    plil3strm, \[x3,#24\]
- 514:  f9800c70        prfm    pstl1keep, \[x3,#24\]
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+ 4dc:  f8be58ff        prfm    #0x1f, \[x7, w30, uxtw #3\]
+ 4e0:  f9800c7f        prfm    #0x1f, \[x3, #24\]
+ 4e4:  f9800c60        prfm    pldl1keep, \[x3, #24\]
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+ 528:  f9800c75        prfm    pstl3strm, \[x3, #24\]
index 751e797..378fcb5 100644 (file)
@@ -9,7 +9,7 @@ Disassembly of section \.text:
                        0: R_AARCH64_TLSDESC_OFF_G1     var
    4:  f2800000        movk    x0, #0x0
                        4: R_AARCH64_TLSDESC_OFF_G0_NC  var
-   8:  f8606a41        ldr     x1, \[x18,x0\]
+   8:  f8606a41        ldr     x1, \[x18, x0\]
                        8: R_AARCH64_TLSDESC_LDR        var
    c:  8b000240        add     x0, x18, x0
                        c: R_AARCH64_TLSDESC_ADD        var
index 314a5cc..5696a5c 100644 (file)
@@ -2,9 +2,9 @@
 [^:]*:4: Error: missing shift amount at operand 2 -- `strb w7,\[x30,x0,lsl\]'
 [^:]*:5: Error: operand mismatch -- `ubfm w0,x1,8,31'
 [^:]*:5: Info:    did you mean this\?
-[^:]*:5: Info:         ubfm w0,w1,#8,#31
+[^:]*:5: Info:         ubfm w0, w1, #8, #31
 [^:]*:5: Info:    other valid variant\(s\):
-[^:]*:5: Info:         ubfm x0,x1,#8,#31
+[^:]*:5: Info:         ubfm x0, x1, #8, #31
 [^:]*:6: Error: immediate value out of range 0 to 31 at operand 4 -- `bfm w0,w1,8,43'
 [^:]*:7: Error: invalid shift amount at operand 2 -- `strb w7,\[x30,x0,lsl#1\]'
 [^:]*:8: Error: invalid addressing mode at operand 2 -- `st2 {v4.2d,v5.2d},\[x3,#3\]'
 [^:]*:11: Error: missing immediate expression at operand 1 -- `svc'
 [^:]*:12: Error: operand mismatch -- `add v0.4s,v1.4s,v2.2s'
 [^:]*:12: Info:    did you mean this\?
-[^:]*:12: Info:        add v0.4s,v1.4s,v2.4s
+[^:]*:12: Info:        add v0.4s, v1.4s, v2.4s
 [^:]*:12: Info:    other valid variant\(s\):
-[^:]*:12: Info:        add v0.8b,v1.8b,v2.8b
-[^:]*:12: Info:        add v0.16b,v1.16b,v2.16b
-[^:]*:12: Info:        add v0.4h,v1.4h,v2.4h
-[^:]*:12: Info:        add v0.8h,v1.8h,v2.8h
-[^:]*:12: Info:        add v0.2s,v1.2s,v2.2s
-[^:]*:12: Info:        add v0.2d,v1.2d,v2.2d
+[^:]*:12: Info:        add v0.8b, v1.8b, v2.8b
+[^:]*:12: Info:        add v0.16b, v1.16b, v2.16b
+[^:]*:12: Info:        add v0.4h, v1.4h, v2.4h
+[^:]*:12: Info:        add v0.8h, v1.8h, v2.8h
+[^:]*:12: Info:        add v0.2s, v1.2s, v2.2s
+[^:]*:12: Info:        add v0.2d, v1.2d, v2.2d
 [^:]*:13: Error: operand mismatch -- `urecpe v0.1d,v7.1d'
 [^:]*:13: Info:    did you mean this\?
-[^:]*:13: Info:        urecpe v0.2s,v7.2s
+[^:]*:13: Info:        urecpe v0.2s, v7.2s
 [^:]*:13: Info:    other valid variant\(s\):
-[^:]*:13: Info:        urecpe v0.4s,v7.4s
+[^:]*:13: Info:        urecpe v0.4s, v7.4s
 [^:]*:14: Error: operand mismatch -- `adds w0,wsp,x0,uxtx#1'
 [^:]*:14: Info:    did you mean this\?
-[^:]*:14: Info:        adds w0,wsp,w0, uxtx #1
+[^:]*:14: Info:        adds w0, wsp, w0, uxtx #1
 [^:]*:14: Info:    other valid variant\(s\):
-[^:]*:14: Info:        adds x0,sp,w0, uxtx #1
-[^:]*:14: Info:        adds x0,sp,x0, lsl #1
+[^:]*:14: Info:        adds x0, sp, w0, uxtx #1
+[^:]*:14: Info:        adds x0, sp, x0, lsl #1
 [^:]*:15: Error: operand mismatch -- `fmov d0,s0'
 [^:]*:15: Info:    did you mean this\?
-[^:]*:15: Info:        fmov s0,s0
+[^:]*:15: Info:        fmov s0, s0
 [^:]*:15: Info:    other valid variant\(s\):
-[^:]*:15: Info:        fmov d0,d0
+[^:]*:15: Info:        fmov d0, d0
 [^:]*:16: Error: operand mismatch -- `ldnp h3,h7,\[sp\],#16'
 [^:]*:16: Info:    did you mean this\?
-[^:]*:16: Info:        ldnp s3,s7,\[sp\],#16
+[^:]*:16: Info:        ldnp s3, s7, \[sp\], #16
 [^:]*:16: Info:    other valid variant\(s\):
-[^:]*:16: Info:        ldnp d3,d7,\[sp\],#16
-[^:]*:16: Info:        ldnp q3,q7,\[sp\],#16
+[^:]*:16: Info:        ldnp d3, d7, \[sp\], #16
+[^:]*:16: Info:        ldnp q3, q7, \[sp\], #16
 [^:]*:18: Error: operand mismatch -- `suqadd v0.8b,v1.16b'
 [^:]*:18: Info:    did you mean this\?
-[^:]*:18: Info:        suqadd v0.8b,v1.8b
+[^:]*:18: Info:        suqadd v0.8b, v1.8b
 [^:]*:18: Info:    other valid variant\(s\):
-[^:]*:18: Info:        suqadd v0.16b,v1.16b
-[^:]*:18: Info:        suqadd v0.4h,v1.4h
-[^:]*:18: Info:        suqadd v0.8h,v1.8h
-[^:]*:18: Info:        suqadd v0.2s,v1.2s
-[^:]*:18: Info:        suqadd v0.4s,v1.4s
-[^:]*:18: Info:        suqadd v0.2d,v1.2d
+[^:]*:18: Info:        suqadd v0.16b, v1.16b
+[^:]*:18: Info:        suqadd v0.4h, v1.4h
+[^:]*:18: Info:        suqadd v0.8h, v1.8h
+[^:]*:18: Info:        suqadd v0.2s, v1.2s
+[^:]*:18: Info:        suqadd v0.4s, v1.4s
+[^:]*:18: Info:        suqadd v0.2d, v1.2d
 [^:]*:20: Error: operand mismatch -- `ursqrte v2.8b,v3.8b'
 [^:]*:20: Info:    did you mean this\?
-[^:]*:20: Info:        ursqrte v2.2s,v3.2s
+[^:]*:20: Info:        ursqrte v2.2s, v3.2s
 [^:]*:20: Info:    other valid variant\(s\):
-[^:]*:20: Info:        ursqrte v2.4s,v3.4s
+[^:]*:20: Info:        ursqrte v2.4s, v3.4s
 [^:]*:22: Error: operand mismatch -- `rev32 v4.2s,v5.2s'
 [^:]*:22: Info:    did you mean this\?
-[^:]*:22: Info:        rev32 v4.8b,v5.8b
+[^:]*:22: Info:        rev32 v4.8b, v5.8b
 [^:]*:22: Info:    other valid variant\(s\):
-[^:]*:22: Info:        rev32 v4.16b,v5.16b
-[^:]*:22: Info:        rev32 v4.4h,v5.4h
-[^:]*:22: Info:        rev32 v4.8h,v5.8h
+[^:]*:22: Info:        rev32 v4.16b, v5.16b
+[^:]*:22: Info:        rev32 v4.4h, v5.4h
+[^:]*:22: Info:        rev32 v4.8h, v5.8h
 [^:]*:24: Error: operand mismatch -- `frintn v6.8b,v7.8b'
 [^:]*:24: Info:    did you mean this\?
-[^:]*:24: Info:        frintn v6.4h,v7.4h
+[^:]*:24: Info:        frintn v6.4h, v7.4h
 [^:]*:24: Info:    other valid variant\(s\):
-[^:]*:24: Info:        frintn v6.8h,v7.8h
+[^:]*:24: Info:        frintn v6.8h, v7.8h
 [^:]*:26: Error: operand mismatch -- `rev64 v8.2d,v9.2d'
 [^:]*:26: Info:    did you mean this\?
-[^:]*:26: Info:        rev64 v8.8b,v9.8b
+[^:]*:26: Info:        rev64 v8.8b, v9.8b
 [^:]*:26: Info:    other valid variant\(s\):
-[^:]*:26: Info:        rev64 v8.16b,v9.16b
-[^:]*:26: Info:        rev64 v8.4h,v9.4h
-[^:]*:26: Info:        rev64 v8.8h,v9.8h
-[^:]*:26: Info:        rev64 v8.2s,v9.2s
-[^:]*:26: Info:        rev64 v8.4s,v9.4s
+[^:]*:26: Info:        rev64 v8.16b, v9.16b
+[^:]*:26: Info:        rev64 v8.4h, v9.4h
+[^:]*:26: Info:        rev64 v8.8h, v9.8h
+[^:]*:26: Info:        rev64 v8.2s, v9.2s
+[^:]*:26: Info:        rev64 v8.4s, v9.4s
 [^:]*:28: Error: operand mismatch -- `rev16 v10.2s,v11.2s'
 [^:]*:28: Info:    did you mean this\?
-[^:]*:28: Info:        rev16 v10.8b,v11.8b
+[^:]*:28: Info:        rev16 v10.8b, v11.8b
 [^:]*:28: Info:    other valid variant\(s\):
-[^:]*:28: Info:        rev16 v10.16b,v11.16b
+[^:]*:28: Info:        rev16 v10.16b, v11.16b
 [^:]*:30: Error: operand mismatch -- `saddlp v12.8b,v13.8b'
 [^:]*:30: Info:    did you mean this\?
-[^:]*:30: Info:        saddlp v12.4h,v13.8b
+[^:]*:30: Info:        saddlp v12.4h, v13.8b
 [^:]*:30: Info:    other valid variant\(s\):
-[^:]*:30: Info:        saddlp v12.8h,v13.16b
-[^:]*:30: Info:        saddlp v12.2s,v13.4h
-[^:]*:30: Info:        saddlp v12.4s,v13.8h
-[^:]*:30: Info:        saddlp v12.1d,v13.2s
-[^:]*:30: Info:        saddlp v12.2d,v13.4s
+[^:]*:30: Info:        saddlp v12.8h, v13.16b
+[^:]*:30: Info:        saddlp v12.2s, v13.4h
+[^:]*:30: Info:        saddlp v12.4s, v13.8h
+[^:]*:30: Info:        saddlp v12.1d, v13.2s
+[^:]*:30: Info:        saddlp v12.2d, v13.4s
 [^:]*:32: Error: operand mismatch -- `shll v14.8b,v15.8h,#1'
 [^:]*:32: Info:    did you mean this\?
-[^:]*:32: Info:        shll v14.8h,v15.8b,#1
+[^:]*:32: Info:        shll v14.8h, v15.8b, #1
 [^:]*:32: Info:    other valid variant\(s\):
-[^:]*:32: Info:        shll v14.4s,v15.4h,#1
-[^:]*:32: Info:        shll v14.2d,v15.2s,#1
+[^:]*:32: Info:        shll v14.4s, v15.4h, #1
+[^:]*:32: Info:        shll v14.2d, v15.2s, #1
 [^:]*:34: Error: operand mismatch -- `shll2 v14.8b,v15.8h,#1'
 [^:]*:34: Info:    did you mean this\?
-[^:]*:34: Info:        shll2 v14.4s,v15.8h,#1
+[^:]*:34: Info:        shll2 v14.4s, v15.8h, #1
 [^:]*:34: Info:    other valid variant\(s\):
-[^:]*:34: Info:        shll2 v14.8h,v15.16b,#1
-[^:]*:34: Info:        shll2 v14.2d,v15.4s,#1
+[^:]*:34: Info:        shll2 v14.8h, v15.16b, #1
+[^:]*:34: Info:        shll2 v14.2d, v15.4s, #1
 [^:]*:36: Error: operand mismatch -- `fcvtxn v22.8b,v23.8b'
 [^:]*:36: Info:    did you mean this\?
-[^:]*:36: Info:        fcvtxn v22.2s,v23.2d
+[^:]*:36: Info:        fcvtxn v22.2s, v23.2d
 [^:]*:38: Error: operand mismatch -- `fcvtxn2 v24.8b,v25.8b'
 [^:]*:38: Info:    did you mean this\?
-[^:]*:38: Info:        fcvtxn2 v24.4s,v25.2d
+[^:]*:38: Info:        fcvtxn2 v24.4s, v25.2d
 [^:]*:40: Error: operand mismatch -- `fcvtn v25.4s,v26.4s'
 [^:]*:40: Info:    did you mean this\?
-[^:]*:40: Info:        fcvtn v25.4h,v26.4s
+[^:]*:40: Info:        fcvtn v25.4h, v26.4s
 [^:]*:40: Info:    other valid variant\(s\):
-[^:]*:40: Info:        fcvtn v25.2s,v26.2d
+[^:]*:40: Info:        fcvtn v25.2s, v26.2d
 [^:]*:42: Error: operand mismatch -- `fcvtn2 v27.4s,v28.4s'
 [^:]*:42: Info:    did you mean this\?
-[^:]*:42: Info:        fcvtn2 v27.8h,v28.4s
+[^:]*:42: Info:        fcvtn2 v27.8h, v28.4s
 [^:]*:42: Info:    other valid variant\(s\):
-[^:]*:42: Info:        fcvtn2 v27.4s,v28.2d
+[^:]*:42: Info:        fcvtn2 v27.4s, v28.2d
 [^:]*:44: Error: operand mismatch -- `fcvtl v29.8b,v30.8b'
 [^:]*:44: Info:    did you mean this\?
-[^:]*:44: Info:        fcvtl v29.4s,v30.4h
+[^:]*:44: Info:        fcvtl v29.4s, v30.4h
 [^:]*:44: Info:    other valid variant\(s\):
-[^:]*:44: Info:        fcvtl v29.2d,v30.2s
+[^:]*:44: Info:        fcvtl v29.2d, v30.2s
 [^:]*:46: Error: operand mismatch -- `fcvtl2 v1.2d,v2.2d'
 [^:]*:46: Info:    did you mean this\?
-[^:]*:46: Info:        fcvtl2 v1.2d,v2.4s
+[^:]*:46: Info:        fcvtl2 v1.2d, v2.4s
 [^:]*:46: Info:    other valid variant\(s\):
-[^:]*:46: Info:        fcvtl2 v1.4s,v2.8h
+[^:]*:46: Info:        fcvtl2 v1.4s, v2.8h
 [^:]*:48: Error: operand mismatch -- `sqadd v16.8b,v17.8h,v18.8h'
 [^:]*:48: Info:    did you mean this\?
-[^:]*:48: Info:        sqadd v16.8h,v17.8h,v18.8h
+[^:]*:48: Info:        sqadd v16.8h, v17.8h, v18.8h
 [^:]*:48: Info:    other valid variant\(s\):
-[^:]*:48: Info:        sqadd v16.8b,v17.8b,v18.8b
-[^:]*:48: Info:        sqadd v16.16b,v17.16b,v18.16b
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-[^:]*:48: Info:        sqadd v16.2d,v17.2d,v18.2d
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+[^:]*:48: Info:        sqadd v16.2s, v17.2s, v18.2s
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+[^:]*:48: Info:        sqadd v16.2d, v17.2d, v18.2d
 [^:]*:50: Error: operand mismatch -- `shadd v19.8b,v20.8h,v21.8h'
 [^:]*:50: Info:    did you mean this\?
-[^:]*:50: Info:        shadd v19.8h,v20.8h,v21.8h
+[^:]*:50: Info:        shadd v19.8h, v20.8h, v21.8h
 [^:]*:50: Info:    other valid variant\(s\):
-[^:]*:50: Info:        shadd v19.8b,v20.8b,v21.8b
-[^:]*:50: Info:        shadd v19.16b,v20.16b,v21.16b
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-[^:]*:50: Info:        shadd v19.2s,v20.2s,v21.2s
-[^:]*:50: Info:        shadd v19.4s,v20.4s,v21.4s
+[^:]*:50: Info:        shadd v19.8b, v20.8b, v21.8b
+[^:]*:50: Info:        shadd v19.16b, v20.16b, v21.16b
+[^:]*:50: Info:        shadd v19.4h, v20.4h, v21.4h
+[^:]*:50: Info:        shadd v19.2s, v20.2s, v21.2s
+[^:]*:50: Info:        shadd v19.4s, v20.4s, v21.4s
 [^:]*:52: Error: operand mismatch -- `sha1su0 v1.16b,v2.16b,v3.16b'
 [^:]*:52: Info:    did you mean this\?
-[^:]*:52: Info:        sha1su0 v1.4s,v2.4s,v3.4s
+[^:]*:52: Info:        sha1su0 v1.4s, v2.4s, v3.4s
 [^:]*:54: Error: operand mismatch -- `shadd v1.2d,v2.2d,v3.2d'
 [^:]*:54: Info:    did you mean this\?
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+[^:]*:54: Info:        shadd v1.8b, v2.8b, v3.8b
 [^:]*:54: Info:    other valid variant\(s\):
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 [^:]*:56: Error: operand mismatch -- `sqdmulh v1.16b,v2.16b,v3.16b'
 [^:]*:56: Info:    did you mean this\?
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 [^:]*:56: Info:    other valid variant\(s\):
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+[^:]*:56: Info:        sqdmulh v1.8h, v2.8h, v3.8h
+[^:]*:56: Info:        sqdmulh v1.2s, v2.2s, v3.2s
+[^:]*:56: Info:        sqdmulh v1.4s, v2.4s, v3.4s
 [^:]*:58: Error: operand mismatch -- `sqdmlal2 v1.16b,v2.16b,v3.16b'
 [^:]*:58: Info:    did you mean this\?
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+[^:]*:58: Info:        sqdmlal2 v1.4s, v2.8h, v3.8h
 [^:]*:58: Info:    other valid variant\(s\):
-[^:]*:58: Info:        sqdmlal2 v1.2d,v2.4s,v3.4s
+[^:]*:58: Info:        sqdmlal2 v1.2d, v2.4s, v3.4s
index 01c8a04..0d900f8 100644 (file)
@@ -1,5 +1,49 @@
 2016-09-21  Richard Sandiford  <richard.sandiford@arm.com>
 
+       * testsuite/ld-aarch64/emit-relocs-28.d: Expect spaces after ","
+       in addresses.
+       * testsuite/ld-aarch64/emit-relocs-301-be.d: Likewise.
+       * testsuite/ld-aarch64/emit-relocs-301.d: Likewise.
+       * testsuite/ld-aarch64/emit-relocs-302-be.d: Likewise.
+       * testsuite/ld-aarch64/emit-relocs-302.d: Likewise.
+       * testsuite/ld-aarch64/emit-relocs-310-be.d: Likewise.
+       * testsuite/ld-aarch64/emit-relocs-310.d: Likewise.
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+       * testsuite/ld-aarch64/emit-relocs-515-be.d: Likewise.
+       * testsuite/ld-aarch64/emit-relocs-515.d: Likewise.
+       * testsuite/ld-aarch64/emit-relocs-516-be.d: Likewise.
+       * testsuite/ld-aarch64/emit-relocs-516.d: Likewise.
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+       * testsuite/ld-aarch64/emit-relocs-538.d: Likewise.
+       * testsuite/ld-aarch64/erratum835769.d: Likewise.
+       * testsuite/ld-aarch64/erratum843419.d: Likewise.
+       * testsuite/ld-aarch64/farcall-b-plt.d: Likewise.
+       * testsuite/ld-aarch64/farcall-bl-plt.d: Likewise.
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+       * testsuite/ld-aarch64/ifunc-21.d: Likewise.
+       * testsuite/ld-aarch64/ifunc-7c.d: Likewise.
+       * testsuite/ld-aarch64/tls-desc-ie.d: Likewise.
+       * testsuite/ld-aarch64/tls-large-desc-be.d: Likewise.
+       * testsuite/ld-aarch64/tls-large-desc.d: Likewise.
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+       * testsuite/ld-aarch64/tls-relax-all.d: Likewise.
+       * testsuite/ld-aarch64/tls-relax-gd-ie.d: Likewise.
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+       * testsuite/ld-aarch64/tls-relax-large-desc-ie.d: Likewise.
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+       * testsuite/ld-aarch64/tls-tiny-gd.d: Likewise.
+
+2016-09-21  Richard Sandiford  <richard.sandiford@arm.com>
+
        * testsuite/ld-aarch64/emit-relocs-280.d: Match branch comments.
        * testsuite/ld-aarch64/weak-undefined.d: Likewise.
 
index 24424b9..fd5c71c 100644 (file)
@@ -11,9 +11,9 @@ Disassembly of section .text:
 .* <\.text>:
   .*:  .*      adrp    x2, .* <.*>
                        .*: R_AARCH64_P32_ADR_PREL_PG_HI21      _GLOBAL_OFFSET_TABLE_
-  .*:  .*      ldr     x0, \[x2,#.*\]
+  .*:  .*      ldr     x0, \[x2, #.*\]
                        .*: R_AARCH64_P32_LD32_GOTPAGE_LO14     globala
-  .*:  .*      ldr     x0, \[x2,#.*\]
+  .*:  .*      ldr     x0, \[x2, #.*\]
                        .*: R_AARCH64_P32_LD32_GOTPAGE_LO14     globalb
-  .*:  .*      ldr     x0, \[x2,#.*\]
+  .*:  .*      ldr     x0, \[x2, #.*\]
                        .*: R_AARCH64_P32_LD32_GOTPAGE_LO14     globalc
index dbe2560..63f1045 100644 (file)
@@ -17,7 +17,7 @@ Disassembly of section .text:
                        10010: R_AARCH64_MOVW_GOTOFF_G0_NC      globalb
    10014:      f2800100        movk    x0, #0x8
                        10014: R_AARCH64_MOVW_GOTOFF_G0_NC      globalc
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+   10018:      f8606820        ldr     x0, \[x1, x0\]
    1001c:      00000000        \.word  0x00000000
                        1001c: R_AARCH64_PREL64 _GLOBAL_OFFSET_TABLE_
    10020:      0000ffe4        \.word  0x0000ffe4
index 9270c9e..9d6e31f 100644 (file)
@@ -17,7 +17,7 @@ Disassembly of section .text:
                        10010: R_AARCH64_MOVW_GOTOFF_G0_NC      globalb
    10014:      f2800100        movk    x0, #0x8
                        10014: R_AARCH64_MOVW_GOTOFF_G0_NC      globalc
-   10018:      f8606820        ldr     x0, \[x1,x0\]
+   10018:      f8606820        ldr     x0, \[x1, x0\]
    1001c:      0000ffe4        \.word  0x0000ffe4
                        1001c: R_AARCH64_PREL64 _GLOBAL_OFFSET_TABLE_
    10020:      00000000        \.word  0x00000000
index da8beef..3cdf9fe 100644 (file)
@@ -17,7 +17,7 @@ Disassembly of section .text:
                        10010: R_AARCH64_MOVW_GOTOFF_G1 globalb
    10014:      d2a00000        movz    x0, #0x0, lsl #16
                        10014: R_AARCH64_MOVW_GOTOFF_G1 globalc
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+   10018:      f8606820        ldr     x0, \[x1, x0\]
    1001c:      00000000        \.word  0x00000000
                        1001c: R_AARCH64_PREL64 _GLOBAL_OFFSET_TABLE_
    10020:      0000ffe4        \.word  0x0000ffe4
index 696b836..a36d25e 100644 (file)
@@ -17,7 +17,7 @@ Disassembly of section .text:
                        10010: R_AARCH64_MOVW_GOTOFF_G1 globalb
    10014:      d2a00000        movz    x0, #0x0, lsl #16
                        10014: R_AARCH64_MOVW_GOTOFF_G1 globalc
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+   10018:      f8606820        ldr     x0, \[x1, x0\]
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    10020:      00000000        \.word  0x00000000
index 7ef6fb6..7eec2ab 100644 (file)
@@ -11,11 +11,11 @@ Disassembly of section .text:
    10000:      580000c1        ldr     x1, 10018 <\.text\+0x18>
    10004:      100000a2        adr     x2, 10018 <\.text\+0x18>
    10008:      8b010041        add     x1, x2, x1
-   1000c:      f9400820        ldr     x0, \[x1,#16\]
+   1000c:      f9400820        ldr     x0, \[x1, #16\]
                        1000c: R_AARCH64_LD64_GOTOFF_LO15       globala
-   10010:      f9400c20        ldr     x0, \[x1,#24\]
+   10010:      f9400c20        ldr     x0, \[x1, #24\]
                        10010: R_AARCH64_LD64_GOTOFF_LO15       globalb
-   10014:      f9400420        ldr     x0, \[x1,#8\]
+   10014:      f9400420        ldr     x0, \[x1, #8\]
                        10014: R_AARCH64_LD64_GOTOFF_LO15       globalc
    10018:      00000000        .word   0x00000000
                        10018: R_AARCH64_PREL64 _GLOBAL_OFFSET_TABLE_
index 2f78ddd..f7af0a3 100644 (file)
@@ -11,11 +11,11 @@ Disassembly of section .text:
    10000:      580000c1        ldr     x1, 10018 <\.text\+0x18>
    10004:      100000a2        adr     x2, 10018 <\.text\+0x18>
    10008:      8b010041        add     x1, x2, x1
-   1000c:      f9400820        ldr     x0, \[x1,#16\]
+   1000c:      f9400820        ldr     x0, \[x1, #16\]
                        1000c: R_AARCH64_LD64_GOTOFF_LO15       globala
-   10010:      f9400c20        ldr     x0, \[x1,#24\]
+   10010:      f9400c20        ldr     x0, \[x1, #24\]
                        10010: R_AARCH64_LD64_GOTOFF_LO15       globalb
-   10014:      f9400420        ldr     x0, \[x1,#8\]
+   10014:      f9400420        ldr     x0, \[x1, #8\]
                        10014: R_AARCH64_LD64_GOTOFF_LO15       globalc
    10018:      0000ffe8        .word   0x0000ffe8
                        10018: R_AARCH64_PREL64 _GLOBAL_OFFSET_TABLE_
index 0a7b5d1..1a28b35 100644 (file)
@@ -10,9 +10,9 @@ Disassembly of section .text:
 0000000000010000 <\.text>:
    10000:      90000082        adrp    x2, 20000 <_GLOBAL_OFFSET_TABLE_>
                        10000: R_AARCH64_ADR_PREL_PG_HI21       _GLOBAL_OFFSET_TABLE_
-   10004:      f9400840        ldr     x0, \[x2,#16\]
+   10004:      f9400840        ldr     x0, \[x2, #16\]
                        10004: R_AARCH64_LD64_GOTPAGE_LO15      globala
-   10008:      f9400c40        ldr     x0, \[x2,#24\]
+   10008:      f9400c40        ldr     x0, \[x2, #24\]
                        10008: R_AARCH64_LD64_GOTPAGE_LO15      globalb
-   1000c:      f9400440        ldr     x0, \[x2,#8\]
+   1000c:      f9400440        ldr     x0, \[x2, #8\]
                        1000c: R_AARCH64_LD64_GOTPAGE_LO15      globalc
index 6e0039d..0bd39e3 100644 (file)
@@ -20,15 +20,15 @@ Disassembly of section .text:
 Disassembly of section .plt:
 
 0000000000010024 \<.plt\>:
-   10024:      a9bf7bf0        stp     x16, x30, \[sp,#-16\]!
+   10024:      a9bf7bf0        stp     x16, x30, \[sp, #-16\]!
    10028:      90000090        adrp    x16, 20000 \<_GLOBAL_OFFSET_TABLE_\>
-   1002c:      f9401611        ldr     x17, \[x16,#40\]
+   1002c:      f9401611        ldr     x17, \[x16, #40\]
    10030:      9100a210        add     x16, x16, #0x28
    10034:      d61f0220        br      x17
    10038:      d503201f        nop
    1003c:      d503201f        nop
    10040:      d503201f        nop
    10044:      90000090        adrp    x16, 20000 \<_GLOBAL_OFFSET_TABLE_\>
-   10048:      f9401a11        ldr     x17, \[x16,#48\]
+   10048:      f9401a11        ldr     x17, \[x16, #48\]
    1004c:      9100c210        add     x16, x16, #0x30
    10050:      d61f0220        br      x17
index a4e8a47..67f436b 100644 (file)
@@ -20,15 +20,15 @@ Disassembly of section .text:
 Disassembly of section .plt:
 
 0000000000010024 \<.plt\>:
-   10024:      a9bf7bf0        stp     x16, x30, \[sp,#-16\]!
+   10024:      a9bf7bf0        stp     x16, x30, \[sp, #-16\]!
    10028:      90000090        adrp    x16, 20000 \<_GLOBAL_OFFSET_TABLE_\>
-   1002c:      f9401611        ldr     x17, \[x16,#40\]
+   1002c:      f9401611        ldr     x17, \[x16, #40\]
    10030:      9100a210        add     x16, x16, #0x28
    10034:      d61f0220        br      x17
    10038:      d503201f        nop
    1003c:      d503201f        nop
    10040:      d503201f        nop
    10044:      90000090        adrp    x16, 20000 \<_GLOBAL_OFFSET_TABLE_\>
-   10048:      f9401a11        ldr     x17, \[x16,#48\]
+   10048:      f9401a11        ldr     x17, \[x16, #48\]
    1004c:      9100c210        add     x16, x16, #0x30
    10050:      d61f0220        br      x17
index 3a55762..e3b528d 100644 (file)
@@ -21,15 +21,15 @@ Disassembly of section .text:
 Disassembly of section .plt:
 
 0000000000010028 \<.plt\>:
-   10028:      a9bf7bf0        stp     x16, x30, \[sp,#-16\]!
+   10028:      a9bf7bf0        stp     x16, x30, \[sp, #-16\]!
    1002c:      90000090        adrp    x16, 20000 \<_GLOBAL_OFFSET_TABLE_\>
-   10030:      f9401e11        ldr     x17, \[x16,#56\]
+   10030:      f9401e11        ldr     x17, \[x16, #56\]
    10034:      9100e210        add     x16, x16, #0x38
    10038:      d61f0220        br      x17
    1003c:      d503201f        nop
    10040:      d503201f        nop
    10044:      d503201f        nop
    10048:      90000090        adrp    x16, 20000 \<_GLOBAL_OFFSET_TABLE_\>
-   1004c:      f9402211        ldr     x17, \[x16,#64\]
+   1004c:      f9402211        ldr     x17, \[x16, #64\]
    10050:      91010210        add     x16, x16, #0x40
    10054:      d61f0220        br      x17
index 09d2c7a..2ace032 100644 (file)
@@ -21,15 +21,15 @@ Disassembly of section .text:
 Disassembly of section .plt:
 
 0000000000010028 \<.plt\>:
-   10028:      a9bf7bf0        stp     x16, x30, \[sp,#-16\]!
+   10028:      a9bf7bf0        stp     x16, x30, \[sp, #-16\]!
    1002c:      90000090        adrp    x16, 20000 \<_GLOBAL_OFFSET_TABLE_\>
-   10030:      f9401e11        ldr     x17, \[x16,#56\]
+   10030:      f9401e11        ldr     x17, \[x16, #56\]
    10034:      9100e210        add     x16, x16, #0x38
    10038:      d61f0220        br      x17
    1003c:      d503201f        nop
    10040:      d503201f        nop
    10044:      d503201f        nop
    10048:      90000090        adrp    x16, 20000 \<_GLOBAL_OFFSET_TABLE_\>
-   1004c:      f9402211        ldr     x17, \[x16,#64\]
+   1004c:      f9402211        ldr     x17, \[x16, #64\]
    10050:      91010210        add     x16, x16, #0x40
    10054:      d61f0220        br      x17
index 588f127..20b78e9 100644 (file)
@@ -3,5 +3,5 @@
 #objdump: -dr
 #...
 0000000000010000 <.text>:
-   10000:      39801115        ldrsb   x21, \[x8,#4\]
+   10000:      39801115        ldrsb   x21, \[x8, #4\]
                        10000: R_AARCH64_TLSLD_LDST8_DTPREL_LO12        v2
index f5f49b8..318c926 100644 (file)
@@ -3,7 +3,7 @@
 #objdump: -dr
 #...
 0000000000010000 <.text>:
-   10000:      3980109d        ldrsb   x29, \[x4,#4\]
+   10000:      3980109d        ldrsb   x29, \[x4, #4\]
                        10000: R_AARCH64_TLSLD_LDST8_DTPREL_LO12_NC     v2
-   10004:      398020f2        ldrsb   x18, \[x7,#8\]
+   10004:      398020f2        ldrsb   x18, \[x7, #8\]
                        10004: R_AARCH64_TLSLD_LDST8_DTPREL_LO12_NC     v3
index 09b3d11..35f8cc1 100644 (file)
@@ -3,5 +3,5 @@
 #objdump: -dr
 #...
 0000000000010000 <.text>:
-   10000:      798008eb        ldrsh   x11, \[x7,#4\]
+   10000:      798008eb        ldrsh   x11, \[x7, #4\]
                        10000: R_AARCH64_TLSLD_LDST16_DTPREL_LO12       v2
index e2fa478..121fdc4 100644 (file)
@@ -3,7 +3,7 @@
 #objdump: -dr
 #...
 0000000000010000 <.text>:
-   10000:      798009d6        ldrsh   x22, \[x14,#4\]
+   10000:      798009d6        ldrsh   x22, \[x14, #4\]
                        10000: R_AARCH64_TLSLD_LDST16_DTPREL_LO12_NC    v2
-   10004:      79a71a28        ldrsh   x8, \[x17,#5004\]
+   10004:      79a71a28        ldrsh   x8, \[x17, #5004\]
                        10004: R_AARCH64_TLSLD_LDST16_DTPREL_LO12_NC    v3
index 32766bf..4dfc127 100644 (file)
@@ -3,5 +3,5 @@
 #objdump: -dr
 #...
 0000000000010000 <.text>:
-   10000:      b9800661        ldrsw   x1, \[x19,#4\]
+   10000:      b9800661        ldrsw   x1, \[x19, #4\]
                        10000: R_AARCH64_TLSLD_LDST32_DTPREL_LO12       v2
index 862208a..0a42fa1 100644 (file)
@@ -3,7 +3,7 @@
 #objdump: -dr
 #...
 0000000000010000 <.text>:
-   10000:      b98005d6        ldrsw   x22, \[x14,#4\]
+   10000:      b98005d6        ldrsw   x22, \[x14, #4\]
                        10000: R_AARCH64_TLSLD_LDST32_DTPREL_LO12_NC    v2
-   10004:      b9800628        ldrsw   x8, \[x17,#4\]
+   10004:      b9800628        ldrsw   x8, \[x17, #4\]
                        10004: R_AARCH64_TLSLD_LDST32_DTPREL_LO12_NC    v3
index 82cc9bb..9067a90 100644 (file)
@@ -3,5 +3,5 @@
 #objdump: -dr
 #...
 0000000000010000 <.text>:
-   10000:      f9400520        ldr     x0, \[x9,#8\]
+   10000:      f9400520        ldr     x0, \[x9, #8\]
                        10000: R_AARCH64_TLSLD_LDST64_DTPREL_LO12       v2
index dffde23..6824c0b 100644 (file)
@@ -3,7 +3,7 @@
 #objdump: -dr
 #...
 0000000000010000 <.text>:
-   10000:      f9400482        ldr     x2, \[x4,#8\]
+   10000:      f9400482        ldr     x2, \[x4, #8\]
                        10000: R_AARCH64_TLSLD_LDST64_DTPREL_LO12_NC    v2
-   10004:      f940062e        ldr     x14, \[x17,#8\]
+   10004:      f940062e        ldr     x14, \[x17, #8\]
                        10004: R_AARCH64_TLSLD_LDST64_DTPREL_LO12_NC    v3
index f3b0ed4..c1a71ad 100644 (file)
@@ -2,7 +2,7 @@
 Disassembly of section .text:
 #...
 [0-9a-f]+ <a1ldr>:
-[ \t0-9a-f]+:[ \t]+b8408c87[ \t]+ldr[ \t]+w7, \[x4,#8\]\!
+[ \t0-9a-f]+:[ \t]+b8408c87[ \t]+ldr[ \t]+w7, \[x4, #8\]\!
 [ \t0-9a-f]+:[ \t]+1b017c06[ \t]+mul[ \t]+w6, w0, w1
 [ \t0-9a-f]+:[ \t]+f9400084[ \t]+ldr[ \t]+x4, \[x4\]
 [ \t0-9a-f]+:[ \t0-9a-z]+[ \t]+b[ \t]+[0-9a-f]+ <__erratum_835769_veneer_0>
@@ -10,7 +10,7 @@ Disassembly of section .text:
 [ \t0-9a-f]+:[ \t]+d65f03c0[ \t]+ret
 
 [0-9a-f]+ <a5ldr>:
-[ \t0-9a-f]+:[ \t]+b8408c87[ \t]+ldr[ \t]+w7, \[x4,#8\]!
+[ \t0-9a-f]+:[ \t]+b8408c87[ \t]+ldr[ \t]+w7, \[x4, #8\]!
 [ \t0-9a-f]+:[ \t]+1b017c06[ \t]+mul[ \t]+w6, w0, w1
 [ \t0-9a-f]+:[ \t]+f9400084[ \t]+ldr[ \t]+x4, \[x4\]
 [ \t0-9a-f]+:[ \t0-9a-z]+[ \t]+b[ \t]+[0-9a-f]+ <__erratum_835769_veneer_1>
@@ -18,7 +18,7 @@ Disassembly of section .text:
 [ \t0-9a-f]+:[ \t]+d65f03c0[ \t]+ret
 
 [0-9a-f]+ <a6ldr>:
-[ \t0-9a-f]+:[ \t]+b8408c87[ \t]+ldr[ \t]+w7, \[x4,#8\]!
+[ \t0-9a-f]+:[ \t]+b8408c87[ \t]+ldr[ \t]+w7, \[x4, #8\]!
 [ \t0-9a-f]+:[ \t]+1b017c06[ \t]+mul[ \t]+w6, w0, w1
 [ \t0-9a-f]+:[ \t]+f9400084[ \t]+ldr[ \t]+x4, \[x4\]
 [ \t0-9a-f]+:[ \t]+9b031885[ \t]+madd[ \t]+x5, x4, x3, x6
@@ -26,7 +26,7 @@ Disassembly of section .text:
 [ \t0-9a-f]+:[ \t]+d65f03c0[ \t]+ret
 
 [0-9a-f]+ <a7str>:
-[ \t0-9a-f]+:[ \t]+b8408c87[ \t]+ldr[ \t]+w7, \[x4,#8\]!
+[ \t0-9a-f]+:[ \t]+b8408c87[ \t]+ldr[ \t]+w7, \[x4, #8\]!
 [ \t0-9a-f]+:[ \t]+1b017c06[ \t]+mul[ \t]+w6, w0, w1
 [ \t0-9a-f]+:[ \t]+f9000084[ \t]+str[ \t]+x4, \[x4\]
 [ \t0-9a-f]+:[ \t0-9a-z]+[ \t]+b[ \t]+[0-9a-f]+ <__erratum_835769_veneer_2>
index 4be8f9e..55a8a8c 100644 (file)
@@ -9,17 +9,17 @@ Disassembly of section .e843419:
 0000000020000000 <e843419>:
     20000000:  d10043ff        sub     sp, sp, #0x10
     20000004:  d28001a7        mov     x7, #0xd                        // #13
-    20000008:  b9000fe7        str     w7, \[sp,#12\]
+    20000008:  b9000fe7        str     w7, \[sp, #12\]
     2000000c:  140003fb        b       20000ff8 <e843419_1>
        ...
 
 0000000020000ff8 <e843419_1>:
     20000ff8:  90100000        adrp    x0, 40000000 <[_a-zA-z0-9]+>
-    20000ffc:  f800c007        stur    x7, \[x0,#12\]
+    20000ffc:  f800c007        stur    x7, \[x0, #12\]
     20001000:  d2800128        mov     x8, #0x9                        // #9
     20001004:  14000008        b       20001024 <e843419@0002_00000013_1004>
     20001008:  8b050020        add     x0, x1, x5
-    2000100c:  b9400fe7        ldr     w7, \[sp,#12\]
+    2000100c:  b9400fe7        ldr     w7, \[sp, #12\]
     20001010:  0b0700e0        add     w0, w7, w7
     20001014:  910043ff        add     sp, sp, #0x10
     20001018:  14000005        b       2000102c <__e835769_veneer>
@@ -39,7 +39,7 @@ Disassembly of section .e843419:
 Disassembly of section .e835769:
 
 0000000003000000 <e835769>:
- 3000000:      b8408c87        ldr     w7, \[x4,#8\]!
+ 3000000:      b8408c87        ldr     w7, \[x4, #8\]!
  3000004:      1b017c06        mul     w6, w0, w1
  3000008:      f9400084        ldr     x4, \[x4\]
  300000c:      14000004        b       300001c <__erratum_835769_veneer_0>
@@ -57,7 +57,7 @@ Disassembly of section .text:
 0000000000400000 <main>:
   400000:      d10043ff        sub     sp, sp, #0x10
   400004:      d28001a7        mov     x7, #0xd                        // #13
-  400008:      b9000fe7        str     w7, \[sp,#12\]
+  400008:      b9000fe7        str     w7, \[sp, #12\]
   40000c:      14000003        b       400018 <__e843419_veneer>
   400010:      d65f03c0        ret
   400014:      14000400        b       401014 <__e843419_veneer\+0xffc>
index 49c82eb..00469af 100644 (file)
@@ -8,9 +8,9 @@
 Disassembly of section .plt:
 
 .* <foo@plt.*>:
-.*:    a9bf7bf0        stp     x16, x30, \[sp,#-16\]!
+.*:    a9bf7bf0        stp     x16, x30, \[sp, #-16\]!
 .*:    .*      adrp    x16, .* <__foo_veneer\+.*>
-.*:    .*      ldr     x17, \[x16,#.*\]
+.*:    .*      ldr     x17, \[x16, #.*\]
 .*:    .*      add     x16, x16, #.*
 .*:    d61f0220        br      x17
 .*:    d503201f        nop
@@ -19,7 +19,7 @@ Disassembly of section .plt:
 
 .* <foo@plt>:
 .*:    .*      adrp    x16, .* <__foo_veneer\+.*>
-.*:    .*      ldr     x17, \[x16,#.*\]
+.*:    .*      ldr     x17, \[x16, #.*\]
 .*:    .*      add     x16, x16, #.*
 .*:    d61f0220        br      x17
 
index 457a4fa..28fcb8c 100644 (file)
@@ -8,9 +8,9 @@
 Disassembly of section .plt:
 
 .* <foo@plt.*>:
-.*:    a9bf7bf0        stp     x16, x30, \[sp,#-16\]!
+.*:    a9bf7bf0        stp     x16, x30, \[sp, #-16\]!
 .*:    .*      adrp    x16, .* <__foo_veneer\+.*>
-.*:    .*      ldr     x17, \[x16,#.*\]
+.*:    .*      ldr     x17, \[x16, #.*\]
 .*:    .*      add     x16, x16, #.*
 .*:    d61f0220        br      x17
 .*:    d503201f        nop
@@ -19,7 +19,7 @@ Disassembly of section .plt:
 
 .* <foo@plt>:
 .*:    .*      adrp    x16, .* <__foo_veneer\+.*>
-.*:    .*      ldr     x17, \[x16,#.*\]
+.*:    .*      ldr     x17, \[x16, #.*\]
 .*:    .*      add     x16, x16, #.*
 .*:    d61f0220        br      x17
 
index cb38c8d..086968c 100644 (file)
@@ -34,15 +34,15 @@ Disassembly of section .text:
 Disassembly of section .plt:
 
 0+8010 \<\.plt\>:
-    8010:      a9bf7bf0        stp     x16, x30, \[sp,#-16\]!
+    8010:      a9bf7bf0        stp     x16, x30, \[sp, #-16\]!
     8014:      b0000010        adrp    x16, 9000 .*
-    8018:      f9400e11        ldr     x17, \[x16,#24\]
+    8018:      f9400e11        ldr     x17, \[x16, #24\]
     801c:      91006210        add     x16, x16, #0x18
     8020:      d61f0220        br      x17
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     8030:      b0000010        adrp    x16, 9000 .*
-    8034:      f9401211        ldr     x17, \[x16,#32\]
+    8034:      f9401211        ldr     x17, \[x16, #32\]
     8038:      91008210        add     x16, x16, #0x20
     803c:      d61f0220        br      x17
index 9ea01e6..eef2e62 100644 (file)
@@ -20,7 +20,7 @@ Disassembly of section .text:
 
 .* <bar>:
  .*:   90000080        adrp    x0, 10000 <.*>
- .*:   .*      ldr     x0, \[x0,#(960|1040)\]
+ .*:   .*      ldr     x0, \[x0, #(960|1040)\]
  .*:   d65f03c0        ret
 
 #pass
\ No newline at end of file
index 1967742..e56322a 100644 (file)
@@ -16,4 +16,4 @@ Disassembly of section \.text:
 [0-9a-f]+ <__start>:
  [0-9a-f]+:    [0-9a-f]+       bl      [0-9a-f]+ <\*ABS\*\+0x[0-9a-f]+@plt>
  [0-9a-f]+:    [0-9a-f]+       adrp    x0, [0-9]+ <__start\+0x[0-9a-f]+>
- [0-9a-f]+:    [0-9a-f]+       ldr     x0, \[x0,.+\]
+ [0-9a-f]+:    [0-9a-f]+       ldr     x0, \[x0, .+\]
index 037da07..5b77872 100644 (file)
@@ -7,14 +7,14 @@
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 Disassembly of section .plt:
 
 0000000000010040 <.plt>:
- +10040:       a9bf7bf0        stp     x16, x30, \[sp,#-16\]!
+ +10040:       a9bf7bf0        stp     x16, x30, \[sp, #-16\]!
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+ +10048:       f9401a11        ldr     x17, \[x16, #48\]
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+ +10064:       f9401e11        ldr     x17, \[x16, #56\]
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index 2d72da6..217794c 100644 (file)
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@@ -21,18 +21,18 @@ Disassembly of section .text:
 Disassembly of section .plt:
 
 0000000000010028 <.plt>:
-  +10028:      a9bf7bf0        stp     x16, x30, \[sp,#-16\]!
+  +10028:      a9bf7bf0        stp     x16, x30, \[sp, #-16\]!
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+  +10030:      f9401211        ldr     x17, \[x16, #32\]
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+  +10048:      a9bf0fe2        stp     x2, x3, \[sp, #-16\]!
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+  +10054:      f9400442        ldr     x2, \[x2, #8\]
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index b8dcc02..9fa6dcc 100644 (file)
@@ -12,7 +12,7 @@ Disassembly of section .text:
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@@ -21,18 +21,18 @@ Disassembly of section .text:
 Disassembly of section .plt:
 
 0000000000010028 <.plt>:
-  +10028:      a9bf7bf0        stp     x16, x30, \[sp,#-16\]!
+  +10028:      a9bf7bf0        stp     x16, x30, \[sp, #-16\]!
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+  +10030:      f9401211        ldr     x17, \[x16, #32\]
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+  +10048:      a9bf0fe2        stp     x2, x3, \[sp, #-16\]!
   +1004c:      90000082        adrp    x2, 20000 \<_GLOBAL_OFFSET_TABLE_\>
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+  +10054:      f9400442        ldr     x2, \[x2, #8\]
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index 380718b..64a4384 100644 (file)
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index 13b77f3..98606d6 100644 (file)
@@ -13,7 +13,7 @@ Disassembly of section .text:
    1000c:      d53bd042        mrs     x2, tpidr_el0
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index b36b634..5942186 100644 (file)
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 #objdump: -dr
 #...
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+ +10000:       a9bf7bfd        stp     x29, x30, \[sp, #-16\]!
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@@ -20,7 +20,7 @@
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+ +10048:       f9400800        ldr     x0, \[x0, #16\]
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index d3783ac..f80bb90 100644 (file)
@@ -3,7 +3,7 @@
 #objdump: -dr
 #...
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index 92002de..2b8e346 100644 (file)
@@ -4,7 +4,7 @@
 #...
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index 634a55a..86277f8 100644 (file)
@@ -3,7 +3,7 @@
 #objdump: -dr
 #...
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index ea2e59b..8994b94 100644 (file)
@@ -12,7 +12,7 @@ Disassembly of section .text:
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index 680fc57..21ad5e5 100644 (file)
@@ -12,7 +12,7 @@ Disassembly of section .text:
   +10008:      8b020032        add     x18, x1, x2
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index fc75eee..7b88786 100644 (file)
@@ -13,18 +13,18 @@ Disassembly of section .text:
 Disassembly of section .plt:
 
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+ +1002c:       a9bf0fe2        stp     x2, x3, \[sp, #-16\]!
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index 5e77706..2f55f7b 100644 (file)
@@ -13,15 +13,15 @@ Disassembly of section .text:
 Disassembly of section .plt:
 
 000000000001000c \<.plt\>:
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- +10014:       f9401611        ldr     x17, \[x16,#40\]
+ +10014:       f9401611        ldr     x17, \[x16, #40\]
  +10018:       9100a210        add     x16, x16, #0x28
  +1001c:       d61f0220        br      x17
  +10020:       d503201f        nop
  +10024:       d503201f        nop
  +10028:       d503201f        nop
  +1002c:       90000090        adrp    x16, 20000 \<_GLOBAL_OFFSET_TABLE_\>
- +10030:       f9401a11        ldr     x17, \[x16,#48\]
+ +10030:       f9401a11        ldr     x17, \[x16, #48\]
  +10034:       9100c210        add     x16, x16, #0x30
  +10038:       d61f0220        br      x17
index 63271f2..c712058 100644 (file)
@@ -1,5 +1,11 @@
 2016-09-21  Richard Sandiford  <richard.sandiford@arm.com>
 
+       * aarch64-opc.c (print_immediate_offset_address): Print spaces
+       after commas in addresses.
+       (aarch64_print_operand): Likewise.
+
+2016-09-21  Richard Sandiford  <richard.sandiford@arm.com>
+
        * aarch64-opc.c (operand_general_constraint_met_p): Use "must be"
        rather than "should be" or "expected to be" in error messages.
 
index 0f0795b..adc34e2 100644 (file)
@@ -2864,20 +2864,20 @@ print_immediate_offset_address (char *buf, size_t size,
   if (opnd->addr.writeback)
     {
       if (opnd->addr.preind)
-       snprintf (buf, size, "[%s,#%d]!", base, opnd->addr.offset.imm);
+       snprintf (buf, size, "[%s, #%d]!", base, opnd->addr.offset.imm);
       else
-       snprintf (buf, size, "[%s],#%d", base, opnd->addr.offset.imm);
+       snprintf (buf, size, "[%s], #%d", base, opnd->addr.offset.imm);
     }
   else
     {
       if (opnd->shifter.operator_present)
        {
          assert (opnd->shifter.kind == AARCH64_MOD_MUL_VL);
-         snprintf (buf, size, "[%s,#%d,mul vl]",
+         snprintf (buf, size, "[%s, #%d, mul vl]",
                    base, opnd->addr.offset.imm);
        }
       else if (opnd->addr.offset.imm)
-       snprintf (buf, size, "[%s,#%d]", base, opnd->addr.offset.imm);
+       snprintf (buf, size, "[%s, #%d]", base, opnd->addr.offset.imm);
       else
        snprintf (buf, size, "[%s]", base);
     }
@@ -2912,15 +2912,15 @@ print_register_offset_address (char *buf, size_t size,
   if (print_extend_p)
     {
       if (print_amount_p)
-       snprintf (tb, sizeof (tb), ",%s #%" PRIi64, shift_name,
+       snprintf (tb, sizeof (tb), ", %s #%" PRIi64, shift_name,
                  opnd->shifter.amount);
       else
-       snprintf (tb, sizeof (tb), ",%s", shift_name);
+       snprintf (tb, sizeof (tb), ", %s", shift_name);
     }
   else
     tb[0] = '\0';
 
-  snprintf (buf, size, "[%s,%s%s]", base, offset, tb);
+  snprintf (buf, size, "[%s, %s%s]", base, offset, tb);
 }
 
 /* Generate the string representation of the operand OPNDS[IDX] for OPCODE
@@ -3433,7 +3433,7 @@ aarch64_print_operand (char *buf, size_t size, bfd_vma pc,
     case AARCH64_OPND_ADDR_UIMM12:
       name = get_64bit_int_reg_name (opnd->addr.base_regno, 1);
       if (opnd->addr.offset.imm)
-       snprintf (buf, size, "[%s,#%d]", name, opnd->addr.offset.imm);
+       snprintf (buf, size, "[%s, #%d]", name, opnd->addr.offset.imm);
       else
        snprintf (buf, size, "[%s]", name);
       break;