#include "drmP.h"
#include "drm.h"
#include "nouveau_drv.h"
+#include "nv50_grctx.h"
#define IS_G80 ((dev_priv->chipset & 0xf0) == 0x50)
NV_WRITE(NV04_PGRAPH_DEBUG_3, (1<<2) /* HW_CONTEXT_SWITCH_ENABLED */);
}
-static uint32_t nv50_ctx_voodoo[] = {
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-};
-
-static uint32_t nv84_ctx_voodoo[] = {
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-};
-
-static uint32_t nvaa_ctx_voodoo[] = {
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- 0x005000cb, 0x0048004d, ~0
-};
-
static int
nv50_graph_init_ctxctl(struct drm_device *dev)
{
switch (dev_priv->chipset) {
case 0x50:
- voodoo = nv50_ctx_voodoo;
+ voodoo = nv50_ctxprog;
break;
case 0x84:
- voodoo = nv84_ctx_voodoo;
+ voodoo = nv84_ctxprog;
break;
case 0x86:
- voodoo = nv86_ctx_voodoo;
+ voodoo = nv86_ctxprog;
break;
case 0x92:
- voodoo = nv92_ctx_voodoo;
+ voodoo = nv92_ctxprog;
break;
case 0xaa:
- voodoo = nvaa_ctx_voodoo;
+ voodoo = nvaa_ctxprog;
break;
default:
- DRM_ERROR("no voodoo for chipset NV%02x\n", dev_priv->chipset);
+ DRM_ERROR("no ctxprog for chipset NV%02x\n", dev_priv->chipset);
return -EINVAL;
}
DRM_DEBUG("\n");
}
-static void
-nv50_graph_init_ctxvals(struct drm_device *dev, struct nouveau_gpuobj_ref *ref)
-{
- struct drm_nouveau_private *dev_priv = dev->dev_private;
- struct nouveau_gpuobj *ctx = ref->gpuobj;
-
- INSTANCE_WR(ctx, 0x0010c/4, 0x00000030);
- INSTANCE_WR(ctx, 0x00120/4, 0xff400040);
- INSTANCE_WR(ctx, 0x00124/4, 0xfff00080);
- INSTANCE_WR(ctx, 0x00128/4, 0xfff70090);
- INSTANCE_WR(ctx, 0x0012c/4, 0xffe806a8);
- INSTANCE_WR(ctx, 0x001d4/4, 0x00000003);
- INSTANCE_WR(ctx, 0x001d8/4, 0x00001000);
- INSTANCE_WR(ctx, 0x00214/4, 0x0000fe0c);
- INSTANCE_WR(ctx, 0x00228/4, 0x00001000);
- INSTANCE_WR(ctx, 0x00254/4, 0x0001fd87);
- INSTANCE_WR(ctx, 0x00268/4, 0x00001018);
- INSTANCE_WR(ctx, 0x0026c/4, 0x000000ff);
- INSTANCE_WR(ctx, 0x002a4/4, 0x00000004);
- INSTANCE_WR(ctx, 0x002a8/4, 0x0001005f);
- INSTANCE_WR(ctx, 0x002b0/4, 0x00000600);
- INSTANCE_WR(ctx, 0x002b4/4, 0x00000006);
- INSTANCE_WR(ctx, 0x002c8/4, 0x000000ff);
- INSTANCE_WR(ctx, 0x002d0/4, 0x00000400);
- INSTANCE_WR(ctx, 0x002e4/4, 0x00000001);
- INSTANCE_WR(ctx, 0x002e8/4, 0x00300080);
- INSTANCE_WR(ctx, 0x002ec/4, 0x00000004);
- INSTANCE_WR(ctx, 0x00308/4, 0x00000002);
- INSTANCE_WR(ctx, 0x0030c/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00318/4, 0x00000001);
- INSTANCE_WR(ctx, 0x0031c/4, 0x00000100);
- INSTANCE_WR(ctx, 0x00334/4, 0x00000002);
- INSTANCE_WR(ctx, 0x00338/4, 0x00000001);
- INSTANCE_WR(ctx, 0x0033c/4, 0x00000001);
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- INSTANCE_WR(ctx, 0x00350/4, 0x003fffff);
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- INSTANCE_WR(ctx, 0x0035c/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00360/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00368/4, 0x00000004);
- INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00368/4, 0x00000007);
- INSTANCE_WR(ctx, 0x00388/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00388/4, 0x00000007);
- INSTANCE_WR(ctx, 0x00388/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00388/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00388/4, 0x00000001);
- INSTANCE_WR(ctx, 0x003ac/4, 0x00000001);
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- INSTANCE_WR(ctx, 0x00454/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00458/4, 0x00000100);
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- INSTANCE_WR(ctx, 0x004a8/4, 0x00000003);
- INSTANCE_WR(ctx, 0x004c4/4, 0x00000004);
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- INSTANCE_WR(ctx, 0x004f8/4, 0x00000001);
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- INSTANCE_WR(ctx, 0x004f8/4, 0x00000005);
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- INSTANCE_WR(ctx, 0x004f8/4, 0x00000001);
- INSTANCE_WR(ctx, 0x00558/4, 0x000000cf);
- INSTANCE_WR(ctx, 0x00584/4, 0x00000080);
- INSTANCE_WR(ctx, 0x00584/4, 0x00000004);
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-}
-
-static void
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-{
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-
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-}
-
-static void
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-
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-
-static void
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-
-static void
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-
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- INSTANCE_WR(ctx, 0x418a0/4, 0x000000c0);
- INSTANCE_WR(ctx, 0x418c0/4, 0x00001000);
- INSTANCE_WR(ctx, 0x41920/4, 0x00000e00);
- INSTANCE_WR(ctx, 0x41940/4, 0x00001e00);
- INSTANCE_WR(ctx, 0x41960/4, 0x00000001);
- INSTANCE_WR(ctx, 0x419c0/4, 0x00000001);
- INSTANCE_WR(ctx, 0x41a00/4, 0x00000004);
- INSTANCE_WR(ctx, 0x41a20/4, 0x00000002);
- INSTANCE_WR(ctx, 0x41ba0/4, 0x08100c12);
- INSTANCE_WR(ctx, 0x41be0/4, 0x0001fe21);
- INSTANCE_WR(ctx, 0x41ca0/4, 0x0000ffff);
- INSTANCE_WR(ctx, 0x41cc0/4, 0x0000ffff);
- INSTANCE_WR(ctx, 0x41ce0/4, 0x0000ffff);
- INSTANCE_WR(ctx, 0x41d00/4, 0x0000ffff);
- INSTANCE_WR(ctx, 0x41d20/4, 0x00000001);
- INSTANCE_WR(ctx, 0x41d40/4, 0x00010001);
- INSTANCE_WR(ctx, 0x41d60/4, 0x00010001);
- INSTANCE_WR(ctx, 0x41d80/4, 0x00000001);
- INSTANCE_WR(ctx, 0x41dc0/4, 0x0001fe21);
- INSTANCE_WR(ctx, 0x41e80/4, 0x08100c12);
- INSTANCE_WR(ctx, 0x41ea0/4, 0x00000004);
- INSTANCE_WR(ctx, 0x41ee0/4, 0x00000002);
- INSTANCE_WR(ctx, 0x41f00/4, 0x00000011);
- INSTANCE_WR(ctx, 0x42020/4, 0x0fac6881);
- INSTANCE_WR(ctx, 0x420c0/4, 0x00000004);
- INSTANCE_WR(ctx, 0x42200/4, 0x00000002);
- INSTANCE_WR(ctx, 0x42220/4, 0x00000001);
- INSTANCE_WR(ctx, 0x42240/4, 0x00000001);
- INSTANCE_WR(ctx, 0x42260/4, 0x00000002);
- INSTANCE_WR(ctx, 0x42280/4, 0x00000001);
- INSTANCE_WR(ctx, 0x422a0/4, 0x00000001);
- INSTANCE_WR(ctx, 0x422c0/4, 0x00000001);
- INSTANCE_WR(ctx, 0x42300/4, 0x00000004);
- INSTANCE_WR(ctx, 0x49700/4, 0x00000011);
- INSTANCE_WR(ctx, 0x49740/4, 0x00000001);
- INSTANCE_WR(ctx, 0x0012c/4, 0x00000002);
-}
-
int
nv50_graph_create_context(struct nouveau_channel *chan)
{
struct drm_device *dev = chan->dev;
struct drm_nouveau_private *dev_priv = dev->dev_private;
struct nouveau_gpuobj *ramin = chan->ramin->gpuobj;
+ struct nouveau_gpuobj *ctx;
struct nouveau_engine *engine = &dev_priv->Engine;
+ uint32_t *ctxvals = NULL;
int grctx_size = 0x70000, hdr;
int ret;
NVOBJ_FLAG_ZERO_FREE, &chan->ramin_grctx);
if (ret)
return ret;
+ ctx = chan->ramin_grctx->gpuobj;
hdr = IS_G80 ? 0x200 : 0x20;
INSTANCE_WR(ramin, (hdr + 0x00)/4, 0x00190002);
INSTANCE_WR(ramin, (hdr + 0x10)/4, 0);
INSTANCE_WR(ramin, (hdr + 0x14)/4, 0x00010000);
- INSTANCE_WR(chan->ramin_grctx->gpuobj, 0x00000/4,
- chan->ramin->instance >> 12);
- if (dev_priv->chipset == 0xaa)
- INSTANCE_WR(chan->ramin_grctx->gpuobj, 0x00004/4, 0x00000002);
- else
- INSTANCE_WR(chan->ramin_grctx->gpuobj, 0x0011c/4, 0x00000002);
-
switch (dev_priv->chipset) {
case 0x50:
- nv50_graph_init_ctxvals(dev, chan->ramin_grctx);
+ ctxvals = nv50_ctxvals;
break;
case 0x84:
- nv84_graph_init_ctxvals(dev, chan->ramin_grctx);
+ ctxvals = nv84_ctxvals;
break;
case 0x86:
- nv86_graph_init_ctxvals(dev, chan->ramin_grctx);
+ ctxvals = nv86_ctxvals;
break;
case 0x92:
- nv92_graph_init_ctxvals(dev, chan->ramin_grctx);
+ ctxvals = nv92_ctxvals;
break;
case 0xaa:
- nvaa_graph_init_ctxvals(dev, chan->ramin_grctx);
+ ctxvals = nvaa_ctxvals;
break;
default:
+ break;
+ }
+
+ if (ctxvals) {
+ int pos = 0;
+
+ while (*ctxvals) {
+ int cnt = *ctxvals++;
+
+ while (cnt--)
+ INSTANCE_WR(ctx, pos++, *ctxvals);
+ ctxvals++;
+ }
+ } else {
/* This is complete crack, it accidently used to make at
* least some G8x cards work partially somehow, though there's
* no good reason why - and it stopped working as the rest
DRM_ERROR("Error hacking up context: %d\n", ret);
return ret;
}
- break;
}
+ INSTANCE_WR(ctx, 0x00000/4, chan->ramin->instance >> 12);
+ if (dev_priv->chipset == 0xaa)
+ INSTANCE_WR(ctx, 0x00004/4, 0x00000002);
+ else
+ INSTANCE_WR(ctx, 0x0011c/4, 0x00000002);
+
return 0;
}
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