+2013-08-04 Jürgen Urban <JuergenUrban@gmx.de>
+ Richard Sandiford <rdsandiford@googlemail.com>
+
+ * config/tc-mips.c (MAX_OPERANDS): Bump to 6.
+ (RWARN): Bump to 0x8000000.
+ (RTYPE_VI, RTYPE_VF, RTYPE_R5900_I, RTYPE_R5900_Q, RTYPE_R5900_R)
+ (RTYPE_R5900_ACC): New register types.
+ (RTYPE_MASK): Include them.
+ (R5900_I_NAMES, R5900_Q_NAMES, R5900_R_NAMES, R5900_ACC_NAMES): New
+ macros.
+ (reg_names): Include them.
+ (mips_parse_register_1): New function, split out from...
+ (mips_parse_register): ...here. Add a channels_ptr parameter.
+ Look for VU0 channel suffixes when nonnull.
+ (reg_lookup): Update the call to mips_parse_register.
+ (mips_parse_vu0_channels): New function.
+ (OT_CHANNELS, OT_DOUBLE_CHAR): New mips_operand_token_types.
+ (mips_operand_token): Add a "channels" field to the union.
+ Extend the comment above "ch" to OT_DOUBLE_CHAR.
+ (mips_parse_base_start): Match -- and ++. Handle channel suffixes.
+ (mips_parse_argument_token): Handle channel suffixes here too.
+ (validate_mips_insn): Handle INSN2_VU0_CHANNEL_SUFFIX.
+ Ignore OP_VU0_MATCH_SUFFIX when calculating the used bits.
+ Handle '#' formats.
+ (md_begin): Register $vfN and $vfI registers.
+ (operand_reg_mask): Handle OP_VU0_SUFFIX and OP_VU0_MATCH_SUFFIX.
+ (convert_reg_type): Handle OP_REG_VI, OP_REG_VF, OP_REG_R5900_I,
+ OP_REG_R5900_Q, OP_REG_R5900_R and OP_REG_R5900_ACC.
+ (match_vu0_suffix_operand): New function.
+ (match_operand): Handle OP_VU0_SUFFIX and OP_VU0_MATCH_SUFFIX.
+ (macro): Use "+7" rather than "E" for LDQ2 and STQ2.
+ (mips_lookup_insn): New function.
+ (mips_ip): Use it. Allow "+K" operands to be elided at the end
+ of an instruction. Handle '#' sequences.
+
2013-08-03 Richard Sandiford <rdsandiford@googlemail.com>
* config/tc-mips.c (macro, mips16_macro): Create an array of operand
static struct mips_cl_insn history[1 + MAX_NOPS];
/* Arrays of operands for each instruction. */
-#define MAX_OPERANDS 5
+#define MAX_OPERANDS 6
struct mips_operand_array {
const struct mips_operand *operand[MAX_OPERANDS];
};
unsigned int num;
};
-#define RTYPE_MASK 0x1ff00
-#define RTYPE_NUM 0x00100
-#define RTYPE_FPU 0x00200
-#define RTYPE_FCC 0x00400
-#define RTYPE_VEC 0x00800
-#define RTYPE_GP 0x01000
-#define RTYPE_CP0 0x02000
-#define RTYPE_PC 0x04000
-#define RTYPE_ACC 0x08000
-#define RTYPE_CCC 0x10000
-#define RNUM_MASK 0x000ff
-#define RWARN 0x80000
+#define RNUM_MASK 0x00000ff
+#define RTYPE_MASK 0x0efff00
+#define RTYPE_NUM 0x0000100
+#define RTYPE_FPU 0x0000200
+#define RTYPE_FCC 0x0000400
+#define RTYPE_VEC 0x0000800
+#define RTYPE_GP 0x0001000
+#define RTYPE_CP0 0x0002000
+#define RTYPE_PC 0x0004000
+#define RTYPE_ACC 0x0008000
+#define RTYPE_CCC 0x0010000
+#define RTYPE_VI 0x0020000
+#define RTYPE_VF 0x0040000
+#define RTYPE_R5900_I 0x0080000
+#define RTYPE_R5900_Q 0x0100000
+#define RTYPE_R5900_R 0x0200000
+#define RTYPE_R5900_ACC 0x0400000
+#define RWARN 0x8000000
#define GENERIC_REGISTER_NUMBERS \
{"$0", RTYPE_NUM | 0}, \
{"$v30", RTYPE_VEC | 30}, \
{"$v31", RTYPE_VEC | 31}
+#define R5900_I_NAMES \
+ {"$I", RTYPE_R5900_I | 0}
+
+#define R5900_Q_NAMES \
+ {"$Q", RTYPE_R5900_Q | 0}
+
+#define R5900_R_NAMES \
+ {"$R", RTYPE_R5900_R | 0}
+
+#define R5900_ACC_NAMES \
+ {"$ACC", RTYPE_R5900_ACC | 0 }
+
#define MIPS_DSP_ACCUMULATOR_NAMES \
{"$ac0", RTYPE_ACC | 0}, \
{"$ac1", RTYPE_ACC | 1}, \
MIPS16_SPECIAL_REGISTER_NAMES,
MDMX_VECTOR_REGISTER_NAMES,
+ R5900_I_NAMES,
+ R5900_Q_NAMES,
+ R5900_R_NAMES,
+ R5900_ACC_NAMES,
MIPS_DSP_ACCUMULATOR_NAMES,
{0, 0}
};
return symval;
}
-/* Return true if the string at *SPTR is a valid register name. If so,
- move *SPTR past the register and store the register's symbol value
- in *SYMVAL. This symbol value includes the register number
- (RNUM_MASK) and register type (RTYPE_MASK). */
+/* Return true if string [S, E) is a valid register name, storing its
+ symbol value in *SYMVAL_PTR if so. */
static bfd_boolean
-mips_parse_register (char **sptr, unsigned int *symval)
+mips_parse_register_1 (char *s, char *e, unsigned int *symval_ptr)
{
- symbolS *symbol;
- char *s, *e;
char save_c;
-
- /* Find end of name. */
- s = e = *sptr;
- if (is_name_beginner (*e))
- ++e;
- while (is_part_of_name (*e))
- ++e;
+ symbolS *symbol;
/* Terminate name. */
save_c = *e;
if (!symbol || S_GET_SEGMENT (symbol) != reg_section)
return FALSE;
+ *symval_ptr = S_GET_VALUE (symbol);
+ return TRUE;
+}
+
+/* Return true if the string at *SPTR is a valid register name. Allow it
+ to have a VU0-style channel suffix of the form x?y?z?w? if CHANNELS_PTR
+ is nonnull.
+
+ When returning true, move *SPTR past the register, store the
+ register's symbol value in *SYMVAL_PTR and the channel mask in
+ *CHANNELS_PTR (if nonnull). The symbol value includes the register
+ number (RNUM_MASK) and register type (RTYPE_MASK). The channel mask
+ is a 4-bit value of the form XYZW and is 0 if no suffix was given. */
+
+static bfd_boolean
+mips_parse_register (char **sptr, unsigned int *symval_ptr,
+ unsigned int *channels_ptr)
+{
+ char *s, *e, *m;
+ const char *q;
+ unsigned int channels, symval, bit;
+
+ /* Find end of name. */
+ s = e = *sptr;
+ if (is_name_beginner (*e))
+ ++e;
+ while (is_part_of_name (*e))
+ ++e;
+
+ channels = 0;
+ if (!mips_parse_register_1 (s, e, &symval))
+ {
+ if (!channels_ptr)
+ return FALSE;
+
+ /* Eat characters from the end of the string that are valid
+ channel suffixes. The preceding register must be $ACC or
+ end with a digit, so there is no ambiguity. */
+ bit = 1;
+ m = e;
+ for (q = "wzyx"; *q; q++, bit <<= 1)
+ if (m > s && m[-1] == *q)
+ {
+ --m;
+ channels |= bit;
+ }
+
+ if (channels == 0
+ || !mips_parse_register_1 (s, m, &symval)
+ || (symval & (RTYPE_VI | RTYPE_VF | RTYPE_R5900_ACC)) == 0)
+ return FALSE;
+ }
+
*sptr = e;
- *symval = S_GET_VALUE (symbol);
+ *symval_ptr = symval;
+ if (channels_ptr)
+ *channels_ptr = channels;
return TRUE;
}
{
unsigned int regno;
- if (mips_parse_register (s, ®no))
+ if (mips_parse_register (s, ®no, NULL))
{
if (types & RTYPE_VEC)
regno = mips_prefer_vec_regno (regno);
return regno <= RNUM_MASK;
}
+/* Parse a VU0 "x?y?z?w?" channel mask at S and store the associated
+ mask in *CHANNELS. Return a pointer to the first unconsumed character. */
+
+static char *
+mips_parse_vu0_channels (char *s, unsigned int *channels)
+{
+ unsigned int i;
+
+ *channels = 0;
+ for (i = 0; i < 4; i++)
+ if (*s == "xyzw"[i])
+ {
+ *channels |= 1 << (3 - i);
+ ++s;
+ }
+ return s;
+}
+
/* Token types for parsed operand lists. */
enum mips_operand_token_type {
/* A plain register, e.g. $f2. */
OT_REG,
+ /* A 4-bit XYZW channel mask. */
+ OT_CHANNELS,
+
/* An element of a vector, e.g. $v0[1]. */
OT_REG_ELEMENT,
before OT_REGs. */
OT_CHAR,
+ /* A doubled character, either "--" or "++". */
+ OT_DOUBLE_CHAR,
+
/* The end of the operand list. */
OT_END
};
/* The register symbol value for an OT_REG. */
unsigned int regno;
+ /* The 4-bit channel mask for an OT_CHANNEL_SUFFIX. */
+ unsigned int channels;
+
/* The register symbol value and index for an OT_REG_ELEMENT. */
struct {
unsigned int regno;
int length;
} flt;
- /* The character represented by an OT_CHAR. */
+ /* The character represented by an OT_CHAR or OT_DOUBLE_CHAR. */
char ch;
} u;
};
mips_parse_base_start (char *s)
{
struct mips_operand_token token;
- unsigned int regno;
+ unsigned int regno, channels;
+ bfd_boolean decrement_p;
if (*s != '(')
return 0;
++s;
SKIP_SPACE_TABS (s);
- if (!mips_parse_register (&s, ®no))
+
+ /* Only match "--" as part of a base expression. In other contexts "--X"
+ is a double negative. */
+ decrement_p = (s[0] == '-' && s[1] == '-');
+ if (decrement_p)
+ {
+ s += 2;
+ SKIP_SPACE_TABS (s);
+ }
+
+ /* Allow a channel specifier because that leads to better error messages
+ than treating something like "$vf0x++" as an expression. */
+ if (!mips_parse_register (&s, ®no, &channels))
return 0;
token.u.ch = '(';
mips_add_token (&token, OT_CHAR);
+ if (decrement_p)
+ {
+ token.u.ch = '-';
+ mips_add_token (&token, OT_DOUBLE_CHAR);
+ }
+
token.u.regno = regno;
mips_add_token (&token, OT_REG);
+ if (channels)
+ {
+ token.u.channels = channels;
+ mips_add_token (&token, OT_CHANNELS);
+ }
+
+ /* For consistency, only match "++" as part of base expressions too. */
+ SKIP_SPACE_TABS (s);
+ if (s[0] == '+' && s[1] == '+')
+ {
+ s += 2;
+ token.u.ch = '+';
+ mips_add_token (&token, OT_DOUBLE_CHAR);
+ }
+
return s;
}
mips_parse_argument_token (char *s, char float_format)
{
char *end, *save_in, *err;
- unsigned int regno1, regno2;
+ unsigned int regno1, regno2, channels;
struct mips_operand_token token;
/* First look for "($reg", since we want to treat that as an
}
/* Handle tokens that start with a register. */
- if (mips_parse_register (&s, ®no1))
+ if (mips_parse_register (&s, ®no1, &channels))
{
+ if (channels)
+ {
+ /* A register and a VU0 channel suffix. */
+ token.u.regno = regno1;
+ mips_add_token (&token, OT_REG);
+
+ token.u.channels = channels;
+ mips_add_token (&token, OT_CHANNELS);
+ return s;
+ }
+
SKIP_SPACE_TABS (s);
if (*s == '-')
{
/* A register range. */
++s;
SKIP_SPACE_TABS (s);
- if (!mips_parse_register (&s, ®no2))
+ if (!mips_parse_register (&s, ®no2, NULL))
{
insn_error = _("Invalid register range");
return 0;
}
used_bits = 0;
opno = 0;
+ if (opcode->pinfo2 & INSN2_VU0_CHANNEL_SUFFIX)
+ used_bits = mips_insert_operand (&mips_vu0_channel_mask, used_bits, -1);
for (s = opcode->args; *s; ++s)
switch (*s)
{
case ')':
break;
+ case '#':
+ s++;
+ break;
+
default:
if (!decode_operand)
operand = decode_mips16_operand (*s, FALSE);
}
gas_assert (opno < MAX_OPERANDS);
operands->operand[opno] = operand;
- if (operand)
+ if (operand && operand->type != OP_VU0_MATCH_SUFFIX)
{
- used_bits |= ((1 << operand->size) - 1) << operand->lsb;
+ used_bits = mips_insert_operand (operand, used_bits, -1);
if (operand->type == OP_MDMX_IMM_REG)
/* Bit 5 is the format selector (OB vs QH). The opcode table
has separate entries for each format. */
reg_names_o32[i].num, /* & RNUM_MASK, */
&zero_address_frag));
+ for (i = 0; i < 32; i++)
+ {
+ char regname[7];
+
+ /* R5900 VU0 floating-point register. */
+ regname[sizeof (rename) - 1] = 0;
+ snprintf (regname, sizeof (regname) - 1, "$vf%d", i);
+ symbol_table_insert (symbol_new (regname, reg_section,
+ RTYPE_VF | i, &zero_address_frag));
+
+ /* R5900 VU0 integer register. */
+ snprintf (regname, sizeof (regname) - 1, "$vi%d", i);
+ symbol_table_insert (symbol_new (regname, reg_section,
+ RTYPE_VI | i, &zero_address_frag));
+
+ }
+
obstack_init (&mips_operand_tokens);
mips_no_prev_insn ();
case OP_REPEAT_DEST_REG:
case OP_REPEAT_PREV_REG:
case OP_PC:
+ case OP_VU0_SUFFIX:
+ case OP_VU0_MATCH_SUFFIX:
abort ();
case OP_REG:
case OP_REG_HW:
return RTYPE_NUM;
+
+ case OP_REG_VI:
+ return RTYPE_NUM | RTYPE_VI;
+
+ case OP_REG_VF:
+ return RTYPE_NUM | RTYPE_VF;
+
+ case OP_REG_R5900_I:
+ return RTYPE_R5900_I;
+
+ case OP_REG_R5900_Q:
+ return RTYPE_R5900_Q;
+
+ case OP_REG_R5900_R:
+ return RTYPE_R5900_R;
+
+ case OP_REG_R5900_ACC:
+ return RTYPE_R5900_ACC;
}
abort ();
}
return TRUE;
}
+/* OP_VU0_SUFFIX and OP_VU0_MATCH_SUFFIX matcher; MATCH_P selects between
+ them. */
+
+static bfd_boolean
+match_vu0_suffix_operand (struct mips_arg_info *arg,
+ const struct mips_operand *operand,
+ bfd_boolean match_p)
+{
+ unsigned int uval;
+
+ /* The operand can be an XYZW mask or a single 2-bit channel index
+ (with X being 0). */
+ gas_assert (operand->size == 2 || operand->size == 4);
+
+ /* The suffix can be omitted when matching a previous 4-bit mask. */
+ if (arg->token->type != OT_CHANNELS)
+ return operand->size == 4 && match_p;
+
+ uval = arg->token->u.channels;
+ if (operand->size == 2)
+ {
+ /* Check that a single bit is set and convert it into a 2-bit index. */
+ if ((uval & -uval) != uval)
+ return FALSE;
+ uval = 4 - ffs (uval);
+ }
+
+ if (match_p && insn_extract_operand (arg->insn, operand) != uval)
+ return FALSE;
+
+ ++arg->token;
+ if (!match_p)
+ insn_insert_operand (arg->insn, operand, uval);
+ return TRUE;
+}
+
/* S is the text seen for ARG. Match it against OPERAND. Return the end
of the argument text if the match is successful, otherwise return null. */
case OP_PC:
return match_pc_operand (arg);
+
+ case OP_VU0_SUFFIX:
+ return match_vu0_suffix_operand (arg, operand, FALSE);
+
+ case OP_VU0_MATCH_SUFFIX:
+ return match_vu0_suffix_operand (arg, operand, TRUE);
}
abort ();
}
goto ld_st;
case M_LQC2_AB:
s = "lqc2";
- fmt = "E,o(b)";
+ fmt = "+7,o(b)";
/* Itbl support may require additional care here. */
coproc = 1;
goto ld_st;
goto ld_st;
case M_SQC2_AB:
s = "sqc2";
- fmt = "E,o(b)";
+ fmt = "+7,o(b)";
/* Itbl support may require additional care here. */
coproc = 1;
goto ld_st;
}
}
+/* Look up instruction [START, START + LENGTH) in HASH. Record any extra
+ opcode bits in *OPCODE_EXTRA. */
+
+static struct mips_opcode *
+mips_lookup_insn (struct hash_control *hash, const char *start,
+ unsigned int length, unsigned int *opcode_extra)
+{
+ char *name, *dot, *p;
+ unsigned int mask, suffix;
+ size_t opend;
+ struct mips_opcode *insn;
+
+ /* Make a copy of the instruction so that we can fiddle with it. */
+ name = alloca (length + 1);
+ memcpy (name, start, length);
+ name[length] = '\0';
+
+ /* Look up the instruction as-is. */
+ insn = (struct mips_opcode *) hash_find (hash, name);
+ if (insn && (insn->pinfo2 & INSN2_VU0_CHANNEL_SUFFIX) == 0)
+ return insn;
+
+ dot = strchr (name, '.');
+ if (dot && dot[1])
+ {
+ /* Try to interpret the text after the dot as a VU0 channel suffix. */
+ p = mips_parse_vu0_channels (dot + 1, &mask);
+ if (*p == 0 && mask != 0)
+ {
+ *dot = 0;
+ insn = (struct mips_opcode *) hash_find (hash, name);
+ *dot = '.';
+ if (insn && (insn->pinfo2 & INSN2_VU0_CHANNEL_SUFFIX) != 0)
+ {
+ *opcode_extra |= mask << mips_vu0_channel_mask.lsb;
+ return insn;
+ }
+ }
+ }
+
+ if (mips_opts.micromips)
+ {
+ /* See if there's an instruction size override suffix,
+ either `16' or `32', at the end of the mnemonic proper,
+ that defines the operation, i.e. before the first `.'
+ character if any. Strip it and retry. */
+ opend = dot != NULL ? dot - name : length;
+ if (opend >= 3 && name[opend - 2] == '1' && name[opend - 1] == '6')
+ suffix = 2;
+ else if (name[opend - 2] == '3' && name[opend - 1] == '2')
+ suffix = 4;
+ else
+ suffix = 0;
+ if (suffix)
+ {
+ memcpy (name + opend - 2, name + opend, length - opend + 1);
+ insn = (struct mips_opcode *) hash_find (hash, name);
+ if (insn && (insn->pinfo2 & INSN2_VU0_CHANNEL_SUFFIX) == 0)
+ {
+ forced_insn_length = suffix;
+ return insn;
+ }
+ }
+ }
+
+ return NULL;
+}
+
/* Assemble an instruction into its binary format. If the instruction
is a macro, set imm_expr, imm2_expr and offset_expr to the values
associated with "I", "+I" and "A" operands respectively. Otherwise
struct hash_control *hash;
const char *args;
char c = 0;
- struct mips_opcode *insn;
- long opend;
- char *name;
- char *dot;
+ struct mips_opcode *first, *insn;
char format;
- long end;
+ size_t end;
const struct mips_operand *operand;
struct mips_arg_info arg;
struct mips_operand_token *tokens;
bfd_boolean optional_reg;
+ unsigned int opcode_extra;
insn_error = NULL;
}
forced_insn_length = 0;
insn = NULL;
+ opcode_extra = 0;
/* We first try to match an instruction up to a space or to the end. */
for (end = 0; str[end] != '\0' && !ISSPACE (str[end]); end++)
continue;
- /* Make a copy of the instruction so that we can fiddle with it. */
- name = alloca (end + 1);
- memcpy (name, str, end);
- name[end] = '\0';
-
- for (;;)
- {
- insn = (struct mips_opcode *) hash_find (hash, name);
-
- if (insn != NULL || !mips_opts.micromips)
- break;
- if (forced_insn_length)
- break;
-
- /* See if there's an instruction size override suffix,
- either `16' or `32', at the end of the mnemonic proper,
- that defines the operation, i.e. before the first `.'
- character if any. Strip it and retry. */
- dot = strchr (name, '.');
- opend = dot != NULL ? dot - name : end;
- if (opend < 3)
- break;
- if (name[opend - 2] == '1' && name[opend - 1] == '6')
- forced_insn_length = 2;
- else if (name[opend - 2] == '3' && name[opend - 1] == '2')
- forced_insn_length = 4;
- else
- break;
- memcpy (name + opend - 2, name + opend, end - opend + 1);
- }
+ first = insn = mips_lookup_insn (hash, str, end, &opcode_extra);
if (insn == NULL)
{
insn_error = _("Unrecognized opcode");
return;
}
- if (strcmp (name, "li.s") == 0)
+ if (strcmp (insn->name, "li.s") == 0)
format = 'f';
- else if (strcmp (name, "li.d") == 0)
+ else if (strcmp (insn->name, "li.d") == 0)
format = 'd';
else
format = 0;
bfd_boolean ok;
bfd_boolean more_alts;
- gas_assert (strcmp (insn->name, name) == 0);
+ gas_assert (strcmp (insn->name, first->name) == 0);
ok = is_opcode_valid (insn);
size_ok = is_size_valid (insn);
offset_reloc[2] = BFD_RELOC_UNUSED;
create_insn (ip, insn);
+ ip->insn_opcode |= opcode_extra;
insn_error = NULL;
memset (&arg, 0, sizeof (arg));
arg.insn = ip;
if (strcmp (args, "(b)") == 0)
args += 3;
+ if (args[0] == '+' && args[1] == 'K')
+ args += 2;
+
/* Fail the match if there were too few operands. */
if (*args)
break;
continue;
break;
}
+ if (*args == '#')
+ {
+ ++args;
+ if (arg.token->type == OT_DOUBLE_CHAR
+ && arg.token->u.ch == *args)
+ {
+ ++arg.token;
+ continue;
+ }
+ break;
+ }
/* Handle special macro operands. Work out the properties of
other operands. */
+2013-08-04 Jürgen Urban <JuergenUrban@gmx.de>
+
+ * gas/mips/r5900-vu0.d: Expect $vfN and $viN instead of numeric
+ coprocessor registers.
+ * gas/mips/r5900-all-vu0.s, gas/mips/r5900-all-vu0.d,
+ gas/mips/r5900-full-vu0.s, gas/mips/r5900-full-vu0.d,
+ gas/mips/r5900-error-vu0.s, gas/mips/r5900-error-vu0.l: New tests.
+ * gas/mips/mips.exp: Run them.
+
2013-08-03 Richard Sandiford <rdsandiford@googlemail.com>
* gas/mips/mips16-macro.s, gas/mips/mips16-macro.d: New test.
run_dump_test "r5900-full"
run_list_test "r5900-nollsc" "-mabi=o64 -march=r5900"
run_dump_test "r5900-vu0"
+ run_dump_test "r5900-full-vu0"
+ run_dump_test "r5900-all-vu0"
+ run_list_test "r5900-error-vu0" "-march=r5900"
run_list_test_arches "ext-ill" [mips_arch_list_matching mips64r2]
--- /dev/null
+#objdump: -dr --prefix-addresses --show-raw-insn -M gpr-names=numeric -mmips:5900
+#name: MIPS R5900 All VU0
+#as: -march=r5900
+
+.*: +file format .*mips.*
+
+Disassembly of section \.text:
+[0-9a-f]+ <[^>]*> 4a2001fd vabs\.w \$vf0w,\$vf0w
+[0-9a-f]+ <[^>]*> 4a20f9fd vabs\.w \$vf0w,\$vf31w
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+ vmaddy.xw $vf1xw, $vf2xw, $vf3y
+ vmaddy.xw $vf31xw, $vf0xw, $vf0y
+ vmaddy.xw $vf31xw, $vf15xw, $vf7y
+ vmaddy.xw $vf31xw, $vf31xw, $vf31y
+ vmaddy.xy $vf0xy, $vf0xy, $vf0y
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+ vmaddy.xy $vf0xy, $vf31xy, $vf0y
+ vmaddy.xy $vf1xy, $vf2xy, $vf3y
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+ vmaddy.xy $vf31xy, $vf31xy, $vf31y
+ vmaddy.xyw $vf0xyw, $vf0xyw, $vf0y
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+.*: Error: Illegal operands `vsubaq\.yw \$ACCyw,\$vf31y,\$Q'
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+.*: Error: Illegal operands `vsubaq\.yz \$ACCyz,\$vf1yz,\$I'
+.*: Error: Illegal operands `vsubax\.w \$ACCw,\$vf0w,\$vf0w'
+.*: Error: Illegal operands `vsubax\.w \$ACCw,\$vf0x,\$vf31x'
+.*: Error: Illegal operands `vsubax\.w \$ACCx,\$vf1w,\$vf2x'
+.*: Error: Illegal operands `vsubax\.w \$ACCx,\$vf31x,\$vf0x'
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+.*: Error: Illegal operands `vsubax\.xzw \$ACCxzw,\$vf1xzw,\$vf2xzw'
+.*: Error: Illegal operands `vsubax\.y \$ACCy,\$vf1y,\$vf2'
+.*: Error: Illegal operands `vsubax\.y \$ACCy,\$vf31y,\$vf0y'
+.*: Error: Illegal operands `vsubax\.yw \$ACCyw,\$vf0yw,\$vf0yw'
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+.*: Error: Illegal operands `vsubay\.z \$ACCz,\$vf0z,\$vf31z'
+.*: Error: Illegal operands `vsubay\.zw \$ACCzw,\$vf0zw,\$vf0zw'
+.*: Error: Illegal operands `vsubaz\.w \$ACCw,\$vf31w,\$vf15w'
+.*: Error: Illegal operands `vsubaz\.x \$ACCx,\$vf0x,\$vf31x'
+.*: Error: Illegal operands `vsubaz\.xy \$ACCxy,\$vf0xy,\$vf0xy'
+.*: Error: Illegal operands `vsubaz\.xz \$ACCxz,\$vf31xz,\$vf15xz'
+.*: Error: Illegal operands `vsubaz\.xz \$ACCxz,\$vf31z,\$vf31z'
+.*: Error: Illegal operands `vsubaz\.xzw \$ACCxw,\$vf0xzw,\$vf0z'
+.*: Error: Illegal operands `vsubaz\.xzw \$ACCz,\$vf0xzw,\$vf31z'
+.*: Error: Illegal operands `vsubaz\.xzw \$ACCxzw,\$vf1z,\$vf2z'
+.*: Error: Illegal operands `vsubaz\.yw \$ACCyw,\$vf1yw,\$vf2yw'
+.*: Error: Illegal operands `vsubi\.w \$vf31w,\$vf15w,\$0'
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+.*: Error: Illegal operands `vsubi\.x \$vf0x,\$vf0y,\$I'
+.*: Error: Illegal operands `vsubi\.x \$vf0x,\$vf31x,\$Ix'
+.*: Error: Illegal operands `vsubi\.xy \$vf0xy,\$vf31y,\$I'
+.*: Error: Illegal operands `vsubi\.xy \$vf1x,\$vf2xy,\$I'
+.*: Error: Illegal operands `vsubq\.x \$vf31x,\$vf15x,\$Qx'
+.*: Error: Illegal operands `vsubq\.x \$vf31x,\$vf31y,\$Q'
+.*: Error: Illegal operands `vsubq\.xw \$vf0xw,\$vf0xw,\$0'
+.*: Error: Illegal operands `vsubq\.xw \$vf0xw,\$vf31xw,\$2'
+.*: Error: Illegal operands `vsubq\.xyzw \$vf1yzw,\$vf2xyzw,\$Q'
+.*: Error: Illegal operands `vsubq\.yw \$vf31w,\$vf15yw,\$Q'
+.*: Error: Illegal operands `vsubq\.yw \$vf31yw,\$vf31y,\$Q'
+.*: Error: Illegal operands `vsubx\.xyw \$vf0xyw,\$vf31xyw,\$vf0xyw'
+.*: Error: Illegal operands `vsubx\.xzw \$vf1xzw,\$vf2xzw,\$vf3xzw'
+.*: Error: Illegal operands `vsuby\.xw \$vf0xw,\$vf0xw,\$vf0xw'
+.*: Error: Illegal operands `vsuby\.zw \$vf0zw,\$vf0zw,\$vf0zw'
+.*: Error: Illegal operands `vsub\.z \$vf0z,\$vf31z,\$vf0x'
+.*: Error: Illegal operands `vsubz\.xyw \$vf31yw,\$vf15xyw,\$vf7z'
+.*: Error: Illegal operands `vsubz\.xyw \$vf31xyw,\$vf31yw,\$vf31z'
+.*: Error: Illegal operands `vsubz\.xyz \$vf0xyz,\$vf0xyz,\$vf0x'
+.*: Error: Illegal operands `vwaitq \$vf0x'
--- /dev/null
+ .set noreorder
+ .set noat
+
+ .globl text_label .text
+text_label:
+ # All instructions have at least one error in suffix or in register
+ # usage. All errors should be detected by the assembler.
+ vabs.w $vf0w, $vf0z
+ vabs.w $vf0z, $vf31w
+ vabs.xw $vf0xw, $vf0w
+ vabs.xw $vf0x, $vf31xw
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+ vaddai.w $ACCw, $vf0w, $Q
+ vaddai.w $ACCz, $vf0w, $Q
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+ vaddaq.z $ACCxz, $vf0xz, $Q
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+ vaddaq.xzw $ACCxw, $vf0xzw, $Q
+ vaddaq.y $ACCy, $vf0y, $R
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+ vaddaq.yw $ACCyw, $vf31wy, $Q
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+ vaddaq.yzw $ACCyzw, $vf31yzw, $Qyzw
+ vadda.w $ACCw, $vf1w, $vf2z
+ vadda.w $ACCw, $vf31w, $vf0x
+ vaddaw.xyzw $ACCxyzw, $vf0xyzw, $vf0x
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+ vaddaw.xz $ACCxyz, $vf0xz, $vf0w
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+ vaddaw.xz $ACCxz, $vf1xyz, $vf2w
+ vaddaw.xz $ACCxz, $vf31xzw, $vf0w
+ vaddaw.xz $ACCxz, $vf31z, $vf15w
+ vaddaw.xzw $ACCxyzw, $vf0xzw, $vf0w
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+ vaddaw.xzw $ACCxzw, $vf1xzw, $vf2z
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+ vaddaw.y $ACCy, $vf0y, $vf0z
+ vaddax.w $ACCw, $vf0w, $vf31z
+ vaddax.w $ACC, $vf1, $vf2z
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+ vadda.xw $ACCxw, $vf0xw, $vf31wx
+ vaddax.x $ACCw, $vf0x, $vf0x
+ vaddax.x $ACCx, $vf0x, $vf31w
+ vaddax.x $ACCx, $vf1x, $vf2y
+ vaddax.x $ACCx, $vf31x, $vf0z
+ vaddax.xw $ACCxw, $vf0xw, $vf0y
+ vaddax.xw $ACCxw, $vf0xw, $vf31z
+ vaddax.xw $ACCxw, $vf1xw, $vf2w
+ vaddax.xw $ACCxw, $vf31wx, $vf0
+ vaddax.xyzw $ACC, $vf1, $vf2y
+ vaddax.xyzw $ACC, $vf31, $vf0z
+ vadda.zw $ACCzw, $vf0zw, $vf0wz
+ vadda.zw $ACCzw, $vf0w, $vf31zw
+ vadda.zw $ACCw, $vf1zw, $vf2zw
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+ vaddaz.x $ACCx, $vf0x, $vf0x
+ vaddaz.x $ACCx, $vf0x, $vf31y
+ vaddaz.xw $ACCxw, $vf31w, $vf15z
+ vaddaz.xw $ACCx, $vf31xw, $vf31z
+ vaddaz.xy $ACCx, $vf0xy, $vf0z
+ vaddaz.xy $ACCxyz, $vf0xy, $vf31z
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+ vaddq.w $vf31w, $vf31w, $ACC
+ vaddq.xyzw $vf31xyzw, $vf32xyzw, $Q
+ vaddq.xyzw $vf31xyzw, $32, $Q
+ vaddq.xz $vf0xz, $-1, $Q
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+ vaddx.yw $vf31yw, $vf31yw, $vf31y
+ vadd.xyz $vf0xyz, $vf0xyz, $vf0xz
+ vadd.xyz $vf0xyz, $vf0xyz, $vf31xyzw
+ vadd.xyz $vf0xyz, $vf31xyzw, $vf0xyz
+ vaddx.yz $vf0yz, $vf0xyz, $vf0x
+ vaddz.xyzw $vf31xyzw, $vf0xyzw, $vf0x
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+ vaddz.xyzw $vf31xyzw, $vf31xyzw, $vf31w
+ vcallms -1
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+ vcallms 0x40000
+ vcallms 0x40008
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+ vclipw.xyz $vf0xyz, $vf31y
+ vclipw.xyz $vf1xyz, $vf2z
+ vdiv $Q, $vf0x, $vf0xy
+ vdiv $Q, $vf0xyzw, $vf31y
+ vdiv $Q, $vf1, $vf2z
+ vdiv $Q, $vf31x, $vf15
+ vdiv $0, $vf31w, $vf31y
+ vdiv $Q, $vf32y, $vf0w
+ vftoi0.w $vf0w, $vf0x
+ vftoi0.w $vf0x, $vf31w
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+ viaddi $vi0, $vi0, -17
+ viaddi $vi1, $vi2, 16
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+ viand $vi1, $vi2, $vi3x
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+ viand $vi31w, $vi15, $vi7
+ viand $vi31, $vi31, $vi31x
+ vilwr.w $vi0, ($vi0x)
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+ vilwr.x $vi0y, ($vi0)
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+ vilwr.x $vi31zw, ($vi31)
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+ vilwr.y $vi0xyzw, ($vi31)
+ vilwr.y $vi1y, ($vi2)
+ vilwr.y $vi31, ($vi0y)
+ vilwr.z $vi0z, ($vi0)
+ vilwr.z $vi0, ($vi31z)
+ vior $vi0x, $vi0, $vi0
+ vior $vi0, $vi0x, $vi31
+ vior $vi0, $vi31, $vi0x
+ vior $vi1y, $vi2, $vi3
+ vior $vi31, $vi0y, $vi0
+ vior $vi31, $vi15, $vi7y
+ vior $vi31xyzw, $vi31, $vi31
+ visub $vi0x, $vi0, $vi0
+ visub $vi0, $vi0y, $vi31
+ visub $vi0, $vi31, $vi0z
+ visub $vi1w, $vi2, $vi3
+ visub $vi31, $vi0xy, $vi0
+ visub $vi31, $vi15, $vi7zw
+ visub $vi31, $vi31, $vi31w
+ viswr.w $vi0, ($vi0w)
+ viswr.w $vi0w, ($vi31)
+ viswr.x $vi0x, ($vi31)
+ viswr.x $vi1, ($vi2x)
+ viswr.x $vi31x, ($vi0x)
+ viswr.y $vi31y, ($vi15)
+ viswr.y $vi31, ($vi31y)
+ viswr.z $vi0, ($vi0z)
+ viswr.z $vi0z, ($vi31)
+ viswr.z $vi1z, ($vi2z)
+ vitof0.w $vf1w, $vf2x
+ vitof0.w $vf31z, $vf0w
+ vitof0.xw $vf0xw, $vf0xyw
+ vitof0.xw $vf0xw, $vf31w
+ vitof12.xw $vf31xw, $vf0x
+ vitof12.xzw $vf0xzw, $vf31xz
+ vitof12.xzw $vf1xzw, $vf2xw
+ vitof12.xzw $vf31xzw, $vf0xyzw
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+ vitof15.xyw $vf0xyw, $vf31xw
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+ vitof4.xy $0xy, $vf0xy
+ vitof4.xyzw $vf0yzw, $vf0xyzw
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+ vlqd.w $vf0, (--$vi31w)
+ vlqd.w $vf0x, (--$vi0)
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+ vlqd.x $vf0x, (--$vi31x)
+ vlqd.x $vf0w, (--$vi0)
+ vlqd.xw $vf0, (--$vi0xw)
+ vlqd.xy $vf0, (--$vi0xy)
+ vlqd.xyw $vf0, (--$vi0xyw)
+ vlqd.xyz $vf0, (--$vi0xyz)
+ vlqd.xyzw $vf0, (--$vi0xyzw)
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+ vlqd.yz $vf0, (--$vi0yz)
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+ vlqd.zw $vf0, (--$vi0zw)
+ vlqi.w $vf0, ($vi0w++)
+ vlqi.x $vf31, ($vi15x++)
+ vlqi.xw $vf0x, ($vi0++)
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+ vlqi.xyw $vf0, ($vi0xyw++)
+ vlqi.xyz $vf0, ($vi0xyz++)
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+ vlqi.y $vf0, ($vi0y++)
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+ vmaddai.w $ACCw, $vf0w, $R
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+ vmaddai.w $ACCw, $vf31w, $Q
+ vmaddai.x $ACCx, $vf0x, $ACC
+ vmaddai.x $ACCy, $vf1w, $I
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+ vmaddaq.xyz $ACCxyz, $vf0xyz, $R
+ vmaddaq.xyz $ACCxyz, $vf1xyz, $Qxyz
+ vmaddaq.xzw $ACCxzw, $vf31xzw, $Qxzw
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+ vmaddax.w $ACCw, $vf1w, $vf2w
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+ vmaddi.xyw $vf0xyw, $vf0xyw, $Ixyw
+ vmaddi.xyzw $vf1xyzw, $vf2xyzw, $Ixyzw
+ vmaddi.y $vf0y, $vf0y, $Iy
+ vmaddi.yw $vf0yw, $vf0yw, $Iyw
+ vmaddi.zw $vf0zw, $vf31zw, $0
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+ vmaxw.xw $vf0w, $vf0w, $vf31w
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+ vmaxw.xy $vf31w, $vf0xy, $vf0w
+ vmax.x $vf0x, $vf0x, $vf31w
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+ vmaxx.w $vf0x, $vf31x, $vf0x
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+ vmaxx.xw $vf31xw, $vf15xw, $vf7xw
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+ vmaxx.z $vf31x, $vf31z, $vf31x
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+ vmaxy.z $vf0y, $vf31z, $vf0y
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+ vmfir.z $vf0z, $vi0z
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+ vmfir.zw $vf0zw, $vi0zw
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+ vminii.w $vf0w, $vf31x, $I
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+ minii.xz $vf31z, $vf15xz, $I
+ vminii.xz $vf31xz, $vf31x, $I
+ vminii.xzw $vf0xzw, $vf0xw, $I
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+ vminii.xzw $vf31xzw, $vf0xyzw, $I
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+ vminii.yzw $vf31yzw, $vf31yzw, $Q
+ vmini.w $vf0w, $vf0w, $vf0x
+ vminiw.w $vf31w, $vf31w, $vf31x
+ vminiw.x $vf0x, $vf0x, $vf0x
+ vminiw.x $vf0x, $vf0w, $vf31w
+ vminiw.x $vf0w, $vf31x, $vf0w
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+ vminiw.xz $vf31xz, $vf0xz, $vf0xz
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+ vminiw.z $vf31z, $vf15w, $vf7w
+ vminiw.z $vf31w, $vf31z, $vf31w
+ vminix.xw $vf0xw, $vf31xw, $vf0xw
+ vminix.xyw $vf0xyw, $vf0xyw, $vf0xyw
+ vminix.xyzw $vf0xyzw, $vf31xyzw, $vf0xyzw
+ vminix.yw $vf31yw, $vf31yw, $vf31yw
+ vminix.zw $vf31zw, $vf31zw, $vf31zw
+ vmini.y $vf0y, $vf0x, $vf0y
+ vminiy.w $vf0w, $vf31w, $vf0w
+ vminiy.x $vf31x, $vf15x, $vf7x
+ vminiy.x $vf31x, $vf31y, $vf31y
+ vminiy.xw $vf0y, $vf0xw, $vf0y
+ vminiy.xw $vf0xw, $vf0y, $vf31y
+ vminiy.xw $vf0xw, $vf31xw, $vf0xw
+ vminiy.xyz $vf31xyz, $vf31xyz, $vf31xyz
+ vminiy.xyzw $vf0xyzw, $vf0y, $vf0y
+ vminiy.xyzw $vf0y, $vf0xyzw, $vf31y
+ vminiy.xyzw $vf0xyzw, $vf31xyzw, $vf0xyzw
+ vminiy.yw $vf1yw, $vf2yw, $vf3yw
+ vminiy.zw $vf1zw, $vf2zw, $vf3zw
+ vmini.z $vf0z, $vf0z, $vf0x
+ vminiz.x $vf0x, $vf31x, $vf0x
+ vminiz.xw $vf0xw, $vf31xw, $vf0xw
+ vminiz.xyw $vf31xyw, $vf0xyw, $vf0xyw
+ vminiz.xyw $vf31xyw, $vf15z, $vf7z
+ vmove.xyw $vf0xyw, $vf0xw
+ vmove.y $vf0y, $vf31x
+ vmr32.xw $vf0xw, $vf0w
+ vmr32.xw $vf0w, $vf31xw
+ vmsubai.xy $ACCxy, $vf31xy, $Q
+ vmsubai.xyw $ACCxyw, $vf0xyw, $0
+ vmsubai.xyw $ACCxyw, $vf1xyw, $ACC
+ vmsubai.xyw $ACCxyw, $vf31xw, $I
+ vmsubaq.y $ACCy, $vf31y, $Qy
+ vmsubaq.yw $ACCw, $vf0yw, $Q
+ vmsubaq.yw $ACCwy, $vf1yw, $Q
+ vmsubaw.x $ACCx, $vf31x, $vf0x
+ vmsubaw.x $ACCx, $vf31w, $vf15w
+ vmsubaw.x $ACCw, $vf31x, $vf31w
+ vmsubaw.xw $ACCw, $vf0xw, $vf0w
+ vmsubaw.xw $ACCxw, $vf0w, $vf31w
+ vmsubaw.xw $ACCxw, $vf1xw, $vf2xw
+ vmsubax.yzw $ACCyzw, $vf0yzw, $vf31yzw
+ vmsubax.z $ACCz, $vf31z, $vf0z
+ vmsuba.y $ACCy, $vf31y, $vf15a
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+ vmsubay.x $ACCx, $vf31x, $vf15x
+ vmsubay.x $ACCx, $vf31y, $vf31y
+ vmsubay.xw $ACCxw, $vf0xw, $vf0xw
+ vmsubaz.xy $ACCxy, $vf0xy, $vf31xy
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+ vmsubw.xyw $vf0xyw, $vf0xyw, $vf0xyw
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+ vmsubw.y $vf31y, $vf31y, $vf31y
+ vmsubw.yw $vf0yw, $vf0y, $vf0w
+ vmsubw.yw $vf0w, $vf0yw, $vf31w
+ vmsubw.zw $vf0zw, $vf0zw, $vf31zw
+ vmsubx.w $vf0w, $vf0w, $vf0w
+ vmsub.y $vf31y, $vf15y, $vf7w
+ vmsuby.x $vf0x, $vf0x, $vf31x
+ vmsuby.x $vf0x, $vf31y, $vf0y
+ vmsubz.x $vf0x, $vf31x, $vf0x
+ vmulai.xyz $ACCxyz, $vf1xz, $I
+ vmulaq.zw $ACCzw, $vf31zw, $I
+ vmula.w $ACCw, $vf31w, $vf0x
+ vmulax.xz $ACCxz, $vf0xz, $vf31xz
+ vmulax.xz $ACCxz, $vf1x, $vf2x
+ vmulax.xz $ACCx, $vf31xz, $vf0x
+ vmulay.yzw $ACCyzw, $vf0yzw, $vf31yzw
+ vmulaz.w $ACCw, $vf0w, $vf31w
+ mulaz.xy $ACCz, $vf31xy, $vf0z
+ vmulaz.xy $ACCxy, $vf31z, $vf15z
+ vmulaz.z $ACCz, $vf1z, $vf2x
+ vmuli.x $vf31x, $vf15x, $ACC
+ vmulq.x $vf0x, $vf31x, $0
+ vmulq.x $vf1x, $vf2x, $ACC
+ vmulq.x $vf31x, $vf0x, $R
+ vmulq.x $vf31x, $vf15x, $I
+ vmulw.z $vf31z, $vf15z, $vf7z
+ vmulw.z $vf31z, $vf31w, $vf31w
+ vmulw.zw $vf0zw, $vf0zw, $vf0zw
+ vmuly.xyzw $vf0xyzw, $vf0y, $vf31y
+ vmuly.xyzw $vf0xyzw, $vf31xyzw, $vf0xyzw
+ vmuly.xyzw $vf1xyzw, $vf2y, $vf3y
+ vmuly.xyzw $vf31y, $vf0xyzw, $vf0y
+ vmulz.y $vf0y, $vf31y, $vf0y
+ vmulz.y $vf1y, $vf2z, $vf3z
+ vmulz.y $vf31z, $vf0y, $vf0z
+ vmulz.y $vf31z, $vf15z, $vf7z
+ vopmsub $vf0x, $vf0, $vf31
+ vopmsub $vf0, $vf31x, $vf0
+ vopmsub $vf1, $vf2, $vf3x
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+ vopmsub $vf31, $R, $vf7
+ vopmsub $vf31, $vf31, $I
+ vopmsub.xyz $vf0xyz, $vf0xyz, $vf0xy
+ vopmula $0, $vf0, $vf0
+ vopmula $Q, $vf0, $vf31
+ vopmula $R, $vf1, $vf2
+ vopmula $I, $vf31, $vf0
+ vopmula $ACCx, $vf31, $vf15
+ vopmula $ACCxyzw, $vf31, $vf31
+ vopmula.xyz $ACCxyzw, $vf0xyz, $vf0xyz
+ vopmula.xyzw $ACCxyzw, $vf0xyzw, $vf31xyzw
+ vrget.w $vf0w, $0
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+ vrget.w $vf31w, $Q
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+ vrget.xy $vf31x, $R
+ vrget.xyw $vf0xw, $R
+ vrget.xyw $vf1yw, $R
+ vrget.xyw $vf31xy, $R
+ vrget.xyz $vf0xy, $R
+ vrget.xyz $vf1xyzw, $R
+ vrget.xyz $vf31xyzw, $R
+ vrget.xyzw $vf0xyz, $R
+ vrget.xyzw $vf1xzw, $R
+ vrget.xyzw $vf31yzw, $R
+ vrget.xz $vf0xz, $0
+ vrget.xz $vf1z, $R
+ vrget.xzw $vf0xw, $R
+ vrget.y $vf0z, $R
+ vrget.y $vf1y, $I
+ vrget.z $vf31z, $Q
+ vrget.zw $vf0zw, $ACC
+ vrnext.xyzw $vf0xyz, $R
+ vrnext.xyzw $vf1xyzw, $0
+ vrnext.xyzw $vf31xyzw, $Rxyzw
+ vrnext.yz $vf31yz, $Ryz
+ vrnext.z $vf0z, $Rz
+ vrsqrt $Q, $vf0xz, $vf31y
+ vrsqrt $Q, $vf1z, $vf2xz
+ vrsqrt $Q, $vf31yx, $vf15w
+ vrsqrt $Qx, $vf31x, $vf31y
+ vrsqrt $0, $vf31y, $vf0w
+ vrxor $0, $vf0w
+ vrxor $R, $vf0xy
+ vrxor $R, $vf0zw
+ vrxor $R, $vf1yz
+ vrxor $ACC, $vf31x
+ vrxor $Q, $vf31y
+ vsqd.w $vf0, (--$vi0w)
+ vsqd.w $vf0, (--$vi31w)
+ vsqd.x $vf1, (--$vi2x)
+ vsqd.xw $vf0, (--$vi0xw)
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+ vsqd.xzw $vf0, (--$vi0xzw)
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+ vsqd.zw $vf1, (--$vi2zw)
+ vsqi.w $vf0, ($vi0w++)
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+ vsqi.xw $vf0xw, ($vi0xw++)
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+ vsqrt $Q, $vf1zw
+ vsqrt $Q, $vf31xw
+ vsqrt $Q, $vf31xy
+ vsubai.w $ACCw, $vf0w, $0
+ vsubai.w $ACCw, $vf1x, $I
+ vsubai.w $ACCx, $vf31w, $I
+ vsubai.x $ACCw, $vf31x, $I
+ vsubai.xw $ACCw, $vf0xw, $I
+ vsubai.xw $ACCxw, $vf1x, $I
+ vsubai.xw $ACCxw, $vf31xw, $0
+ vsubai.xy $ACCxy, $vf0y, $I
+ vsubai.xy $ACCxy, $vf1x, $I
+ vsubai.xy $ACCxy, $vf311xy, $I
+ vsubai.xyz $ACCxyz, $vf1yz, $I
+ vsubai.xyz $ACCxyz, $vf31xyz, $ACC
+ vsubai.xyzw $ACCxyzw, $vf0xyzw, $R
+ vsubai.xyzw $ACCxyzw, $vf1xyzw, $Q
+ vsubai.xz $ACCxz, $vf1z, $I
+ vsubai.y $ACCy, $vf31, $3
+ vsubai.yw $ACCyw, $vf0yw, $Iyw
+ vsubai.zw $ACCzw, $vf1zw, $Izw
+ vsubai.zw $ACCzw, $vf31w, $I
+ vsubaq.w $ACCw, $Q, $Q
+ vsubaq.w $ACCw, $I, $Q
+ vsubaq.xyw $ACCxyw, $vf0xw, $Q
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+ vsubaq.yw $ACCyw, $vf31y, $Q
+ vsubaq.yz $ACCyz, $vf0yz, $ACC
+ vsubaq.yz $ACCyz, $vf1yz, $I
+ vsubax.w $ACCw, $vf0w, $vf0w
+ vsubax.w $ACCw, $vf0x, $vf31x
+ vsubax.w $ACCx, $vf1w, $vf2x
+ vsubax.w $ACCx, $vf31x, $vf0x
+ vsubax.xyzw $ACCxyzw, $vf31xyzw, $vf0xyzw
+ vsubax.xzw $ACCxzw, $vf1xzw, $vf2xzw
+ vsubax.y $ACCy, $vf1y, $vf2
+ vsubax.y $ACCy, $vf31y, $vf0y
+ vsubax.yw $ACCyw, $vf0yw, $vf0yw
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+ vsubay.yzw $ACCyzw, $vf0yzw, $vf31yzw
+ vsubay.z $ACCz, $vf0z, $vf31z
+ vsubay.zw $ACCzw, $vf0zw, $vf0zw
+ vsubaz.w $ACCw, $vf31w, $vf15w
+ vsubaz.x $ACCx, $vf0x, $vf31x
+ vsubaz.xy $ACCxy, $vf0xy, $vf0xy
+ vsubaz.xz $ACCxz, $vf31xz, $vf15xz
+ vsubaz.xz $ACCxz, $vf31z, $vf31z
+ vsubaz.xzw $ACCxw, $vf0xzw, $vf0z
+ vsubaz.xzw $ACCz, $vf0xzw, $vf31z
+ vsubaz.xzw $ACCxzw, $vf1z, $vf2z
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+ vsubi.w $vf31w, $vf15w, $0
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+ vsubi.xy $vf0xy, $vf31y, $I
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+ vsubq.x $vf31x, $vf15x, $Qx
+ vsubq.x $vf31x, $vf31y, $Q
+ vsubq.xw $vf0xw, $vf0xw, $0
+ vsubq.xw $vf0xw, $vf31xw, $2
+ vsubq.xyzw $vf1yzw, $vf2xyzw, $Q
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+ vsubq.yw $vf31yw, $vf31y, $Q
+ vsubx.xyw $vf0xyw, $vf31xyw, $vf0xyw
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+ vsuby.xw $vf0xw, $vf0xw, $vf0xw
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+ vsubz.xyw $vf31xyw, $vf31yw, $vf31z
+ vsubz.xyz $vf0xyz, $vf0xyz, $vf0x
+ vwaitq $vf0x
+
+# Force at least 8 (non-delay-slot) zero bytes, to make 'objdump' print ...
+ .space 8
--- /dev/null
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+#name: MIPS R5900 Full VU0
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+
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+
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+[0-9a-f]+ <[^>]*> 4a807bff viswr\.y \$vi0,\(\$vi15\)
+[0-9a-f]+ <[^>]*> 4a407bff viswr\.z \$vi0,\(\$vi15\)
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+text_label:
+
+ # VU Macromode instruction set
+ vabs.xyzw $vf0xyzw,$vf31xyzw
+ vadd.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vaddi.xyzw $vf10xyzw,$vf31xyzw,$I
+ vaddq.xyzw $vf10xyzw,$vf31xyzw,$Q
+ vaddw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vaddx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vaddy.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vaddz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vadda.xyzw $ACCxyzw,$vf0xyzw,$vf31xyzw
+ vaddai.xyzw $ACCxyzw,$vf31xyzw,$I
+ vaddaq.xyzw $ACCxyzw,$vf31xyzw,$Q
+ vaddaw.xyzw $ACCxyzw,$vf31xyzw,$vf1w
+ vaddax.xyzw $ACCxyzw,$vf31xyzw,$vf1x
+ vadday.xyzw $ACCxyzw,$vf31xyzw,$vf1y
+ vaddaz.xyzw $ACCxyzw,$vf31xyzw,$vf1z
+ vcallms 0x0
+ vcallms 0x340
+ vcallms 0xff8
+ vcallmsr $vi27
+ vclipw.xyz $vf31xyz,$vf1w
+ vdiv $Q,$vf1y,$vf11x
+ vftoi0.xyzw $vf0xyzw,$vf31xyzw
+ vftoi4.xyzw $vf0xyzw,$vf31xyzw
+ vftoi12.xyzw $vf0xyzw,$vf31xyzw
+ vftoi15.xyzw $vf0xyzw,$vf31xyzw
+ viadd $vi1,$vi15,$vi0
+ viaddi $vi0,$vi15,-1
+ viand $vi1,$vi15,$vi0
+ vilwr.w $vi0,($vi15)
+ vilwr.x $vi0,($vi15)
+ vilwr.y $vi0,($vi15)
+ vilwr.z $vi0,($vi15)
+ vior $vi1,$vi15,$vi0
+ viswr.w $vi0,($vi15)
+ viswr.x $vi0,($vi15)
+ viswr.y $vi0,($vi15)
+ viswr.z $vi0,($vi15)
+ visub $vi1,$vi15,$vi0
+ vitof0.xyzw $vf0xyzw,$vf31xyzw
+ vitof4.xyzw $vf0xyzw,$vf31xyzw
+ vitof12.xyzw $vf0xyzw,$vf31xyzw
+ vitof15.xyzw $vf0xyzw,$vf31xyzw
+ vlqd.xyzw $vf0xyzw,(--$vi15)
+ vlqi.xyzw $vf0xyzw,($vi15++)
+ vmadd.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vmaddi.xyzw $vf10xyzw,$vf31xyzw,$I
+ vmaddq.xyzw $vf10xyzw,$vf31xyzw,$Q
+ vmaddw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vmaddx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vmaddy.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vmaddz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vmadda.xyzw $ACCxyzw,$vf31xyzw,$vf0xyzw
+ vmaddai.xyzw $ACCxyzw,$vf31xyzw,$I
+ vmaddaq.xyzw $ACCxyzw,$vf31xyzw,$Q
+ vmaddaw.xyzw $ACCxyzw,$vf31xyzw,$vf1w
+ vmaddax.xyzw $ACCxyzw,$vf31xyzw,$vf1x
+ vmadday.xyzw $ACCxyzw,$vf31xyzw,$vf1y
+ vmaddaz.xyzw $ACCxyzw,$vf31xyzw,$vf1z
+ vmax.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vmaxi.xyzw $vf10xyzw,$vf31xyzw,$I
+ vmaxw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vmaxx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vmaxy.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vmaxz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vmfir.xyzw $vf0xyzw,$vi15
+ vmini.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vminii.xyzw $vf10xyzw,$vf31xyzw,$I
+ vminiw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vminix.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vminiy.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vminiz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vmove.xyzw $vf0xyzw,$vf31xyzw
+ vmr32.xyzw $vf0xyzw,$vf31xyzw
+ vmsub.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vmsubi.xyzw $vf10xyzw,$vf31xyzw,$I
+ vmsubq.xyzw $vf10xyzw,$vf31xyzw,$Q
+ vmsubw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vmsubx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vmsuby.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vmsubz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vmsuba.xyzw $ACCxyzw,$vf0xyzw,$vf31xyzw
+ vmsubai.xyzw $ACCxyzw,$vf31xyzw,$I
+ vmsubaq.xyzw $ACCxyzw,$vf31xyzw,$Q
+ vmsubaw.xyzw $ACCxyzw,$vf31xyzw,$vf1w
+ vmsubax.xyzw $ACCxyzw,$vf31xyzw,$vf1x
+ vmsubay.xyzw $ACCxyzw,$vf31xyzw,$vf1y
+ vmsubaz.xyzw $ACCxyzw,$vf31xyzw,$vf1z
+ vmtir $vi0,$vf1z
+ vmul.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vmuli.xyzw $vf10xyzw,$vf31xyzw,$I
+ vmulq.xyzw $vf10xyzw,$vf31xyzw,$Q
+ vmulw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vmulx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vmuly.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vmulz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vmula.xyzw $ACCxyzw,$vf31xyzw,$vf0xyzw
+ vmulai.xyzw $ACCxyzw,$vf31xyzw,$I
+ vmulaq.xyzw $ACCxyzw,$vf31xyzw,$Q
+ vmulaw.xyzw $ACCxyzw,$vf31xyzw,$vf1w
+ vmulax.xyzw $ACCxyzw,$vf31xyzw,$vf1x
+ vmulay.xyzw $ACCxyzw,$vf31xyzw,$vf1y
+ vmulaz.xyzw $ACCxyzw,$vf31xyzw,$vf1z
+ vnop
+ vopmula.xyz $ACCxyz,$vf31xyz,$vf0xyz
+ vopmsub.xyz $vf10xyz,$vf31xyz,$vf0xyz
+ vrget.xyzw $vf0xyzw,$R
+ vrinit $R,$vf1w
+ vrnext.xyzw $vf0xyzw,$R
+ vrsqrt $Q,$vf1w,$vf11x
+ vrxor $R,$vf1x
+ vsqd.xyzw $vf31xyzw,(--$vi0)
+ vsqi.xyzw $vf31xyzw,($vi0++)
+ vsqrt $Q,$vf11z
+ vsub.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vsubi.xyzw $vf10xyzw,$vf31xyzw,$I
+ vsubq.xyzw $vf10xyzw,$vf31xyzw,$Q
+ vsubw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vsubx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vsuby.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vsubz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vsuba.xyzw $ACCxyzw,$vf31xyzw,$vf0xyzw
+ vsubai.xyzw $ACCxyzw,$vf31xyzw,$I
+ vsubaq.xyzw $ACCxyzw,$vf31xyzw,$Q
+ vsubaw.xyzw $ACCxyzw,$vf31xyzw,$vf1w
+ vsubax.xyzw $ACCxyzw,$vf31xyzw,$vf1x
+ vsubay.xyzw $ACCxyzw,$vf31xyzw,$vf1y
+ vsubaz.xyzw $ACCxyzw,$vf31xyzw,$vf1z
+ vwaitq
+
+ # Implicit suffixes
+ vadd.xyzw $vf10,$vf31,$vf0
+ vadd.xy $vf10,$vf31,$vf0
+ vadd.xyzw $vf10,$vf31,$vf0
+ vlqi.xy $vf0,($vi15++)
+
+ # VU floating point registers
+ vadd.xyzw $vf0,$vf1,$vf2
+ vadd.xyzw $vf3,$vf4,$vf5
+ vadd.xyzw $vf6,$vf7,$vf8
+ vadd.xyzw $vf9,$vf10,$vf11
+ vadd.xyzw $vf12,$vf13,$vf14
+ vadd.xyzw $vf15,$vf16,$vf17
+ vadd.xyzw $vf18,$vf19,$vf20
+ vadd.xyzw $vf21,$vf22,$vf23
+ vadd.xyzw $vf24,$vf25,$vf26
+ vadd.xyzw $vf27,$vf28,$vf29
+ vadd.xyzw $vf30,$vf31,$vf0
+
+ # VU integer registers
+ viadd $vi0,$vi1,$vi2
+ viadd $vi3,$vi4,$vi5
+ viadd $vi6,$vi7,$vi8
+ viadd $vi9,$vi10,$vi11
+ viadd $vi12,$vi13,$vi14
+ viadd $vi15,$vi16,$vi17
+ viadd $vi18,$vi19,$vi20
+ viadd $vi21,$vi22,$vi23
+ viadd $vi24,$vi25,$vi26
+ viadd $vi27,$vi28,$vi29
+ viadd $vi30,$vi31,$vi0
+
+ # Floating point transfer to VU
+ lqc2 $0,0($0)
+ lqc2 $1, 0x7fff($1)
+ lqc2 $8, -0x8000($8)
+ lqc2 $31, -1($31)
+
+ # Floating point transfer from VU
+ sqc2 $0,0($0)
+ sqc2 $1, 0x7fff($1)
+ sqc2 $8, -0x8000($8)
+ sqc2 $31, -1($31)
+
+ # Integer transfer from VU
+ cfc2 $0,$0
+ cfc2 $0,$31
+ cfc2.i $0,$0
+ cfc2.i $0,$31
+ cfc2.ni $0,$0
+ cfc2.ni $0,$31
+
+ # Integer transfer to VU
+ ctc2 $0,$0
+ ctc2 $0,$31
+ ctc2.i $0,$0
+ ctc2.i $0,$31
+ ctc2.ni $0,$0
+ ctc2.ni $0,$31
+
+ # Floating point transfer from VU
+ qmfc2 $0,$0
+ qmfc2 $0,$31
+ qmfc2.i $0,$0
+ qmfc2.i $0,$31
+ qmfc2.ni $0,$0
+ qmfc2.ni $0,$31
+
+ # Floating point transfer to VU
+ qmtc2 $0,$0
+ qmtc2 $0,$31
+ qmtc2.i $0,$0
+ qmtc2.i $0,$31
+ qmtc2.ni $0,$0
+ qmtc2.ni $0,$31
+
+# Force at least 8 (non-delay-slot) zero bytes, to make 'objdump' print ...
+ .space 8
.*: +file format .*mips.*
Disassembly of section \.text:
-[0-9a-f]+ <[^>]*> d8000000 lqc2 \$0,0\(\$0\)
-[0-9a-f]+ <[^>]*> d8217fff lqc2 \$1,32767\(\$1\)
-[0-9a-f]+ <[^>]*> d9088000 lqc2 \$8,-32768\(\$8\)
-[0-9a-f]+ <[^>]*> dbffffff lqc2 \$31,-1\(\$31\)
+[0-9a-f]+ <[^>]*> d8000000 lqc2 \$vf0,0\(\$0\)
+[0-9a-f]+ <[^>]*> d8217fff lqc2 \$vf1,32767\(\$1\)
+[0-9a-f]+ <[^>]*> d9088000 lqc2 \$vf8,-32768\(\$8\)
+[0-9a-f]+ <[^>]*> dbffffff lqc2 \$vf31,-1\(\$31\)
[0-9a-f]+ <[^>]*> 3c010001 lui \$1,0x1
[0-9a-f]+ <[^>]*> 00220821 addu \$1,\$1,\$2
-[0-9a-f]+ <[^>]*> d8208000 lqc2 \$0,-32768\(\$1\)
+[0-9a-f]+ <[^>]*> d8208000 lqc2 \$vf0,-32768\(\$1\)
[0-9a-f]+ <[^>]*> 3c01ffff lui \$1,0xffff
[0-9a-f]+ <[^>]*> 003f0821 addu \$1,\$1,\$31
-[0-9a-f]+ <[^>]*> d8287fff lqc2 \$8,32767\(\$1\)
+[0-9a-f]+ <[^>]*> d8287fff lqc2 \$vf8,32767\(\$1\)
[0-9a-f]+ <[^>]*> 3c01f123 lui \$1,0xf123
[0-9a-f]+ <[^>]*> 00240821 addu \$1,\$1,\$4
-[0-9a-f]+ <[^>]*> d83f4567 lqc2 \$31,17767\(\$1\)
-[0-9a-f]+ <[^>]*> f8000000 sqc2 \$0,0\(\$0\)
-[0-9a-f]+ <[^>]*> f8217fff sqc2 \$1,32767\(\$1\)
-[0-9a-f]+ <[^>]*> f9088000 sqc2 \$8,-32768\(\$8\)
-[0-9a-f]+ <[^>]*> fbffffff sqc2 \$31,-1\(\$31\)
+[0-9a-f]+ <[^>]*> d83f4567 lqc2 \$vf31,17767\(\$1\)
+[0-9a-f]+ <[^>]*> f8000000 sqc2 \$vf0,0\(\$0\)
+[0-9a-f]+ <[^>]*> f8217fff sqc2 \$vf1,32767\(\$1\)
+[0-9a-f]+ <[^>]*> f9088000 sqc2 \$vf8,-32768\(\$8\)
+[0-9a-f]+ <[^>]*> fbffffff sqc2 \$vf31,-1\(\$31\)
[0-9a-f]+ <[^>]*> 3c010001 lui \$1,0x1
[0-9a-f]+ <[^>]*> 00220821 addu \$1,\$1,\$2
-[0-9a-f]+ <[^>]*> f8208000 sqc2 \$0,-32768\(\$1\)
+[0-9a-f]+ <[^>]*> f8208000 sqc2 \$vf0,-32768\(\$1\)
[0-9a-f]+ <[^>]*> 3c01ffff lui \$1,0xffff
[0-9a-f]+ <[^>]*> 003f0821 addu \$1,\$1,\$31
-[0-9a-f]+ <[^>]*> f8287fff sqc2 \$8,32767\(\$1\)
+[0-9a-f]+ <[^>]*> f8287fff sqc2 \$vf8,32767\(\$1\)
[0-9a-f]+ <[^>]*> 3c01f123 lui \$1,0xf123
[0-9a-f]+ <[^>]*> 00240821 addu \$1,\$1,\$4
-[0-9a-f]+ <[^>]*> f83f4567 sqc2 \$31,17767\(\$1\)
-[0-9a-f]+ <[^>]*> 48400000 cfc2 \$0,\$0
-[0-9a-f]+ <[^>]*> 4840f800 cfc2 \$0,\$31
-[0-9a-f]+ <[^>]*> 48400001 cfc2.i \$0,\$0
-[0-9a-f]+ <[^>]*> 4840f801 cfc2.i \$0,\$31
-[0-9a-f]+ <[^>]*> 48400000 cfc2 \$0,\$0
-[0-9a-f]+ <[^>]*> 4840f800 cfc2 \$0,\$31
-[0-9a-f]+ <[^>]*> 48c00000 ctc2 \$0,\$0
-[0-9a-f]+ <[^>]*> 48c0f800 ctc2 \$0,\$31
-[0-9a-f]+ <[^>]*> 48c00001 ctc2.i \$0,\$0
-[0-9a-f]+ <[^>]*> 48c0f801 ctc2.i \$0,\$31
-[0-9a-f]+ <[^>]*> 48c00000 ctc2 \$0,\$0
-[0-9a-f]+ <[^>]*> 48c0f800 ctc2 \$0,\$31
-[0-9a-f]+ <[^>]*> 48200000 qmfc2 \$0,\$0
-[0-9a-f]+ <[^>]*> 4820f800 qmfc2 \$0,\$31
-[0-9a-f]+ <[^>]*> 48200001 qmfc2.i \$0,\$0
-[0-9a-f]+ <[^>]*> 4820f801 qmfc2.i \$0,\$31
-[0-9a-f]+ <[^>]*> 48200000 qmfc2 \$0,\$0
-[0-9a-f]+ <[^>]*> 4820f800 qmfc2 \$0,\$31
-[0-9a-f]+ <[^>]*> 48a00000 qmtc2 \$0,\$0
-[0-9a-f]+ <[^>]*> 48a0f800 qmtc2 \$0,\$31
-[0-9a-f]+ <[^>]*> 48a00001 qmtc2.i \$0,\$0
-[0-9a-f]+ <[^>]*> 48a0f801 qmtc2.i \$0,\$31
-[0-9a-f]+ <[^>]*> 48a00000 qmtc2 \$0,\$0
-[0-9a-f]+ <[^>]*> 48a0f800 qmtc2 \$0,\$31
+[0-9a-f]+ <[^>]*> f83f4567 sqc2 \$vf31,17767\(\$1\)
+[0-9a-f]+ <[^>]*> 48400000 cfc2 \$0,\$vi0
+[0-9a-f]+ <[^>]*> 4840f800 cfc2 \$0,\$vi31
+[0-9a-f]+ <[^>]*> 48400001 cfc2.i \$0,\$vi0
+[0-9a-f]+ <[^>]*> 4840f801 cfc2.i \$0,\$vi31
+[0-9a-f]+ <[^>]*> 48400000 cfc2 \$0,\$vi0
+[0-9a-f]+ <[^>]*> 4840f800 cfc2 \$0,\$vi31
+[0-9a-f]+ <[^>]*> 48c00000 ctc2 \$0,\$vi0
+[0-9a-f]+ <[^>]*> 48c0f800 ctc2 \$0,\$vi31
+[0-9a-f]+ <[^>]*> 48c00001 ctc2.i \$0,\$vi0
+[0-9a-f]+ <[^>]*> 48c0f801 ctc2.i \$0,\$vi31
+[0-9a-f]+ <[^>]*> 48c00000 ctc2 \$0,\$vi0
+[0-9a-f]+ <[^>]*> 48c0f800 ctc2 \$0,\$vi31
+[0-9a-f]+ <[^>]*> 48200000 qmfc2 \$0,\$vf0
+[0-9a-f]+ <[^>]*> 4820f800 qmfc2 \$0,\$vf31
+[0-9a-f]+ <[^>]*> 48200001 qmfc2.i \$0,\$vf0
+[0-9a-f]+ <[^>]*> 4820f801 qmfc2.i \$0,\$vf31
+[0-9a-f]+ <[^>]*> 48200000 qmfc2 \$0,\$vf0
+[0-9a-f]+ <[^>]*> 4820f800 qmfc2 \$0,\$vf31
+[0-9a-f]+ <[^>]*> 48a00000 qmtc2 \$0,\$vf0
+[0-9a-f]+ <[^>]*> 48a0f800 qmtc2 \$0,\$vf31
+[0-9a-f]+ <[^>]*> 48a00001 qmtc2.i \$0,\$vf0
+[0-9a-f]+ <[^>]*> 48a0f801 qmtc2.i \$0,\$vf31
+[0-9a-f]+ <[^>]*> 48a00000 qmtc2 \$0,\$vf0
+[0-9a-f]+ <[^>]*> 48a0f800 qmtc2 \$0,\$vf31
[0-9a-f]+ <[^>]*> 4900ffff bc2f [0-9a-f]+ <branch_label>
[0-9a-f]+ <[^>]*> 00000000 nop
[0-9a-f]+ <[^>]*> 4902fffd bc2fl [0-9a-f]+ <branch_label>
+2013-08-04 Jürgen Urban <JuergenUrban@gmx.de>
+ Richard Sandiford <rdsandiford@googlemail.com>
+
+ * mips.h: Document new VU0 operand characters.
+ (OP_VU0_SUFFIX, OP_VU0_MATCH_SUFFIX): New mips_operand_types.
+ (OP_REG_VF, OP_REG_VI, OP_REG_R5900_I, OP_REG_R5900_Q, OP_REG_R5900_R)
+ (OP_REG_R5900_ACC): New mips_reg_operand_types.
+ (INSN2_VU0_CHANNEL_SUFFIX): New macro.
+ (mips_vu0_channel_mask): Declare.
+
2013-08-03 Richard Sandiford <rdsandiford@googlemail.com>
* mips.h (mips_pcrel_operand): Inherit from mips_int_operand.
OP_REPEAT_PREV_REG,
/* $pc, which has no encoding in the architectural instruction. */
- OP_PC
+ OP_PC,
+
+ /* A 4-bit XYZW channel mask or 2-bit XYZW index; the size determines
+ which. */
+ OP_VU0_SUFFIX,
+
+ /* Like OP_VU0_SUFFIX, but used when the operand's value has already
+ been set. Any suffix used here must match the previous value. */
+ OP_VU0_MATCH_SUFFIX
};
/* Enumerates the types of MIPS register. */
/* Hardware registers $0-$31. Mnemonic names like hwr_cpunum can
also be used in some contexts. */
- OP_REG_HW
+ OP_REG_HW,
+
+ /* Floating-point registers $vf0-$vf31. */
+ OP_REG_VF,
+
+ /* Integer registers $vi0-$vi31. */
+ OP_REG_VI,
+
+ /* R5900 VU0 registers $I, $Q, $R and $ACC. */
+ OP_REG_R5900_I,
+ OP_REG_R5900_Q,
+ OP_REG_R5900_R,
+ OP_REG_R5900_ACC
};
/* Base class for all operands. */
"Y" source register (OP_*_FS)
"Z" source register (OP_*_FT)
+ R5900 VU0 Macromode instructions:
+ "+5" 5 bit floating point register (FD)
+ "+6" 5 bit floating point register (FS)
+ "+7" 5 bit floating point register (FT)
+ "+8" 5 bit integer register (FD)
+ "+9" 5 bit integer register (FS)
+ "+0" 5 bit integer register (FT)
+ "+K" match an existing 4-bit channel mask starting at bit 21
+ "+L" 2-bit channel index starting at bit 21
+ "+M" 2-bit channel index starting at bit 23
+ "+N" match an existing 2-bit channel index starting at bit 0
+ "+f" 15 bit immediate for VCALLMS
+ "+g" 5 bit signed immediate for VIADDI
+ "+m" $ACC register (syntax only)
+ "+q" $Q register (syntax only)
+ "+r" $R register (syntax only)
+ "+y" $I register (syntax only)
+ "#+" "++" decorator in ($reg++) sequence
+ "#-" "--" decorator in (--$reg) sequence
+
DSP ASE usage:
"2" 2 bit unsigned immediate for byte align (OP_*_BP)
"3" 3 bit unsigned immediate (OP_*_SA3)
Characters used so far, for quick reference when adding more:
"1234567890"
- "%[]<>(),+:'@!$*&\~"
+ "%[]<>(),+:'@!#$*&\~"
"ABCDEFGHIJKLMNOPQRSTUVWXYZ"
"abcdefghijklopqrstuvwxz"
Extension character sequences used so far ("+" followed by the
following), for quick reference when adding more:
- "1234"
- "ABCEFGHIJPQSXZ"
- "abcijpstxz"
+ "1234567890"
+ "ABCEFGHIJKLMNPQSXZ"
+ "abcfgijmpqrstxyz"
*/
/* These are the bits which may be set in the pinfo field of an
#define INSN2_COND_BRANCH 0x00001000
/* Reads from $16. This is true of the MIPS16 0x6500 nop. */
#define INSN2_READ_GPR_16 0x00002000
+/* Has an "\.x?y?z?w?" suffix based on mips_vu0_channel_mask. */
+#define INSN2_VU0_CHANNEL_SUFFIX 0x00004000
/* Masks used to mark instructions to indicate which MIPS ISA level
they were introduced in. INSN_ISA_MASK masks an enumeration that
Many instructions are short hand for other instructions (i.e., The
jal <register> instruction is short for jalr <register>). */
+extern const struct mips_operand mips_vu0_channel_mask;
extern const struct mips_operand *decode_mips_operand (const char *);
extern const struct mips_opcode mips_builtin_opcodes[];
extern const int bfd_mips_num_builtin_opcodes;
+2013-08-04 Jürgen Urban <JuergenUrban@gmx.de>
+ Richard Sandiford <rdsandiford@googlemail.com>
+
+ * mips-dis.c (print_reg): Handle OP_REG_VI, OP_REG_VF, OP_REG_R5900_I,
+ OP_REG_R5900_Q, OP_REG_R5900_R and OP_REG_R5900_ACC.
+ (print_vu0_channel): New function.
+ (print_insn_arg): Handle OP_VU0_SUFFIX and OP_VU0_MATCH_SUFFIX.
+ (print_insn_args): Handle '#'.
+ (print_insn_mips): Handle INSN2_VU0_CHANNEL_SUFFIX.
+ * mips-opc.c (mips_vu0_channel_mask): New constant.
+ (decode_mips_operand): Handle new VU0 operand types.
+ (VU0, VU0CH): New macros.
+ (mips_builtin_opcodes): Add VU0 opcodes. Use "+7" rather than "E"
+ for LQC2 and SQC2. Use "+9" rather than "G" for EE CFC2 and CTC2.
+ Use "+6" rather than "G" for QMFC2 and QMTC2.
+
2013-08-03 Richard Sandiford <rdsandiford@googlemail.com>
* mips-formats.h (PCREL): Reorder parameters and update the definition
case OP_REG_HW:
info->fprintf_func (info->stream, "%s", mips_hwr_names[regno]);
break;
+
+ case OP_REG_VF:
+ info->fprintf_func (info->stream, "$vf%d", regno);
+ break;
+
+ case OP_REG_VI:
+ info->fprintf_func (info->stream, "$vi%d", regno);
+ break;
+
+ case OP_REG_R5900_I:
+ info->fprintf_func (info->stream, "$I");
+ break;
+
+ case OP_REG_R5900_Q:
+ info->fprintf_func (info->stream, "$Q");
+ break;
+
+ case OP_REG_R5900_R:
+ info->fprintf_func (info->stream, "$R");
+ break;
+
+ case OP_REG_R5900_ACC:
+ info->fprintf_func (info->stream, "$ACC");
+ break;
}
}
\f
memset (state, 0, sizeof (*state));
}
+/* Print OP_VU0_SUFFIX or OP_VU0_MATCH_SUFFIX operand OPERAND,
+ whose value is given by UVAL. */
+
+static void
+print_vu0_channel (struct disassemble_info *info,
+ const struct mips_operand *operand, unsigned int uval)
+{
+ if (operand->size == 4)
+ info->fprintf_func (info->stream, "%s%s%s%s",
+ uval & 8 ? "x" : "",
+ uval & 4 ? "y" : "",
+ uval & 2 ? "z" : "",
+ uval & 1 ? "w" : "");
+ else if (operand->size == 2)
+ info->fprintf_func (info->stream, "%c", "xyzw"[uval]);
+ else
+ abort ();
+}
+
/* Print operand OPERAND of OPCODE, using STATE to track inter-operand state.
UVAL is the encoding of the operand (shifted into bit 0) and BASE_PC is
the base address for OP_PCREL operands. */
case OP_PC:
infprintf (is, "$pc");
break;
+
+ case OP_VU0_SUFFIX:
+ case OP_VU0_MATCH_SUFFIX:
+ print_vu0_channel (info, operand, uval);
+ break;
}
}
infprintf (is, "%c", *s);
break;
+ case '#':
+ ++s;
+ infprintf (is, "%c%c", *s, *s);
+ break;
+
default:
operand = decode_operand (s);
if (!operand)
info->insn_type = dis_dref;
infprintf (is, "%s", op->name);
+ if (op->pinfo2 & INSN2_VU0_CHANNEL_SUFFIX)
+ {
+ unsigned int uval;
+
+ infprintf (is, ".");
+ uval = mips_extract_operand (&mips_vu0_channel_mask, word);
+ print_vu0_channel (info, &mips_vu0_channel_mask, uval);
+ }
if (op->args[0])
{
#include "opcode/mips.h"
#include "mips-formats.h"
+/* The 4-bit XYZW mask used in some VU0 instructions. */
+const struct mips_operand mips_vu0_channel_mask = { OP_VU0_SUFFIX, 4, 21 };
+
static unsigned char reg_0_map[] = { 0 };
/* Return the mips_operand structure for the operand at the beginning of P. */
case '2': HINT (10, 6);
case '3': HINT (15, 6);
case '4': HINT (20, 6);
+ case '5': REG (5, 6, VF);
+ case '6': REG (5, 11, VF);
+ case '7': REG (5, 16, VF);
+ case '8': REG (5, 6, VI);
+ case '9': REG (5, 11, VI);
+ case '0': REG (5, 16, VI);
case 'A': BIT (5, 6, 0); /* (0 .. 31) */
case 'B': MSB (5, 11, 1, TRUE, 32); /* (1 .. 32), 32-bit op */
case 'G': MSB (5, 11, 33, FALSE, 64); /* (33 .. 64), 64-bit op */
case 'H': MSB (5, 11, 1, FALSE, 64); /* (1 .. 32), 64-bit op */
case 'J': HINT (10, 11);
+ case 'K': SPECIAL (4, 21, VU0_MATCH_SUFFIX);
+ case 'L': SPECIAL (2, 21, VU0_SUFFIX);
+ case 'M': SPECIAL (2, 23, VU0_SUFFIX);
+ case 'N': SPECIAL (2, 0, VU0_MATCH_SUFFIX);
case 'P': BIT (5, 6, 32); /* (32 .. 63) */
case 'Q': SINT (10, 6);
case 'S': MSB (5, 11, 0, FALSE, 63); /* (0 .. 31), 64-bit op */
case 'a': SINT (8, 6);
case 'b': SINT (8, 3);
case 'c': INT_ADJ (9, 6, 255, 4, FALSE); /* (-256 .. 255) << 4 */
+ case 'f': INT_ADJ (15, 6, 32767, 3, TRUE);
+ case 'g': SINT (5, 6);
case 'i': JALX (26, 0, 2);
case 'j': SINT (9, 7);
+ case 'm': REG (0, 0, R5900_ACC);
case 'p': BIT (5, 6, 0); /* (0 .. 31), 32-bit op */
+ case 'q': REG (0, 0, R5900_Q);
+ case 'r': REG (0, 0, R5900_R);
case 's': MSB (5, 11, 0, FALSE, 31); /* (0 .. 31) */
case 't': REG (5, 16, COPRO);
case 'x': BIT (5, 16, 0); /* (0 .. 31) */
+ case 'y': REG (0, 0, R5900_I);
case 'z': REG (5, 0, GP);
}
break;
/* 64 bit CPU with only 32 bit multiplication/division support. */
#define M32 EE
+/* Support for VU0 Coprocessor instructions */
+#define VU0 EE
+#define VU0CH INSN2_VU0_CHANNEL_SUFFIX
+
/* MIPS DSP ASE support.
NOTE:
1. MIPS DSP ASE includes 4 accumulators ($ac0 - $ac3). $ac0 is the pair
{"gslqc1", "+Z,T,+c(b)", 0xc8008020, 0xfc008020, WR_1|WR_2|RD_4|LDD, 0, IL3A, 0, 0 },
{"gssqc1", "+Z,T,+c(b)", 0xe8008020, 0xfc008020, RD_1|RD_2|RD_4|SM, 0, IL3A, 0, 0 },
+/* R5900 VU0 Macromode instructions. */
+{"vabs", "+7+K,+6+K", 0x4a0001fd, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vadd", "+5+K,+6+K,+7+K", 0x4a000028, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vaddi", "+5+K,+6+K,+y", 0x4a000022, 0xfe1f003f, CP, VU0CH, VU0, 0, 0 },
+{"vaddq", "+5+K,+6+K,+q", 0x4a000020, 0xfe1f003f, CP, VU0CH, VU0, 0, 0 },
+{"vaddw", "+5+K,+6+K,+7+N", 0x4a000003, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vaddx", "+5+K,+6+K,+7+N", 0x4a000000, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vaddy", "+5+K,+6+K,+7+N", 0x4a000001, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vaddz", "+5+K,+6+K,+7+N", 0x4a000002, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vadda", "+m+K,+7+K,+6+K", 0x4a0002bc, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vaddai", "+m+K,+6+K,+y", 0x4a00023e, 0xfe1f07ff, CP, VU0CH, VU0, 0, 0 },
+{"vaddaq", "+m+K,+6+K,+q", 0x4a00023c, 0xfe1f07ff, CP, VU0CH, VU0, 0, 0 },
+{"vaddaw", "+m+K,+6+K,+7+N", 0x4a00003f, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vaddax", "+m+K,+6+K,+7+N", 0x4a00003c, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vadday", "+m+K,+6+K,+7+N", 0x4a00003d, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vaddaz", "+m+K,+6+K,+7+N", 0x4a00003e, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vcallms", "+f", 0x4a000038, 0xffe0003f, CP, 0, VU0, 0, 0 },
+{"vcallmsr", "+9", 0x4a000039, 0xffff07ff, CP, 0, VU0, 0, 0 },
+{"vclipw.xyz", "+6+K,+7+N", 0x4bc001ff, 0xffe007ff, CP, 0, VU0, 0, 0 },
+{"vdiv", "+q,+6+L,+7+M", 0x4a0003bc, 0xfe0007ff, CP, 0, VU0, 0, 0 },
+{"vftoi0", "+7+K,+6+K", 0x4a00017c, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vftoi4", "+7+K,+6+K", 0x4a00017d, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vftoi12", "+7+K,+6+K", 0x4a00017e, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vftoi15", "+7+K,+6+K", 0x4a00017f, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"viadd", "+8,+9,+0", 0x4a000030, 0xffe0003f, CP, 0, VU0, 0, 0 },
+{"viaddi", "+0,+9,+g", 0x4a000032, 0xffe0003f, CP, 0, VU0, 0, 0 },
+{"viand", "+8,+9,+0", 0x4a000034, 0xffe0003f, CP, 0, VU0, 0, 0 },
+{"vilwr.w", "+0,(+9)", 0x4a2003fe, 0xffe007ff, CP, 0, VU0, 0, 0 },
+{"vilwr.x", "+0,(+9)", 0x4b0003fe, 0xffe007ff, CP, 0, VU0, 0, 0 },
+{"vilwr.y", "+0,(+9)", 0x4a8003fe, 0xffe007ff, CP, 0, VU0, 0, 0 },
+{"vilwr.z", "+0,(+9)", 0x4a4003fe, 0xffe007ff, CP, 0, VU0, 0, 0 },
+{"vior", "+8,+9,+0", 0x4a000035, 0xffe0003f, CP, 0, VU0, 0, 0 },
+{"viswr.w", "+0,(+9)", 0x4a2003ff, 0xffe007ff, CP, 0, VU0, 0, 0 },
+{"viswr.x", "+0,(+9)", 0x4b0003ff, 0xffe007ff, CP, 0, VU0, 0, 0 },
+{"viswr.y", "+0,(+9)", 0x4a8003ff, 0xffe007ff, CP, 0, VU0, 0, 0 },
+{"viswr.z", "+0,(+9)", 0x4a4003ff, 0xffe007ff, CP, 0, VU0, 0, 0 },
+{"visub", "+8,+9,+0", 0x4a000031, 0xffe0003f, CP, 0, VU0, 0, 0 },
+{"vitof0", "+7+K,+6+K", 0x4a00013c, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vitof4", "+7+K,+6+K", 0x4a00013d, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vitof12", "+7+K,+6+K", 0x4a00013e, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vitof15", "+7+K,+6+K", 0x4a00013f, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vlqd", "+7+K,(#-+9)", 0x4a00037e, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vlqi", "+7+K,(+9#+)", 0x4a00037c, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmadd", "+5+K,+6+K,+7+K", 0x4a000029, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmaddi", "+5+K,+6+K,+y", 0x4a000023, 0xfe1f003f, CP, VU0CH, VU0, 0, 0 },
+{"vmaddq", "+5+K,+6+K,+q", 0x4a000021, 0xfe1f003f, CP, VU0CH, VU0, 0, 0 },
+{"vmaddw", "+5+K,+6+K,+7+N", 0x4a00000b, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmaddx", "+5+K,+6+K,+7+N", 0x4a000008, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmaddy", "+5+K,+6+K,+7+N", 0x4a000009, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmaddz", "+5+K,+6+K,+7+N", 0x4a00000a, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmadda", "+m+K,+6+K,+7+K", 0x4a0002bd, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmaddai", "+m+K,+6+K,+y", 0x4a00023f, 0xfe1f07ff, CP, VU0CH, VU0, 0, 0 },
+{"vmaddaq", "+m+K,+6+K,+q", 0x4a00023d, 0xfe1f07ff, CP, VU0CH, VU0, 0, 0 },
+{"vmaddaw", "+m+K,+6+K,+7+N", 0x4a0000bf, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmaddax", "+m+K,+6+K,+7+N", 0x4a0000bc, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmadday", "+m+K,+6+K,+7+N", 0x4a0000bd, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmaddaz", "+m+K,+6+K,+7+N", 0x4a0000be, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmax", "+5+K,+6+K,+7+K", 0x4a00002b, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmaxi", "+5+K,+6+K,+y", 0x4a00001d, 0xfe1f003f, CP, VU0CH, VU0, 0, 0 },
+{"vmaxw", "+5+K,+6+K,+7+N", 0x4a000013, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmaxx", "+5+K,+6+K,+7+N", 0x4a000010, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmaxy", "+5+K,+6+K,+7+N", 0x4a000011, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmaxz", "+5+K,+6+K,+7+N", 0x4a000012, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmfir", "+7+K,+9", 0x4a0003fd, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmini", "+5+K,+6+K,+7+K", 0x4a00002f, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vminii", "+5+K,+6+K,+y", 0x4a00001f, 0xfe1f003f, CP, VU0CH, VU0, 0, 0 },
+{"vminiw", "+5+K,+6+K,+7+N", 0x4a000017, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vminix", "+5+K,+6+K,+7+N", 0x4a000014, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vminiy", "+5+K,+6+K,+7+N", 0x4a000015, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vminiz", "+5+K,+6+K,+7+N", 0x4a000016, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmove", "+7+K,+6+K", 0x4a00033c, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmr32", "+7+K,+6+K", 0x4a00033d, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmsub", "+5+K,+6+K,+7+K", 0x4a00002d, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmsubi", "+5+K,+6+K,+y", 0x4a000027, 0xfe1f003f, CP, VU0CH, VU0, 0, 0 },
+{"vmsubq", "+5+K,+6+K,+q", 0x4a000025, 0xfe1f003f, CP, VU0CH, VU0, 0, 0 },
+{"vmsubw", "+5+K,+6+K,+7+N", 0x4a00000f, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmsubx", "+5+K,+6+K,+7+N", 0x4a00000c, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmsuby", "+5+K,+6+K,+7+N", 0x4a00000d, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmsubz", "+5+K,+6+K,+7+N", 0x4a00000e, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmsuba", "+m+K,+7+K,+6+K", 0x4a0002fd, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmsubai", "+m+K,+6+K,+y", 0x4a00027f, 0xfe1f07ff, CP, VU0CH, VU0, 0, 0 },
+{"vmsubaq", "+m+K,+6+K,+q", 0x4a00027d, 0xfe1f07ff, CP, VU0CH, VU0, 0, 0 },
+{"vmsubaw", "+m+K,+6+K,+7+N", 0x4a0000ff, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmsubax", "+m+K,+6+K,+7+N", 0x4a0000fc, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmsubay", "+m+K,+6+K,+7+N", 0x4a0000fd, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmsubaz", "+m+K,+6+K,+7+N", 0x4a0000fe, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmtir", "+0,+6+L", 0x4a0003fc, 0xff8007ff, CP, 0, VU0, 0, 0 },
+{"vmul", "+5+K,+6+K,+7+K", 0x4a00002a, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmuli", "+5+K,+6+K,+y", 0x4a00001e, 0xfe1f003f, CP, VU0CH, VU0, 0, 0 },
+{"vmulq", "+5+K,+6+K,+q", 0x4a00001c, 0xfe1f003f, CP, VU0CH, VU0, 0, 0 },
+{"vmulw", "+5+K,+6+K,+7+N", 0x4a00001b, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmulx", "+5+K,+6+K,+7+N", 0x4a000018, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmuly", "+5+K,+6+K,+7+N", 0x4a000019, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmulz", "+5+K,+6+K,+7+N", 0x4a00001a, 0xfe00003f, CP, VU0CH, VU0, 0, 0 },
+{"vmula", "+m+K,+6+K,+7+K", 0x4a0002be, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmulai", "+m+K,+6+K,+y", 0x4a0001fe, 0xfe1f07ff, CP, VU0CH, VU0, 0, 0 },
+{"vmulaq", "+m+K,+6+K,+q", 0x4a0001fc, 0xfe1f07ff, CP, VU0CH, VU0, 0, 0 },
+{"vmulaw", "+m+K,+6+K,+7+N", 0x4a0001bf, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmulax", "+m+K,+6+K,+7+N", 0x4a0001bc, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmulay", "+m+K,+6+K,+7+N", 0x4a0001bd, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vmulaz", "+m+K,+6+K,+7+N", 0x4a0001be, 0xfe0007ff, CP, VU0CH, VU0, 0, 0 },
+{"vnop", "", 0x4a0002ff, 0xffffffff, CP, 0, VU0, 0, 0 },
+{"vopmula.xyz", "+m+K,+6+K,+7+K", 0x4bc002fe, 0xffe007ff, CP, 0, VU0, 0, 0 },
+{"vopmula", "+m+K,+6+K,+7+K", 0x4bc002fe, 0xffe007ff, CP, 0, VU0, 0, 0 },
+{"vopmsub.xyz", "+5+K,+6+K,+7+K", 0x4bc0002e, 0xffe0003f, CP, 0, VU0, 0, 0 },
+{"vopmsub", "+5+K,+6+K,+7+K", 0x4bc0002e, 0xffe0003f, CP, 0, VU0, 0, 0 },
+{"vrget", "+7+K,+r", 0x4a00043d, 0xfe00ffff, CP, VU0CH, VU0, 0, 0 },
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+{"vwaitq", "", 0x4a0003bf, 0xffffffff, CP, 0, VU0, 0, 0 },
+
{"abs", "d,v", 0, (int) M_ABS, INSN_MACRO, 0, I1, 0, 0 },
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{"lld", "t,A(b)", 0, (int) M_LLD_AB, INSN_MACRO, 0, I3, 0, EE },
{"lq", "t,o(b)", 0x78000000, 0xfc000000, WR_1|RD_3, 0, MMI, 0, 0 },
{"lq", "t,A(b)", 0, (int) M_LQ_AB, INSN_MACRO, 0, MMI, 0, 0 },
-{"lqc2", "E,o(b)", 0xd8000000, 0xfc000000, RD_3|WR_C2, 0, EE, 0, 0 },
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+{"lqc2", "+7,o(b)", 0xd8000000, 0xfc000000, RD_3|WR_C2, 0, EE, 0, 0 },
+{"lqc2", "+7,A(b)", 0, (int) M_LQC2_AB, INSN_MACRO, 0, EE, 0, 0 },
{"lui", "t,u", 0x3c000000, 0xffe00000, WR_1, 0, I1, 0, 0 },
{"luxc1", "D,t(b)", 0x4c000005, 0xfc00f83f, WR_1|RD_2|RD_3|LDD|FP_D, 0, I5_33|N55, 0, 0},
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{"snei", "t,r,+Q", 0x7000002f, 0xfc00003f, WR_1|RD_2, 0, IOCT, 0, 0 },
{"sq", "t,o(b)", 0x7c000000, 0xfc000000, RD_1|RD_3|SM, 0, MMI, 0, 0 },
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-{"sqc2", "E,o(b)", 0xf8000000, 0xfc000000, RD_3|RD_C2|SM, 0, EE, 0, 0 },
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+{"sqc2", "+7,o(b)", 0xf8000000, 0xfc000000, RD_3|RD_C2|SM, 0, EE, 0, 0 },
+{"sqc2", "+7,A(b)", 0, (int) M_SQC2_AB, INSN_MACRO, 0, EE, 0, 0 },
{"sqrt.d", "D,S", 0x46200004, 0xffff003f, WR_1|RD_2|FP_D, 0, I2, 0, SF },
{"sqrt.s", "D,S", 0x46000004, 0xffff003f, WR_1|RD_2|FP_S, 0, I2, 0, 0 },
{"sqrt.ps", "D,S", 0x46c00004, 0xffff003f, WR_1|RD_2|FP_D, 0, SB1, 0, 0 },
{"bc2t", "N,p", 0x49010000, 0xffe30000, RD_CC|CBD, 0, I32, 0, IOCT|IOCTP|IOCT2 },
{"bc2tl", "p", 0x49030000, 0xffff0000, RD_CC|CBL, 0, I2|T3, 0, IOCT|IOCTP|IOCT2 },
{"bc2tl", "N,p", 0x49030000, 0xffe30000, RD_CC|CBL, 0, I32, 0, IOCT|IOCTP|IOCT2 },
-{"cfc2", "t,G", 0x48400000, 0xffe007ff, WR_1|RD_C2|LCD, 0, I1, 0, IOCT|IOCTP|IOCT2 },
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-{"qmfc2", "t,G", 0x48200000, 0xffe007ff, WR_1|RD_C2, 0, EE, 0, 0 },
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-{"qmtc2.ni", "t,G", 0x48a00000, 0xffe007ff, RD_1|WR_C2, 0, EE, 0, 0 },
+{"qmfc2", "t,+6", 0x48200000, 0xffe007ff, WR_1|RD_C2, 0, EE, 0, 0 },
+{"qmfc2.i", "t,+6", 0x48200001, 0xffe007ff, WR_1|RD_C2, 0, EE, 0, 0 },
+{"qmfc2.ni", "t,+6", 0x48200000, 0xffe007ff, WR_1|RD_C2, 0, EE, 0, 0 },
+{"qmtc2", "t,+6", 0x48a00000, 0xffe007ff, RD_1|WR_C2, 0, EE, 0, 0 },
+{"qmtc2.i", "t,+6", 0x48a00001, 0xffe007ff, RD_1|WR_C2, 0, EE, 0, 0 },
+{"qmtc2.ni", "t,+6", 0x48a00000, 0xffe007ff, RD_1|WR_C2, 0, EE, 0, 0 },
/* Coprocessor 3 move/branch operations overlap with MIPS IV COP1X
instructions, so they are here for the latters to take precedence. */
{"bc3f", "p", 0x4d000000, 0xffff0000, RD_CC|CBD, 0, I1, 0, IOCT|IOCTP|IOCT2|EE },
projects / external / binutils.git / commitdiff