pinctrl: tegra-xusb: Correct lane mux options
authorJon Hunter <jonathanh@nvidia.com>
Fri, 16 Oct 2015 09:24:01 +0000 (10:24 +0100)
committerLinus Walleij <linus.walleij@linaro.org>
Tue, 27 Oct 2015 16:06:23 +0000 (17:06 +0100)
commit9d4cc85d290578ec07e37d063d73f0e8707ea3eb
tree0edeabc05499e3dab4000288105c936bd72a9efc
parentee1a6ca43dba07465c71f6ab661702d703f5eb06
pinctrl: tegra-xusb: Correct lane mux options

The description of the XUSB_PADCTL_USB3_PAD_MUX_0 register in the Tegra124
documentation implies that all functions (pcie, usb3 and sata) can be
muxed onto to all lanes (pcie lanes 0-4 and sata lane 0). However, it has
been confirmed that this is not the case and the mux'ing options much more
limited. Unfortunately, the public documentation has not been updated to
reflect this and so detail the actual mux'ing options here by function:

Function: Lanes:
pcie1 x2: pcie3, pcie4
pcie1 x4: pcie1, pcie2, pcie3, pcie4
pcie2 x1 (option1): pcie0
pcie2 x1 (option2): pcie2
usb3 port 0: pcie0
usb3 port 1 (option 1): pcie1
usb3 port 1 (option 2): sata0
sata: sata0

Signed-off-by: Jon Hunter <jonathanh@nvidia.com>
Acked-by: Stephen Warren <swarren@nvidia.com>
Signed-off-by: Linus Walleij <linus.walleij@linaro.org>
drivers/pinctrl/pinctrl-tegra-xusb.c