parisc: Fix exception handler for fldw and fstw instructions
authorHelge Deller <deller@gmx.de>
Sat, 20 Aug 2022 15:59:17 +0000 (17:59 +0200)
committerHelge Deller <deller@gmx.de>
Sun, 21 Aug 2022 06:43:09 +0000 (08:43 +0200)
commit7ae1f5508d9a33fd58ed3059bd2d569961e3b8bd
tree93e6bcf4c56c21ea6f9adcaa16da43b29243e359
parent568035b01cfb107af8d2e4bd2fb9aea22cf5b868
parisc: Fix exception handler for fldw and fstw instructions

The exception handler is broken for unaligned memory acceses with fldw
and fstw instructions, because it trashes or uses randomly some other
floating point register than the one specified in the instruction word
on loads and stores.

The instruction "fldw 0(addr),%fr22L" (and the other fldw/fstw
instructions) encode the target register (%fr22) in the rightmost 5 bits
of the instruction word. The 7th rightmost bit of the instruction word
defines if the left or right half of %fr22 should be used.

While processing unaligned address accesses, the FR3() define is used to
extract the offset into the local floating-point register set.  But the
calculation in FR3() was buggy, so that for example instead of %fr22,
register %fr12 [((22 * 2) & 0x1f) = 12] was used.

This bug has been since forever in the parisc kernel and I wonder why it
wasn't detected earlier. Interestingly I noticed this bug just because
the libime debian package failed to build on *native* hardware, while it
successfully built in qemu.

This patch corrects the bitshift and masking calculation in FR3().

Signed-off-by: Helge Deller <deller@gmx.de>
Cc: <stable@vger.kernel.org>
arch/parisc/kernel/unaligned.c