bus: mbus: fix window size calculation for 4GB windows
authorJan Luebbe <jlu@pengutronix.de>
Mon, 28 Aug 2017 15:25:16 +0000 (17:25 +0200)
committerGregory CLEMENT <gregory.clement@free-electrons.com>
Thu, 12 Oct 2017 13:01:30 +0000 (15:01 +0200)
commit2bbbd96357ce76cc45ec722c00f654aa7b189112
tree45980b752faf887d9e6e21e1a3da1d268fe99f67
parentfbffee74986c899524de5707dab9cf321d02dab8
bus: mbus: fix window size calculation for 4GB windows

At least the Armada XP SoC supports 4GB on a single DRAM window. Because
the size register values contain the actual size - 1, the MSB is set in
that case. For example, the SDRAM window's control register's value is
0xffffffe1 for 4GB (bits 31 to 24 contain the size).

The MBUS driver reads back each window's size from registers and
calculates the actual size as (control_reg | ~DDR_SIZE_MASK) + 1, which
overflows for 32 bit values, resulting in other miscalculations further
on (a bad RAM window for the CESA crypto engine calculated by
mvebu_mbus_setup_cpu_target_nooverlap() in my case).

This patch changes the type in 'struct mbus_dram_window' from u32 to
u64, which allows us to keep using the same register calculation code in
most MBUS-using drivers (which calculate ->size - 1 again).

Fixes: fddddb52a6c4 ("bus: introduce an Marvell EBU MBus driver")
CC: stable@vger.kernel.org
Signed-off-by: Jan Luebbe <jlu@pengutronix.de>
Signed-off-by: Gregory CLEMENT <gregory.clement@free-electrons.com>
drivers/bus/mvebu-mbus.c
include/linux/mbus.h