/* Print i386 instructions for GDB, the GNU debugger.
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This file is part of the GNU opcodes library.
static void OP_VEX (int, int);
static void OP_EX_Vex (int, int);
static void OP_EX_VexW (int, int);
+static void OP_EX_VexImmW (int, int);
static void OP_XMM_Vex (int, int);
static void OP_XMM_VexW (int, int);
+static void OP_Rounding (int, int);
static void OP_REG_VexI4 (int, int);
static void PCLMUL_Fixup (int, int);
static void VEXI4_Fixup (int, int);
static void VZERO_Fixup (int, int);
static void VCMP_Fixup (int, int);
+static void VPCMP_Fixup (int, int);
static void OP_0f07 (int, int);
static void OP_Monitor (int, int);
static void OP_Mwait (int, int);
static void CMP_Fixup (int, int);
static void BadOp (void);
static void REP_Fixup (int, int);
+static void BND_Fixup (int, int);
+static void HLE_Fixup1 (int, int);
+static void HLE_Fixup2 (int, int);
+static void HLE_Fixup3 (int, int);
static void CMPXCHG8B_Fixup (int, int);
static void XMM_Fixup (int, int);
static void CRC32_Fixup (int, int);
static void FXSAVE_Fixup (int, int);
static void OP_LWPCB_E (int, int);
static void OP_LWP_E (int, int);
-static void OP_LWP_I (int, int);
static void OP_Vex_2src_1 (int, int);
static void OP_Vex_2src_2 (int, int);
static void MOVBE_Fixup (int, int);
+static void OP_Mask (int, int);
+
struct dis_private {
/* Points to first byte not fetched. */
bfd_byte *max_fetched;
bfd_byte the_buffer[MAX_MNEM_SIZE];
bfd_vma insn_start;
int orig_sizeflag;
- jmp_buf bailout;
+ OPCODES_SIGJMP_BUF bailout;
};
enum address_mode
static int rex;
/* Bits of REX we've already used. */
static int rex_used;
-/* Original REX prefix. */
-static int rex_original;
-/* REX bits in original REX prefix ignored. It may not be the same
- as rex_original since some bits may not be ignored. */
+/* REX bits in original REX prefix ignored. */
static int rex_ignored;
/* Mark parts used in the REX prefix. When we are testing for
empty prefix (for 8bit register REX extension), just mask it
STATUS. */
if (priv->max_fetched == priv->the_buffer)
(*info->memory_error_func) (status, start, info);
- longjmp (priv->bailout, 1);
+ OPCODES_SIGLONGJMP (priv->bailout, 1);
}
else
priv->max_fetched = addr;
}
#define XX { NULL, 0 }
+#define Bad_Opcode NULL, { { NULL, 0 } }
#define Eb { OP_E, b_mode }
+#define Ebnd { OP_E, bnd_mode }
#define EbS { OP_E, b_swap_mode }
#define Ev { OP_E, v_mode }
+#define Ev_bnd { OP_E, v_bnd_mode }
#define EvS { OP_E, v_swap_mode }
#define Ed { OP_E, d_mode }
#define Edq { OP_E, dq_mode }
#define Edqw { OP_E, dqw_mode }
+#define EdqwS { OP_E, dqw_swap_mode }
#define Edqb { OP_E, dqb_mode }
+#define Edb { OP_E, db_mode }
+#define Edw { OP_E, dw_mode }
#define Edqd { OP_E, dqd_mode }
#define Eq { OP_E, q_mode }
#define indirEv { OP_indirE, stack_v_mode }
#define Mx { OP_M, x_mode }
#define Mxmm { OP_M, xmm_mode }
#define Gb { OP_G, b_mode }
+#define Gbnd { OP_G, bnd_mode }
#define Gv { OP_G, v_mode }
#define Gd { OP_G, d_mode }
#define Gdq { OP_G, dq_mode }
#define Gm { OP_G, m_mode }
#define Gw { OP_G, w_mode }
#define Rd { OP_R, d_mode }
+#define Rdq { OP_R, dq_mode }
#define Rm { OP_R, m_mode }
#define Ib { OP_I, b_mode }
#define sIb { OP_sI, b_mode } /* sign extened byte */
+#define sIbT { OP_sI, b_T_mode } /* sign extened byte like 'T' */
#define Iv { OP_I, v_mode }
+#define sIv { OP_sI, v_mode }
#define Iq { OP_I, q_mode }
#define Iv64 { OP_I64, v_mode }
#define Iw { OP_I, w_mode }
#define RMrSI { OP_REG, rSI_reg }
#define RMrDI { OP_REG, rDI_reg }
#define RMAL { OP_REG, al_reg }
-#define RMAL { OP_REG, al_reg }
#define RMCL { OP_REG, cl_reg }
#define RMDL { OP_REG, dl_reg }
#define RMBL { OP_REG, bl_reg }
#define MX { OP_MMX, 0 }
#define XM { OP_XMM, 0 }
+#define XMScalar { OP_XMM, scalar_mode }
+#define XMGatherQ { OP_XMM, vex_vsib_q_w_dq_mode }
#define XMM { OP_XMM, xmm_mode }
+#define XMxmmq { OP_XMM, xmmq_mode }
#define EM { OP_EM, v_mode }
#define EMS { OP_EM, v_swap_mode }
#define EMd { OP_EM, d_mode }
#define EMx { OP_EM, x_mode }
#define EXw { OP_EX, w_mode }
#define EXd { OP_EX, d_mode }
+#define EXdScalar { OP_EX, d_scalar_mode }
#define EXdS { OP_EX, d_swap_mode }
+#define EXdScalarS { OP_EX, d_scalar_swap_mode }
#define EXq { OP_EX, q_mode }
+#define EXqScalar { OP_EX, q_scalar_mode }
+#define EXqScalarS { OP_EX, q_scalar_swap_mode }
#define EXqS { OP_EX, q_swap_mode }
#define EXx { OP_EX, x_mode }
#define EXxS { OP_EX, x_swap_mode }
#define EXxmm { OP_EX, xmm_mode }
+#define EXymm { OP_EX, ymm_mode }
#define EXxmmq { OP_EX, xmmq_mode }
+#define EXEvexHalfBcstXmmq { OP_EX, evex_half_bcst_xmmq_mode }
+#define EXxmm_mb { OP_EX, xmm_mb_mode }
+#define EXxmm_mw { OP_EX, xmm_mw_mode }
+#define EXxmm_md { OP_EX, xmm_md_mode }
+#define EXxmm_mq { OP_EX, xmm_mq_mode }
+#define EXxmm_mdq { OP_EX, xmm_mdq_mode }
+#define EXxmmdw { OP_EX, xmmdw_mode }
+#define EXxmmqd { OP_EX, xmmqd_mode }
#define EXymmq { OP_EX, ymmq_mode }
#define EXVexWdq { OP_EX, vex_w_dq_mode }
+#define EXVexWdqScalar { OP_EX, vex_scalar_w_dq_mode }
+#define EXEvexXGscat { OP_EX, evex_x_gscat_mode }
+#define EXEvexXNoBcst { OP_EX, evex_x_nobcst_mode }
#define MS { OP_MS, v_mode }
#define XS { OP_XS, v_mode }
#define EMCq { OP_EMC, q_mode }
#define Vex_2src_2 { OP_Vex_2src_2, 0 }
#define Vex { OP_VEX, vex_mode }
+#define VexScalar { OP_VEX, vex_scalar_mode }
+#define VexGatherQ { OP_VEX, vex_vsib_q_w_dq_mode }
#define Vex128 { OP_VEX, vex128_mode }
#define Vex256 { OP_VEX, vex256_mode }
+#define VexGdq { OP_VEX, dq_mode }
#define VexI4 { VEXI4_Fixup, 0}
#define EXdVex { OP_EX_Vex, d_mode }
#define EXdVexS { OP_EX_Vex, d_swap_mode }
+#define EXdVexScalarS { OP_EX_Vex, d_scalar_swap_mode }
#define EXqVex { OP_EX_Vex, q_mode }
#define EXqVexS { OP_EX_Vex, q_swap_mode }
+#define EXqVexScalarS { OP_EX_Vex, q_scalar_swap_mode }
#define EXVexW { OP_EX_VexW, x_mode }
#define EXdVexW { OP_EX_VexW, d_mode }
#define EXqVexW { OP_EX_VexW, q_mode }
+#define EXVexImmW { OP_EX_VexImmW, x_mode }
#define XMVex { OP_XMM_Vex, 0 }
+#define XMVexScalar { OP_XMM_Vex, scalar_mode }
#define XMVexW { OP_XMM_VexW, 0 }
#define XMVexI4 { OP_REG_VexI4, x_mode }
#define PCLMUL { PCLMUL_Fixup, 0 }
#define VZERO { VZERO_Fixup, 0 }
#define VCMP { VCMP_Fixup, 0 }
+#define VPCMP { VPCMP_Fixup, 0 }
+
+#define EXxEVexR { OP_Rounding, evex_rounding_mode }
+#define EXxEVexS { OP_Rounding, evex_sae_mode }
+
+#define XMask { OP_Mask, mask_mode }
+#define MaskG { OP_G, mask_mode }
+#define MaskE { OP_E, mask_mode }
+#define MaskBDE { OP_E, mask_bd_mode }
+#define MaskR { OP_R, mask_mode }
+#define MaskVex { OP_VEX, mask_mode }
+
+#define MVexVSIBDWpX { OP_M, vex_vsib_d_w_dq_mode }
+#define MVexVSIBDQWpX { OP_M, vex_vsib_d_w_d_mode }
+#define MVexVSIBQWpX { OP_M, vex_vsib_q_w_dq_mode }
+#define MVexVSIBQDWpX { OP_M, vex_vsib_q_w_d_mode }
/* Used handle "rep" prefix for string instructions. */
#define Xbr { REP_Fixup, eSI_reg }
#define ALr { REP_Fixup, al_reg }
#define eAXr { REP_Fixup, eAX_reg }
+/* Used handle HLE prefix for lockable instructions. */
+#define Ebh1 { HLE_Fixup1, b_mode }
+#define Evh1 { HLE_Fixup1, v_mode }
+#define Ebh2 { HLE_Fixup2, b_mode }
+#define Evh2 { HLE_Fixup2, v_mode }
+#define Ebh3 { HLE_Fixup3, b_mode }
+#define Evh3 { HLE_Fixup3, v_mode }
+
+#define BND { BND_Fixup, 0 }
+
#define cond_jump_flag { NULL, cond_jump_mode }
#define loop_jcxz_flag { NULL, loop_jcxz_mode }
b_mode = 1,
/* byte operand with operand swapped */
b_swap_mode,
+ /* byte operand, sign extend like 'T' suffix */
+ b_T_mode,
/* operand size depends on prefixes */
v_mode,
/* operand size depends on prefixes with operand swapped */
q_swap_mode,
/* ten-byte operand */
t_mode,
- /* 16-byte XMM or 32-byte YMM operand */
+ /* 16-byte XMM, 32-byte YMM or 64-byte ZMM operand. In EVEX with
+ broadcast enabled. */
x_mode,
- /* 16-byte XMM or 32-byte YMM operand with operand swapped */
+ /* Similar to x_mode, but with different EVEX mem shifts. */
+ evex_x_gscat_mode,
+ /* Similar to x_mode, but with disabled broadcast. */
+ evex_x_nobcst_mode,
+ /* Similar to x_mode, but with operands swapped and disabled broadcast
+ in EVEX. */
x_swap_mode,
/* 16-byte XMM operand */
xmm_mode,
- /* 16-byte XMM or quad word operand */
+ /* XMM, XMM or YMM register operand, or quad word, xmmword or ymmword
+ memory operand (depending on vector length). Broadcast isn't
+ allowed. */
xmmq_mode,
- /* 32-byte YMM or quad word operand */
+ /* Same as xmmq_mode, but broadcast is allowed. */
+ evex_half_bcst_xmmq_mode,
+ /* XMM register or byte memory operand */
+ xmm_mb_mode,
+ /* XMM register or word memory operand */
+ xmm_mw_mode,
+ /* XMM register or double word memory operand */
+ xmm_md_mode,
+ /* XMM register or quad word memory operand */
+ xmm_mq_mode,
+ /* XMM register or double/quad word memory operand, depending on
+ VEX.W. */
+ xmm_mdq_mode,
+ /* 16-byte XMM, word, double word or quad word operand. */
+ xmmdw_mode,
+ /* 16-byte XMM, double word, quad word operand or xmm word operand. */
+ xmmqd_mode,
+ /* 32-byte YMM operand */
+ ymm_mode,
+ /* quad word, ymmword or zmmword memory operand. */
ymmq_mode,
+ /* 32-byte YMM or 16-byte word operand */
+ ymmxmm_mode,
/* d_mode in 32bit, q_mode in 64bit mode. */
m_mode,
/* pair of v_mode operands */
a_mode,
cond_jump_mode,
loop_jcxz_mode,
+ v_bnd_mode,
/* operand size depends on REX prefixes. */
dq_mode,
/* registers like dq_mode, memory like w_mode. */
dqw_mode,
+ dqw_swap_mode,
+ bnd_mode,
/* 4- or 6-byte pointer operand */
f_mode,
const_1_mode,
o_mode,
/* registers like dq_mode, memory like b_mode. */
dqb_mode,
+ /* registers like d_mode, memory like b_mode. */
+ db_mode,
+ /* registers like d_mode, memory like w_mode. */
+ dw_mode,
/* registers like dq_mode, memory like d_mode. */
dqd_mode,
/* normal vex mode */
/* operand size depends on the VEX.W bit. */
vex_w_dq_mode,
+ /* Similar to vex_w_dq_mode, with VSIB dword indices. */
+ vex_vsib_d_w_dq_mode,
+ /* Similar to vex_vsib_d_w_dq_mode, with smaller memory. */
+ vex_vsib_d_w_d_mode,
+ /* Similar to vex_w_dq_mode, with VSIB qword indices. */
+ vex_vsib_q_w_dq_mode,
+ /* Similar to vex_vsib_q_w_dq_mode, with smaller memory. */
+ vex_vsib_q_w_d_mode,
+
+ /* scalar, ignore vector length. */
+ scalar_mode,
+ /* like d_mode, ignore vector length. */
+ d_scalar_mode,
+ /* like d_swap_mode, ignore vector length. */
+ d_scalar_swap_mode,
+ /* like q_mode, ignore vector length. */
+ q_scalar_mode,
+ /* like q_swap_mode, ignore vector length. */
+ q_scalar_swap_mode,
+ /* like vex_mode, ignore vector length. */
+ vex_scalar_mode,
+ /* like vex_w_dq_mode, ignore vector length. */
+ vex_scalar_w_dq_mode,
+
+ /* Static rounding. */
+ evex_rounding_mode,
+ /* Supress all exceptions. */
+ evex_sae_mode,
+
+ /* Mask register operand. */
+ mask_mode,
+ /* Mask register operand. */
+ mask_bd_mode,
+
es_reg,
cs_reg,
ss_reg,
USE_VEX_C4_TABLE,
USE_VEX_C5_TABLE,
USE_VEX_LEN_TABLE,
- USE_VEX_W_TABLE
+ USE_VEX_W_TABLE,
+ USE_EVEX_TABLE
};
#define FLOAT NULL, { { NULL, FLOATCODE } }
#define VEX_C5_TABLE(I) DIS386 (USE_VEX_C5_TABLE, (I))
#define VEX_LEN_TABLE(I) DIS386 (USE_VEX_LEN_TABLE, (I))
#define VEX_W_TABLE(I) DIS386 (USE_VEX_W_TABLE, (I))
+#define EVEX_TABLE(I) DIS386 (USE_EVEX_TABLE, (I))
enum
{
REG_0FAE,
REG_0FBA,
REG_0FC7,
- REG_VEX_71,
- REG_VEX_72,
- REG_VEX_73,
- REG_VEX_AE,
+ REG_VEX_0F71,
+ REG_VEX_0F72,
+ REG_VEX_0F73,
+ REG_VEX_0FAE,
+ REG_VEX_0F38F3,
REG_XOP_LWPCB,
- REG_XOP_LWP
+ REG_XOP_LWP,
+ REG_XOP_TBM_01,
+ REG_XOP_TBM_02,
+
+ REG_EVEX_0F71,
+ REG_EVEX_0F72,
+ REG_EVEX_0F73,
+ REG_EVEX_0F38C6,
+ REG_EVEX_0F38C7
};
enum
{
MOD_8D = 0,
+ MOD_C6_REG_7,
+ MOD_C7_REG_7,
+ MOD_FF_REG_3,
+ MOD_FF_REG_5,
MOD_0F01_REG_0,
MOD_0F01_REG_1,
MOD_0F01_REG_2,
MOD_0F18_REG_1,
MOD_0F18_REG_2,
MOD_0F18_REG_3,
- MOD_0F20,
- MOD_0F21,
- MOD_0F22,
- MOD_0F23,
+ MOD_0F18_REG_4,
+ MOD_0F18_REG_5,
+ MOD_0F18_REG_6,
+ MOD_0F18_REG_7,
+ MOD_0F1A_PREFIX_0,
+ MOD_0F1B_PREFIX_0,
+ MOD_0F1B_PREFIX_1,
MOD_0F24,
MOD_0F26,
MOD_0F2B_PREFIX_0,
MOD_0FB2,
MOD_0FB4,
MOD_0FB5,
+ MOD_0FC7_REG_3,
+ MOD_0FC7_REG_4,
+ MOD_0FC7_REG_5,
MOD_0FC7_REG_6,
MOD_0FC7_REG_7,
MOD_0FD7,
MOD_62_32BIT,
MOD_C4_32BIT,
MOD_C5_32BIT,
- MOD_VEX_12_PREFIX_0,
- MOD_VEX_13,
- MOD_VEX_16_PREFIX_0,
- MOD_VEX_17,
- MOD_VEX_2B,
- MOD_VEX_50,
- MOD_VEX_71_REG_2,
- MOD_VEX_71_REG_4,
- MOD_VEX_71_REG_6,
- MOD_VEX_72_REG_2,
- MOD_VEX_72_REG_4,
- MOD_VEX_72_REG_6,
- MOD_VEX_73_REG_2,
- MOD_VEX_73_REG_3,
- MOD_VEX_73_REG_6,
- MOD_VEX_73_REG_7,
- MOD_VEX_AE_REG_2,
- MOD_VEX_AE_REG_3,
- MOD_VEX_D7_PREFIX_2,
- MOD_VEX_E7_PREFIX_2,
- MOD_VEX_F0_PREFIX_3,
- MOD_VEX_3818_PREFIX_2,
- MOD_VEX_3819_PREFIX_2,
- MOD_VEX_381A_PREFIX_2,
- MOD_VEX_382A_PREFIX_2,
- MOD_VEX_382C_PREFIX_2,
- MOD_VEX_382D_PREFIX_2,
- MOD_VEX_382E_PREFIX_2,
- MOD_VEX_382F_PREFIX_2
+ MOD_VEX_0F12_PREFIX_0,
+ MOD_VEX_0F13,
+ MOD_VEX_0F16_PREFIX_0,
+ MOD_VEX_0F17,
+ MOD_VEX_0F2B,
+ MOD_VEX_0F50,
+ MOD_VEX_0F71_REG_2,
+ MOD_VEX_0F71_REG_4,
+ MOD_VEX_0F71_REG_6,
+ MOD_VEX_0F72_REG_2,
+ MOD_VEX_0F72_REG_4,
+ MOD_VEX_0F72_REG_6,
+ MOD_VEX_0F73_REG_2,
+ MOD_VEX_0F73_REG_3,
+ MOD_VEX_0F73_REG_6,
+ MOD_VEX_0F73_REG_7,
+ MOD_VEX_0FAE_REG_2,
+ MOD_VEX_0FAE_REG_3,
+ MOD_VEX_0FD7_PREFIX_2,
+ MOD_VEX_0FE7_PREFIX_2,
+ MOD_VEX_0FF0_PREFIX_3,
+ MOD_VEX_0F381A_PREFIX_2,
+ MOD_VEX_0F382A_PREFIX_2,
+ MOD_VEX_0F382C_PREFIX_2,
+ MOD_VEX_0F382D_PREFIX_2,
+ MOD_VEX_0F382E_PREFIX_2,
+ MOD_VEX_0F382F_PREFIX_2,
+ MOD_VEX_0F385A_PREFIX_2,
+ MOD_VEX_0F388C_PREFIX_2,
+ MOD_VEX_0F388E_PREFIX_2,
+
+ MOD_EVEX_0F10_PREFIX_1,
+ MOD_EVEX_0F10_PREFIX_3,
+ MOD_EVEX_0F11_PREFIX_1,
+ MOD_EVEX_0F11_PREFIX_3,
+ MOD_EVEX_0F12_PREFIX_0,
+ MOD_EVEX_0F16_PREFIX_0,
+ MOD_EVEX_0F38C6_REG_1,
+ MOD_EVEX_0F38C6_REG_2,
+ MOD_EVEX_0F38C6_REG_5,
+ MOD_EVEX_0F38C6_REG_6,
+ MOD_EVEX_0F38C7_REG_1,
+ MOD_EVEX_0F38C7_REG_2,
+ MOD_EVEX_0F38C7_REG_5,
+ MOD_EVEX_0F38C7_REG_6
};
enum
{
- RM_0F01_REG_0 = 0,
+ RM_C6_REG_7 = 0,
+ RM_C7_REG_7,
+ RM_0F01_REG_0,
RM_0F01_REG_1,
RM_0F01_REG_2,
RM_0F01_REG_3,
PREFIX_0F11,
PREFIX_0F12,
PREFIX_0F16,
+ PREFIX_0F1A,
+ PREFIX_0F1B,
PREFIX_0F2A,
PREFIX_0F2B,
PREFIX_0F2C,
PREFIX_0F7D,
PREFIX_0F7E,
PREFIX_0F7F,
+ PREFIX_0FAE_REG_0,
+ PREFIX_0FAE_REG_1,
+ PREFIX_0FAE_REG_2,
+ PREFIX_0FAE_REG_3,
+ PREFIX_0FAE_REG_6,
+ PREFIX_0FAE_REG_7,
+ PREFIX_RM_0_0FAE_REG_7,
PREFIX_0FB8,
+ PREFIX_0FBC,
PREFIX_0FBD,
PREFIX_0FC2,
PREFIX_0FC3,
PREFIX_0F3841,
PREFIX_0F3880,
PREFIX_0F3881,
+ PREFIX_0F3882,
+ PREFIX_0F38C8,
+ PREFIX_0F38C9,
+ PREFIX_0F38CA,
+ PREFIX_0F38CB,
+ PREFIX_0F38CC,
+ PREFIX_0F38CD,
PREFIX_0F38DB,
PREFIX_0F38DC,
PREFIX_0F38DD,
PREFIX_0F38DF,
PREFIX_0F38F0,
PREFIX_0F38F1,
+ PREFIX_0F38F6,
PREFIX_0F3A08,
PREFIX_0F3A09,
PREFIX_0F3A0A,
PREFIX_0F3A61,
PREFIX_0F3A62,
PREFIX_0F3A63,
+ PREFIX_0F3ACC,
PREFIX_0F3ADF,
- PREFIX_VEX_10,
- PREFIX_VEX_11,
- PREFIX_VEX_12,
- PREFIX_VEX_16,
- PREFIX_VEX_2A,
- PREFIX_VEX_2C,
- PREFIX_VEX_2D,
- PREFIX_VEX_2E,
- PREFIX_VEX_2F,
- PREFIX_VEX_51,
- PREFIX_VEX_52,
- PREFIX_VEX_53,
- PREFIX_VEX_58,
- PREFIX_VEX_59,
- PREFIX_VEX_5A,
- PREFIX_VEX_5B,
- PREFIX_VEX_5C,
- PREFIX_VEX_5D,
- PREFIX_VEX_5E,
- PREFIX_VEX_5F,
- PREFIX_VEX_60,
- PREFIX_VEX_61,
- PREFIX_VEX_62,
- PREFIX_VEX_63,
- PREFIX_VEX_64,
- PREFIX_VEX_65,
- PREFIX_VEX_66,
- PREFIX_VEX_67,
- PREFIX_VEX_68,
- PREFIX_VEX_69,
- PREFIX_VEX_6A,
- PREFIX_VEX_6B,
- PREFIX_VEX_6C,
- PREFIX_VEX_6D,
- PREFIX_VEX_6E,
- PREFIX_VEX_6F,
- PREFIX_VEX_70,
- PREFIX_VEX_71_REG_2,
- PREFIX_VEX_71_REG_4,
- PREFIX_VEX_71_REG_6,
- PREFIX_VEX_72_REG_2,
- PREFIX_VEX_72_REG_4,
- PREFIX_VEX_72_REG_6,
- PREFIX_VEX_73_REG_2,
- PREFIX_VEX_73_REG_3,
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+ VEX_W_0F3807_P_2,
+ VEX_W_0F3808_P_2,
+ VEX_W_0F3809_P_2,
+ VEX_W_0F380A_P_2,
+ VEX_W_0F380B_P_2,
+ VEX_W_0F380C_P_2,
+ VEX_W_0F380D_P_2,
+ VEX_W_0F380E_P_2,
+ VEX_W_0F380F_P_2,
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+ VEX_W_0F3A02_P_2,
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+ VEX_W_0F3A05_P_2,
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+ VEX_W_0F3A0A_P_2,
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+ VEX_W_0F3A0F_P_2,
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+ VEX_W_0F3A15_P_2,
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+ VEX_W_0F3A19_P_2,
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+ VEX_W_0F3A21_P_2,
+ VEX_W_0F3A30_P_2_LEN_0,
+ VEX_W_0F3A31_P_2_LEN_0,
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+ VEX_W_0F3A41_P_2,
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+ VEX_W_0F3A44_P_2,
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+ VEX_W_0F3A48_P_2,
+ VEX_W_0F3A49_P_2,
+ VEX_W_0F3A4A_P_2,
+ VEX_W_0F3A4B_P_2,
+ VEX_W_0F3A4C_P_2,
+ VEX_W_0F3A60_P_2,
+ VEX_W_0F3A61_P_2,
+ VEX_W_0F3A62_P_2,
+ VEX_W_0F3A63_P_2,
+ VEX_W_0F3ADF_P_2,
+
+ EVEX_W_0F10_P_0,
+ EVEX_W_0F10_P_1_M_0,
+ EVEX_W_0F10_P_1_M_1,
+ EVEX_W_0F10_P_2,
+ EVEX_W_0F10_P_3_M_0,
+ EVEX_W_0F10_P_3_M_1,
+ EVEX_W_0F11_P_0,
+ EVEX_W_0F11_P_1_M_0,
+ EVEX_W_0F11_P_1_M_1,
+ EVEX_W_0F11_P_2,
+ EVEX_W_0F11_P_3_M_0,
+ EVEX_W_0F11_P_3_M_1,
+ EVEX_W_0F12_P_0_M_0,
+ EVEX_W_0F12_P_0_M_1,
+ EVEX_W_0F12_P_1,
+ EVEX_W_0F12_P_2,
+ EVEX_W_0F12_P_3,
+ EVEX_W_0F13_P_0,
+ EVEX_W_0F13_P_2,
+ EVEX_W_0F14_P_0,
+ EVEX_W_0F14_P_2,
+ EVEX_W_0F15_P_0,
+ EVEX_W_0F15_P_2,
+ EVEX_W_0F16_P_0_M_0,
+ EVEX_W_0F16_P_0_M_1,
+ EVEX_W_0F16_P_1,
+ EVEX_W_0F16_P_2,
+ EVEX_W_0F17_P_0,
+ EVEX_W_0F17_P_2,
+ EVEX_W_0F28_P_0,
+ EVEX_W_0F28_P_2,
+ EVEX_W_0F29_P_0,
+ EVEX_W_0F29_P_2,
+ EVEX_W_0F2A_P_1,
+ EVEX_W_0F2A_P_3,
+ EVEX_W_0F2B_P_0,
+ EVEX_W_0F2B_P_2,
+ EVEX_W_0F2E_P_0,
+ EVEX_W_0F2E_P_2,
+ EVEX_W_0F2F_P_0,
+ EVEX_W_0F2F_P_2,
+ EVEX_W_0F51_P_0,
+ EVEX_W_0F51_P_1,
+ EVEX_W_0F51_P_2,
+ EVEX_W_0F51_P_3,
+ EVEX_W_0F54_P_0,
+ EVEX_W_0F54_P_2,
+ EVEX_W_0F55_P_0,
+ EVEX_W_0F55_P_2,
+ EVEX_W_0F56_P_0,
+ EVEX_W_0F56_P_2,
+ EVEX_W_0F57_P_0,
+ EVEX_W_0F57_P_2,
+ EVEX_W_0F58_P_0,
+ EVEX_W_0F58_P_1,
+ EVEX_W_0F58_P_2,
+ EVEX_W_0F58_P_3,
+ EVEX_W_0F59_P_0,
+ EVEX_W_0F59_P_1,
+ EVEX_W_0F59_P_2,
+ EVEX_W_0F59_P_3,
+ EVEX_W_0F5A_P_0,
+ EVEX_W_0F5A_P_1,
+ EVEX_W_0F5A_P_2,
+ EVEX_W_0F5A_P_3,
+ EVEX_W_0F5B_P_0,
+ EVEX_W_0F5B_P_1,
+ EVEX_W_0F5B_P_2,
+ EVEX_W_0F5C_P_0,
+ EVEX_W_0F5C_P_1,
+ EVEX_W_0F5C_P_2,
+ EVEX_W_0F5C_P_3,
+ EVEX_W_0F5D_P_0,
+ EVEX_W_0F5D_P_1,
+ EVEX_W_0F5D_P_2,
+ EVEX_W_0F5D_P_3,
+ EVEX_W_0F5E_P_0,
+ EVEX_W_0F5E_P_1,
+ EVEX_W_0F5E_P_2,
+ EVEX_W_0F5E_P_3,
+ EVEX_W_0F5F_P_0,
+ EVEX_W_0F5F_P_1,
+ EVEX_W_0F5F_P_2,
+ EVEX_W_0F5F_P_3,
+ EVEX_W_0F62_P_2,
+ EVEX_W_0F66_P_2,
+ EVEX_W_0F6A_P_2,
+ EVEX_W_0F6B_P_2,
+ EVEX_W_0F6C_P_2,
+ EVEX_W_0F6D_P_2,
+ EVEX_W_0F6E_P_2,
+ EVEX_W_0F6F_P_1,
+ EVEX_W_0F6F_P_2,
+ EVEX_W_0F6F_P_3,
+ EVEX_W_0F70_P_2,
+ EVEX_W_0F72_R_2_P_2,
+ EVEX_W_0F72_R_6_P_2,
+ EVEX_W_0F73_R_2_P_2,
+ EVEX_W_0F73_R_6_P_2,
+ EVEX_W_0F76_P_2,
+ EVEX_W_0F78_P_0,
+ EVEX_W_0F78_P_2,
+ EVEX_W_0F79_P_0,
+ EVEX_W_0F79_P_2,
+ EVEX_W_0F7A_P_1,
+ EVEX_W_0F7A_P_2,
+ EVEX_W_0F7A_P_3,
+ EVEX_W_0F7B_P_1,
+ EVEX_W_0F7B_P_2,
+ EVEX_W_0F7B_P_3,
+ EVEX_W_0F7E_P_1,
+ EVEX_W_0F7E_P_2,
+ EVEX_W_0F7F_P_1,
+ EVEX_W_0F7F_P_2,
+ EVEX_W_0F7F_P_3,
+ EVEX_W_0FC2_P_0,
+ EVEX_W_0FC2_P_1,
+ EVEX_W_0FC2_P_2,
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+ EVEX_W_0FC6_P_0,
+ EVEX_W_0FC6_P_2,
+ EVEX_W_0FD2_P_2,
+ EVEX_W_0FD3_P_2,
+ EVEX_W_0FD4_P_2,
+ EVEX_W_0FD6_P_2,
+ EVEX_W_0FE6_P_1,
+ EVEX_W_0FE6_P_2,
+ EVEX_W_0FE6_P_3,
+ EVEX_W_0FE7_P_2,
+ EVEX_W_0FF2_P_2,
+ EVEX_W_0FF3_P_2,
+ EVEX_W_0FF4_P_2,
+ EVEX_W_0FFA_P_2,
+ EVEX_W_0FFB_P_2,
+ EVEX_W_0FFE_P_2,
+ EVEX_W_0F380C_P_2,
+ EVEX_W_0F380D_P_2,
+ EVEX_W_0F3810_P_1,
+ EVEX_W_0F3810_P_2,
+ EVEX_W_0F3811_P_1,
+ EVEX_W_0F3811_P_2,
+ EVEX_W_0F3812_P_1,
+ EVEX_W_0F3812_P_2,
+ EVEX_W_0F3813_P_1,
+ EVEX_W_0F3813_P_2,
+ EVEX_W_0F3814_P_1,
+ EVEX_W_0F3815_P_1,
+ EVEX_W_0F3818_P_2,
+ EVEX_W_0F3819_P_2,
+ EVEX_W_0F381A_P_2,
+ EVEX_W_0F381B_P_2,
+ EVEX_W_0F381E_P_2,
+ EVEX_W_0F381F_P_2,
+ EVEX_W_0F3820_P_1,
+ EVEX_W_0F3821_P_1,
+ EVEX_W_0F3822_P_1,
+ EVEX_W_0F3823_P_1,
+ EVEX_W_0F3824_P_1,
+ EVEX_W_0F3825_P_1,
+ EVEX_W_0F3825_P_2,
+ EVEX_W_0F3826_P_1,
+ EVEX_W_0F3826_P_2,
+ EVEX_W_0F3828_P_1,
+ EVEX_W_0F3828_P_2,
+ EVEX_W_0F3829_P_1,
+ EVEX_W_0F3829_P_2,
+ EVEX_W_0F382A_P_1,
+ EVEX_W_0F382A_P_2,
+ EVEX_W_0F382B_P_2,
+ EVEX_W_0F3830_P_1,
+ EVEX_W_0F3831_P_1,
+ EVEX_W_0F3832_P_1,
+ EVEX_W_0F3833_P_1,
+ EVEX_W_0F3834_P_1,
+ EVEX_W_0F3835_P_1,
+ EVEX_W_0F3835_P_2,
+ EVEX_W_0F3837_P_2,
+ EVEX_W_0F3838_P_1,
+ EVEX_W_0F3839_P_1,
+ EVEX_W_0F383A_P_1,
+ EVEX_W_0F3840_P_2,
+ EVEX_W_0F3858_P_2,
+ EVEX_W_0F3859_P_2,
+ EVEX_W_0F385A_P_2,
+ EVEX_W_0F385B_P_2,
+ EVEX_W_0F3866_P_2,
+ EVEX_W_0F3875_P_2,
+ EVEX_W_0F3878_P_2,
+ EVEX_W_0F3879_P_2,
+ EVEX_W_0F387A_P_2,
+ EVEX_W_0F387B_P_2,
+ EVEX_W_0F387D_P_2,
+ EVEX_W_0F3883_P_2,
+ EVEX_W_0F388D_P_2,
+ EVEX_W_0F3891_P_2,
+ EVEX_W_0F3893_P_2,
+ EVEX_W_0F38A1_P_2,
+ EVEX_W_0F38A3_P_2,
+ EVEX_W_0F38C7_R_1_P_2,
+ EVEX_W_0F38C7_R_2_P_2,
+ EVEX_W_0F38C7_R_5_P_2,
+ EVEX_W_0F38C7_R_6_P_2,
+
+ EVEX_W_0F3A00_P_2,
+ EVEX_W_0F3A01_P_2,
+ EVEX_W_0F3A04_P_2,
+ EVEX_W_0F3A05_P_2,
+ EVEX_W_0F3A08_P_2,
+ EVEX_W_0F3A09_P_2,
+ EVEX_W_0F3A0A_P_2,
+ EVEX_W_0F3A0B_P_2,
+ EVEX_W_0F3A16_P_2,
+ EVEX_W_0F3A18_P_2,
+ EVEX_W_0F3A19_P_2,
+ EVEX_W_0F3A1A_P_2,
+ EVEX_W_0F3A1B_P_2,
+ EVEX_W_0F3A1D_P_2,
+ EVEX_W_0F3A21_P_2,
+ EVEX_W_0F3A22_P_2,
+ EVEX_W_0F3A23_P_2,
+ EVEX_W_0F3A38_P_2,
+ EVEX_W_0F3A39_P_2,
+ EVEX_W_0F3A3A_P_2,
+ EVEX_W_0F3A3B_P_2,
+ EVEX_W_0F3A3E_P_2,
+ EVEX_W_0F3A3F_P_2,
+ EVEX_W_0F3A42_P_2,
+ EVEX_W_0F3A43_P_2,
+ EVEX_W_0F3A50_P_2,
+ EVEX_W_0F3A51_P_2,
+ EVEX_W_0F3A56_P_2,
+ EVEX_W_0F3A57_P_2,
+ EVEX_W_0F3A66_P_2,
+ EVEX_W_0F3A67_P_2
};
typedef void (*op_rtn) (int bytemode, int sizeflag);
"LB" => print "abs" in 64bit mode and behave as 'B' otherwise
"LS" => print "abs" in 64bit mode and behave as 'S' otherwise
"LV" => print "abs" for 64bit operand and behave as 'S' otherwise
+ "LW" => print 'd', 'q' depending on the VEX.W bit
+ "LP" => print 'w' or 'l' ('d' in Intel mode) if instruction has
+ an operand size prefix, or suffix_always is true. print
+ 'q' if rex prefix is present.
Many of the above letters print nothing in Intel mode. See "putop"
for the details.
static const struct dis386 dis386[] = {
/* 00 */
- { "addB", { Eb, Gb } },
- { "addS", { Ev, Gv } },
+ { "addB", { Ebh1, Gb } },
+ { "addS", { Evh1, Gv } },
{ "addB", { Gb, EbS } },
{ "addS", { Gv, EvS } },
{ "addB", { AL, Ib } },
{ X86_64_TABLE (X86_64_06) },
{ X86_64_TABLE (X86_64_07) },
/* 08 */
- { "orB", { Eb, Gb } },
- { "orS", { Ev, Gv } },
+ { "orB", { Ebh1, Gb } },
+ { "orS", { Evh1, Gv } },
{ "orB", { Gb, EbS } },
{ "orS", { Gv, EvS } },
{ "orB", { AL, Ib } },
{ "orS", { eAX, Iv } },
{ X86_64_TABLE (X86_64_0D) },
- { "(bad)", { XX } }, /* 0x0f extended opcode escape */
+ { Bad_Opcode }, /* 0x0f extended opcode escape */
/* 10 */
- { "adcB", { Eb, Gb } },
- { "adcS", { Ev, Gv } },
+ { "adcB", { Ebh1, Gb } },
+ { "adcS", { Evh1, Gv } },
{ "adcB", { Gb, EbS } },
{ "adcS", { Gv, EvS } },
{ "adcB", { AL, Ib } },
{ X86_64_TABLE (X86_64_16) },
{ X86_64_TABLE (X86_64_17) },
/* 18 */
- { "sbbB", { Eb, Gb } },
- { "sbbS", { Ev, Gv } },
+ { "sbbB", { Ebh1, Gb } },
+ { "sbbS", { Evh1, Gv } },
{ "sbbB", { Gb, EbS } },
{ "sbbS", { Gv, EvS } },
{ "sbbB", { AL, Ib } },
{ X86_64_TABLE (X86_64_1E) },
{ X86_64_TABLE (X86_64_1F) },
/* 20 */
- { "andB", { Eb, Gb } },
- { "andS", { Ev, Gv } },
+ { "andB", { Ebh1, Gb } },
+ { "andS", { Evh1, Gv } },
{ "andB", { Gb, EbS } },
{ "andS", { Gv, EvS } },
{ "andB", { AL, Ib } },
{ "andS", { eAX, Iv } },
- { "(bad)", { XX } }, /* SEG ES prefix */
+ { Bad_Opcode }, /* SEG ES prefix */
{ X86_64_TABLE (X86_64_27) },
/* 28 */
- { "subB", { Eb, Gb } },
- { "subS", { Ev, Gv } },
+ { "subB", { Ebh1, Gb } },
+ { "subS", { Evh1, Gv } },
{ "subB", { Gb, EbS } },
{ "subS", { Gv, EvS } },
{ "subB", { AL, Ib } },
{ "subS", { eAX, Iv } },
- { "(bad)", { XX } }, /* SEG CS prefix */
+ { Bad_Opcode }, /* SEG CS prefix */
{ X86_64_TABLE (X86_64_2F) },
/* 30 */
- { "xorB", { Eb, Gb } },
- { "xorS", { Ev, Gv } },
+ { "xorB", { Ebh1, Gb } },
+ { "xorS", { Evh1, Gv } },
{ "xorB", { Gb, EbS } },
{ "xorS", { Gv, EvS } },
{ "xorB", { AL, Ib } },
{ "xorS", { eAX, Iv } },
- { "(bad)", { XX } }, /* SEG SS prefix */
+ { Bad_Opcode }, /* SEG SS prefix */
{ X86_64_TABLE (X86_64_37) },
/* 38 */
{ "cmpB", { Eb, Gb } },
{ "cmpS", { Gv, EvS } },
{ "cmpB", { AL, Ib } },
{ "cmpS", { eAX, Iv } },
- { "(bad)", { XX } }, /* SEG DS prefix */
+ { Bad_Opcode }, /* SEG DS prefix */
{ X86_64_TABLE (X86_64_3F) },
/* 40 */
{ "inc{S|}", { RMeAX } },
{ X86_64_TABLE (X86_64_61) },
{ X86_64_TABLE (X86_64_62) },
{ X86_64_TABLE (X86_64_63) },
- { "(bad)", { XX } }, /* seg fs */
- { "(bad)", { XX } }, /* seg gs */
- { "(bad)", { XX } }, /* op size prefix */
- { "(bad)", { XX } }, /* adr size prefix */
+ { Bad_Opcode }, /* seg fs */
+ { Bad_Opcode }, /* seg gs */
+ { Bad_Opcode }, /* op size prefix */
+ { Bad_Opcode }, /* adr size prefix */
/* 68 */
- { "pushT", { Iq } },
+ { "pushT", { sIv } },
{ "imulS", { Gv, Ev, Iv } },
- { "pushT", { sIb } },
+ { "pushT", { sIbT } },
{ "imulS", { Gv, Ev, sIb } },
{ "ins{b|}", { Ybr, indirDX } },
{ X86_64_TABLE (X86_64_6D) },
{ "outs{b|}", { indirDXr, Xb } },
{ X86_64_TABLE (X86_64_6F) },
/* 70 */
- { "joH", { Jb, XX, cond_jump_flag } },
- { "jnoH", { Jb, XX, cond_jump_flag } },
- { "jbH", { Jb, XX, cond_jump_flag } },
- { "jaeH", { Jb, XX, cond_jump_flag } },
- { "jeH", { Jb, XX, cond_jump_flag } },
- { "jneH", { Jb, XX, cond_jump_flag } },
- { "jbeH", { Jb, XX, cond_jump_flag } },
- { "jaH", { Jb, XX, cond_jump_flag } },
+ { "joH", { Jb, BND, cond_jump_flag } },
+ { "jnoH", { Jb, BND, cond_jump_flag } },
+ { "jbH", { Jb, BND, cond_jump_flag } },
+ { "jaeH", { Jb, BND, cond_jump_flag } },
+ { "jeH", { Jb, BND, cond_jump_flag } },
+ { "jneH", { Jb, BND, cond_jump_flag } },
+ { "jbeH", { Jb, BND, cond_jump_flag } },
+ { "jaH", { Jb, BND, cond_jump_flag } },
/* 78 */
- { "jsH", { Jb, XX, cond_jump_flag } },
- { "jnsH", { Jb, XX, cond_jump_flag } },
- { "jpH", { Jb, XX, cond_jump_flag } },
- { "jnpH", { Jb, XX, cond_jump_flag } },
- { "jlH", { Jb, XX, cond_jump_flag } },
- { "jgeH", { Jb, XX, cond_jump_flag } },
- { "jleH", { Jb, XX, cond_jump_flag } },
- { "jgH", { Jb, XX, cond_jump_flag } },
+ { "jsH", { Jb, BND, cond_jump_flag } },
+ { "jnsH", { Jb, BND, cond_jump_flag } },
+ { "jpH", { Jb, BND, cond_jump_flag } },
+ { "jnpH", { Jb, BND, cond_jump_flag } },
+ { "jlH", { Jb, BND, cond_jump_flag } },
+ { "jgeH", { Jb, BND, cond_jump_flag } },
+ { "jleH", { Jb, BND, cond_jump_flag } },
+ { "jgH", { Jb, BND, cond_jump_flag } },
/* 80 */
{ REG_TABLE (REG_80) },
{ REG_TABLE (REG_81) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ REG_TABLE (REG_82) },
{ "testB", { Eb, Gb } },
{ "testS", { Ev, Gv } },
- { "xchgB", { Eb, Gb } },
- { "xchgS", { Ev, Gv } },
+ { "xchgB", { Ebh2, Gb } },
+ { "xchgS", { Evh2, Gv } },
/* 88 */
- { "movB", { Eb, Gb } },
- { "movS", { Ev, Gv } },
+ { "movB", { Ebh3, Gb } },
+ { "movS", { Evh3, Gv } },
{ "movB", { Gb, EbS } },
{ "movS", { Gv, EvS } },
{ "movD", { Sv, Sw } },
{ "cW{t|}R", { XX } },
{ "cR{t|}O", { XX } },
{ X86_64_TABLE (X86_64_9A) },
- { "(bad)", { XX } }, /* fwait */
+ { Bad_Opcode }, /* fwait */
{ "pushfT", { XX } },
{ "popfT", { XX } },
{ "sahf", { XX } },
/* c0 */
{ REG_TABLE (REG_C0) },
{ REG_TABLE (REG_C1) },
- { "retT", { Iw } },
- { "retT", { XX } },
+ { "retT", { Iw, BND } },
+ { "retT", { BND } },
{ X86_64_TABLE (X86_64_C4) },
{ X86_64_TABLE (X86_64_C5) },
{ REG_TABLE (REG_C6) },
{ "int3", { XX } },
{ "int", { Ib } },
{ X86_64_TABLE (X86_64_CE) },
- { "iretP", { XX } },
+ { "iret%LP", { XX } },
/* d0 */
{ REG_TABLE (REG_D0) },
{ REG_TABLE (REG_D1) },
{ REG_TABLE (REG_D3) },
{ X86_64_TABLE (X86_64_D4) },
{ X86_64_TABLE (X86_64_D5) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "xlat", { DSBX } },
/* d8 */
{ FLOAT },
{ "outB", { Ib, AL } },
{ "outG", { Ib, zAX } },
/* e8 */
- { "callT", { Jv } },
- { "jmpT", { Jv } },
+ { "callT", { Jv, BND } },
+ { "jmpT", { Jv, BND } },
{ X86_64_TABLE (X86_64_EA) },
- { "jmp", { Jb } },
+ { "jmp", { Jb, BND } },
{ "inB", { AL, indirDX } },
{ "inG", { zAX, indirDX } },
{ "outB", { indirDX, AL } },
{ "outG", { indirDX, zAX } },
/* f0 */
- { "(bad)", { XX } }, /* lock prefix */
+ { Bad_Opcode }, /* lock prefix */
{ "icebp", { XX } },
- { "(bad)", { XX } }, /* repne */
- { "(bad)", { XX } }, /* repz */
+ { Bad_Opcode }, /* repne */
+ { Bad_Opcode }, /* repz */
{ "hlt", { XX } },
{ "cmc", { XX } },
{ REG_TABLE (REG_F6) },
{ REG_TABLE (REG_0F01 ) },
{ "larS", { Gv, Ew } },
{ "lslS", { Gv, Ew } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "syscall", { XX } },
{ "clts", { XX } },
- { "sysretP", { XX } },
+ { "sysret%LP", { XX } },
/* 08 */
{ "invd", { XX } },
{ "wbinvd", { XX } },
- { "(bad)", { XX } },
- { "ud2a", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { "ud2", { XX } },
+ { Bad_Opcode },
{ REG_TABLE (REG_0F0D) },
{ "femms", { XX } },
{ "", { MX, EM, OPSUF } }, /* See OP_3DNowSuffix. */
/* 18 */
{ REG_TABLE (REG_0F18) },
{ "nopQ", { Ev } },
- { "nopQ", { Ev } },
- { "nopQ", { Ev } },
+ { PREFIX_TABLE (PREFIX_0F1A) },
+ { PREFIX_TABLE (PREFIX_0F1B) },
{ "nopQ", { Ev } },
{ "nopQ", { Ev } },
{ "nopQ", { Ev } },
{ "nopQ", { Ev } },
/* 20 */
- { MOD_TABLE (MOD_0F20) },
- { MOD_TABLE (MOD_0F21) },
- { MOD_TABLE (MOD_0F22) },
- { MOD_TABLE (MOD_0F23) },
+ { "movZ", { Rm, Cm } },
+ { "movZ", { Rm, Dm } },
+ { "movZ", { Cm, Rm } },
+ { "movZ", { Dm, Rm } },
{ MOD_TABLE (MOD_0F24) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0F26) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
/* 28 */
{ "movapX", { XM, EXx } },
{ "movapX", { EXxS, XM } },
{ "rdpmc", { XX } },
{ "sysenter", { XX } },
{ "sysexit", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "getsec", { XX } },
/* 38 */
{ THREE_BYTE_TABLE (THREE_BYTE_0F38) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ THREE_BYTE_TABLE (THREE_BYTE_0F3A) },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
/* 40 */
{ "cmovoS", { Gv, Ev } },
{ "cmovnoS", { Gv, Ev } },
{ PREFIX_TABLE (PREFIX_0F78) },
{ PREFIX_TABLE (PREFIX_0F79) },
{ THREE_BYTE_TABLE (THREE_BYTE_0F7A) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ PREFIX_TABLE (PREFIX_0F7C) },
{ PREFIX_TABLE (PREFIX_0F7D) },
{ PREFIX_TABLE (PREFIX_0F7E) },
{ PREFIX_TABLE (PREFIX_0F7F) },
/* 80 */
- { "joH", { Jv, XX, cond_jump_flag } },
- { "jnoH", { Jv, XX, cond_jump_flag } },
- { "jbH", { Jv, XX, cond_jump_flag } },
- { "jaeH", { Jv, XX, cond_jump_flag } },
- { "jeH", { Jv, XX, cond_jump_flag } },
- { "jneH", { Jv, XX, cond_jump_flag } },
- { "jbeH", { Jv, XX, cond_jump_flag } },
- { "jaH", { Jv, XX, cond_jump_flag } },
+ { "joH", { Jv, BND, cond_jump_flag } },
+ { "jnoH", { Jv, BND, cond_jump_flag } },
+ { "jbH", { Jv, BND, cond_jump_flag } },
+ { "jaeH", { Jv, BND, cond_jump_flag } },
+ { "jeH", { Jv, BND, cond_jump_flag } },
+ { "jneH", { Jv, BND, cond_jump_flag } },
+ { "jbeH", { Jv, BND, cond_jump_flag } },
+ { "jaH", { Jv, BND, cond_jump_flag } },
/* 88 */
- { "jsH", { Jv, XX, cond_jump_flag } },
- { "jnsH", { Jv, XX, cond_jump_flag } },
- { "jpH", { Jv, XX, cond_jump_flag } },
- { "jnpH", { Jv, XX, cond_jump_flag } },
- { "jlH", { Jv, XX, cond_jump_flag } },
- { "jgeH", { Jv, XX, cond_jump_flag } },
- { "jleH", { Jv, XX, cond_jump_flag } },
- { "jgH", { Jv, XX, cond_jump_flag } },
+ { "jsH", { Jv, BND, cond_jump_flag } },
+ { "jnsH", { Jv, BND, cond_jump_flag } },
+ { "jpH", { Jv, BND, cond_jump_flag } },
+ { "jnpH", { Jv, BND, cond_jump_flag } },
+ { "jlH", { Jv, BND, cond_jump_flag } },
+ { "jgeH", { Jv, BND, cond_jump_flag } },
+ { "jleH", { Jv, BND, cond_jump_flag } },
+ { "jgH", { Jv, BND, cond_jump_flag } },
/* 90 */
{ "seto", { Eb } },
{ "setno", { Eb } },
{ "pushT", { gs } },
{ "popT", { gs } },
{ "rsm", { XX } },
- { "btsS", { Ev, Gv } },
+ { "btsS", { Evh1, Gv } },
{ "shrdS", { Ev, Gv, Ib } },
{ "shrdS", { Ev, Gv, CL } },
{ REG_TABLE (REG_0FAE) },
{ "imulS", { Gv, Ev } },
/* b0 */
- { "cmpxchgB", { Eb, Gb } },
- { "cmpxchgS", { Ev, Gv } },
+ { "cmpxchgB", { Ebh1, Gb } },
+ { "cmpxchgS", { Evh1, Gv } },
{ MOD_TABLE (MOD_0FB2) },
- { "btrS", { Ev, Gv } },
+ { "btrS", { Evh1, Gv } },
{ MOD_TABLE (MOD_0FB4) },
{ MOD_TABLE (MOD_0FB5) },
{ "movz{bR|x}", { Gv, Eb } },
{ "movz{wR|x}", { Gv, Ew } }, /* yes, there really is movzww ! */
/* b8 */
{ PREFIX_TABLE (PREFIX_0FB8) },
- { "ud2b", { XX } },
+ { "ud1", { XX } },
{ REG_TABLE (REG_0FBA) },
- { "btcS", { Ev, Gv } },
- { "bsfS", { Gv, Ev } },
+ { "btcS", { Evh1, Gv } },
+ { PREFIX_TABLE (PREFIX_0FBC) },
{ PREFIX_TABLE (PREFIX_0FBD) },
{ "movs{bR|x}", { Gv, Eb } },
{ "movs{wR|x}", { Gv, Ew } }, /* yes, there really is movsww ! */
/* c0 */
- { "xaddB", { Eb, Gb } },
- { "xaddS", { Ev, Gv } },
+ { "xaddB", { Ebh1, Gb } },
+ { "xaddS", { Evh1, Gv } },
{ PREFIX_TABLE (PREFIX_0FC2) },
{ PREFIX_TABLE (PREFIX_0FC3) },
{ "pinsrw", { MX, Edqw, Ib } },
{ "paddb", { MX, EM } },
{ "paddw", { MX, EM } },
{ "paddd", { MX, EM } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
};
static const unsigned char onebyte_has_modrm[256] = {
/* 0 1 2 3 4 5 6 7 8 9 a b c d e f */
};
+static const unsigned char twobyte_has_mandatory_prefix[256] = {
+ /* 0 1 2 3 4 5 6 7 8 9 a b c d e f */
+ /* ------------------------------- */
+ /* 00 */ 0,0,0,0,0,0,0,0,0,0,0,0,0,0,0,0, /* 0f */
+ /* 10 */ 1,1,1,1,1,1,1,1,0,0,0,0,0,0,0,0, /* 1f */
+ /* 20 */ 0,0,0,0,0,0,0,0,1,1,1,1,1,1,0,0, /* 2f */
+ /* 30 */ 0,0,0,0,0,0,0,0,1,0,1,0,0,0,0,0, /* 3f */
+ /* 40 */ 0,0,0,0,0,0,0,0,0,0,0,0,0,0,0,0, /* 4f */
+ /* 50 */ 1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1, /* 5f */
+ /* 60 */ 1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1, /* 6f */
+ /* 70 */ 1,0,0,0,1,1,1,1,0,0,1,1,1,1,1,1, /* 7f */
+ /* 80 */ 0,0,0,0,0,0,0,0,0,0,0,0,0,0,0,0, /* 8f */
+ /* 90 */ 0,0,0,0,0,0,0,0,0,0,0,0,0,0,0,0, /* 9f */
+ /* a0 */ 0,0,0,0,0,0,0,0,0,0,0,0,0,0,0,0, /* af */
+ /* b0 */ 0,0,0,0,0,0,0,0,0,0,0,0,0,0,0,0, /* bf */
+ /* c0 */ 0,0,1,1,1,1,1,0,0,0,0,0,0,0,0,0, /* cf */
+ /* d0 */ 1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1, /* df */
+ /* e0 */ 1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1, /* ef */
+ /* f0 */ 1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,0 /* ff */
+ /* ------------------------------- */
+ /* 0 1 2 3 4 5 6 7 8 9 a b c d e f */
+};
+
static char obuf[100];
static char *obufp;
static char *mnemonicendp;
static unsigned char *start_codep;
static unsigned char *insn_codep;
static unsigned char *codep;
+static unsigned char *end_codep;
static int last_lock_prefix;
static int last_repz_prefix;
static int last_repnz_prefix;
static int last_addr_prefix;
static int last_rex_prefix;
static int last_seg_prefix;
+static int fwait_prefix;
+/* The PREFIX_REPZ/PREFIX_REPNZ/PREFIX_DATA prefix is mandatory. */
+static int mandatory_prefix;
+/* The active segment register prefix. */
+static int active_seg_prefix;
#define MAX_CODE_LENGTH 15
/* We can up to 14 prefixes since the maximum instruction length is
15bytes. */
static unsigned char need_modrm;
static struct
{
+ int scale;
+ int index;
+ int base;
+ }
+sib;
+static struct
+ {
int register_specifier;
int length;
int prefix;
int w;
+ int evex;
+ int r;
+ int v;
+ int mask_register_specifier;
+ int zeroing;
+ int ll;
+ int b;
}
vex;
static unsigned char need_vex;
static const char *index64;
static const char *index32;
static const char **index16;
+static const char **names_bnd;
static const char *intel_names64[] = {
"rax", "rcx", "rdx", "rbx", "rsp", "rbp", "rsi", "rdi",
"%bx,%si", "%bx,%di", "%bp,%si", "%bp,%di", "%si", "%di", "%bp", "%bx"
};
+static const char **names_mm;
+static const char *intel_names_mm[] = {
+ "mm0", "mm1", "mm2", "mm3",
+ "mm4", "mm5", "mm6", "mm7"
+};
+static const char *att_names_mm[] = {
+ "%mm0", "%mm1", "%mm2", "%mm3",
+ "%mm4", "%mm5", "%mm6", "%mm7"
+};
+
+static const char *intel_names_bnd[] = {
+ "bnd0", "bnd1", "bnd2", "bnd3"
+};
+
+static const char *att_names_bnd[] = {
+ "%bnd0", "%bnd1", "%bnd2", "%bnd3"
+};
+
+static const char **names_xmm;
+static const char *intel_names_xmm[] = {
+ "xmm0", "xmm1", "xmm2", "xmm3",
+ "xmm4", "xmm5", "xmm6", "xmm7",
+ "xmm8", "xmm9", "xmm10", "xmm11",
+ "xmm12", "xmm13", "xmm14", "xmm15",
+ "xmm16", "xmm17", "xmm18", "xmm19",
+ "xmm20", "xmm21", "xmm22", "xmm23",
+ "xmm24", "xmm25", "xmm26", "xmm27",
+ "xmm28", "xmm29", "xmm30", "xmm31"
+};
+static const char *att_names_xmm[] = {
+ "%xmm0", "%xmm1", "%xmm2", "%xmm3",
+ "%xmm4", "%xmm5", "%xmm6", "%xmm7",
+ "%xmm8", "%xmm9", "%xmm10", "%xmm11",
+ "%xmm12", "%xmm13", "%xmm14", "%xmm15",
+ "%xmm16", "%xmm17", "%xmm18", "%xmm19",
+ "%xmm20", "%xmm21", "%xmm22", "%xmm23",
+ "%xmm24", "%xmm25", "%xmm26", "%xmm27",
+ "%xmm28", "%xmm29", "%xmm30", "%xmm31"
+};
+
+static const char **names_ymm;
+static const char *intel_names_ymm[] = {
+ "ymm0", "ymm1", "ymm2", "ymm3",
+ "ymm4", "ymm5", "ymm6", "ymm7",
+ "ymm8", "ymm9", "ymm10", "ymm11",
+ "ymm12", "ymm13", "ymm14", "ymm15",
+ "ymm16", "ymm17", "ymm18", "ymm19",
+ "ymm20", "ymm21", "ymm22", "ymm23",
+ "ymm24", "ymm25", "ymm26", "ymm27",
+ "ymm28", "ymm29", "ymm30", "ymm31"
+};
+static const char *att_names_ymm[] = {
+ "%ymm0", "%ymm1", "%ymm2", "%ymm3",
+ "%ymm4", "%ymm5", "%ymm6", "%ymm7",
+ "%ymm8", "%ymm9", "%ymm10", "%ymm11",
+ "%ymm12", "%ymm13", "%ymm14", "%ymm15",
+ "%ymm16", "%ymm17", "%ymm18", "%ymm19",
+ "%ymm20", "%ymm21", "%ymm22", "%ymm23",
+ "%ymm24", "%ymm25", "%ymm26", "%ymm27",
+ "%ymm28", "%ymm29", "%ymm30", "%ymm31"
+};
+
+static const char **names_zmm;
+static const char *intel_names_zmm[] = {
+ "zmm0", "zmm1", "zmm2", "zmm3",
+ "zmm4", "zmm5", "zmm6", "zmm7",
+ "zmm8", "zmm9", "zmm10", "zmm11",
+ "zmm12", "zmm13", "zmm14", "zmm15",
+ "zmm16", "zmm17", "zmm18", "zmm19",
+ "zmm20", "zmm21", "zmm22", "zmm23",
+ "zmm24", "zmm25", "zmm26", "zmm27",
+ "zmm28", "zmm29", "zmm30", "zmm31"
+};
+static const char *att_names_zmm[] = {
+ "%zmm0", "%zmm1", "%zmm2", "%zmm3",
+ "%zmm4", "%zmm5", "%zmm6", "%zmm7",
+ "%zmm8", "%zmm9", "%zmm10", "%zmm11",
+ "%zmm12", "%zmm13", "%zmm14", "%zmm15",
+ "%zmm16", "%zmm17", "%zmm18", "%zmm19",
+ "%zmm20", "%zmm21", "%zmm22", "%zmm23",
+ "%zmm24", "%zmm25", "%zmm26", "%zmm27",
+ "%zmm28", "%zmm29", "%zmm30", "%zmm31"
+};
+
+static const char **names_mask;
+static const char *intel_names_mask[] = {
+ "k0", "k1", "k2", "k3", "k4", "k5", "k6", "k7"
+};
+static const char *att_names_mask[] = {
+ "%k0", "%k1", "%k2", "%k3", "%k4", "%k5", "%k6", "%k7"
+};
+
+static const char *names_rounding[] =
+{
+ "{rn-sae}",
+ "{rd-sae}",
+ "{ru-sae}",
+ "{rz-sae}"
+};
+
static const struct dis386 reg_table[][8] = {
/* REG_80 */
{
- { "addA", { Eb, Ib } },
- { "orA", { Eb, Ib } },
- { "adcA", { Eb, Ib } },
- { "sbbA", { Eb, Ib } },
- { "andA", { Eb, Ib } },
- { "subA", { Eb, Ib } },
- { "xorA", { Eb, Ib } },
+ { "addA", { Ebh1, Ib } },
+ { "orA", { Ebh1, Ib } },
+ { "adcA", { Ebh1, Ib } },
+ { "sbbA", { Ebh1, Ib } },
+ { "andA", { Ebh1, Ib } },
+ { "subA", { Ebh1, Ib } },
+ { "xorA", { Ebh1, Ib } },
{ "cmpA", { Eb, Ib } },
},
/* REG_81 */
{
- { "addQ", { Ev, Iv } },
- { "orQ", { Ev, Iv } },
- { "adcQ", { Ev, Iv } },
- { "sbbQ", { Ev, Iv } },
- { "andQ", { Ev, Iv } },
- { "subQ", { Ev, Iv } },
- { "xorQ", { Ev, Iv } },
+ { "addQ", { Evh1, Iv } },
+ { "orQ", { Evh1, Iv } },
+ { "adcQ", { Evh1, Iv } },
+ { "sbbQ", { Evh1, Iv } },
+ { "andQ", { Evh1, Iv } },
+ { "subQ", { Evh1, Iv } },
+ { "xorQ", { Evh1, Iv } },
{ "cmpQ", { Ev, Iv } },
},
/* REG_82 */
{
- { "addQ", { Ev, sIb } },
- { "orQ", { Ev, sIb } },
- { "adcQ", { Ev, sIb } },
- { "sbbQ", { Ev, sIb } },
- { "andQ", { Ev, sIb } },
- { "subQ", { Ev, sIb } },
- { "xorQ", { Ev, sIb } },
+ { "addQ", { Evh1, sIb } },
+ { "orQ", { Evh1, sIb } },
+ { "adcQ", { Evh1, sIb } },
+ { "sbbQ", { Evh1, sIb } },
+ { "andQ", { Evh1, sIb } },
+ { "subQ", { Evh1, sIb } },
+ { "xorQ", { Evh1, sIb } },
{ "cmpQ", { Ev, sIb } },
},
/* REG_8F */
{
{ "popU", { stackEv } },
{ XOP_8F_TABLE (XOP_09) },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ XOP_8F_TABLE (XOP_09) },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
},
/* REG_C0 */
{
{ "rcrA", { Eb, Ib } },
{ "shlA", { Eb, Ib } },
{ "shrA", { Eb, Ib } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "sarA", { Eb, Ib } },
},
/* REG_C1 */
{ "rcrQ", { Ev, Ib } },
{ "shlQ", { Ev, Ib } },
{ "shrQ", { Ev, Ib } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "sarQ", { Ev, Ib } },
},
/* REG_C6 */
{
- { "movA", { Eb, Ib } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { "movA", { Ebh3, Ib } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_C6_REG_7) },
},
/* REG_C7 */
{
- { "movQ", { Ev, Iv } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { "movQ", { Evh3, Iv } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_C7_REG_7) },
},
/* REG_D0 */
{
{ "rcrA", { Eb, I1 } },
{ "shlA", { Eb, I1 } },
{ "shrA", { Eb, I1 } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "sarA", { Eb, I1 } },
},
/* REG_D1 */
{ "rcrQ", { Ev, I1 } },
{ "shlQ", { Ev, I1 } },
{ "shrQ", { Ev, I1 } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "sarQ", { Ev, I1 } },
},
/* REG_D2 */
{ "rcrA", { Eb, CL } },
{ "shlA", { Eb, CL } },
{ "shrA", { Eb, CL } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "sarA", { Eb, CL } },
},
/* REG_D3 */
{ "rcrQ", { Ev, CL } },
{ "shlQ", { Ev, CL } },
{ "shrQ", { Ev, CL } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "sarQ", { Ev, CL } },
},
/* REG_F6 */
{
{ "testA", { Eb, Ib } },
- { "(bad)", { XX } },
- { "notA", { Eb } },
- { "negA", { Eb } },
+ { Bad_Opcode },
+ { "notA", { Ebh1 } },
+ { "negA", { Ebh1 } },
{ "mulA", { Eb } }, /* Don't print the implicit %al register, */
{ "imulA", { Eb } }, /* to distinguish these opcodes from other */
{ "divA", { Eb } }, /* mul/imul opcodes. Do the same for div */
/* REG_F7 */
{
{ "testQ", { Ev, Iv } },
- { "(bad)", { XX } },
- { "notQ", { Ev } },
- { "negQ", { Ev } },
+ { Bad_Opcode },
+ { "notQ", { Evh1 } },
+ { "negQ", { Evh1 } },
{ "mulQ", { Ev } }, /* Don't print the implicit register. */
{ "imulQ", { Ev } },
{ "divQ", { Ev } },
},
/* REG_FE */
{
- { "incA", { Eb } },
- { "decA", { Eb } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { "incA", { Ebh1 } },
+ { "decA", { Ebh1 } },
},
/* REG_FF */
{
- { "incQ", { Ev } },
- { "decQ", { Ev } },
- { "callT", { indirEv } },
- { "JcallT", { indirEp } },
- { "jmpT", { indirEv } },
- { "JjmpT", { indirEp } },
+ { "incQ", { Evh1 } },
+ { "decQ", { Evh1 } },
+ { "call{T|}", { indirEv, BND } },
+ { MOD_TABLE (MOD_FF_REG_3) },
+ { "jmp{T|}", { indirEv, BND } },
+ { MOD_TABLE (MOD_FF_REG_5) },
{ "pushU", { stackEv } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
},
/* REG_0F00 */
{
{ "ltr", { Ew } },
{ "verr", { Ew } },
{ "verw", { Ew } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
},
/* REG_0F01 */
{
{ MOD_TABLE (MOD_0F01_REG_2) },
{ MOD_TABLE (MOD_0F01_REG_3) },
{ "smswD", { Sv } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "lmsw", { Ew } },
{ MOD_TABLE (MOD_0F01_REG_7) },
},
/* REG_0F0D */
{
- { "prefetch", { Eb } },
- { "prefetchw", { Eb } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { "prefetch", { Mb } },
+ { "prefetchw", { Mb } },
+ { "prefetchwt1", { Mb } },
+ { "prefetch", { Mb } },
+ { "prefetch", { Mb } },
+ { "prefetch", { Mb } },
+ { "prefetch", { Mb } },
+ { "prefetch", { Mb } },
},
/* REG_0F18 */
{
{ MOD_TABLE (MOD_0F18_REG_1) },
{ MOD_TABLE (MOD_0F18_REG_2) },
{ MOD_TABLE (MOD_0F18_REG_3) },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { MOD_TABLE (MOD_0F18_REG_4) },
+ { MOD_TABLE (MOD_0F18_REG_5) },
+ { MOD_TABLE (MOD_0F18_REG_6) },
+ { MOD_TABLE (MOD_0F18_REG_7) },
},
/* REG_0F71 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0F71_REG_2) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0F71_REG_4) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0F71_REG_6) },
- { "(bad)", { XX } },
},
/* REG_0F72 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0F72_REG_2) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0F72_REG_4) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0F72_REG_6) },
- { "(bad)", { XX } },
},
/* REG_0F73 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0F73_REG_2) },
{ MOD_TABLE (MOD_0F73_REG_3) },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0F73_REG_6) },
{ MOD_TABLE (MOD_0F73_REG_7) },
},
{ "montmul", { { OP_0f07, 0 } } },
{ "xsha1", { { OP_0f07, 0 } } },
{ "xsha256", { { OP_0f07, 0 } } },
- { "(bad)", { { OP_0f07, 0 } } },
- { "(bad)", { { OP_0f07, 0 } } },
- { "(bad)", { { OP_0f07, 0 } } },
- { "(bad)", { { OP_0f07, 0 } } },
- { "(bad)", { { OP_0f07, 0 } } },
},
/* REG_0FA7 */
{
{ "xcrypt-ctr", { { OP_0f07, 0 } } },
{ "xcrypt-cfb", { { OP_0f07, 0 } } },
{ "xcrypt-ofb", { { OP_0f07, 0 } } },
- { "(bad)", { { OP_0f07, 0 } } },
- { "(bad)", { { OP_0f07, 0 } } },
},
/* REG_0FAE */
{
},
/* REG_0FBA */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "btQ", { Ev, Ib } },
- { "btsQ", { Ev, Ib } },
- { "btrQ", { Ev, Ib } },
- { "btcQ", { Ev, Ib } },
+ { "btsQ", { Evh1, Ib } },
+ { "btrQ", { Evh1, Ib } },
+ { "btcQ", { Evh1, Ib } },
},
/* REG_0FC7 */
{
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "cmpxchg8b", { { CMPXCHG8B_Fixup, q_mode } } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_0FC7_REG_3) },
+ { MOD_TABLE (MOD_0FC7_REG_4) },
+ { MOD_TABLE (MOD_0FC7_REG_5) },
{ MOD_TABLE (MOD_0FC7_REG_6) },
{ MOD_TABLE (MOD_0FC7_REG_7) },
},
- /* REG_VEX_71 */
- {
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { MOD_TABLE (MOD_VEX_71_REG_2) },
- { "(bad)", { XX } },
- { MOD_TABLE (MOD_VEX_71_REG_4) },
- { "(bad)", { XX } },
- { MOD_TABLE (MOD_VEX_71_REG_6) },
- { "(bad)", { XX } },
- },
- /* REG_VEX_72 */
- {
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { MOD_TABLE (MOD_VEX_72_REG_2) },
- { "(bad)", { XX } },
- { MOD_TABLE (MOD_VEX_72_REG_4) },
- { "(bad)", { XX } },
- { MOD_TABLE (MOD_VEX_72_REG_6) },
- { "(bad)", { XX } },
- },
- /* REG_VEX_73 */
- {
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { MOD_TABLE (MOD_VEX_73_REG_2) },
- { MOD_TABLE (MOD_VEX_73_REG_3) },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { MOD_TABLE (MOD_VEX_73_REG_6) },
- { MOD_TABLE (MOD_VEX_73_REG_7) },
- },
- /* REG_VEX_AE */
- {
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { MOD_TABLE (MOD_VEX_AE_REG_2) },
- { MOD_TABLE (MOD_VEX_AE_REG_3) },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ /* REG_VEX_0F71 */
+ {
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_VEX_0F71_REG_2) },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_VEX_0F71_REG_4) },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_VEX_0F71_REG_6) },
+ },
+ /* REG_VEX_0F72 */
+ {
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_VEX_0F72_REG_2) },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_VEX_0F72_REG_4) },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_VEX_0F72_REG_6) },
+ },
+ /* REG_VEX_0F73 */
+ {
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_VEX_0F73_REG_2) },
+ { MOD_TABLE (MOD_VEX_0F73_REG_3) },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_VEX_0F73_REG_6) },
+ { MOD_TABLE (MOD_VEX_0F73_REG_7) },
+ },
+ /* REG_VEX_0FAE */
+ {
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { MOD_TABLE (MOD_VEX_0FAE_REG_2) },
+ { MOD_TABLE (MOD_VEX_0FAE_REG_3) },
+ },
+ /* REG_VEX_0F38F3 */
+ {
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F38F3_REG_1) },
+ { PREFIX_TABLE (PREFIX_VEX_0F38F3_REG_2) },
+ { PREFIX_TABLE (PREFIX_VEX_0F38F3_REG_3) },
},
/* REG_XOP_LWPCB */
{
{ "llwpcb", { { OP_LWPCB_E, 0 } } },
{ "slwpcb", { { OP_LWPCB_E, 0 } } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
},
/* REG_XOP_LWP */
{
- { "lwpins", { { OP_LWP_E, 0 }, Ed, { OP_LWP_I, 0 } } },
- { "lwpval", { { OP_LWP_E, 0 }, Ed, { OP_LWP_I, 0 } } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- },
+ { "lwpins", { { OP_LWP_E, 0 }, Ed, Iq } },
+ { "lwpval", { { OP_LWP_E, 0 }, Ed, Iq } },
+ },
+ /* REG_XOP_TBM_01 */
+ {
+ { Bad_Opcode },
+ { "blcfill", { { OP_LWP_E, 0 }, Ev } },
+ { "blsfill", { { OP_LWP_E, 0 }, Ev } },
+ { "blcs", { { OP_LWP_E, 0 }, Ev } },
+ { "tzmsk", { { OP_LWP_E, 0 }, Ev } },
+ { "blcic", { { OP_LWP_E, 0 }, Ev } },
+ { "blsic", { { OP_LWP_E, 0 }, Ev } },
+ { "t1mskc", { { OP_LWP_E, 0 }, Ev } },
+ },
+ /* REG_XOP_TBM_02 */
+ {
+ { Bad_Opcode },
+ { "blcmsk", { { OP_LWP_E, 0 }, Ev } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { "blci", { { OP_LWP_E, 0 }, Ev } },
+ },
+#define NEED_REG_TABLE
+#include "i386-dis-evex.h"
+#undef NEED_REG_TABLE
};
static const struct dis386 prefix_table[][4] = {
{ "xchgS", { { NOP_Fixup1, eAX_reg }, { NOP_Fixup2, eAX_reg } } },
{ "pause", { XX } },
{ "xchgS", { { NOP_Fixup1, eAX_reg }, { NOP_Fixup2, eAX_reg } } },
- { "(bad)", { XX } },
},
/* PREFIX_0F10 */
{ MOD_TABLE (MOD_0F16_PREFIX_0) },
{ "movshdup", { XM, EXx } },
{ "movhpd", { XM, EXq } },
- { "(bad)", { XX } },
+ },
+
+ /* PREFIX_0F1A */
+ {
+ { MOD_TABLE (MOD_0F1A_PREFIX_0) },
+ { "bndcl", { Gbnd, Ev_bnd } },
+ { "bndmov", { Gbnd, Ebnd } },
+ { "bndcu", { Gbnd, Ev_bnd } },
+ },
+
+ /* PREFIX_0F1B */
+ {
+ { MOD_TABLE (MOD_0F1B_PREFIX_0) },
+ { MOD_TABLE (MOD_0F1B_PREFIX_1) },
+ { "bndmov", { Ebnd, Gbnd } },
+ { "bndcn", { Gbnd, Ev_bnd } },
},
/* PREFIX_0F2A */
/* PREFIX_0F2E */
{
- { "ucomiss",{ XM, EXd } },
- { "(bad)", { XX } },
- { "ucomisd",{ XM, EXq } },
- { "(bad)", { XX } },
+ { "ucomiss",{ XM, EXd } },
+ { Bad_Opcode },
+ { "ucomisd",{ XM, EXq } },
},
/* PREFIX_0F2F */
{
{ "comiss", { XM, EXd } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "comisd", { XM, EXq } },
- { "(bad)", { XX } },
},
/* PREFIX_0F51 */
{
{ "rsqrtps",{ XM, EXx } },
{ "rsqrtss",{ XM, EXd } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
},
/* PREFIX_0F53 */
{
{ "rcpps", { XM, EXx } },
{ "rcpss", { XM, EXd } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
},
/* PREFIX_0F58 */
{ "cvtdq2ps", { XM, EXx } },
{ "cvttps2dq", { XM, EXx } },
{ "cvtps2dq", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F5C */
/* PREFIX_0F60 */
{
{ "punpcklbw",{ MX, EMd } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "punpcklbw",{ MX, EMx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F61 */
{
{ "punpcklwd",{ MX, EMd } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "punpcklwd",{ MX, EMx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F62 */
{
{ "punpckldq",{ MX, EMd } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "punpckldq",{ MX, EMx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F6C */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "punpcklqdq", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F6D */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "punpckhqdq", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F6F */
{ "movq", { MX, EM } },
{ "movdqu", { XM, EXx } },
{ "movdqa", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F70 */
/* PREFIX_0F73_REG_3 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "psrldq", { XS, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F73_REG_7 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pslldq", { XS, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F78 */
{
{"vmread", { Em, Gm } },
- {"(bad)", { XX } },
+ { Bad_Opcode },
{"extrq", { XS, Ib, Ib } },
{"insertq", { XM, XS, Ib, Ib } },
},
/* PREFIX_0F79 */
{
{"vmwrite", { Gm, Em } },
- {"(bad)", { XX } },
+ { Bad_Opcode },
{"extrq", { XM, XS } },
{"insertq", { XM, XS } },
},
/* PREFIX_0F7C */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "haddpd", { XM, EXx } },
{ "haddps", { XM, EXx } },
},
/* PREFIX_0F7D */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "hsubpd", { XM, EXx } },
{ "hsubps", { XM, EXx } },
},
{ "movK", { Edq, MX } },
{ "movq", { XM, EXq } },
{ "movK", { Edq, XM } },
- { "(bad)", { XX } },
},
/* PREFIX_0F7F */
{ "movq", { EMS, MX } },
{ "movdqu", { EXxS, XM } },
{ "movdqa", { EXxS, XM } },
- { "(bad)", { XX } },
+ },
+
+ /* PREFIX_0FAE_REG_0 */
+ {
+ { Bad_Opcode },
+ { "rdfsbase", { Ev } },
+ },
+
+ /* PREFIX_0FAE_REG_1 */
+ {
+ { Bad_Opcode },
+ { "rdgsbase", { Ev } },
+ },
+
+ /* PREFIX_0FAE_REG_2 */
+ {
+ { Bad_Opcode },
+ { "wrfsbase", { Ev } },
+ },
+
+ /* PREFIX_0FAE_REG_3 */
+ {
+ { Bad_Opcode },
+ { "wrgsbase", { Ev } },
+ },
+
+ /* PREFIX_0FAE_REG_6 */
+ {
+ { "xsaveopt", { FXSAVE } },
+ { Bad_Opcode },
+ { "clwb", { Mb } },
+ },
+
+ /* PREFIX_0FAE_REG_7 */
+ {
+ { "clflush", { Mb } },
+ { Bad_Opcode },
+ { "clflushopt", { Mb } },
+ },
+
+ /* PREFIX_RM_0_0FAE_REG_7 */
+ {
+ { "sfence", { Skip_MODRM } },
+ { Bad_Opcode },
+ { "pcommit", { Skip_MODRM } },
},
/* PREFIX_0FB8 */
{
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "popcntS", { Gv, Ev } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ },
+
+ /* PREFIX_0FBC */
+ {
+ { "bsfS", { Gv, Ev } },
+ { "tzcntS", { Gv, Ev } },
+ { "bsfS", { Gv, Ev } },
},
/* PREFIX_0FBD */
{ "bsrS", { Gv, Ev } },
{ "lzcntS", { Gv, Ev } },
{ "bsrS", { Gv, Ev } },
- { "(bad)", { XX } },
},
/* PREFIX_0FC2 */
/* PREFIX_0FC3 */
{
{ "movntiS", { Ma, Gv } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
},
/* PREFIX_0FC7_REG_6 */
{ "vmptrld",{ Mq } },
{ "vmxon", { Mq } },
{ "vmclear",{ Mq } },
- { "(bad)", { XX } },
},
/* PREFIX_0FD0 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "addsubpd", { XM, EXx } },
{ "addsubps", { XM, EXx } },
},
/* PREFIX_0FD6 */
{
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "movq2dq",{ XM, MS } },
{ "movq", { EXqS, XM } },
{ "movdq2q",{ MX, XS } },
/* PREFIX_0FE6 */
{
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "cvtdq2pd", { XM, EXq } },
{ "cvttpd2dq", { XM, EXx } },
{ "cvtpd2dq", { XM, EXx } },
/* PREFIX_0FE7 */
{
{ "movntq", { Mq, MX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0FE7_PREFIX_2) },
- { "(bad)", { XX } },
},
/* PREFIX_0FF0 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0FF0_PREFIX_3) },
},
/* PREFIX_0FF7 */
{
{ "maskmovq", { MX, MS } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "maskmovdqu", { XM, XS } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3810 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pblendvb", { XM, EXx, XMM0 } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3814 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "blendvps", { XM, EXx, XMM0 } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3815 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "blendvpd", { XM, EXx, XMM0 } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3817 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "ptest", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3820 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmovsxbw", { XM, EXq } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3821 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmovsxbd", { XM, EXd } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3822 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmovsxbq", { XM, EXw } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3823 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmovsxwd", { XM, EXq } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3824 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmovsxwq", { XM, EXd } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3825 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmovsxdq", { XM, EXq } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3828 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmuldq", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3829 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pcmpeqq", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F382A */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ MOD_TABLE (MOD_0F382A_PREFIX_2) },
- { "(bad)", { XX } },
},
/* PREFIX_0F382B */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "packusdw", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3830 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
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- { "(bad)", { XX } },
},
/* PREFIX_0F3831 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
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- { "(bad)", { XX } },
},
/* PREFIX_0F3832 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmovzxbq", { XM, EXw } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3833 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmovzxwd", { XM, EXq } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3834 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmovzxwq", { XM, EXd } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3835 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmovzxdq", { XM, EXq } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3837 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
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- { "(bad)", { XX } },
},
/* PREFIX_0F3838 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pminsb", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3839 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pminsd", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F383A */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
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+ { Bad_Opcode },
{ "pminuw", { XM, EXx } },
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},
/* PREFIX_0F383B */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pminud", { XM, EXx } },
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},
/* PREFIX_0F383C */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmaxsb", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F383D */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmaxsd", { XM, EXx } },
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},
/* PREFIX_0F383E */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmaxuw", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F383F */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmaxud", { XM, EXx } },
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},
/* PREFIX_0F3840 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pmulld", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3841 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "phminposuw", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3880 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "invept", { Gm, Mo } },
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},
/* PREFIX_0F3881 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "invvpid", { Gm, Mo } },
- { "(bad)", { XX } },
+ },
+
+ /* PREFIX_0F3882 */
+ {
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { "invpcid", { Gm, M } },
+ },
+
+ /* PREFIX_0F38C8 */
+ {
+ { "sha1nexte", { XM, EXxmm } },
+ },
+
+ /* PREFIX_0F38C9 */
+ {
+ { "sha1msg1", { XM, EXxmm } },
+ },
+
+ /* PREFIX_0F38CA */
+ {
+ { "sha1msg2", { XM, EXxmm } },
+ },
+
+ /* PREFIX_0F38CB */
+ {
+ { "sha256rnds2", { XM, EXxmm, XMM0 } },
+ },
+
+ /* PREFIX_0F38CC */
+ {
+ { "sha256msg1", { XM, EXxmm } },
+ },
+
+ /* PREFIX_0F38CD */
+ {
+ { "sha256msg2", { XM, EXxmm } },
},
/* PREFIX_0F38DB */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "aesimc", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F38DC */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "aesenc", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F38DD */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "aesenclast", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F38DE */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "aesdec", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F38DF */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "aesdeclast", { XM, EXx } },
- { "(bad)", { XX } },
},
/* PREFIX_0F38F0 */
{
{ "movbeS", { Gv, { MOVBE_Fixup, v_mode } } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "movbeS", { Gv, { MOVBE_Fixup, v_mode } } },
- { "crc32", { Gdq, { CRC32_Fixup, b_mode } } },
+ { "crc32", { Gdq, { CRC32_Fixup, b_mode } } },
},
/* PREFIX_0F38F1 */
{
{ "movbeS", { { MOVBE_Fixup, v_mode }, Gv } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "movbeS", { { MOVBE_Fixup, v_mode }, Gv } },
- { "crc32", { Gdq, { CRC32_Fixup, v_mode } } },
+ { "crc32", { Gdq, { CRC32_Fixup, v_mode } } },
+ },
+
+ /* PREFIX_0F38F6 */
+ {
+ { Bad_Opcode },
+ { "adoxS", { Gdq, Edq} },
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},
/* PREFIX_0F3A08 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "roundps", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A09 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "roundpd", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A0A */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "roundss", { XM, EXd, Ib } },
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},
/* PREFIX_0F3A0B */
{
- { "(bad)", { XX } },
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+ { Bad_Opcode },
{ "roundsd", { XM, EXq, Ib } },
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/* PREFIX_0F3A0C */
{
- { "(bad)", { XX } },
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+ { Bad_Opcode },
+ { Bad_Opcode },
{ "blendps", { XM, EXx, Ib } },
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},
/* PREFIX_0F3A0D */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "blendpd", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A0E */
{
- { "(bad)", { XX } },
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+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pblendw", { XM, EXx, Ib } },
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},
/* PREFIX_0F3A14 */
{
- { "(bad)", { XX } },
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+ { Bad_Opcode },
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},
/* PREFIX_0F3A15 */
{
- { "(bad)", { XX } },
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+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pextrw", { Edqw, XM, Ib } },
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},
/* PREFIX_0F3A16 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pextrK", { Edq, XM, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A17 */
{
- { "(bad)", { XX } },
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+ { Bad_Opcode },
+ { Bad_Opcode },
{ "extractps", { Edqd, XM, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A20 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pinsrb", { XM, Edqb, Ib } },
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},
/* PREFIX_0F3A21 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "insertps", { XM, EXd, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A22 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pinsrK", { XM, Edq, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A40 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "dpps", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A41 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "dppd", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A42 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "mpsadbw", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A44 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pclmulqdq", { XM, EXx, PCLMUL } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A60 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pcmpestrm", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A61 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pcmpestri", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A62 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pcmpistrm", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
/* PREFIX_0F3A63 */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "pcmpistri", { XM, EXx, Ib } },
- { "(bad)", { XX } },
+ },
+
+ /* PREFIX_0F3ACC */
+ {
+ { "sha1rnds4", { XM, EXxmm, Ib } },
},
/* PREFIX_0F3ADF */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "aeskeygenassist", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
- /* PREFIX_VEX_10 */
+ /* PREFIX_VEX_0F10 */
{
- { VEX_W_TABLE (VEX_W_10_P_0) },
- { VEX_LEN_TABLE (VEX_LEN_10_P_1) },
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+ { VEX_W_TABLE (VEX_W_0F10_P_0) },
+ { VEX_LEN_TABLE (VEX_LEN_0F10_P_1) },
+ { VEX_W_TABLE (VEX_W_0F10_P_2) },
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},
- /* PREFIX_VEX_11 */
+ /* PREFIX_VEX_0F11 */
{
- { VEX_W_TABLE (VEX_W_11_P_0) },
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},
- /* PREFIX_VEX_12 */
+ /* PREFIX_VEX_0F12 */
{
- { MOD_TABLE (MOD_VEX_12_PREFIX_0) },
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- { VEX_LEN_TABLE (VEX_LEN_12_P_2) },
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},
- /* PREFIX_VEX_16 */
+ /* PREFIX_VEX_0F16 */
{
- { MOD_TABLE (MOD_VEX_16_PREFIX_0) },
- { VEX_W_TABLE (VEX_W_16_P_1) },
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- { "(bad)", { XX } },
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+ { VEX_W_TABLE (VEX_W_0F16_P_1) },
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},
- /* PREFIX_VEX_2A */
+ /* PREFIX_VEX_0F2A */
{
- { "(bad)", { XX } },
- { VEX_LEN_TABLE (VEX_LEN_2A_P_1) },
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+ { Bad_Opcode },
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},
- /* PREFIX_VEX_2C */
+ /* PREFIX_VEX_0F2C */
{
- { "(bad)", { XX } },
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- { "(bad)", { XX } },
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+ { Bad_Opcode },
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},
- /* PREFIX_VEX_2D */
+ /* PREFIX_VEX_0F2D */
{
- { "(bad)", { XX } },
- { VEX_LEN_TABLE (VEX_LEN_2D_P_1) },
- { "(bad)", { XX } },
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},
- /* PREFIX_VEX_2E */
+ /* PREFIX_VEX_0F2E */
{
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- { "(bad)", { XX } },
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+ { VEX_LEN_TABLE (VEX_LEN_0F2E_P_2) },
},
- /* PREFIX_VEX_2F */
+ /* PREFIX_VEX_0F2F */
{
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},
- /* PREFIX_VEX_51 */
+ /* PREFIX_VEX_0F41 */
{
- { VEX_W_TABLE (VEX_W_51_P_0) },
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},
- /* PREFIX_VEX_52 */
+ /* PREFIX_VEX_0F42 */
{
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},
- /* PREFIX_VEX_53 */
+ /* PREFIX_VEX_0F44 */
{
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},
- /* PREFIX_VEX_58 */
+ /* PREFIX_VEX_0F45 */
{
- { VEX_W_TABLE (VEX_W_58_P_0) },
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},
- /* PREFIX_VEX_59 */
+ /* PREFIX_VEX_0F46 */
{
- { VEX_W_TABLE (VEX_W_59_P_0) },
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- /* PREFIX_VEX_38BC */
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+ /* PREFIX_VEX_0F3A0E */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { VEX_LEN_TABLE (VEX_LEN_3A7F_P_2) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { VEX_W_TABLE (VEX_W_0F3A0E_P_2) },
},
- /* PREFIX_VEX_3ADF */
+ /* PREFIX_VEX_0F3A0F */
{
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { VEX_LEN_TABLE (VEX_LEN_3ADF_P_2) },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { VEX_W_TABLE (VEX_W_0F3A0F_P_2) },
},
-};
-static const struct dis386 x86_64_table[][2] = {
- /* X86_64_06 */
+ /* PREFIX_VEX_0F3A14 */
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- { "push{T|}", { es } },
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+ { Bad_Opcode },
+ { VEX_LEN_TABLE (VEX_LEN_0F3A14_P_2) },
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- /* X86_64_07 */
+ /* PREFIX_VEX_0F3A15 */
{
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+ { Bad_Opcode },
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- /* X86_64_0D */
+ /* PREFIX_VEX_0F3A16 */
{
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+ { Bad_Opcode },
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- /* X86_64_16 */
+ /* PREFIX_VEX_0F3A17 */
{
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+ { Bad_Opcode },
+ { Bad_Opcode },
+ { VEX_LEN_TABLE (VEX_LEN_0F3A17_P_2) },
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- /* X86_64_17 */
+ /* PREFIX_VEX_0F3A18 */
{
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+ /* PREFIX_VEX_0F3A19 */
{
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+ /* PREFIX_VEX_0F3A1D */
{
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+ { Bad_Opcode },
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+ /* PREFIX_VEX_0F3A20 */
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- /* X86_64_2F */
+ /* PREFIX_VEX_0F3A21 */
{
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+ { Bad_Opcode },
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- /* X86_64_37 */
+ /* PREFIX_VEX_0F3A22 */
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- /* X86_64_3F */
+ /* PREFIX_VEX_0F3A30 */
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- /* X86_64_60 */
+ /* PREFIX_VEX_0F3A31 */
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- /* X86_64_61 */
+ /* PREFIX_VEX_0F3A32 */
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+ /* PREFIX_VEX_0F3A40 */
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+ /* PREFIX_VEX_0F3A46 */
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- /* X86_64_D4 */
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- /* X86_64_D5 */
+ /* PREFIX_VEX_0F3A49 */
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- /* X86_64_EA */
+ /* PREFIX_VEX_0F3A4A */
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- /* X86_64_0F01_REG_0 */
+ /* PREFIX_VEX_0F3A4B */
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+ { Bad_Opcode },
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- /* X86_64_0F01_REG_1 */
+ /* PREFIX_VEX_0F3A4C */
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+ /* PREFIX_VEX_0F3A5C */
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- /* X86_64_0F01_REG_3 */
+ /* PREFIX_VEX_0F3A5D */
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-static const struct dis386 three_byte_table[][256] = {
+ /* PREFIX_VEX_0F3A5E */
+ {
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+ { Bad_Opcode },
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- { "phsubsw", { MX, EM } },
- /* 08 */
- { "psignb", { MX, EM } },
- { "psignw", { MX, EM } },
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- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- /* 10 */
- { PREFIX_TABLE (PREFIX_0F3810) },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
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- { PREFIX_TABLE (PREFIX_0F3814) },
- { PREFIX_TABLE (PREFIX_0F3815) },
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- { PREFIX_TABLE (PREFIX_0F3817) },
- /* 18 */
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "pabsb", { MX, EM } },
+ { Bad_Opcode },
+ { Bad_Opcode },
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+ },
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+ /* PREFIX_VEX_0F3A60 */
+ {
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+ /* PREFIX_VEX_0F3A61 */
+ {
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+ {
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+ {
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+ /* PREFIX_VEX_0F3A68 */
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+ /* PREFIX_VEX_0F3A69 */
+ {
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+ /* PREFIX_VEX_0F3A6A */
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+ /* PREFIX_VEX_0F3A6E */
+ {
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+ /* PREFIX_VEX_0F3A78 */
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+ /* PREFIX_VEX_0F3A79 */
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+ /* PREFIX_VEX_0F3A7A */
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+ /* PREFIX_VEX_0F3A7C */
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+ /* PREFIX_VEX_0F3A7E */
+ {
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+ /* PREFIX_VEX_0F3A7F */
+ {
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+ /* PREFIX_VEX_0F3ADF */
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+
+ /* PREFIX_VEX_0F3AF0 */
+ {
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+ { Bad_Opcode },
+ { Bad_Opcode },
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+#define NEED_PREFIX_TABLE
+#include "i386-dis-evex.h"
+#undef NEED_PREFIX_TABLE
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+static const struct dis386 x86_64_table[][2] = {
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+};
+
+static const struct dis386 three_byte_table[][256] = {
+
+ /* THREE_BYTE_0F38 */
+ {
+ /* 00 */
+ { "pshufb", { MX, EM } },
+ { "phaddw", { MX, EM } },
+ { "phaddd", { MX, EM } },
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+ { "phsubw", { MX, EM } },
+ { "phsubd", { MX, EM } },
+ { "phsubsw", { MX, EM } },
+ /* 08 */
+ { "psignb", { MX, EM } },
+ { "psignw", { MX, EM } },
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+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
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+ /* 10 */
+ { PREFIX_TABLE (PREFIX_0F3810) },
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/* 48 */
- { "(bad)", { XX } },
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/* 50 */
- { "(bad)", { XX } },
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+ { Bad_Opcode },
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+ { Bad_Opcode },
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- { "(bad)", { XX } },
- { "(bad)", { XX } },
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+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "vpmacsww", { XMVexW, Vex, EXVexW, EXVexW, VexI4 } },
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/* 98 */
- { "(bad)", { XX } },
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- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "vpmacsdd", { XMVexW, Vex, EXVexW, EXVexW, VexI4 } },
{ "vpmacsdqh", { XMVexW, Vex, EXVexW, EXVexW, VexI4 } },
/* a0 */
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/* f8 */
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/* 20 */
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/* 88 */
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/* 90 */
{ "vprotb", { XM, Vex_2src_1, Vex_2src_2 } },
{ "vprotw", { XM, Vex_2src_1, Vex_2src_2 } },
{ "vpshaw", { XM, Vex_2src_1, Vex_2src_2 } },
{ "vpshad", { XM, Vex_2src_1, Vex_2src_2 } },
{ "vpshaq", { XM, Vex_2src_1, Vex_2src_2 } },
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/* a8 */
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/* XOP_0A */
{
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/* 08 */
- { "(bad)", { XX } },
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/* 10 */
- { "(bad)", { XX } },
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+ { "bextr", { Gv, Ev, Iq } },
+ { Bad_Opcode },
{ REG_TABLE (REG_XOP_LWP) },
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+ { Bad_Opcode },
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/* 88 */
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/* 28 */
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- { PREFIX_TABLE (PREFIX_VEX_3898) },
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- { PREFIX_TABLE (PREFIX_VEX_3ADF) },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F3ADF) },
/* e0 */
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
/* e8 */
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
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+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
/* f0 */
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
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- { "(bad)", { XX } },
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+ { PREFIX_TABLE (PREFIX_VEX_0F3AF0) },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
/* f8 */
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
},
};
+#define NEED_OPCODE_TABLE
+#include "i386-dis-evex.h"
+#undef NEED_OPCODE_TABLE
static const struct dis386 vex_len_table[][2] = {
- /* VEX_LEN_10_P_1 */
- {
- { VEX_W_TABLE (VEX_W_10_P_1) },
- { "(bad)", { XX } },
- },
-
- /* VEX_LEN_10_P_3 */
- {
- { VEX_W_TABLE (VEX_W_10_P_3) },
- { "(bad)", { XX } },
- },
-
- /* VEX_LEN_11_P_1 */
- {
- { VEX_W_TABLE (VEX_W_11_P_1) },
- { "(bad)", { XX } },
- },
-
- /* VEX_LEN_11_P_3 */
- {
- { VEX_W_TABLE (VEX_W_11_P_3) },
- { "(bad)", { XX } },
- },
-
- /* VEX_LEN_12_P_0_M_0 */
- {
- { VEX_W_TABLE (VEX_W_12_P_0_M_0) },
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- },
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- /* VEX_LEN_12_P_0_M_1 */
- {
- { VEX_W_TABLE (VEX_W_12_P_0_M_1) },
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- },
-
- /* VEX_LEN_12_P_2 */
- {
- { VEX_W_TABLE (VEX_W_12_P_2) },
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- },
-
- /* VEX_LEN_13_M_0 */
- {
- { VEX_W_TABLE (VEX_W_13_M_0) },
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- },
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- /* VEX_LEN_16_P_0_M_0 */
- {
- { VEX_W_TABLE (VEX_W_16_P_0_M_0) },
- { "(bad)", { XX } },
- },
-
- /* VEX_LEN_16_P_0_M_1 */
- {
- { VEX_W_TABLE (VEX_W_16_P_0_M_1) },
- { "(bad)", { XX } },
- },
-
- /* VEX_LEN_16_P_2 */
- {
- { VEX_W_TABLE (VEX_W_16_P_2) },
- { "(bad)", { XX } },
- },
-
- /* VEX_LEN_17_M_0 */
- {
- { VEX_W_TABLE (VEX_W_17_M_0) },
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- },
-
- /* VEX_LEN_2A_P_1 */
- {
- { "vcvtsi2ss%LQ", { XM, Vex128, Ev } },
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- },
-
- /* VEX_LEN_2A_P_3 */
- {
- { "vcvtsi2sd%LQ", { XM, Vex128, Ev } },
- { "(bad)", { XX } },
- },
-
- /* VEX_LEN_2C_P_1 */
- {
- { "vcvttss2siY", { Gv, EXd } },
- { "(bad)", { XX } },
- },
-
- /* VEX_LEN_2C_P_3 */
- {
- { "vcvttsd2siY", { Gv, EXq } },
- { "(bad)", { XX } },
- },
-
- /* VEX_LEN_2D_P_1 */
- {
- { "vcvtss2siY", { Gv, EXd } },
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- },
-
- /* VEX_LEN_2D_P_3 */
+ /* VEX_LEN_0F10_P_1 */
{
- { "vcvtsd2siY", { Gv, EXq } },
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+ { VEX_W_TABLE (VEX_W_0F10_P_1) },
+ { VEX_W_TABLE (VEX_W_0F10_P_1) },
},
- /* VEX_LEN_2E_P_0 */
+ /* VEX_LEN_0F10_P_3 */
{
- { VEX_W_TABLE (VEX_W_2E_P_0) },
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+ { VEX_W_TABLE (VEX_W_0F10_P_3) },
},
- /* VEX_LEN_2E_P_2 */
+ /* VEX_LEN_0F11_P_1 */
{
- { VEX_W_TABLE (VEX_W_2E_P_2) },
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+ { VEX_W_TABLE (VEX_W_0F11_P_1) },
},
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+ /* VEX_LEN_0F11_P_3 */
{
- { VEX_W_TABLE (VEX_W_2F_P_0) },
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{
- { VEX_W_TABLE (VEX_W_2F_P_2) },
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- /* VEX_LEN_51_P_1 */
+ /* VEX_LEN_0F12_P_0_M_1 */
{
- { VEX_W_TABLE (VEX_W_51_P_1) },
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{
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+ /* VEX_LEN_0F13_M_0 */
{
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+ /* VEX_LEN_0F16_P_0_M_0 */
{
- { VEX_W_TABLE (VEX_W_53_P_1) },
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+ /* VEX_LEN_0F2A_P_1 */
{
- { VEX_W_TABLE (VEX_W_59_P_3) },
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+ { "vcvtsi2ss%LQ", { XMScalar, VexScalar, Ev } },
+ { "vcvtsi2ss%LQ", { XMScalar, VexScalar, Ev } },
},
- /* VEX_LEN_5A_P_1 */
+ /* VEX_LEN_0F2A_P_3 */
{
- { VEX_W_TABLE (VEX_W_5A_P_1) },
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+ { "vcvtsi2sd%LQ", { XMScalar, VexScalar, Ev } },
},
- /* VEX_LEN_5A_P_3 */
+ /* VEX_LEN_0F2C_P_1 */
{
- { VEX_W_TABLE (VEX_W_5A_P_3) },
- { "(bad)", { XX } },
+ { "vcvttss2siY", { Gv, EXdScalar } },
+ { "vcvttss2siY", { Gv, EXdScalar } },
},
- /* VEX_LEN_5C_P_1 */
+ /* VEX_LEN_0F2C_P_3 */
{
- { VEX_W_TABLE (VEX_W_5C_P_1) },
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+ { "vcvttsd2siY", { Gv, EXqScalar } },
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- /* VEX_LEN_5C_P_3 */
+ /* VEX_LEN_0F2D_P_1 */
{
- { VEX_W_TABLE (VEX_W_5C_P_3) },
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+ { "vcvtss2siY", { Gv, EXdScalar } },
},
- /* VEX_LEN_5D_P_1 */
+ /* VEX_LEN_0F2D_P_3 */
{
- { VEX_W_TABLE (VEX_W_5D_P_1) },
- { "(bad)", { XX } },
+ { "vcvtsd2siY", { Gv, EXqScalar } },
+ { "vcvtsd2siY", { Gv, EXqScalar } },
},
- /* VEX_LEN_5D_P_3 */
+ /* VEX_LEN_0F2E_P_0 */
{
- { VEX_W_TABLE (VEX_W_5D_P_3) },
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- /* VEX_LEN_5E_P_1 */
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{
- { VEX_W_TABLE (VEX_W_5E_P_1) },
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+ /* VEX_LEN_0F2F_P_0 */
{
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- /* VEX_LEN_5F_P_1 */
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{
- { VEX_W_TABLE (VEX_W_5F_P_1) },
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+ { VEX_W_TABLE (VEX_W_0F2F_P_2) },
},
- /* VEX_LEN_5F_P_3 */
+ /* VEX_LEN_0F41_P_0 */
{
- { VEX_W_TABLE (VEX_W_5F_P_3) },
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+ { Bad_Opcode },
+ { VEX_W_TABLE (VEX_W_0F41_P_0_LEN_1) },
},
-
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- {
- { VEX_W_TABLE (VEX_W_60_P_2) },
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- },
-
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- {
- { VEX_W_TABLE (VEX_W_61_P_2) },
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- {
- { VEX_W_TABLE (VEX_W_62_P_2) },
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- },
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- {
- { VEX_W_TABLE (VEX_W_63_P_2) },
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- {
- { VEX_W_TABLE (VEX_W_64_P_2) },
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-
- /* VEX_LEN_65_P_2 */
+ /* VEX_LEN_0F41_P_2 */
{
- { VEX_W_TABLE (VEX_W_65_P_2) },
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+ { VEX_W_TABLE (VEX_W_0F41_P_2_LEN_1) },
},
-
- /* VEX_LEN_66_P_2 */
+ /* VEX_LEN_0F42_P_0 */
{
- { VEX_W_TABLE (VEX_W_66_P_2) },
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+ { VEX_W_TABLE (VEX_W_0F42_P_0_LEN_1) },
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-
- /* VEX_LEN_67_P_2 */
+ /* VEX_LEN_0F42_P_2 */
{
- { VEX_W_TABLE (VEX_W_67_P_2) },
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-
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- { VEX_W_TABLE (VEX_W_68_P_2) },
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-
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{
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-
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{
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{
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-
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{
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},
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-
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+ /* VEX_LEN_0F4A_P_2 */
{
- { VEX_W_TABLE (VEX_W_70_P_3) },
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},
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+ { VEX_W_TABLE (VEX_W_0F53_P_1) },
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+ { VEX_W_TABLE (VEX_W_0F58_P_1) },
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+ { VEX_W_TABLE (VEX_W_0F58_P_3) },
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+ { VEX_W_TABLE (VEX_W_0F59_P_1) },
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- /* VEX_LEN_73_R_7_P_2 */
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- /* VEX_LEN_75_P_2 */
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- /* VEX_LEN_76_P_2 */
+ /* VEX_LEN_0F5C_P_1 */
{
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+ { VEX_W_TABLE (VEX_W_0F3A39_P_2) },
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- /* VEX_LEN_3829_P_2 */
+ /* VEX_LEN_0F3A41_P_2 */
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- { VEX_W_TABLE (VEX_W_3829_P_2) },
- { "(bad)", { XX } },
+ { VEX_W_TABLE (VEX_W_0F3A41_P_2) },
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- { VEX_W_TABLE (VEX_W_382A_P_2_M_0) },
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- { VEX_W_TABLE (VEX_W_3839_P_2) },
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- { VEX_W_TABLE (VEX_W_38DF_P_2) },
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+ /* VEX_LEN_0FXOP_09_80 */
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- /* VEX_LEN_3A0A_P_2 */
+ /* VEX_LEN_0FXOP_09_81 */
{
- { VEX_W_TABLE (VEX_W_3A0A_P_2) },
- { "(bad)", { XX } },
+ { "vfrczpd", { XM, EXxmm } },
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+};
- /* VEX_LEN_3A0B_P_2 */
+static const struct dis386 vex_w_table[][2] = {
{
- { VEX_W_TABLE (VEX_W_3A0B_P_2) },
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-
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{
- { VEX_W_TABLE (VEX_W_3A0E_P_2) },
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{
- { VEX_W_TABLE (VEX_W_3A0F_P_2) },
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{
- { VEX_W_TABLE (VEX_W_3A14_P_2) },
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+ /* VEX_W_0F10_P_3 */
+ { "vmovsd", { XMVexScalar, VexScalar, EXqScalar } },
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{
- { VEX_W_TABLE (VEX_W_3A15_P_2) },
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+ /* VEX_W_0F11_P_0 */
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{
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+ /* VEX_W_0F11_P_1 */
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- /* VEX_LEN_3A17_P_2 */
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- },
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- {
- { "(bad)", { XX } },
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- /* VEX_LEN_3A19_P_2 */
{
- { "(bad)", { XX } },
- { VEX_W_TABLE (VEX_W_3A19_P_2) },
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- /* VEX_LEN_3A20_P_2 */
{
- { VEX_W_TABLE (VEX_W_3A20_P_2) },
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- /* VEX_LEN_3A21_P_2 */
{
- { VEX_W_TABLE (VEX_W_3A21_P_2) },
- { "(bad)", { XX } },
+ /* VEX_W_0F12_P_0_M_1 */
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+ /* VEX_W_0F12_P_1 */
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},
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{
- { VEX_W_TABLE (VEX_W_3A41_P_2) },
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- /* VEX_LEN_3A42_P_2 */
{
- { VEX_W_TABLE (VEX_W_3A42_P_2) },
- { "(bad)", { XX } },
+ /* VEX_W_0F12_P_3 */
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{
- { VEX_W_TABLE (VEX_W_3A44_P_2) },
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+ /* VEX_W_0F13_M_0 */
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- /* VEX_LEN_3A4C_P_2 */
{
- { VEX_W_TABLE (VEX_W_3A4C_P_2) },
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- /* VEX_LEN_3A60_P_2 */
{
- { VEX_W_TABLE (VEX_W_3A60_P_2) },
- { "(bad)", { XX } },
+ /* VEX_W_0F15 */
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- /* VEX_LEN_3A61_P_2 */
{
- { VEX_W_TABLE (VEX_W_3A61_P_2) },
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+ /* VEX_W_0F16_P_0_M_0 */
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- /* VEX_LEN_3A62_P_2 */
{
- { VEX_W_TABLE (VEX_W_3A62_P_2) },
- { "(bad)", { XX } },
+ /* VEX_W_0F16_P_0_M_1 */
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- /* VEX_LEN_3A63_P_2 */
{
- { VEX_W_TABLE (VEX_W_3A63_P_2) },
- { "(bad)", { XX } },
+ /* VEX_W_0F16_P_1 */
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-
- /* VEX_LEN_3A6A_P_2 */
{
- { "vfmaddss", { XMVexW, Vex128, EXdVexW, EXdVexW, VexI4 } },
- { "(bad)", { XX } },
+ /* VEX_W_0F16_P_2 */
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- /* VEX_LEN_3A6B_P_2 */
{
- { "vfmaddsd", { XMVexW, Vex128, EXqVexW, EXqVexW, VexI4 } },
- { "(bad)", { XX } },
+ /* VEX_W_0F17_M_0 */
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{
- { "vfmsubss", { XMVexW, Vex128, EXdVexW, EXdVexW, VexI4 } },
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+ /* VEX_W_0F28 */
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- /* VEX_LEN_3A6F_P_2 */
{
- { "vfmsubsd", { XMVexW, Vex128, EXqVexW, EXqVexW, VexI4 } },
- { "(bad)", { XX } },
+ /* VEX_W_0F29 */
+ { "vmovapX", { EXxS, XM } },
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- /* VEX_LEN_3A7A_P_2 */
{
- { "vfnmaddss", { XMVexW, Vex128, EXdVexW, EXdVexW, VexI4 } },
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},
-
- /* VEX_LEN_3A7E_P_2 */
{
- { "vfnmsubss", { XMVexW, Vex128, EXdVexW, EXdVexW, VexI4 } },
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+ /* VEX_W_0F2E_P_2 */
+ { "vucomisd", { XMScalar, EXqScalar } },
},
-
- /* VEX_LEN_3A7F_P_2 */
{
- { "vfnmsubsd", { XMVexW, Vex128, EXqVexW, EXqVexW, VexI4 } },
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+ /* VEX_W_0F2F_P_0 */
+ { "vcomiss", { XMScalar, EXdScalar } },
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- /* VEX_LEN_3ADF_P_2 */
{
- { VEX_W_TABLE (VEX_W_3ADF_P_2) },
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+ { "vcomisd", { XMScalar, EXqScalar } },
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-
- /* VEX_LEN_XOP_09_80 */
{
- { "vfrczps", { XM, EXxmm } },
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- /* VEX_LEN_XOP_09_81 */
{
- { "vfrczpd", { XM, EXxmm } },
- { "vfrczpd", { XM, EXymmq } },
+ /* VEX_W_0F41_P_2_LEN_1 */
+ { "kandb", { MaskG, MaskVex, MaskR } },
+ { "kandd", { MaskG, MaskVex, MaskR } },
},
-};
-
-static const struct dis386 vex_w_table[][2] = {
{
- /* VEX_W_10_P_0 */
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+ /* VEX_W_0F42_P_0_LEN_1 */
+ { "kandnw", { MaskG, MaskVex, MaskR } },
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},
{
- /* VEX_W_10_P_1 */
- { "vmovss", { XMVex, Vex128, EXd } },
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+ /* VEX_W_0F42_P_2_LEN_1 */
+ { "kandnb", { MaskG, MaskVex, MaskR } },
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},
{
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+ { "knotw", { MaskG, MaskR } },
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{
- /* VEX_W_10_P_3 */
- { "vmovsd", { XMVex, Vex128, EXq } },
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+ { "knotb", { MaskG, MaskR } },
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{
- /* VEX_W_11_P_0 */
- { "vmovups", { EXxS, XM } },
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+ { "korw", { MaskG, MaskVex, MaskR } },
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{
- /* VEX_W_11_P_1 */
- { "vmovss", { EXdVexS, Vex128, XM } },
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+ { "korb", { MaskG, MaskVex, MaskR } },
+ { "kord", { MaskG, MaskVex, MaskR } },
},
{
- /* VEX_W_11_P_2 */
- { "vmovupd", { EXxS, XM } },
- { "(bad)", { XX } },
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+ { "kxnorw", { MaskG, MaskVex, MaskR } },
+ { "kxnorq", { MaskG, MaskVex, MaskR } },
},
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- /* VEX_W_11_P_3 */
- { "vmovsd", { EXqVexS, Vex128, XM } },
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+ { "kxnorb", { MaskG, MaskVex, MaskR } },
+ { "kxnord", { MaskG, MaskVex, MaskR } },
},
{
- /* VEX_W_12_P_0_M_0 */
- { "vmovlps", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F47_P_0_LEN_1 */
+ { "kxorw", { MaskG, MaskVex, MaskR } },
+ { "kxorq", { MaskG, MaskVex, MaskR } },
},
{
- /* VEX_W_12_P_0_M_1 */
- { "vmovhlps", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F47_P_2_LEN_1 */
+ { "kxorb", { MaskG, MaskVex, MaskR } },
+ { "kxord", { MaskG, MaskVex, MaskR } },
},
{
- /* VEX_W_12_P_1 */
- { "vmovsldup", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F4A_P_0_LEN_1 */
+ { "kaddw", { MaskG, MaskVex, MaskR } },
+ { "kaddq", { MaskG, MaskVex, MaskR } },
},
{
- /* VEX_W_12_P_2 */
- { "vmovlpd", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F4A_P_2_LEN_1 */
+ { "kaddb", { MaskG, MaskVex, MaskR } },
+ { "kaddd", { MaskG, MaskVex, MaskR } },
},
{
- /* VEX_W_12_P_3 */
- { "vmovddup", { XM, EXymmq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F4B_P_0_LEN_1 */
+ { "kunpckwd", { MaskG, MaskVex, MaskR } },
+ { "kunpckdq", { MaskG, MaskVex, MaskR } },
},
{
- /* VEX_W_13_M_0 */
- { "vmovlpX", { EXq, XM } },
- { "(bad)", { XX } },
+ /* VEX_W_0F4B_P_2_LEN_1 */
+ { "kunpckbw", { MaskG, MaskVex, MaskR } },
},
{
- /* VEX_W_14 */
- { "vunpcklpX", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F50_M_0 */
+ { "vmovmskpX", { Gdq, XS } },
},
{
- /* VEX_W_15 */
- { "vunpckhpX", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F51_P_0 */
+ { "vsqrtps", { XM, EXx } },
},
{
- /* VEX_W_16_P_0_M_0 */
- { "vmovhps", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F51_P_1 */
+ { "vsqrtss", { XMScalar, VexScalar, EXdScalar } },
},
{
- /* VEX_W_16_P_0_M_1 */
- { "vmovlhps", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F51_P_2 */
+ { "vsqrtpd", { XM, EXx } },
},
{
- /* VEX_W_16_P_1 */
- { "vmovshdup", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F51_P_3 */
+ { "vsqrtsd", { XMScalar, VexScalar, EXqScalar } },
},
{
- /* VEX_W_16_P_2 */
- { "vmovhpd", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F52_P_0 */
+ { "vrsqrtps", { XM, EXx } },
},
{
- /* VEX_W_17_M_0 */
- { "vmovhpX", { EXq, XM } },
- { "(bad)", { XX } },
+ /* VEX_W_0F52_P_1 */
+ { "vrsqrtss", { XMScalar, VexScalar, EXdScalar } },
},
{
- /* VEX_W_28 */
- { "vmovapX", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F53_P_0 */
+ { "vrcpps", { XM, EXx } },
},
{
- /* VEX_W_29 */
- { "vmovapX", { EXxS, XM } },
- { "(bad)", { XX } },
+ /* VEX_W_0F53_P_1 */
+ { "vrcpss", { XMScalar, VexScalar, EXdScalar } },
},
{
- /* VEX_W_2B_M_0 */
- { "vmovntpX", { Mx, XM } },
- { "(bad)", { XX } },
+ /* VEX_W_0F58_P_0 */
+ { "vaddps", { XM, Vex, EXx } },
},
{
- /* VEX_W_2E_P_0 */
- { "vucomiss", { XM, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F58_P_1 */
+ { "vaddss", { XMScalar, VexScalar, EXdScalar } },
},
{
- /* VEX_W_2E_P_2 */
- { "vucomisd", { XM, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F58_P_2 */
+ { "vaddpd", { XM, Vex, EXx } },
},
{
- /* VEX_W_2F_P_0 */
- { "vcomiss", { XM, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F58_P_3 */
+ { "vaddsd", { XMScalar, VexScalar, EXqScalar } },
},
{
- /* VEX_W_2F_P_2 */
- { "vcomisd", { XM, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F59_P_0 */
+ { "vmulps", { XM, Vex, EXx } },
},
{
- /* VEX_W_50_M_0 */
- { "vmovmskpX", { Gdq, XS } },
- { "(bad)", { XX } },
+ /* VEX_W_0F59_P_1 */
+ { "vmulss", { XMScalar, VexScalar, EXdScalar } },
},
{
- /* VEX_W_51_P_0 */
- { "vsqrtps", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F59_P_2 */
+ { "vmulpd", { XM, Vex, EXx } },
},
{
- /* VEX_W_51_P_1 */
- { "vsqrtss", { XM, Vex128, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F59_P_3 */
+ { "vmulsd", { XMScalar, VexScalar, EXqScalar } },
},
{
- /* VEX_W_51_P_2 */
- { "vsqrtpd", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5A_P_0 */
+ { "vcvtps2pd", { XM, EXxmmq } },
},
{
- /* VEX_W_51_P_3 */
- { "vsqrtsd", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5A_P_1 */
+ { "vcvtss2sd", { XMScalar, VexScalar, EXdScalar } },
},
{
- /* VEX_W_52_P_0 */
- { "vrsqrtps", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5A_P_3 */
+ { "vcvtsd2ss", { XMScalar, VexScalar, EXqScalar } },
},
{
- /* VEX_W_52_P_1 */
- { "vrsqrtss", { XM, Vex128, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5B_P_0 */
+ { "vcvtdq2ps", { XM, EXx } },
},
{
- /* VEX_W_53_P_0 */
- { "vrcpps", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5B_P_1 */
+ { "vcvttps2dq", { XM, EXx } },
},
{
- /* VEX_W_53_P_1 */
- { "vrcpss", { XM, Vex128, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5B_P_2 */
+ { "vcvtps2dq", { XM, EXx } },
},
{
- /* VEX_W_58_P_0 */
- { "vaddps", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5C_P_0 */
+ { "vsubps", { XM, Vex, EXx } },
},
{
- /* VEX_W_58_P_1 */
- { "vaddss", { XM, Vex128, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5C_P_1 */
+ { "vsubss", { XMScalar, VexScalar, EXdScalar } },
},
{
- /* VEX_W_58_P_2 */
- { "vaddpd", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5C_P_2 */
+ { "vsubpd", { XM, Vex, EXx } },
},
{
- /* VEX_W_58_P_3 */
- { "vaddsd", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5C_P_3 */
+ { "vsubsd", { XMScalar, VexScalar, EXqScalar } },
},
{
- /* VEX_W_59_P_0 */
- { "vmulps", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5D_P_0 */
+ { "vminps", { XM, Vex, EXx } },
},
{
- /* VEX_W_59_P_1 */
- { "vmulss", { XM, Vex128, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5D_P_1 */
+ { "vminss", { XMScalar, VexScalar, EXdScalar } },
},
{
- /* VEX_W_59_P_2 */
- { "vmulpd", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5D_P_2 */
+ { "vminpd", { XM, Vex, EXx } },
},
{
- /* VEX_W_59_P_3 */
- { "vmulsd", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5D_P_3 */
+ { "vminsd", { XMScalar, VexScalar, EXqScalar } },
},
{
- /* VEX_W_5A_P_0 */
- { "vcvtps2pd", { XM, EXxmmq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5E_P_0 */
+ { "vdivps", { XM, Vex, EXx } },
},
{
- /* VEX_W_5A_P_1 */
- { "vcvtss2sd", { XM, Vex128, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5E_P_1 */
+ { "vdivss", { XMScalar, VexScalar, EXdScalar } },
},
{
- /* VEX_W_5A_P_3 */
- { "vcvtsd2ss", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5E_P_2 */
+ { "vdivpd", { XM, Vex, EXx } },
},
{
- /* VEX_W_5B_P_0 */
- { "vcvtdq2ps", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5E_P_3 */
+ { "vdivsd", { XMScalar, VexScalar, EXqScalar } },
},
{
- /* VEX_W_5B_P_1 */
- { "vcvttps2dq", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5F_P_0 */
+ { "vmaxps", { XM, Vex, EXx } },
},
{
- /* VEX_W_5B_P_2 */
- { "vcvtps2dq", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5F_P_1 */
+ { "vmaxss", { XMScalar, VexScalar, EXdScalar } },
},
{
- /* VEX_W_5C_P_0 */
- { "vsubps", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5F_P_2 */
+ { "vmaxpd", { XM, Vex, EXx } },
},
{
- /* VEX_W_5C_P_1 */
- { "vsubss", { XM, Vex128, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F5F_P_3 */
+ { "vmaxsd", { XMScalar, VexScalar, EXqScalar } },
},
{
- /* VEX_W_5C_P_2 */
- { "vsubpd", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F60_P_2 */
+ { "vpunpcklbw", { XM, Vex, EXx } },
},
{
- /* VEX_W_5C_P_3 */
- { "vsubsd", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F61_P_2 */
+ { "vpunpcklwd", { XM, Vex, EXx } },
},
{
- /* VEX_W_5D_P_0 */
- { "vminps", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F62_P_2 */
+ { "vpunpckldq", { XM, Vex, EXx } },
},
{
- /* VEX_W_5D_P_1 */
- { "vminss", { XM, Vex128, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F63_P_2 */
+ { "vpacksswb", { XM, Vex, EXx } },
},
{
- /* VEX_W_5D_P_2 */
- { "vminpd", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F64_P_2 */
+ { "vpcmpgtb", { XM, Vex, EXx } },
},
{
- /* VEX_W_5D_P_3 */
- { "vminsd", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F65_P_2 */
+ { "vpcmpgtw", { XM, Vex, EXx } },
},
{
- /* VEX_W_5E_P_0 */
- { "vdivps", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F66_P_2 */
+ { "vpcmpgtd", { XM, Vex, EXx } },
},
{
- /* VEX_W_5E_P_1 */
- { "vdivss", { XM, Vex128, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F67_P_2 */
+ { "vpackuswb", { XM, Vex, EXx } },
},
{
- /* VEX_W_5E_P_2 */
- { "vdivpd", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F68_P_2 */
+ { "vpunpckhbw", { XM, Vex, EXx } },
},
{
- /* VEX_W_5E_P_3 */
- { "vdivsd", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F69_P_2 */
+ { "vpunpckhwd", { XM, Vex, EXx } },
},
{
- /* VEX_W_5F_P_0 */
- { "vmaxps", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F6A_P_2 */
+ { "vpunpckhdq", { XM, Vex, EXx } },
},
{
- /* VEX_W_5F_P_1 */
- { "vmaxss", { XM, Vex128, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F6B_P_2 */
+ { "vpackssdw", { XM, Vex, EXx } },
},
{
- /* VEX_W_5F_P_2 */
- { "vmaxpd", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F6C_P_2 */
+ { "vpunpcklqdq", { XM, Vex, EXx } },
},
{
- /* VEX_W_5F_P_3 */
- { "vmaxsd", { XM, Vex128, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F6D_P_2 */
+ { "vpunpckhqdq", { XM, Vex, EXx } },
},
{
- /* VEX_W_60_P_2 */
- { "vpunpcklbw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F6F_P_1 */
+ { "vmovdqu", { XM, EXx } },
},
{
- /* VEX_W_61_P_2 */
- { "vpunpcklwd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F6F_P_2 */
+ { "vmovdqa", { XM, EXx } },
},
{
- /* VEX_W_62_P_2 */
- { "vpunpckldq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F70_P_1 */
+ { "vpshufhw", { XM, EXx, Ib } },
},
{
- /* VEX_W_63_P_2 */
- { "vpacksswb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F70_P_2 */
+ { "vpshufd", { XM, EXx, Ib } },
},
{
- /* VEX_W_64_P_2 */
- { "vpcmpgtb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F70_P_3 */
+ { "vpshuflw", { XM, EXx, Ib } },
},
{
- /* VEX_W_65_P_2 */
- { "vpcmpgtw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F71_R_2_P_2 */
+ { "vpsrlw", { Vex, XS, Ib } },
},
{
- /* VEX_W_66_P_2 */
- { "vpcmpgtd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F71_R_4_P_2 */
+ { "vpsraw", { Vex, XS, Ib } },
},
{
- /* VEX_W_67_P_2 */
- { "vpackuswb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F71_R_6_P_2 */
+ { "vpsllw", { Vex, XS, Ib } },
},
{
- /* VEX_W_68_P_2 */
- { "vpunpckhbw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F72_R_2_P_2 */
+ { "vpsrld", { Vex, XS, Ib } },
},
{
- /* VEX_W_69_P_2 */
- { "vpunpckhwd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F72_R_4_P_2 */
+ { "vpsrad", { Vex, XS, Ib } },
},
{
- /* VEX_W_6A_P_2 */
- { "vpunpckhdq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F72_R_6_P_2 */
+ { "vpslld", { Vex, XS, Ib } },
},
{
- /* VEX_W_6B_P_2 */
- { "vpackssdw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F73_R_2_P_2 */
+ { "vpsrlq", { Vex, XS, Ib } },
},
{
- /* VEX_W_6C_P_2 */
- { "vpunpcklqdq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F73_R_3_P_2 */
+ { "vpsrldq", { Vex, XS, Ib } },
},
{
- /* VEX_W_6D_P_2 */
- { "vpunpckhqdq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F73_R_6_P_2 */
+ { "vpsllq", { Vex, XS, Ib } },
},
{
- /* VEX_W_6F_P_1 */
- { "vmovdqu", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F73_R_7_P_2 */
+ { "vpslldq", { Vex, XS, Ib } },
},
{
- /* VEX_W_6F_P_2 */
- { "vmovdqa", { XM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F74_P_2 */
+ { "vpcmpeqb", { XM, Vex, EXx } },
},
{
- /* VEX_W_70_P_1 */
- { "vpshufhw", { XM, EXx, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F75_P_2 */
+ { "vpcmpeqw", { XM, Vex, EXx } },
},
{
- /* VEX_W_70_P_2 */
- { "vpshufd", { XM, EXx, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F76_P_2 */
+ { "vpcmpeqd", { XM, Vex, EXx } },
},
{
- /* VEX_W_70_P_3 */
- { "vpshuflw", { XM, EXx, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F77_P_0 */
+ { "", { VZERO } },
},
{
- /* VEX_W_71_R_2_P_2 */
- { "vpsrlw", { Vex128, XS, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F7C_P_2 */
+ { "vhaddpd", { XM, Vex, EXx } },
},
{
- /* VEX_W_71_R_4_P_2 */
- { "vpsraw", { Vex128, XS, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F7C_P_3 */
+ { "vhaddps", { XM, Vex, EXx } },
},
{
- /* VEX_W_71_R_6_P_2 */
- { "vpsllw", { Vex128, XS, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F7D_P_2 */
+ { "vhsubpd", { XM, Vex, EXx } },
},
{
- /* VEX_W_72_R_2_P_2 */
- { "vpsrld", { Vex128, XS, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F7D_P_3 */
+ { "vhsubps", { XM, Vex, EXx } },
},
{
- /* VEX_W_72_R_4_P_2 */
- { "vpsrad", { Vex128, XS, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F7E_P_1 */
+ { "vmovq", { XMScalar, EXqScalar } },
},
{
- /* VEX_W_72_R_6_P_2 */
- { "vpslld", { Vex128, XS, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F7F_P_1 */
+ { "vmovdqu", { EXxS, XM } },
},
{
- /* VEX_W_73_R_2_P_2 */
- { "vpsrlq", { Vex128, XS, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F7F_P_2 */
+ { "vmovdqa", { EXxS, XM } },
},
{
- /* VEX_W_73_R_3_P_2 */
- { "vpsrldq", { Vex128, XS, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F90_P_0_LEN_0 */
+ { "kmovw", { MaskG, MaskE } },
+ { "kmovq", { MaskG, MaskE } },
},
{
- /* VEX_W_73_R_6_P_2 */
- { "vpsllq", { Vex128, XS, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F90_P_2_LEN_0 */
+ { "kmovb", { MaskG, MaskBDE } },
+ { "kmovd", { MaskG, MaskBDE } },
},
{
- /* VEX_W_73_R_7_P_2 */
- { "vpslldq", { Vex128, XS, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F91_P_0_LEN_0 */
+ { "kmovw", { Ew, MaskG } },
+ { "kmovq", { Eq, MaskG } },
},
{
- /* VEX_W_74_P_2 */
- { "vpcmpeqb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F91_P_2_LEN_0 */
+ { "kmovb", { Eb, MaskG } },
+ { "kmovd", { Ed, MaskG } },
},
{
- /* VEX_W_75_P_2 */
- { "vpcmpeqw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F92_P_0_LEN_0 */
+ { "kmovw", { MaskG, Rdq } },
},
{
- /* VEX_W_76_P_2 */
- { "vpcmpeqd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F92_P_2_LEN_0 */
+ { "kmovb", { MaskG, Rdq } },
},
{
- /* VEX_W_77_P_0 */
- { "", { VZERO } },
- { "(bad)", { XX } },
+ /* VEX_W_0F92_P_3_LEN_0 */
+ { "kmovd", { MaskG, Rdq } },
+ { "kmovq", { MaskG, Rdq } },
},
{
- /* VEX_W_7C_P_2 */
- { "vhaddpd", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F93_P_0_LEN_0 */
+ { "kmovw", { Gdq, MaskR } },
},
{
- /* VEX_W_7C_P_3 */
- { "vhaddps", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F93_P_2_LEN_0 */
+ { "kmovb", { Gdq, MaskR } },
},
{
- /* VEX_W_7D_P_2 */
- { "vhsubpd", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F93_P_3_LEN_0 */
+ { "kmovd", { Gdq, MaskR } },
+ { "kmovq", { Gdq, MaskR } },
},
{
- /* VEX_W_7D_P_3 */
- { "vhsubps", { XM, Vex, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F98_P_0_LEN_0 */
+ { "kortestw", { MaskG, MaskR } },
+ { "kortestq", { MaskG, MaskR } },
},
{
- /* VEX_W_7E_P_1 */
- { "vmovq", { XM, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F98_P_2_LEN_0 */
+ { "kortestb", { MaskG, MaskR } },
+ { "kortestd", { MaskG, MaskR } },
},
{
- /* VEX_W_7F_P_1 */
- { "vmovdqu", { EXxS, XM } },
- { "(bad)", { XX } },
+ /* VEX_W_0F99_P_0_LEN_0 */
+ { "ktestw", { MaskG, MaskR } },
+ { "ktestq", { MaskG, MaskR } },
},
{
- /* VEX_W_7F_P_2 */
- { "vmovdqa", { EXxS, XM } },
- { "(bad)", { XX } },
+ /* VEX_W_0F99_P_2_LEN_0 */
+ { "ktestb", { MaskG, MaskR } },
+ { "ktestd", { MaskG, MaskR } },
},
{
- /* VEX_W_AE_R_2_M_0 */
+ /* VEX_W_0FAE_R_2_M_0 */
{ "vldmxcsr", { Md } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_AE_R_3_M_0 */
+ /* VEX_W_0FAE_R_3_M_0 */
{ "vstmxcsr", { Md } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_C2_P_0 */
+ /* VEX_W_0FC2_P_0 */
{ "vcmpps", { XM, Vex, EXx, VCMP } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_C2_P_1 */
- { "vcmpss", { XM, Vex128, EXd, VCMP } },
- { "(bad)", { XX } },
+ /* VEX_W_0FC2_P_1 */
+ { "vcmpss", { XMScalar, VexScalar, EXdScalar, VCMP } },
},
{
- /* VEX_W_C2_P_2 */
+ /* VEX_W_0FC2_P_2 */
{ "vcmppd", { XM, Vex, EXx, VCMP } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_C2_P_3 */
- { "vcmpsd", { XM, Vex128, EXq, VCMP } },
- { "(bad)", { XX } },
+ /* VEX_W_0FC2_P_3 */
+ { "vcmpsd", { XMScalar, VexScalar, EXqScalar, VCMP } },
},
{
- /* VEX_W_C4_P_2 */
+ /* VEX_W_0FC4_P_2 */
{ "vpinsrw", { XM, Vex128, Edqw, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_C5_P_2 */
+ /* VEX_W_0FC5_P_2 */
{ "vpextrw", { Gdq, XS, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_D0_P_2 */
+ /* VEX_W_0FD0_P_2 */
{ "vaddsubpd", { XM, Vex, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_D0_P_3 */
+ /* VEX_W_0FD0_P_3 */
{ "vaddsubps", { XM, Vex, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_D1_P_2 */
- { "vpsrlw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FD1_P_2 */
+ { "vpsrlw", { XM, Vex, EXxmm } },
},
{
- /* VEX_W_D2_P_2 */
- { "vpsrld", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FD2_P_2 */
+ { "vpsrld", { XM, Vex, EXxmm } },
},
{
- /* VEX_W_D3_P_2 */
- { "vpsrlq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FD3_P_2 */
+ { "vpsrlq", { XM, Vex, EXxmm } },
},
{
- /* VEX_W_D4_P_2 */
- { "vpaddq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FD4_P_2 */
+ { "vpaddq", { XM, Vex, EXx } },
},
{
- /* VEX_W_D5_P_2 */
- { "vpmullw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FD5_P_2 */
+ { "vpmullw", { XM, Vex, EXx } },
},
{
- /* VEX_W_D6_P_2 */
- { "vmovq", { EXqS, XM } },
- { "(bad)", { XX } },
+ /* VEX_W_0FD6_P_2 */
+ { "vmovq", { EXqScalarS, XMScalar } },
},
{
- /* VEX_W_D7_P_2_M_1 */
+ /* VEX_W_0FD7_P_2_M_1 */
{ "vpmovmskb", { Gdq, XS } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_D8_P_2 */
- { "vpsubusb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FD8_P_2 */
+ { "vpsubusb", { XM, Vex, EXx } },
},
{
- /* VEX_W_D9_P_2 */
- { "vpsubusw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FD9_P_2 */
+ { "vpsubusw", { XM, Vex, EXx } },
},
{
- /* VEX_W_DA_P_2 */
- { "vpminub", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FDA_P_2 */
+ { "vpminub", { XM, Vex, EXx } },
},
{
- /* VEX_W_DB_P_2 */
- { "vpand", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FDB_P_2 */
+ { "vpand", { XM, Vex, EXx } },
},
{
- /* VEX_W_DC_P_2 */
- { "vpaddusb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FDC_P_2 */
+ { "vpaddusb", { XM, Vex, EXx } },
},
{
- /* VEX_W_DD_P_2 */
- { "vpaddusw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FDD_P_2 */
+ { "vpaddusw", { XM, Vex, EXx } },
},
{
- /* VEX_W_DE_P_2 */
- { "vpmaxub", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FDE_P_2 */
+ { "vpmaxub", { XM, Vex, EXx } },
},
{
- /* VEX_W_DF_P_2 */
- { "vpandn", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FDF_P_2 */
+ { "vpandn", { XM, Vex, EXx } },
},
{
- /* VEX_W_E0_P_2 */
- { "vpavgb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FE0_P_2 */
+ { "vpavgb", { XM, Vex, EXx } },
},
{
- /* VEX_W_E1_P_2 */
- { "vpsraw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FE1_P_2 */
+ { "vpsraw", { XM, Vex, EXxmm } },
},
{
- /* VEX_W_E2_P_2 */
- { "vpsrad", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FE2_P_2 */
+ { "vpsrad", { XM, Vex, EXxmm } },
},
{
- /* VEX_W_E3_P_2 */
- { "vpavgw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FE3_P_2 */
+ { "vpavgw", { XM, Vex, EXx } },
},
{
- /* VEX_W_E4_P_2 */
- { "vpmulhuw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FE4_P_2 */
+ { "vpmulhuw", { XM, Vex, EXx } },
},
{
- /* VEX_W_E5_P_2 */
- { "vpmulhw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FE5_P_2 */
+ { "vpmulhw", { XM, Vex, EXx } },
},
{
- /* VEX_W_E6_P_1 */
- { "vcvtdq2pd", { XM, EXxmmq } },
- { "(bad)", { XX } },
+ /* VEX_W_0FE6_P_1 */
+ { "vcvtdq2pd", { XM, EXxmmq } },
},
{
- /* VEX_W_E6_P_2 */
- { "vcvttpd2dq%XY", { XMM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FE6_P_2 */
+ { "vcvttpd2dq%XY", { XMM, EXx } },
},
{
- /* VEX_W_E6_P_3 */
- { "vcvtpd2dq%XY", { XMM, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FE6_P_3 */
+ { "vcvtpd2dq%XY", { XMM, EXx } },
},
{
- /* VEX_W_E7_P_2_M_0 */
+ /* VEX_W_0FE7_P_2_M_0 */
{ "vmovntdq", { Mx, XM } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_E8_P_2 */
- { "vpsubsb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FE8_P_2 */
+ { "vpsubsb", { XM, Vex, EXx } },
},
{
- /* VEX_W_E9_P_2 */
- { "vpsubsw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FE9_P_2 */
+ { "vpsubsw", { XM, Vex, EXx } },
},
{
- /* VEX_W_EA_P_2 */
- { "vpminsw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FEA_P_2 */
+ { "vpminsw", { XM, Vex, EXx } },
},
{
- /* VEX_W_EB_P_2 */
- { "vpor", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FEB_P_2 */
+ { "vpor", { XM, Vex, EXx } },
},
{
- /* VEX_W_EC_P_2 */
- { "vpaddsb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FEC_P_2 */
+ { "vpaddsb", { XM, Vex, EXx } },
},
{
- /* VEX_W_ED_P_2 */
- { "vpaddsw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FED_P_2 */
+ { "vpaddsw", { XM, Vex, EXx } },
},
{
- /* VEX_W_EE_P_2 */
- { "vpmaxsw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FEE_P_2 */
+ { "vpmaxsw", { XM, Vex, EXx } },
},
{
- /* VEX_W_EF_P_2 */
- { "vpxor", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FEF_P_2 */
+ { "vpxor", { XM, Vex, EXx } },
},
{
- /* VEX_W_F0_P_3_M_0 */
+ /* VEX_W_0FF0_P_3_M_0 */
{ "vlddqu", { XM, M } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_F1_P_2 */
- { "vpsllw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FF1_P_2 */
+ { "vpsllw", { XM, Vex, EXxmm } },
},
{
- /* VEX_W_F2_P_2 */
- { "vpslld", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FF2_P_2 */
+ { "vpslld", { XM, Vex, EXxmm } },
},
{
- /* VEX_W_F3_P_2 */
- { "vpsllq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FF3_P_2 */
+ { "vpsllq", { XM, Vex, EXxmm } },
},
{
- /* VEX_W_F4_P_2 */
- { "vpmuludq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FF4_P_2 */
+ { "vpmuludq", { XM, Vex, EXx } },
},
{
- /* VEX_W_F5_P_2 */
- { "vpmaddwd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FF5_P_2 */
+ { "vpmaddwd", { XM, Vex, EXx } },
},
{
- /* VEX_W_F6_P_2 */
- { "vpsadbw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FF6_P_2 */
+ { "vpsadbw", { XM, Vex, EXx } },
},
{
- /* VEX_W_F7_P_2 */
+ /* VEX_W_0FF7_P_2 */
{ "vmaskmovdqu", { XM, XS } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_F8_P_2 */
- { "vpsubb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FF8_P_2 */
+ { "vpsubb", { XM, Vex, EXx } },
},
{
- /* VEX_W_F9_P_2 */
- { "vpsubw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FF9_P_2 */
+ { "vpsubw", { XM, Vex, EXx } },
},
{
- /* VEX_W_FA_P_2 */
- { "vpsubd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FFA_P_2 */
+ { "vpsubd", { XM, Vex, EXx } },
},
{
- /* VEX_W_FB_P_2 */
- { "vpsubq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FFB_P_2 */
+ { "vpsubq", { XM, Vex, EXx } },
},
{
- /* VEX_W_FC_P_2 */
- { "vpaddb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FFC_P_2 */
+ { "vpaddb", { XM, Vex, EXx } },
},
{
- /* VEX_W_FD_P_2 */
- { "vpaddw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FFD_P_2 */
+ { "vpaddw", { XM, Vex, EXx } },
},
{
- /* VEX_W_FE_P_2 */
- { "vpaddd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0FFE_P_2 */
+ { "vpaddd", { XM, Vex, EXx } },
},
{
- /* VEX_W_3800_P_2 */
- { "vpshufb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3800_P_2 */
+ { "vpshufb", { XM, Vex, EXx } },
},
{
- /* VEX_W_3801_P_2 */
- { "vphaddw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3801_P_2 */
+ { "vphaddw", { XM, Vex, EXx } },
},
{
- /* VEX_W_3802_P_2 */
- { "vphaddd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3802_P_2 */
+ { "vphaddd", { XM, Vex, EXx } },
},
{
- /* VEX_W_3803_P_2 */
- { "vphaddsw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3803_P_2 */
+ { "vphaddsw", { XM, Vex, EXx } },
},
{
- /* VEX_W_3804_P_2 */
- { "vpmaddubsw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3804_P_2 */
+ { "vpmaddubsw", { XM, Vex, EXx } },
},
{
- /* VEX_W_3805_P_2 */
- { "vphsubw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3805_P_2 */
+ { "vphsubw", { XM, Vex, EXx } },
},
{
- /* VEX_W_3806_P_2 */
- { "vphsubd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3806_P_2 */
+ { "vphsubd", { XM, Vex, EXx } },
},
{
- /* VEX_W_3807_P_2 */
- { "vphsubsw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3807_P_2 */
+ { "vphsubsw", { XM, Vex, EXx } },
},
{
- /* VEX_W_3808_P_2 */
- { "vpsignb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3808_P_2 */
+ { "vpsignb", { XM, Vex, EXx } },
},
{
- /* VEX_W_3809_P_2 */
- { "vpsignw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3809_P_2 */
+ { "vpsignw", { XM, Vex, EXx } },
},
{
- /* VEX_W_380A_P_2 */
- { "vpsignd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F380A_P_2 */
+ { "vpsignd", { XM, Vex, EXx } },
},
{
- /* VEX_W_380B_P_2 */
- { "vpmulhrsw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F380B_P_2 */
+ { "vpmulhrsw", { XM, Vex, EXx } },
},
{
- /* VEX_W_380C_P_2 */
+ /* VEX_W_0F380C_P_2 */
{ "vpermilps", { XM, Vex, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_380D_P_2 */
+ /* VEX_W_0F380D_P_2 */
{ "vpermilpd", { XM, Vex, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_380E_P_2 */
+ /* VEX_W_0F380E_P_2 */
{ "vtestps", { XM, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_380F_P_2 */
+ /* VEX_W_0F380F_P_2 */
{ "vtestpd", { XM, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3817_P_2 */
+ /* VEX_W_0F3816_P_2 */
+ { "vpermps", { XM, Vex, EXx } },
+ },
+ {
+ /* VEX_W_0F3817_P_2 */
{ "vptest", { XM, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3819_P_2_M_0 */
- { "vbroadcastsd", { XM, Mq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3818_P_2 */
+ { "vbroadcastss", { XM, EXxmm_md } },
+ },
+ {
+ /* VEX_W_0F3819_P_2 */
+ { "vbroadcastsd", { XM, EXxmm_mq } },
},
{
- /* VEX_W_381A_P_2_M_0 */
+ /* VEX_W_0F381A_P_2_M_0 */
{ "vbroadcastf128", { XM, Mxmm } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_381C_P_2 */
+ /* VEX_W_0F381C_P_2 */
{ "vpabsb", { XM, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_381D_P_2 */
+ /* VEX_W_0F381D_P_2 */
{ "vpabsw", { XM, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_381E_P_2 */
+ /* VEX_W_0F381E_P_2 */
{ "vpabsd", { XM, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3820_P_2 */
- { "vpmovsxbw", { XM, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3820_P_2 */
+ { "vpmovsxbw", { XM, EXxmmq } },
},
{
- /* VEX_W_3821_P_2 */
- { "vpmovsxbd", { XM, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3821_P_2 */
+ { "vpmovsxbd", { XM, EXxmmqd } },
},
{
- /* VEX_W_3822_P_2 */
- { "vpmovsxbq", { XM, EXw } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3822_P_2 */
+ { "vpmovsxbq", { XM, EXxmmdw } },
},
{
- /* VEX_W_3823_P_2 */
- { "vpmovsxwd", { XM, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3823_P_2 */
+ { "vpmovsxwd", { XM, EXxmmq } },
},
{
- /* VEX_W_3824_P_2 */
- { "vpmovsxwq", { XM, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3824_P_2 */
+ { "vpmovsxwq", { XM, EXxmmqd } },
},
{
- /* VEX_W_3825_P_2 */
- { "vpmovsxdq", { XM, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3825_P_2 */
+ { "vpmovsxdq", { XM, EXxmmq } },
},
{
- /* VEX_W_3828_P_2 */
- { "vpmuldq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3828_P_2 */
+ { "vpmuldq", { XM, Vex, EXx } },
},
{
- /* VEX_W_3829_P_2 */
- { "vpcmpeqq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3829_P_2 */
+ { "vpcmpeqq", { XM, Vex, EXx } },
},
{
- /* VEX_W_382A_P_2_M_0 */
+ /* VEX_W_0F382A_P_2_M_0 */
{ "vmovntdqa", { XM, Mx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_382B_P_2 */
- { "vpackusdw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F382B_P_2 */
+ { "vpackusdw", { XM, Vex, EXx } },
+ },
+ {
+ /* VEX_W_0F382C_P_2_M_0 */
+ { "vmaskmovps", { XM, Vex, Mx } },
+ },
+ {
+ /* VEX_W_0F382D_P_2_M_0 */
+ { "vmaskmovpd", { XM, Vex, Mx } },
+ },
+ {
+ /* VEX_W_0F382E_P_2_M_0 */
+ { "vmaskmovps", { Mx, Vex, XM } },
+ },
+ {
+ /* VEX_W_0F382F_P_2_M_0 */
+ { "vmaskmovpd", { Mx, Vex, XM } },
+ },
+ {
+ /* VEX_W_0F3830_P_2 */
+ { "vpmovzxbw", { XM, EXxmmq } },
},
{
- /* VEX_W_3830_P_2 */
- { "vpmovzxbw", { XM, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3831_P_2 */
+ { "vpmovzxbd", { XM, EXxmmqd } },
},
{
- /* VEX_W_3831_P_2 */
- { "vpmovzxbd", { XM, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3832_P_2 */
+ { "vpmovzxbq", { XM, EXxmmdw } },
},
{
- /* VEX_W_3832_P_2 */
- { "vpmovzxbq", { XM, EXw } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3833_P_2 */
+ { "vpmovzxwd", { XM, EXxmmq } },
},
{
- /* VEX_W_3833_P_2 */
- { "vpmovzxwd", { XM, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3834_P_2 */
+ { "vpmovzxwq", { XM, EXxmmqd } },
},
{
- /* VEX_W_3834_P_2 */
- { "vpmovzxwq", { XM, EXd } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3835_P_2 */
+ { "vpmovzxdq", { XM, EXxmmq } },
},
{
- /* VEX_W_3835_P_2 */
- { "vpmovzxdq", { XM, EXq } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3836_P_2 */
+ { "vpermd", { XM, Vex, EXx } },
},
{
- /* VEX_W_3837_P_2 */
- { "vpcmpgtq", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3837_P_2 */
+ { "vpcmpgtq", { XM, Vex, EXx } },
},
{
- /* VEX_W_3838_P_2 */
- { "vpminsb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3838_P_2 */
+ { "vpminsb", { XM, Vex, EXx } },
},
{
- /* VEX_W_3839_P_2 */
- { "vpminsd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3839_P_2 */
+ { "vpminsd", { XM, Vex, EXx } },
},
{
- /* VEX_W_383A_P_2 */
- { "vpminuw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F383A_P_2 */
+ { "vpminuw", { XM, Vex, EXx } },
},
{
- /* VEX_W_383B_P_2 */
- { "vpminud", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F383B_P_2 */
+ { "vpminud", { XM, Vex, EXx } },
},
{
- /* VEX_W_383C_P_2 */
- { "vpmaxsb", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F383C_P_2 */
+ { "vpmaxsb", { XM, Vex, EXx } },
},
{
- /* VEX_W_383D_P_2 */
- { "vpmaxsd", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F383D_P_2 */
+ { "vpmaxsd", { XM, Vex, EXx } },
},
{
- /* VEX_W_383E_P_2 */
- { "vpmaxuw", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F383E_P_2 */
+ { "vpmaxuw", { XM, Vex, EXx } },
},
{
- /* VEX_W_383F_P_2 */
- { "vpmaxud", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F383F_P_2 */
+ { "vpmaxud", { XM, Vex, EXx } },
},
{
- /* VEX_W_3840_P_2 */
- { "vpmulld", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3840_P_2 */
+ { "vpmulld", { XM, Vex, EXx } },
},
{
- /* VEX_W_3841_P_2 */
+ /* VEX_W_0F3841_P_2 */
{ "vphminposuw", { XM, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_38DB_P_2 */
+ /* VEX_W_0F3846_P_2 */
+ { "vpsravd", { XM, Vex, EXx } },
+ },
+ {
+ /* VEX_W_0F3858_P_2 */
+ { "vpbroadcastd", { XM, EXxmm_md } },
+ },
+ {
+ /* VEX_W_0F3859_P_2 */
+ { "vpbroadcastq", { XM, EXxmm_mq } },
+ },
+ {
+ /* VEX_W_0F385A_P_2_M_0 */
+ { "vbroadcasti128", { XM, Mxmm } },
+ },
+ {
+ /* VEX_W_0F3878_P_2 */
+ { "vpbroadcastb", { XM, EXxmm_mb } },
+ },
+ {
+ /* VEX_W_0F3879_P_2 */
+ { "vpbroadcastw", { XM, EXxmm_mw } },
+ },
+ {
+ /* VEX_W_0F38DB_P_2 */
{ "vaesimc", { XM, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_38DC_P_2 */
+ /* VEX_W_0F38DC_P_2 */
{ "vaesenc", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_38DD_P_2 */
+ /* VEX_W_0F38DD_P_2 */
{ "vaesenclast", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_38DE_P_2 */
+ /* VEX_W_0F38DE_P_2 */
{ "vaesdec", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_38DF_P_2 */
+ /* VEX_W_0F38DF_P_2 */
{ "vaesdeclast", { XM, Vex128, EXx } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A04_P_2 */
+ /* VEX_W_0F3A00_P_2 */
+ { Bad_Opcode },
+ { "vpermq", { XM, EXx, Ib } },
+ },
+ {
+ /* VEX_W_0F3A01_P_2 */
+ { Bad_Opcode },
+ { "vpermpd", { XM, EXx, Ib } },
+ },
+ {
+ /* VEX_W_0F3A02_P_2 */
+ { "vpblendd", { XM, Vex, EXx, Ib } },
+ },
+ {
+ /* VEX_W_0F3A04_P_2 */
{ "vpermilps", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A05_P_2 */
+ /* VEX_W_0F3A05_P_2 */
{ "vpermilpd", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A06_P_2 */
+ /* VEX_W_0F3A06_P_2 */
{ "vperm2f128", { XM, Vex256, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A08_P_2 */
+ /* VEX_W_0F3A08_P_2 */
{ "vroundps", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A09_P_2 */
+ /* VEX_W_0F3A09_P_2 */
{ "vroundpd", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A0A_P_2 */
- { "vroundss", { XM, Vex128, EXd, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3A0A_P_2 */
+ { "vroundss", { XMScalar, VexScalar, EXdScalar, Ib } },
},
{
- /* VEX_W_3A0B_P_2 */
- { "vroundsd", { XM, Vex128, EXq, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3A0B_P_2 */
+ { "vroundsd", { XMScalar, VexScalar, EXqScalar, Ib } },
},
{
- /* VEX_W_3A0C_P_2 */
+ /* VEX_W_0F3A0C_P_2 */
{ "vblendps", { XM, Vex, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A0D_P_2 */
+ /* VEX_W_0F3A0D_P_2 */
{ "vblendpd", { XM, Vex, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A0E_P_2 */
- { "vpblendw", { XM, Vex128, EXx, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3A0E_P_2 */
+ { "vpblendw", { XM, Vex, EXx, Ib } },
},
{
- /* VEX_W_3A0F_P_2 */
- { "vpalignr", { XM, Vex128, EXx, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3A0F_P_2 */
+ { "vpalignr", { XM, Vex, EXx, Ib } },
},
{
- /* VEX_W_3A14_P_2 */
+ /* VEX_W_0F3A14_P_2 */
{ "vpextrb", { Edqb, XM, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A15_P_2 */
+ /* VEX_W_0F3A15_P_2 */
{ "vpextrw", { Edqw, XM, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A18_P_2 */
+ /* VEX_W_0F3A18_P_2 */
{ "vinsertf128", { XM, Vex256, EXxmm, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A19_P_2 */
+ /* VEX_W_0F3A19_P_2 */
{ "vextractf128", { EXxmm, XM, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A20_P_2 */
+ /* VEX_W_0F3A20_P_2 */
{ "vpinsrb", { XM, Vex128, Edqb, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A21_P_2 */
+ /* VEX_W_0F3A21_P_2 */
{ "vinsertps", { XM, Vex128, EXd, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A40_P_2 */
+ /* VEX_W_0F3A30_P_2_LEN_0 */
+ { "kshiftrb", { MaskG, MaskR, Ib } },
+ { "kshiftrw", { MaskG, MaskR, Ib } },
+ },
+ {
+ /* VEX_W_0F3A31_P_2_LEN_0 */
+ { "kshiftrd", { MaskG, MaskR, Ib } },
+ { "kshiftrq", { MaskG, MaskR, Ib } },
+ },
+ {
+ /* VEX_W_0F3A32_P_2_LEN_0 */
+ { "kshiftlb", { MaskG, MaskR, Ib } },
+ { "kshiftlw", { MaskG, MaskR, Ib } },
+ },
+ {
+ /* VEX_W_0F3A33_P_2_LEN_0 */
+ { "kshiftld", { MaskG, MaskR, Ib } },
+ { "kshiftlq", { MaskG, MaskR, Ib } },
+ },
+ {
+ /* VEX_W_0F3A38_P_2 */
+ { "vinserti128", { XM, Vex256, EXxmm, Ib } },
+ },
+ {
+ /* VEX_W_0F3A39_P_2 */
+ { "vextracti128", { EXxmm, XM, Ib } },
+ },
+ {
+ /* VEX_W_0F3A40_P_2 */
{ "vdpps", { XM, Vex, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A41_P_2 */
+ /* VEX_W_0F3A41_P_2 */
{ "vdppd", { XM, Vex128, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A42_P_2 */
- { "vmpsadbw", { XM, Vex128, EXx, Ib } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3A42_P_2 */
+ { "vmpsadbw", { XM, Vex, EXx, Ib } },
},
{
- /* VEX_W_3A44_P_2 */
+ /* VEX_W_0F3A44_P_2 */
{ "vpclmulqdq", { XM, Vex128, EXx, PCLMUL } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A4A_P_2 */
+ /* VEX_W_0F3A46_P_2 */
+ { "vperm2i128", { XM, Vex256, EXx, Ib } },
+ },
+ {
+ /* VEX_W_0F3A48_P_2 */
+ { "vpermil2ps", { XMVexW, Vex, EXVexImmW, EXVexImmW, EXVexImmW } },
+ { "vpermil2ps", { XMVexW, Vex, EXVexImmW, EXVexImmW, EXVexImmW } },
+ },
+ {
+ /* VEX_W_0F3A49_P_2 */
+ { "vpermil2pd", { XMVexW, Vex, EXVexImmW, EXVexImmW, EXVexImmW } },
+ { "vpermil2pd", { XMVexW, Vex, EXVexImmW, EXVexImmW, EXVexImmW } },
+ },
+ {
+ /* VEX_W_0F3A4A_P_2 */
{ "vblendvps", { XM, Vex, EXx, XMVexI4 } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A4B_P_2 */
+ /* VEX_W_0F3A4B_P_2 */
{ "vblendvpd", { XM, Vex, EXx, XMVexI4 } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A4C_P_2 */
- { "vpblendvb", { XM, Vex128, EXx, XMVexI4 } },
- { "(bad)", { XX } },
+ /* VEX_W_0F3A4C_P_2 */
+ { "vpblendvb", { XM, Vex, EXx, XMVexI4 } },
},
{
- /* VEX_W_3A60_P_2 */
+ /* VEX_W_0F3A60_P_2 */
{ "vpcmpestrm", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A61_P_2 */
+ /* VEX_W_0F3A61_P_2 */
{ "vpcmpestri", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A62_P_2 */
+ /* VEX_W_0F3A62_P_2 */
{ "vpcmpistrm", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3A63_P_2 */
+ /* VEX_W_0F3A63_P_2 */
{ "vpcmpistri", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
{
- /* VEX_W_3ADF_P_2 */
+ /* VEX_W_0F3ADF_P_2 */
{ "vaeskeygenassist", { XM, EXx, Ib } },
- { "(bad)", { XX } },
},
+#define NEED_VEX_W_TABLE
+#include "i386-dis-evex.h"
+#undef NEED_VEX_W_TABLE
};
static const struct dis386 mod_table[][2] = {
{
/* MOD_8D */
{ "leaS", { Gv, M } },
- { "(bad)", { XX } },
+ },
+ {
+ /* MOD_C6_REG_7 */
+ { Bad_Opcode },
+ { RM_TABLE (RM_C6_REG_7) },
+ },
+ {
+ /* MOD_C7_REG_7 */
+ { Bad_Opcode },
+ { RM_TABLE (RM_C7_REG_7) },
+ },
+ {
+ /* MOD_FF_REG_3 */
+ { "Jcall{T|}", { indirEp } },
+ },
+ {
+ /* MOD_FF_REG_5 */
+ { "Jjmp{T|}", { indirEp } },
},
{
/* MOD_0F01_REG_0 */
{
/* MOD_0F13 */
{ "movlpX", { EXq, XM } },
- { "(bad)", { XX } },
},
{
/* MOD_0F16_PREFIX_0 */
{
/* MOD_0F17 */
{ "movhpX", { EXq, XM } },
- { "(bad)", { XX } },
},
{
/* MOD_0F18_REG_0 */
{ "prefetchnta", { Mb } },
- { "(bad)", { XX } },
},
{
/* MOD_0F18_REG_1 */
{ "prefetcht0", { Mb } },
- { "(bad)", { XX } },
},
{
/* MOD_0F18_REG_2 */
{ "prefetcht1", { Mb } },
- { "(bad)", { XX } },
},
{
/* MOD_0F18_REG_3 */
{ "prefetcht2", { Mb } },
- { "(bad)", { XX } },
},
{
- /* MOD_0F20 */
- { "(bad)", { XX } },
- { "movZ", { Rm, Cm } },
+ /* MOD_0F18_REG_4 */
+ { "nop/reserved", { Mb } },
+ },
+ {
+ /* MOD_0F18_REG_5 */
+ { "nop/reserved", { Mb } },
+ },
+ {
+ /* MOD_0F18_REG_6 */
+ { "nop/reserved", { Mb } },
+ },
+ {
+ /* MOD_0F18_REG_7 */
+ { "nop/reserved", { Mb } },
},
{
- /* MOD_0F21 */
- { "(bad)", { XX } },
- { "movZ", { Rm, Dm } },
+ /* MOD_0F1A_PREFIX_0 */
+ { "bndldx", { Gbnd, Ev_bnd } },
+ { "nopQ", { Ev } },
},
{
- /* MOD_0F22 */
- { "(bad)", { XX } },
- { "movZ", { Cm, Rm } },
+ /* MOD_0F1B_PREFIX_0 */
+ { "bndstx", { Ev_bnd, Gbnd } },
+ { "nopQ", { Ev } },
},
{
- /* MOD_0F23 */
- { "(bad)", { XX } },
- { "movZ", { Dm, Rm } },
+ /* MOD_0F1B_PREFIX_1 */
+ { "bndmk", { Gbnd, Ev_bnd } },
+ { "nopQ", { Ev } },
},
{
/* MOD_0F24 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "movL", { Rd, Td } },
},
{
/* MOD_0F26 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "movL", { Td, Rd } },
},
{
/* MOD_0F2B_PREFIX_0 */
{"movntps", { Mx, XM } },
- { "(bad)", { XX } },
},
{
/* MOD_0F2B_PREFIX_1 */
{"movntss", { Md, XM } },
- { "(bad)", { XX } },
},
{
/* MOD_0F2B_PREFIX_2 */
{"movntpd", { Mx, XM } },
- { "(bad)", { XX } },
},
{
/* MOD_0F2B_PREFIX_3 */
{"movntsd", { Mq, XM } },
- { "(bad)", { XX } },
},
{
/* MOD_0F51 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "movmskpX", { Gdq, XS } },
},
{
/* MOD_0F71_REG_2 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "psrlw", { MS, Ib } },
},
{
/* MOD_0F71_REG_4 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "psraw", { MS, Ib } },
},
{
/* MOD_0F71_REG_6 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "psllw", { MS, Ib } },
},
{
/* MOD_0F72_REG_2 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "psrld", { MS, Ib } },
},
{
/* MOD_0F72_REG_4 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "psrad", { MS, Ib } },
},
{
/* MOD_0F72_REG_6 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "pslld", { MS, Ib } },
},
{
/* MOD_0F73_REG_2 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "psrlq", { MS, Ib } },
},
{
/* MOD_0F73_REG_3 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ PREFIX_TABLE (PREFIX_0F73_REG_3) },
},
{
/* MOD_0F73_REG_6 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "psllq", { MS, Ib } },
},
{
/* MOD_0F73_REG_7 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ PREFIX_TABLE (PREFIX_0F73_REG_7) },
},
{
/* MOD_0FAE_REG_0 */
{ "fxsave", { FXSAVE } },
- { "(bad)", { XX } },
+ { PREFIX_TABLE (PREFIX_0FAE_REG_0) },
},
{
/* MOD_0FAE_REG_1 */
{ "fxrstor", { FXSAVE } },
- { "(bad)", { XX } },
+ { PREFIX_TABLE (PREFIX_0FAE_REG_1) },
},
{
/* MOD_0FAE_REG_2 */
{ "ldmxcsr", { Md } },
- { "(bad)", { XX } },
+ { PREFIX_TABLE (PREFIX_0FAE_REG_2) },
},
{
/* MOD_0FAE_REG_3 */
{ "stmxcsr", { Md } },
- { "(bad)", { XX } },
+ { PREFIX_TABLE (PREFIX_0FAE_REG_3) },
},
{
/* MOD_0FAE_REG_4 */
- { "xsave", { M } },
- { "(bad)", { XX } },
+ { "xsave", { FXSAVE } },
},
{
/* MOD_0FAE_REG_5 */
- { "xrstor", { M } },
+ { "xrstor", { FXSAVE } },
{ RM_TABLE (RM_0FAE_REG_5) },
},
{
/* MOD_0FAE_REG_6 */
- { "xsaveopt", { M } },
+ { PREFIX_TABLE (PREFIX_0FAE_REG_6) },
{ RM_TABLE (RM_0FAE_REG_6) },
},
{
/* MOD_0FAE_REG_7 */
- { "clflush", { Mb } },
+ { PREFIX_TABLE (PREFIX_0FAE_REG_7) },
{ RM_TABLE (RM_0FAE_REG_7) },
},
{
/* MOD_0FB2 */
{ "lssS", { Gv, Mp } },
- { "(bad)", { XX } },
},
{
/* MOD_0FB4 */
{ "lfsS", { Gv, Mp } },
- { "(bad)", { XX } },
},
{
/* MOD_0FB5 */
{ "lgsS", { Gv, Mp } },
- { "(bad)", { XX } },
+ },
+ {
+ /* MOD_0FC7_REG_3 */
+ { "xrstors", { FXSAVE } },
+ },
+ {
+ /* MOD_0FC7_REG_4 */
+ { "xsavec", { FXSAVE } },
+ },
+ {
+ /* MOD_0FC7_REG_5 */
+ { "xsaves", { FXSAVE } },
},
{
/* MOD_0FC7_REG_6 */
{ PREFIX_TABLE (PREFIX_0FC7_REG_6) },
- { "(bad)", { XX } },
+ { "rdrand", { Ev } },
},
{
/* MOD_0FC7_REG_7 */
{ "vmptrst", { Mq } },
- { "(bad)", { XX } },
+ { "rdseed", { Ev } },
},
{
/* MOD_0FD7 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "pmovmskb", { Gdq, MS } },
},
{
/* MOD_0FE7_PREFIX_2 */
{ "movntdq", { Mx, XM } },
- { "(bad)", { XX } },
},
{
/* MOD_0FF0_PREFIX_3 */
{ "lddqu", { XM, M } },
- { "(bad)", { XX } },
},
{
/* MOD_0F382A_PREFIX_2 */
{ "movntdqa", { XM, Mx } },
- { "(bad)", { XX } },
},
{
/* MOD_62_32BIT */
{ "bound{S|}", { Gv, Ma } },
- { "(bad)", { XX } },
+ { EVEX_TABLE (EVEX_0F) },
},
{
/* MOD_C4_32BIT */
{ VEX_C5_TABLE (VEX_0F) },
},
{
- /* MOD_VEX_12_PREFIX_0 */
- { VEX_LEN_TABLE (VEX_LEN_12_P_0_M_0) },
- { VEX_LEN_TABLE (VEX_LEN_12_P_0_M_1) },
+ /* MOD_VEX_0F12_PREFIX_0 */
+ { VEX_LEN_TABLE (VEX_LEN_0F12_P_0_M_0) },
+ { VEX_LEN_TABLE (VEX_LEN_0F12_P_0_M_1) },
},
{
- /* MOD_VEX_13 */
- { VEX_LEN_TABLE (VEX_LEN_13_M_0) },
- { "(bad)", { XX } },
+ /* MOD_VEX_0F13 */
+ { VEX_LEN_TABLE (VEX_LEN_0F13_M_0) },
},
{
- /* MOD_VEX_16_PREFIX_0 */
- { VEX_LEN_TABLE (VEX_LEN_16_P_0_M_0) },
- { VEX_LEN_TABLE (VEX_LEN_16_P_0_M_1) },
+ /* MOD_VEX_0F16_PREFIX_0 */
+ { VEX_LEN_TABLE (VEX_LEN_0F16_P_0_M_0) },
+ { VEX_LEN_TABLE (VEX_LEN_0F16_P_0_M_1) },
},
{
- /* MOD_VEX_17 */
- { VEX_LEN_TABLE (VEX_LEN_17_M_0) },
- { "(bad)", { XX } },
+ /* MOD_VEX_0F17 */
+ { VEX_LEN_TABLE (VEX_LEN_0F17_M_0) },
},
{
- /* MOD_VEX_2B */
- { VEX_W_TABLE (VEX_W_2B_M_0) },
- { "(bad)", { XX } },
+ /* MOD_VEX_0F2B */
+ { VEX_W_TABLE (VEX_W_0F2B_M_0) },
},
{
- /* MOD_VEX_50 */
- { "(bad)", { XX } },
- { VEX_W_TABLE (VEX_W_50_M_0) },
+ /* MOD_VEX_0F50 */
+ { Bad_Opcode },
+ { VEX_W_TABLE (VEX_W_0F50_M_0) },
},
{
- /* MOD_VEX_71_REG_2 */
- { "(bad)", { XX } },
- { PREFIX_TABLE (PREFIX_VEX_71_REG_2) },
+ /* MOD_VEX_0F71_REG_2 */
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F71_REG_2) },
},
{
- /* MOD_VEX_71_REG_4 */
- { "(bad)", { XX } },
- { PREFIX_TABLE (PREFIX_VEX_71_REG_4) },
+ /* MOD_VEX_0F71_REG_4 */
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F71_REG_4) },
},
{
- /* MOD_VEX_71_REG_6 */
- { "(bad)", { XX } },
- { PREFIX_TABLE (PREFIX_VEX_71_REG_6) },
+ /* MOD_VEX_0F71_REG_6 */
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F71_REG_6) },
},
{
- /* MOD_VEX_72_REG_2 */
- { "(bad)", { XX } },
- { PREFIX_TABLE (PREFIX_VEX_72_REG_2) },
+ /* MOD_VEX_0F72_REG_2 */
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F72_REG_2) },
},
{
- /* MOD_VEX_72_REG_4 */
- { "(bad)", { XX } },
- { PREFIX_TABLE (PREFIX_VEX_72_REG_4) },
+ /* MOD_VEX_0F72_REG_4 */
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F72_REG_4) },
},
{
- /* MOD_VEX_72_REG_6 */
- { "(bad)", { XX } },
- { PREFIX_TABLE (PREFIX_VEX_72_REG_6) },
+ /* MOD_VEX_0F72_REG_6 */
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F72_REG_6) },
},
{
- /* MOD_VEX_73_REG_2 */
- { "(bad)", { XX } },
- { PREFIX_TABLE (PREFIX_VEX_73_REG_2) },
+ /* MOD_VEX_0F73_REG_2 */
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F73_REG_2) },
},
{
- /* MOD_VEX_73_REG_3 */
- { "(bad)", { XX } },
- { PREFIX_TABLE (PREFIX_VEX_73_REG_3) },
+ /* MOD_VEX_0F73_REG_3 */
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F73_REG_3) },
},
{
- /* MOD_VEX_73_REG_6 */
- { "(bad)", { XX } },
- { PREFIX_TABLE (PREFIX_VEX_73_REG_6) },
+ /* MOD_VEX_0F73_REG_6 */
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F73_REG_6) },
},
{
- /* MOD_VEX_73_REG_7 */
- { "(bad)", { XX } },
- { PREFIX_TABLE (PREFIX_VEX_73_REG_7) },
+ /* MOD_VEX_0F73_REG_7 */
+ { Bad_Opcode },
+ { PREFIX_TABLE (PREFIX_VEX_0F73_REG_7) },
},
{
- /* MOD_VEX_AE_REG_2 */
- { VEX_LEN_TABLE (VEX_LEN_AE_R_2_M_0) },
- { "(bad)", { XX } },
+ /* MOD_VEX_0FAE_REG_2 */
+ { VEX_LEN_TABLE (VEX_LEN_0FAE_R_2_M_0) },
},
{
- /* MOD_VEX_AE_REG_3 */
- { VEX_LEN_TABLE (VEX_LEN_AE_R_3_M_0) },
- { "(bad)", { XX } },
+ /* MOD_VEX_0FAE_REG_3 */
+ { VEX_LEN_TABLE (VEX_LEN_0FAE_R_3_M_0) },
},
{
- /* MOD_VEX_D7_PREFIX_2 */
- { "(bad)", { XX } },
- { VEX_LEN_TABLE (VEX_LEN_D7_P_2_M_1) },
+ /* MOD_VEX_0FD7_PREFIX_2 */
+ { Bad_Opcode },
+ { VEX_W_TABLE (VEX_W_0FD7_P_2_M_1) },
},
{
- /* MOD_VEX_E7_PREFIX_2 */
- { VEX_W_TABLE (VEX_W_E7_P_2_M_0) },
- { "(bad)", { XX } },
+ /* MOD_VEX_0FE7_PREFIX_2 */
+ { VEX_W_TABLE (VEX_W_0FE7_P_2_M_0) },
},
{
- /* MOD_VEX_F0_PREFIX_3 */
- { VEX_W_TABLE (VEX_W_F0_P_3_M_0) },
- { "(bad)", { XX } },
+ /* MOD_VEX_0FF0_PREFIX_3 */
+ { VEX_W_TABLE (VEX_W_0FF0_P_3_M_0) },
},
{
- /* MOD_VEX_3818_PREFIX_2 */
- { "vbroadcastss", { XM, Md } },
- { "(bad)", { XX } },
+ /* MOD_VEX_0F381A_PREFIX_2 */
+ { VEX_LEN_TABLE (VEX_LEN_0F381A_P_2_M_0) },
},
{
- /* MOD_VEX_3819_PREFIX_2 */
- { VEX_LEN_TABLE (VEX_LEN_3819_P_2_M_0) },
- { "(bad)", { XX } },
+ /* MOD_VEX_0F382A_PREFIX_2 */
+ { VEX_W_TABLE (VEX_W_0F382A_P_2_M_0) },
},
{
- /* MOD_VEX_381A_PREFIX_2 */
- { VEX_LEN_TABLE (VEX_LEN_381A_P_2_M_0) },
- { "(bad)", { XX } },
+ /* MOD_VEX_0F382C_PREFIX_2 */
+ { VEX_W_TABLE (VEX_W_0F382C_P_2_M_0) },
},
{
- /* MOD_VEX_382A_PREFIX_2 */
- { VEX_LEN_TABLE (VEX_LEN_382A_P_2_M_0) },
- { "(bad)", { XX } },
+ /* MOD_VEX_0F382D_PREFIX_2 */
+ { VEX_W_TABLE (VEX_W_0F382D_P_2_M_0) },
},
{
- /* MOD_VEX_382C_PREFIX_2 */
- { "vmaskmovps", { XM, Vex, Mx } },
- { "(bad)", { XX } },
+ /* MOD_VEX_0F382E_PREFIX_2 */
+ { VEX_W_TABLE (VEX_W_0F382E_P_2_M_0) },
},
{
- /* MOD_VEX_382D_PREFIX_2 */
- { "vmaskmovpd", { XM, Vex, Mx } },
- { "(bad)", { XX } },
+ /* MOD_VEX_0F382F_PREFIX_2 */
+ { VEX_W_TABLE (VEX_W_0F382F_P_2_M_0) },
},
{
- /* MOD_VEX_382E_PREFIX_2 */
- { "vmaskmovps", { Mx, Vex, XM } },
- { "(bad)", { XX } },
+ /* MOD_VEX_0F385A_PREFIX_2 */
+ { VEX_LEN_TABLE (VEX_LEN_0F385A_P_2_M_0) },
},
{
- /* MOD_VEX_382F_PREFIX_2 */
- { "vmaskmovpd", { Mx, Vex, XM } },
- { "(bad)", { XX } },
+ /* MOD_VEX_0F388C_PREFIX_2 */
+ { "vpmaskmov%LW", { XM, Vex, Mx } },
+ },
+ {
+ /* MOD_VEX_0F388E_PREFIX_2 */
+ { "vpmaskmov%LW", { Mx, Vex, XM } },
},
+#define NEED_MOD_TABLE
+#include "i386-dis-evex.h"
+#undef NEED_MOD_TABLE
};
static const struct dis386 rm_table[][8] = {
{
+ /* RM_C6_REG_7 */
+ { "xabort", { Skip_MODRM, Ib } },
+ },
+ {
+ /* RM_C7_REG_7 */
+ { "xbeginT", { Skip_MODRM, Jv } },
+ },
+ {
/* RM_0F01_REG_0 */
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "vmcall", { Skip_MODRM } },
{ "vmlaunch", { Skip_MODRM } },
{ "vmresume", { Skip_MODRM } },
{ "vmxoff", { Skip_MODRM } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
},
{
/* RM_0F01_REG_1 */
{ "monitor", { { OP_Monitor, 0 } } },
{ "mwait", { { OP_Mwait, 0 } } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { "clac", { Skip_MODRM } },
+ { "stac", { Skip_MODRM } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { "encls", { Skip_MODRM } },
},
{
/* RM_0F01_REG_2 */
{ "xgetbv", { Skip_MODRM } },
{ "xsetbv", { Skip_MODRM } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { "vmfunc", { Skip_MODRM } },
+ { "xend", { Skip_MODRM } },
+ { "xtest", { Skip_MODRM } },
+ { "enclu", { Skip_MODRM } },
},
{
/* RM_0F01_REG_3 */
/* RM_0F01_REG_7 */
{ "swapgs", { Skip_MODRM } },
{ "rdtscp", { Skip_MODRM } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
},
{
/* RM_0FAE_REG_5 */
{ "lfence", { Skip_MODRM } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
},
{
/* RM_0FAE_REG_6 */
{ "mfence", { Skip_MODRM } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
},
{
/* RM_0FAE_REG_7 */
- { "sfence", { Skip_MODRM } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { PREFIX_TABLE (PREFIX_RM_0_0FAE_REG_7) },
},
};
/* We use the high bit to indicate different name for the same
prefix. */
-#define ADDR16_PREFIX (0x67 | 0x100)
-#define ADDR32_PREFIX (0x67 | 0x200)
-#define DATA16_PREFIX (0x66 | 0x100)
-#define DATA32_PREFIX (0x66 | 0x200)
#define REP_PREFIX (0xf3 | 0x100)
+#define XACQUIRE_PREFIX (0xf2 | 0x200)
+#define XRELEASE_PREFIX (0xf3 | 0x400)
+#define BND_PREFIX (0xf2 | 0x400)
static int
ckprefix (void)
{
int newrex, i, length;
rex = 0;
- rex_original = 0;
rex_ignored = 0;
prefixes = 0;
used_prefixes = 0;
last_addr_prefix = -1;
last_rex_prefix = -1;
last_seg_prefix = -1;
+ fwait_prefix = -1;
+ active_seg_prefix = 0;
for (i = 0; i < (int) ARRAY_SIZE (all_prefixes); i++)
all_prefixes[i] = 0;
i = 0;
case 0x2e:
prefixes |= PREFIX_CS;
last_seg_prefix = i;
+ active_seg_prefix = PREFIX_CS;
break;
case 0x36:
prefixes |= PREFIX_SS;
last_seg_prefix = i;
+ active_seg_prefix = PREFIX_SS;
break;
case 0x3e:
prefixes |= PREFIX_DS;
last_seg_prefix = i;
+ active_seg_prefix = PREFIX_DS;
break;
case 0x26:
prefixes |= PREFIX_ES;
last_seg_prefix = i;
+ active_seg_prefix = PREFIX_ES;
break;
case 0x64:
prefixes |= PREFIX_FS;
last_seg_prefix = i;
+ active_seg_prefix = PREFIX_FS;
break;
case 0x65:
prefixes |= PREFIX_GS;
last_seg_prefix = i;
+ active_seg_prefix = PREFIX_GS;
break;
case 0x66:
prefixes |= PREFIX_DATA;
/* fwait is really an instruction. If there are prefixes
before the fwait, they belong to the fwait, *not* to the
following instruction. */
+ fwait_prefix = i;
if (prefixes || rex)
{
prefixes |= PREFIX_FWAIT;
codep++;
+ /* This ensures that the previous REX prefixes are noticed
+ as unused prefixes, as in the return case below. */
+ rex_used = rex;
return 1;
}
prefixes = PREFIX_FWAIT;
if (*codep != FWAIT_OPCODE)
all_prefixes[i++] = *codep;
rex = newrex;
- rex_original = rex;
codep++;
length++;
}
return 0;
}
-static int
-seg_prefix (int pref)
-{
- switch (pref)
- {
- case 0x2e:
- return PREFIX_CS;
- case 0x36:
- return PREFIX_SS;
- case 0x3e:
- return PREFIX_DS;
- case 0x26:
- return PREFIX_ES;
- case 0x64:
- return PREFIX_FS;
- case 0x65:
- return PREFIX_GS;
- default:
- return 0;
- }
-}
-
/* Return the name of the prefix byte PREF, or NULL if PREF is not a
prefix byte. */
return (sizeflag & AFLAG) ? "addr16" : "addr32";
case FWAIT_OPCODE:
return "fwait";
- case ADDR16_PREFIX:
- return "addr16";
- case ADDR32_PREFIX:
- return "addr32";
- case DATA16_PREFIX:
- return "data16";
- case DATA32_PREFIX:
- return "data32";
case REP_PREFIX:
return "rep";
+ case XACQUIRE_PREFIX:
+ return "xacquire";
+ case XRELEASE_PREFIX:
+ return "xrelease";
+ case BND_PREFIX:
+ return "bnd";
default:
return NULL;
}
fprintf (stream, _(" suffix Always display instruction suffix in AT&T syntax\n"));
}
+/* Bad opcode. */
+static const struct dis386 bad_opcode = { "(bad)", { XX } };
+
/* Get a pointer to struct dis386 with a valid name. */
static const struct dis386 *
break;
}
}
- else
+ else
{
+ int last_prefix = -1;
+ int prefix = 0;
vindex = 0;
- used_prefixes |= (prefixes & PREFIX_REPZ);
- if (prefixes & PREFIX_REPZ)
- {
- vindex = 1;
- all_prefixes[last_repz_prefix] = 0;
- }
- else
+ /* We check PREFIX_REPNZ and PREFIX_REPZ before PREFIX_DATA.
+ When there are multiple PREFIX_REPNZ and PREFIX_REPZ, the
+ last one wins. */
+ if ((prefixes & (PREFIX_REPZ | PREFIX_REPNZ)) != 0)
{
- /* We should check PREFIX_REPNZ and PREFIX_REPZ before
- PREFIX_DATA. */
- used_prefixes |= (prefixes & PREFIX_REPNZ);
- if (prefixes & PREFIX_REPNZ)
+ if (last_repz_prefix > last_repnz_prefix)
{
- vindex = 3;
- all_prefixes[last_repnz_prefix] = 0;
+ vindex = 1;
+ prefix = PREFIX_REPZ;
+ last_prefix = last_repz_prefix;
}
else
{
- used_prefixes |= (prefixes & PREFIX_DATA);
- if (prefixes & PREFIX_DATA)
- {
- vindex = 2;
- all_prefixes[last_data_prefix] = 0;
- }
+ vindex = 3;
+ prefix = PREFIX_REPNZ;
+ last_prefix = last_repnz_prefix;
}
+
+ /* Ignore the invalid index if it isn't mandatory. */
+ if (!mandatory_prefix
+ && (prefix_table[dp->op[1].bytemode][vindex].name
+ == NULL)
+ && (prefix_table[dp->op[1].bytemode][vindex].op[0].bytemode
+ == 0))
+ vindex = 0;
+ }
+
+ if (vindex == 0 && (prefixes & PREFIX_DATA) != 0)
+ {
+ vindex = 2;
+ prefix = PREFIX_DATA;
+ last_prefix = last_data_prefix;
+ }
+
+ if (vindex != 0)
+ {
+ used_prefixes |= prefix;
+ all_prefixes[last_prefix] = 0;
}
}
dp = &prefix_table[dp->op[1].bytemode][vindex];
FETCH_DATA (info, codep + 2);
vindex = *codep++;
dp = &three_byte_table[dp->op[1].bytemode][vindex];
+ end_codep = codep;
modrm.mod = (*codep >> 6) & 3;
modrm.reg = (*codep >> 3) & 7;
modrm.rm = *codep & 7;
switch ((*codep & 0x1f))
{
default:
- BadOp ();
+ dp = &bad_opcode;
+ return dp;
case 0x8:
vex_table_index = XOP_08;
break;
vex.register_specifier = (~(*codep >> 3)) & 0xf;
if (address_mode != mode_64bit
&& vex.register_specifier > 0x7)
- BadOp ();
+ {
+ dp = &bad_opcode;
+ return dp;
+ }
vex.length = (*codep & 0x4) ? 256 : 128;
switch ((*codep & 0x3))
vindex = *codep++;
dp = &xop_table[vex_table_index][vindex];
+ end_codep = codep;
FETCH_DATA (info, codep + 1);
modrm.mod = (*codep >> 6) & 3;
modrm.reg = (*codep >> 3) & 7;
break;
case USE_VEX_C4_TABLE:
+ /* VEX prefix. */
FETCH_DATA (info, codep + 3);
/* All bits in the REX prefix are ignored. */
rex_ignored = rex;
switch ((*codep & 0x1f))
{
default:
- BadOp ();
+ dp = &bad_opcode;
+ return dp;
case 0x1:
vex_table_index = VEX_0F;
break;
vex.register_specifier = (~(*codep >> 3)) & 0xf;
if (address_mode != mode_64bit
&& vex.register_specifier > 0x7)
- BadOp ();
+ {
+ dp = &bad_opcode;
+ return dp;
+ }
vex.length = (*codep & 0x4) ? 256 : 128;
switch ((*codep & 0x3))
codep++;
vindex = *codep++;
dp = &vex_table[vex_table_index][vindex];
+ end_codep = codep;
/* There is no MODRM byte for VEX [82|77]. */
if (vindex != 0x77 && vindex != 0x82)
{
break;
case USE_VEX_C5_TABLE:
+ /* VEX prefix. */
FETCH_DATA (info, codep + 2);
/* All bits in the REX prefix are ignored. */
rex_ignored = rex;
vex.register_specifier = (~(*codep >> 3)) & 0xf;
if (address_mode != mode_64bit
&& vex.register_specifier > 0x7)
- BadOp ();
+ {
+ dp = &bad_opcode;
+ return dp;
+ }
vex.w = 0;
codep++;
vindex = *codep++;
dp = &vex_table[dp->op[1].bytemode][vindex];
+ end_codep = codep;
/* There is no MODRM byte for VEX [82|77]. */
if (vindex != 0x77 && vindex != 0x82)
{
dp = &vex_w_table[dp->op[1].bytemode][vex.w ? 1 : 0];
break;
+ case USE_EVEX_TABLE:
+ two_source_ops = 0;
+ /* EVEX prefix. */
+ vex.evex = 1;
+ FETCH_DATA (info, codep + 4);
+ /* All bits in the REX prefix are ignored. */
+ rex_ignored = rex;
+ /* The first byte after 0x62. */
+ rex = ~(*codep >> 5) & 0x7;
+ vex.r = *codep & 0x10;
+ switch ((*codep & 0xf))
+ {
+ default:
+ return &bad_opcode;
+ case 0x1:
+ vex_table_index = EVEX_0F;
+ break;
+ case 0x2:
+ vex_table_index = EVEX_0F38;
+ break;
+ case 0x3:
+ vex_table_index = EVEX_0F3A;
+ break;
+ }
+
+ /* The second byte after 0x62. */
+ codep++;
+ vex.w = *codep & 0x80;
+ if (vex.w && address_mode == mode_64bit)
+ rex |= REX_W;
+
+ vex.register_specifier = (~(*codep >> 3)) & 0xf;
+ if (address_mode != mode_64bit)
+ {
+ /* In 16/32-bit mode silently ignore following bits. */
+ rex &= ~REX_B;
+ vex.r = 1;
+ vex.v = 1;
+ vex.register_specifier &= 0x7;
+ }
+
+ /* The U bit. */
+ if (!(*codep & 0x4))
+ return &bad_opcode;
+
+ switch ((*codep & 0x3))
+ {
+ case 0:
+ vex.prefix = 0;
+ break;
+ case 1:
+ vex.prefix = DATA_PREFIX_OPCODE;
+ break;
+ case 2:
+ vex.prefix = REPE_PREFIX_OPCODE;
+ break;
+ case 3:
+ vex.prefix = REPNE_PREFIX_OPCODE;
+ break;
+ }
+
+ /* The third byte after 0x62. */
+ codep++;
+
+ /* Remember the static rounding bits. */
+ vex.ll = (*codep >> 5) & 3;
+ vex.b = (*codep & 0x10) != 0;
+
+ vex.v = *codep & 0x8;
+ vex.mask_register_specifier = *codep & 0x7;
+ vex.zeroing = *codep & 0x80;
+
+ need_vex = 1;
+ need_vex_reg = 1;
+ codep++;
+ vindex = *codep++;
+ dp = &evex_table[vex_table_index][vindex];
+ end_codep = codep;
+ FETCH_DATA (info, codep + 1);
+ modrm.mod = (*codep >> 6) & 3;
+ modrm.reg = (*codep >> 3) & 7;
+ modrm.rm = *codep & 7;
+
+ /* Set vector length. */
+ if (modrm.mod == 3 && vex.b)
+ vex.length = 512;
+ else
+ {
+ switch (vex.ll)
+ {
+ case 0x0:
+ vex.length = 128;
+ break;
+ case 0x1:
+ vex.length = 256;
+ break;
+ case 0x2:
+ vex.length = 512;
+ break;
+ default:
+ return &bad_opcode;
+ }
+ }
+ break;
+
+ case 0:
+ dp = &bad_opcode;
+ break;
+
default:
abort ();
}
return get_valid_dis386 (dp, info);
}
+static void
+get_sib (disassemble_info *info, int sizeflag)
+{
+ /* If modrm.mod == 3, operand must be register. */
+ if (need_modrm
+ && ((sizeflag & AFLAG) || address_mode == mode_64bit)
+ && modrm.mod != 3
+ && modrm.rm == 4)
+ {
+ FETCH_DATA (info, codep + 2);
+ sib.index = (codep [1] >> 3) & 7;
+ sib.scale = (codep [1] >> 6) & 3;
+ sib.base = codep [1] & 7;
+ }
+}
+
static int
print_insn (bfd_vma pc, disassemble_info *info)
{
int i;
char *op_txt[MAX_OPERANDS];
int needcomma;
- int sizeflag;
+ int sizeflag, orig_sizeflag;
const char *p;
struct dis_private priv;
- unsigned char op;
int prefix_length;
- int default_prefixes;
- if (info->mach == bfd_mach_x86_64_intel_syntax
- || info->mach == bfd_mach_x86_64
- || info->mach == bfd_mach_l1om
- || info->mach == bfd_mach_l1om_intel_syntax)
- address_mode = mode_64bit;
- else
+ priv.orig_sizeflag = AFLAG | DFLAG;
+ if ((info->mach & bfd_mach_i386_i386) != 0)
address_mode = mode_32bit;
-
- if (intel_syntax == (char) -1)
- intel_syntax = (info->mach == bfd_mach_i386_i386_intel_syntax
- || info->mach == bfd_mach_x86_64_intel_syntax
- || info->mach == bfd_mach_l1om_intel_syntax);
-
- if (info->mach == bfd_mach_i386_i386
- || info->mach == bfd_mach_x86_64
- || info->mach == bfd_mach_l1om
- || info->mach == bfd_mach_i386_i386_intel_syntax
- || info->mach == bfd_mach_x86_64_intel_syntax
- || info->mach == bfd_mach_l1om_intel_syntax)
- priv.orig_sizeflag = AFLAG | DFLAG;
else if (info->mach == bfd_mach_i386_i8086)
- priv.orig_sizeflag = 0;
+ {
+ address_mode = mode_16bit;
+ priv.orig_sizeflag = 0;
+ }
else
- abort ();
+ address_mode = mode_64bit;
+
+ if (intel_syntax == (char) -1)
+ intel_syntax = (info->mach & bfd_mach_i386_intel_syntax) != 0;
for (p = info->disassembler_options; p != NULL; )
{
names8 = intel_names8;
names8rex = intel_names8rex;
names_seg = intel_names_seg;
+ names_mm = intel_names_mm;
+ names_bnd = intel_names_bnd;
+ names_xmm = intel_names_xmm;
+ names_ymm = intel_names_ymm;
+ names_zmm = intel_names_zmm;
index64 = intel_index64;
index32 = intel_index32;
+ names_mask = intel_names_mask;
index16 = intel_index16;
open_char = '[';
close_char = ']';
names8 = att_names8;
names8rex = att_names8rex;
names_seg = att_names_seg;
+ names_mm = att_names_mm;
+ names_bnd = att_names_bnd;
+ names_xmm = att_names_xmm;
+ names_ymm = att_names_ymm;
+ names_zmm = att_names_zmm;
index64 = att_index64;
index32 = att_index32;
+ names_mask = att_names_mask;
index16 = att_index16;
open_char = '(';
close_char = ')';
/* The output looks better if we put 7 bytes on a line, since that
puts most long word instructions on a single line. Use 8 bytes
for Intel L1OM. */
- if (info->mach == bfd_mach_l1om
- || info->mach == bfd_mach_l1om_intel_syntax)
+ if ((info->mach & bfd_mach_l1om) != 0)
info->bytes_per_line = 8;
else
info->bytes_per_line = 7;
start_codep = priv.the_buffer;
codep = priv.the_buffer;
- if (setjmp (priv.bailout) != 0)
+ if (OPCODES_SIGSETJMP (priv.bailout) != 0)
{
const char *name;
{
/* Too many prefixes or unused REX prefixes. */
for (i = 0;
- all_prefixes[i] && i < (int) ARRAY_SIZE (all_prefixes);
+ i < (int) ARRAY_SIZE (all_prefixes) && all_prefixes[i];
i++)
- (*info->fprintf_func) (info->stream, "%s",
+ (*info->fprintf_func) (info->stream, "%s%s",
+ i == 0 ? "" : " ",
prefix_name (all_prefixes[i], sizeflag));
- return 1;
+ return i;
}
insn_codep = codep;
if (((prefixes & PREFIX_FWAIT)
&& ((*codep < 0xd8) || (*codep > 0xdf))))
{
+ /* Handle prefixes before fwait. */
+ for (i = 0; i < fwait_prefix && all_prefixes[i];
+ i++)
+ (*info->fprintf_func) (info->stream, "%s ",
+ prefix_name (all_prefixes[i], sizeflag));
(*info->fprintf_func) (info->stream, "fwait");
- return 1;
+ return i + 1;
}
- op = 0;
-
if (*codep == 0x0f)
{
unsigned char threebyte;
threebyte = *++codep;
dp = &dis386_twobyte[threebyte];
need_modrm = twobyte_has_modrm[*codep];
+ mandatory_prefix = twobyte_has_mandatory_prefix[*codep];
codep++;
}
else
{
dp = &dis386[*codep];
need_modrm = onebyte_has_modrm[*codep];
+ mandatory_prefix = 0;
codep++;
}
- if ((prefixes & PREFIX_REPZ))
- used_prefixes |= PREFIX_REPZ;
- if ((prefixes & PREFIX_REPNZ))
- used_prefixes |= PREFIX_REPNZ;
- if ((prefixes & PREFIX_LOCK))
- used_prefixes |= PREFIX_LOCK;
-
- default_prefixes = 0;
- if (prefixes & PREFIX_ADDR)
- {
- sizeflag ^= AFLAG;
- if (dp->op[2].bytemode != loop_jcxz_mode || intel_syntax)
- {
- if ((sizeflag & AFLAG) || address_mode == mode_64bit)
- all_prefixes[last_addr_prefix] = ADDR32_PREFIX;
- else
- all_prefixes[last_addr_prefix] = ADDR16_PREFIX;
- default_prefixes |= PREFIX_ADDR;
- }
- }
-
- if ((prefixes & PREFIX_DATA))
- {
- sizeflag ^= DFLAG;
- if (dp->op[2].bytemode == cond_jump_mode
- && dp->op[0].bytemode == v_mode
- && !intel_syntax)
- {
- if (sizeflag & DFLAG)
- all_prefixes[last_data_prefix] = DATA32_PREFIX;
- else
- all_prefixes[last_data_prefix] = DATA16_PREFIX;
- default_prefixes |= PREFIX_DATA;
- }
- else if (rex & REX_W)
- {
- /* REX_W will override PREFIX_DATA. */
- default_prefixes |= PREFIX_DATA;
- }
- }
+ /* Save sizeflag for printing the extra prefixes later before updating
+ it for mnemonic and operand processing. The prefix names depend
+ only on the address mode. */
+ orig_sizeflag = sizeflag;
+ if (prefixes & PREFIX_ADDR)
+ sizeflag ^= AFLAG;
+ if ((prefixes & PREFIX_DATA))
+ sizeflag ^= DFLAG;
+ end_codep = codep;
if (need_modrm)
{
FETCH_DATA (info, codep + 1);
modrm.rm = *codep & 7;
}
- need_vex = 0;
- need_vex_reg = 0;
- vex_w_done = 0;
+ need_vex = 0;
+ need_vex_reg = 0;
+ vex_w_done = 0;
+ vex.evex = 0;
if (dp->name == NULL && dp->op[0].bytemode == FLOATCODE)
{
+ get_sib (info, sizeflag);
dofloat (sizeflag);
}
else
{
dp = get_valid_dis386 (dp, info);
if (dp != NULL && putop (dp->name, sizeflag) == 0)
- {
+ {
+ get_sib (info, sizeflag);
for (i = 0; i < MAX_OPERANDS; ++i)
{
obufp = op_out[i];
op_ad = MAX_OPERANDS - 1 - i;
if (dp->op[i].rtn)
(*dp->op[i].rtn) (dp->op[i].bytemode, sizeflag);
+ /* For EVEX instruction after the last operand masking
+ should be printed. */
+ if (i == 0 && vex.evex)
+ {
+ /* Don't print {%k0}. */
+ if (vex.mask_register_specifier)
+ {
+ oappend ("{");
+ oappend (names_mask[vex.mask_register_specifier]);
+ oappend ("}");
+ }
+ if (vex.zeroing)
+ oappend ("{z}");
+ }
}
}
}
- /* See if any prefixes were not used. If so, print the first one
- separately. If we don't do this, we'll wind up printing an
- instruction stream which does not precisely correspond to the
- bytes we are disassembling. */
- if ((prefixes & ~(used_prefixes | default_prefixes)) != 0)
- {
- for (i = 0; i < (int) ARRAY_SIZE (all_prefixes); i++)
- if (all_prefixes[i])
- {
- const char *name;
- name = prefix_name (all_prefixes[i], priv.orig_sizeflag);
- if (name == NULL)
- name = INTERNAL_DISASSEMBLER_ERROR;
- (*info->fprintf_func) (info->stream, "%s", name);
- return 1;
- }
- }
-
- /* Check if the REX prefix used. */
- if (rex_ignored == 0 && (rex ^ rex_used) == 0)
+ /* Check if the REX prefix is used. */
+ if (rex_ignored == 0 && (rex ^ rex_used) == 0 && last_rex_prefix >= 0)
all_prefixes[last_rex_prefix] = 0;
- /* Check if the SEG prefix used. */
+ /* Check if the SEG prefix is used. */
if ((prefixes & (PREFIX_CS | PREFIX_SS | PREFIX_DS | PREFIX_ES
| PREFIX_FS | PREFIX_GS)) != 0
- && (used_prefixes
- & seg_prefix (all_prefixes[last_seg_prefix])) != 0)
+ && (used_prefixes & active_seg_prefix) != 0)
all_prefixes[last_seg_prefix] = 0;
- /* Check if the ADDR prefix used. */
+ /* Check if the ADDR prefix is used. */
if ((prefixes & PREFIX_ADDR) != 0
&& (used_prefixes & PREFIX_ADDR) != 0)
all_prefixes[last_addr_prefix] = 0;
- /* Check if the DATA prefix used. */
+ /* Check if the DATA prefix is used. */
if ((prefixes & PREFIX_DATA) != 0
&& (used_prefixes & PREFIX_DATA) != 0)
all_prefixes[last_data_prefix] = 0;
+ /* Print the extra prefixes. */
prefix_length = 0;
for (i = 0; i < (int) ARRAY_SIZE (all_prefixes); i++)
if (all_prefixes[i])
{
const char *name;
- name = prefix_name (all_prefixes[i], sizeflag);
+ name = prefix_name (all_prefixes[i], orig_sizeflag);
if (name == NULL)
abort ();
prefix_length += strlen (name) + 1;
(*info->fprintf_func) (info->stream, "%s ", name);
}
+ /* If the mandatory PREFIX_REPZ/PREFIX_REPNZ/PREFIX_DATA prefix is
+ unused, opcode is invalid. Since the PREFIX_DATA prefix may be
+ used by putop and MMX/SSE operand and may be overriden by the
+ PREFIX_REPZ/PREFIX_REPNZ fix, we check the PREFIX_DATA prefix
+ separately. */
+ if (mandatory_prefix
+ && dp != &bad_opcode
+ && (((prefixes
+ & (PREFIX_REPZ | PREFIX_REPNZ)) != 0
+ && (used_prefixes
+ & (PREFIX_REPZ | PREFIX_REPNZ)) == 0)
+ || ((((prefixes
+ & (PREFIX_REPZ | PREFIX_REPNZ | PREFIX_DATA))
+ == PREFIX_DATA)
+ && (used_prefixes & PREFIX_DATA) == 0))))
+ {
+ (*info->fprintf_func) (info->stream, "(bad)");
+ return end_codep - priv.the_buffer;
+ }
+
/* Check maximum code length. */
if ((codep - start_codep) > MAX_CODE_LENGTH)
{
bfd_vma riprel;
for (i = 0; i < MAX_OPERANDS; ++i)
- op_txt[i] = op_out[i];
+ op_txt[i] = op_out[i];
for (i = 0; i < (MAX_OPERANDS >> 1); ++i)
{
- op_ad = op_index[i];
- op_index[i] = op_index[MAX_OPERANDS - 1 - i];
- op_index[MAX_OPERANDS - 1 - i] = op_ad;
+ op_ad = op_index[i];
+ op_index[i] = op_index[MAX_OPERANDS - 1 - i];
+ op_index[MAX_OPERANDS - 1 - i] = op_ad;
riprel = op_riprel[i];
op_riprel[i] = op_riprel [MAX_OPERANDS - 1 - i];
op_riprel[MAX_OPERANDS - 1 - i] = riprel;
else
{
for (i = 0; i < MAX_OPERANDS; ++i)
- op_txt[MAX_OPERANDS - 1 - i] = op_out[i];
+ op_txt[MAX_OPERANDS - 1 - i] = op_out[i];
}
needcomma = 0;
{ "fld", { STi } },
{ "fxch", { STi } },
{ FGRPd9_2 },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ FGRPd9_4 },
{ FGRPd9_5 },
{ FGRPd9_6 },
{ "fcmove", { ST, STi } },
{ "fcmovbe",{ ST, STi } },
{ "fcmovu", { ST, STi } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ FGRPda_5 },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
},
/* db */
{
{ FGRPdb_4 },
{ "fucomi", { ST, STi } },
{ "fcomi", { ST, STi } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
},
/* dc */
{
{ "fadd", { STi, ST } },
{ "fmul", { STi, ST } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ "fsub!M", { STi, ST } },
{ "fsubM", { STi, ST } },
{ "fdiv!M", { STi, ST } },
/* dd */
{
{ "ffree", { STi } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ "fst", { STi } },
{ "fstp", { STi } },
{ "fucom", { STi } },
{ "fucomp", { STi } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
},
/* de */
{
{ "faddp", { STi, ST } },
{ "fmulp", { STi, ST } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
{ FGRPde_3 },
{ "fsub!Mp", { STi, ST } },
{ "fsubMp", { STi, ST } },
/* df */
{
{ "ffreep", { STi } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
+ { Bad_Opcode },
+ { Bad_Opcode },
{ FGRPdf_4 },
{ "fucomip", { ST, STi } },
{ "fcomip", { ST, STi } },
- { "(bad)", { XX } },
+ { Bad_Opcode },
},
};
}
}
+/* Like oappend (below), but S is a string starting with '%'.
+ In Intel syntax, the '%' is elided. */
+static void
+oappend_maybe_intel (const char *s)
+{
+ oappend (s + intel_syntax);
+}
+
static void
OP_ST (int bytemode ATTRIBUTE_UNUSED, int sizeflag ATTRIBUTE_UNUSED)
{
- oappend ("%st" + intel_syntax);
+ oappend_maybe_intel ("%st");
}
static void
OP_STi (int bytemode ATTRIBUTE_UNUSED, int sizeflag ATTRIBUTE_UNUSED)
{
sprintf (scratchbuf, "%%st(%d)", modrm.rm);
- oappend (scratchbuf + intel_syntax);
+ oappend_maybe_intel (scratchbuf);
}
/* Capital letters in template are macros. */
used_prefixes |= (prefixes & PREFIX_DATA);
break;
case 'T':
- if (intel_syntax)
- break;
- if (address_mode == mode_64bit && (sizeflag & DFLAG))
+ if (!intel_syntax
+ && address_mode == mode_64bit
+ && ((sizeflag & DFLAG) || (rex & REX_W)))
{
*obufp++ = 'q';
break;
}
/* Fall through. */
+ goto case_P;
case 'P':
- if (intel_syntax)
- break;
- if ((prefixes & PREFIX_DATA)
- || (rex & REX_W)
- || (sizeflag & SUFFIX_ALWAYS))
+ if (l == 0 && len == 1)
{
- USED_REX (REX_W);
- if (rex & REX_W)
- *obufp++ = 'q';
- else
+case_P:
+ if (intel_syntax)
{
- if (sizeflag & DFLAG)
- *obufp++ = 'l';
- else
- *obufp++ = 'w';
- used_prefixes |= (prefixes & PREFIX_DATA);
+ if ((rex & REX_W) == 0
+ && (prefixes & PREFIX_DATA))
+ {
+ if ((sizeflag & DFLAG) == 0)
+ *obufp++ = 'w';
+ used_prefixes |= (prefixes & PREFIX_DATA);
+ }
+ break;
+ }
+ if ((prefixes & PREFIX_DATA)
+ || (rex & REX_W)
+ || (sizeflag & SUFFIX_ALWAYS))
+ {
+ USED_REX (REX_W);
+ if (rex & REX_W)
+ *obufp++ = 'q';
+ else
+ {
+ if (sizeflag & DFLAG)
+ *obufp++ = 'l';
+ else
+ *obufp++ = 'w';
+ used_prefixes |= (prefixes & PREFIX_DATA);
+ }
+ }
+ }
+ else
+ {
+ if (l != 1 || len != 2 || last[0] != 'L')
+ {
+ SAVE_LAST (*p);
+ break;
+ }
+
+ if ((prefixes & PREFIX_DATA)
+ || (rex & REX_W)
+ || (sizeflag & SUFFIX_ALWAYS))
+ {
+ USED_REX (REX_W);
+ if (rex & REX_W)
+ *obufp++ = 'q';
+ else
+ {
+ if (sizeflag & DFLAG)
+ *obufp++ = intel_syntax ? 'd' : 'l';
+ else
+ *obufp++ = 'w';
+ used_prefixes |= (prefixes & PREFIX_DATA);
+ }
}
}
break;
case 'U':
if (intel_syntax)
break;
- if (address_mode == mode_64bit && (sizeflag & DFLAG))
+ if (address_mode == mode_64bit
+ && ((sizeflag & DFLAG) || (rex & REX_W)))
{
if (modrm.mod != 3 || (sizeflag & SUFFIX_ALWAYS))
*obufp++ = 'q';
{
if (intel_syntax)
break;
- if (address_mode == mode_64bit && (sizeflag & DFLAG))
+ if (address_mode == mode_64bit
+ && ((sizeflag & DFLAG) || (rex & REX_W)))
{
if (sizeflag & SUFFIX_ALWAYS)
*obufp++ = 'q';
}
else
{
- if (l != 1 || len != 2 || last[0] != 'X')
+ if (l != 1
+ || len != 2
+ || (last[0] != 'X'
+ && last[0] != 'L'))
{
SAVE_LAST (*p);
break;
}
if (!need_vex)
abort ();
- *obufp++ = vex.w ? 'd': 's';
+ if (last[0] == 'X')
+ *obufp++ = vex.w ? 'd': 's';
+ else
+ *obufp++ = vex.w ? 'q': 'd';
}
break;
}
static void
append_seg (void)
{
- if (prefixes & PREFIX_CS)
- {
- used_prefixes |= PREFIX_CS;
- oappend ("%cs:" + intel_syntax);
- }
- if (prefixes & PREFIX_DS)
- {
- used_prefixes |= PREFIX_DS;
- oappend ("%ds:" + intel_syntax);
- }
- if (prefixes & PREFIX_SS)
- {
- used_prefixes |= PREFIX_SS;
- oappend ("%ss:" + intel_syntax);
- }
- if (prefixes & PREFIX_ES)
- {
- used_prefixes |= PREFIX_ES;
- oappend ("%es:" + intel_syntax);
- }
- if (prefixes & PREFIX_FS)
- {
- used_prefixes |= PREFIX_FS;
- oappend ("%fs:" + intel_syntax);
- }
- if (prefixes & PREFIX_GS)
+ /* Only print the active segment register. */
+ if (!active_seg_prefix)
+ return;
+
+ used_prefixes |= active_seg_prefix;
+ switch (active_seg_prefix)
{
- used_prefixes |= PREFIX_GS;
- oappend ("%gs:" + intel_syntax);
+ case PREFIX_CS:
+ oappend_maybe_intel ("%cs:");
+ break;
+ case PREFIX_DS:
+ oappend_maybe_intel ("%ds:");
+ break;
+ case PREFIX_SS:
+ oappend_maybe_intel ("%ss:");
+ break;
+ case PREFIX_ES:
+ oappend_maybe_intel ("%es:");
+ break;
+ case PREFIX_FS:
+ oappend_maybe_intel ("%fs:");
+ break;
+ case PREFIX_GS:
+ oappend_maybe_intel ("%gs:");
+ break;
+ default:
+ break;
}
}
static void
intel_operand_size (int bytemode, int sizeflag)
{
+ if (vex.evex
+ && vex.b
+ && (bytemode == x_mode
+ || bytemode == evex_half_bcst_xmmq_mode))
+ {
+ if (vex.w)
+ oappend ("QWORD PTR ");
+ else
+ oappend ("DWORD PTR ");
+ return;
+ }
switch (bytemode)
{
case b_mode:
case b_swap_mode:
case dqb_mode:
+ case db_mode:
oappend ("BYTE PTR ");
break;
case w_mode:
+ case dw_mode:
case dqw_mode:
+ case dqw_swap_mode:
oappend ("WORD PTR ");
break;
case stack_v_mode:
- if (address_mode == mode_64bit && (sizeflag & DFLAG))
+ if (address_mode == mode_64bit && ((sizeflag & DFLAG) || (rex & REX_W)))
+ {
+ oappend ("QWORD PTR ");
+ break;
+ }
+ /* FALLTHRU */
+ case v_mode:
+ case v_swap_mode:
+ case dq_mode:
+ USED_REX (REX_W);
+ if (rex & REX_W)
+ oappend ("QWORD PTR ");
+ else
+ {
+ if ((sizeflag & DFLAG) || bytemode == dq_mode)
+ oappend ("DWORD PTR ");
+ else
+ oappend ("WORD PTR ");
+ used_prefixes |= (prefixes & PREFIX_DATA);
+ }
+ break;
+ case z_mode:
+ if ((rex & REX_W) || (sizeflag & DFLAG))
+ *obufp++ = 'D';
+ oappend ("WORD PTR ");
+ if (!(rex & REX_W))
+ used_prefixes |= (prefixes & PREFIX_DATA);
+ break;
+ case a_mode:
+ if (sizeflag & DFLAG)
+ oappend ("QWORD PTR ");
+ else
+ oappend ("DWORD PTR ");
+ used_prefixes |= (prefixes & PREFIX_DATA);
+ break;
+ case d_mode:
+ case d_scalar_mode:
+ case d_scalar_swap_mode:
+ case d_swap_mode:
+ case dqd_mode:
+ oappend ("DWORD PTR ");
+ break;
+ case q_mode:
+ case q_scalar_mode:
+ case q_scalar_swap_mode:
+ case q_swap_mode:
+ oappend ("QWORD PTR ");
+ break;
+ case m_mode:
+ if (address_mode == mode_64bit)
+ oappend ("QWORD PTR ");
+ else
+ oappend ("DWORD PTR ");
+ break;
+ case f_mode:
+ if (sizeflag & DFLAG)
+ oappend ("FWORD PTR ");
+ else
+ oappend ("DWORD PTR ");
+ used_prefixes |= (prefixes & PREFIX_DATA);
+ break;
+ case t_mode:
+ oappend ("TBYTE PTR ");
+ break;
+ case x_mode:
+ case x_swap_mode:
+ case evex_x_gscat_mode:
+ case evex_x_nobcst_mode:
+ if (need_vex)
+ {
+ switch (vex.length)
+ {
+ case 128:
+ oappend ("XMMWORD PTR ");
+ break;
+ case 256:
+ oappend ("YMMWORD PTR ");
+ break;
+ case 512:
+ oappend ("ZMMWORD PTR ");
+ break;
+ default:
+ abort ();
+ }
+ }
+ else
+ oappend ("XMMWORD PTR ");
+ break;
+ case xmm_mode:
+ oappend ("XMMWORD PTR ");
+ break;
+ case ymm_mode:
+ oappend ("YMMWORD PTR ");
+ break;
+ case xmmq_mode:
+ case evex_half_bcst_xmmq_mode:
+ if (!need_vex)
+ abort ();
+
+ switch (vex.length)
+ {
+ case 128:
+ oappend ("QWORD PTR ");
+ break;
+ case 256:
+ oappend ("XMMWORD PTR ");
+ break;
+ case 512:
+ oappend ("YMMWORD PTR ");
+ break;
+ default:
+ abort ();
+ }
+ break;
+ case xmm_mb_mode:
+ if (!need_vex)
+ abort ();
+
+ switch (vex.length)
+ {
+ case 128:
+ case 256:
+ case 512:
+ oappend ("BYTE PTR ");
+ break;
+ default:
+ abort ();
+ }
+ break;
+ case xmm_mw_mode:
+ if (!need_vex)
+ abort ();
+
+ switch (vex.length)
+ {
+ case 128:
+ case 256:
+ case 512:
+ oappend ("WORD PTR ");
+ break;
+ default:
+ abort ();
+ }
+ break;
+ case xmm_md_mode:
+ if (!need_vex)
+ abort ();
+
+ switch (vex.length)
+ {
+ case 128:
+ case 256:
+ case 512:
+ oappend ("DWORD PTR ");
+ break;
+ default:
+ abort ();
+ }
+ break;
+ case xmm_mq_mode:
+ if (!need_vex)
+ abort ();
+
+ switch (vex.length)
+ {
+ case 128:
+ case 256:
+ case 512:
+ oappend ("QWORD PTR ");
+ break;
+ default:
+ abort ();
+ }
+ break;
+ case xmmdw_mode:
+ if (!need_vex)
+ abort ();
+
+ switch (vex.length)
{
+ case 128:
+ oappend ("WORD PTR ");
+ break;
+ case 256:
+ oappend ("DWORD PTR ");
+ break;
+ case 512:
oappend ("QWORD PTR ");
break;
+ default:
+ abort ();
}
- /* FALLTHRU */
- case v_mode:
- case v_swap_mode:
- case dq_mode:
- USED_REX (REX_W);
- if (rex & REX_W)
- oappend ("QWORD PTR ");
- else
+ break;
+ case xmmqd_mode:
+ if (!need_vex)
+ abort ();
+
+ switch (vex.length)
{
- if ((sizeflag & DFLAG) || bytemode == dq_mode)
- oappend ("DWORD PTR ");
- else
- oappend ("WORD PTR ");
- used_prefixes |= (prefixes & PREFIX_DATA);
+ case 128:
+ oappend ("DWORD PTR ");
+ break;
+ case 256:
+ oappend ("QWORD PTR ");
+ break;
+ case 512:
+ oappend ("XMMWORD PTR ");
+ break;
+ default:
+ abort ();
}
break;
- case z_mode:
- if ((rex & REX_W) || (sizeflag & DFLAG))
- *obufp++ = 'D';
- oappend ("WORD PTR ");
- if (!(rex & REX_W))
- used_prefixes |= (prefixes & PREFIX_DATA);
- break;
- case a_mode:
- if (sizeflag & DFLAG)
- oappend ("QWORD PTR ");
- else
- oappend ("DWORD PTR ");
- used_prefixes |= (prefixes & PREFIX_DATA);
+ case ymmq_mode:
+ if (!need_vex)
+ abort ();
+
+ switch (vex.length)
+ {
+ case 128:
+ oappend ("QWORD PTR ");
+ break;
+ case 256:
+ oappend ("YMMWORD PTR ");
+ break;
+ case 512:
+ oappend ("ZMMWORD PTR ");
+ break;
+ default:
+ abort ();
+ }
break;
- case d_mode:
- case d_swap_mode:
- case dqd_mode:
- oappend ("DWORD PTR ");
+ case ymmxmm_mode:
+ if (!need_vex)
+ abort ();
+
+ switch (vex.length)
+ {
+ case 128:
+ case 256:
+ oappend ("XMMWORD PTR ");
+ break;
+ default:
+ abort ();
+ }
break;
- case q_mode:
- case q_swap_mode:
- oappend ("QWORD PTR ");
+ case o_mode:
+ oappend ("OWORD PTR ");
break;
- case m_mode:
- if (address_mode == mode_64bit)
+ case xmm_mdq_mode:
+ case vex_w_dq_mode:
+ case vex_scalar_w_dq_mode:
+ if (!need_vex)
+ abort ();
+
+ if (vex.w)
oappend ("QWORD PTR ");
else
oappend ("DWORD PTR ");
break;
- case f_mode:
- if (sizeflag & DFLAG)
- oappend ("FWORD PTR ");
+ case vex_vsib_d_w_dq_mode:
+ case vex_vsib_q_w_dq_mode:
+ if (!need_vex)
+ abort ();
+
+ if (!vex.evex)
+ {
+ if (vex.w)
+ oappend ("QWORD PTR ");
+ else
+ oappend ("DWORD PTR ");
+ }
else
- oappend ("DWORD PTR ");
- used_prefixes |= (prefixes & PREFIX_DATA);
- break;
- case t_mode:
- oappend ("TBYTE PTR ");
- break;
- case x_mode:
- case x_swap_mode:
- if (need_vex)
{
switch (vex.length)
{
case 256:
oappend ("YMMWORD PTR ");
break;
+ case 512:
+ oappend ("ZMMWORD PTR ");
+ break;
default:
abort ();
}
}
- else
- oappend ("XMMWORD PTR ");
- break;
- case xmm_mode:
- oappend ("XMMWORD PTR ");
break;
- case xmmq_mode:
- if (!need_vex)
+ case vex_vsib_q_w_d_mode:
+ case vex_vsib_d_w_d_mode:
+ if (!need_vex || !vex.evex)
abort ();
switch (vex.length)
case 256:
oappend ("XMMWORD PTR ");
break;
- default:
- abort ();
- }
- break;
- case ymmq_mode:
- if (!need_vex)
- abort ();
-
- switch (vex.length)
- {
- case 128:
- oappend ("QWORD PTR ");
- break;
- case 256:
+ case 512:
oappend ("YMMWORD PTR ");
break;
default:
abort ();
}
+
break;
- case o_mode:
- oappend ("OWORD PTR ");
+ case mask_bd_mode:
+ if (!need_vex || vex.length != 128)
+ abort ();
+ if (vex.w)
+ oappend ("DWORD PTR ");
+ else
+ oappend ("BYTE PTR ");
break;
- case vex_w_dq_mode:
+ case mask_mode:
if (!need_vex)
abort ();
-
if (vex.w)
oappend ("QWORD PTR ");
else
- oappend ("DWORD PTR ");
+ oappend ("WORD PTR ");
break;
+ case v_bnd_mode:
default:
break;
}
reg += 8;
if ((sizeflag & SUFFIX_ALWAYS)
- && (bytemode == b_swap_mode || bytemode == v_swap_mode))
+ && (bytemode == b_swap_mode
+ || bytemode == v_swap_mode
+ || bytemode == dqw_swap_mode))
swap_operand ();
switch (bytemode)
names = names16;
break;
case d_mode:
+ case dw_mode:
+ case db_mode:
names = names32;
break;
case q_mode:
names = names64;
break;
case m_mode:
+ case v_bnd_mode:
names = address_mode == mode_64bit ? names64 : names32;
break;
+ case bnd_mode:
+ names = names_bnd;
+ break;
case stack_v_mode:
- if (address_mode == mode_64bit && (sizeflag & DFLAG))
+ if (address_mode == mode_64bit && ((sizeflag & DFLAG) || (rex & REX_W)))
{
names = names64;
break;
case dqb_mode:
case dqd_mode:
case dqw_mode:
+ case dqw_swap_mode:
USED_REX (REX_W);
if (rex & REX_W)
names = names64;
else
{
- if ((sizeflag & DFLAG)
+ if ((sizeflag & DFLAG)
|| (bytemode != v_mode
&& bytemode != v_swap_mode))
names = names32;
used_prefixes |= (prefixes & PREFIX_DATA);
}
break;
+ case mask_bd_mode:
+ case mask_mode:
+ names = names_mask;
+ break;
case 0:
return;
default:
bfd_vma disp = 0;
int add = (rex & REX_B) ? 8 : 0;
int riprel = 0;
+ int shift;
+
+ if (vex.evex)
+ {
+ /* In EVEX, if operand doesn't allow broadcast, vex.b should be 0. */
+ if (vex.b
+ && bytemode != x_mode
+ && bytemode != xmmq_mode
+ && bytemode != evex_half_bcst_xmmq_mode)
+ {
+ BadOp ();
+ return;
+ }
+ switch (bytemode)
+ {
+ case dqw_mode:
+ case dw_mode:
+ case dqw_swap_mode:
+ shift = 1;
+ break;
+ case dqb_mode:
+ case db_mode:
+ shift = 0;
+ break;
+ case vex_vsib_d_w_dq_mode:
+ case vex_vsib_d_w_d_mode:
+ case vex_vsib_q_w_dq_mode:
+ case vex_vsib_q_w_d_mode:
+ case evex_x_gscat_mode:
+ case xmm_mdq_mode:
+ shift = vex.w ? 3 : 2;
+ break;
+ case x_mode:
+ case evex_half_bcst_xmmq_mode:
+ case xmmq_mode:
+ if (vex.b)
+ {
+ shift = vex.w ? 3 : 2;
+ break;
+ }
+ /* Fall through if vex.b == 0. */
+ case xmmqd_mode:
+ case xmmdw_mode:
+ case ymmq_mode:
+ case evex_x_nobcst_mode:
+ case x_swap_mode:
+ switch (vex.length)
+ {
+ case 128:
+ shift = 4;
+ break;
+ case 256:
+ shift = 5;
+ break;
+ case 512:
+ shift = 6;
+ break;
+ default:
+ abort ();
+ }
+ break;
+ case ymm_mode:
+ shift = 5;
+ break;
+ case xmm_mode:
+ shift = 4;
+ break;
+ case xmm_mq_mode:
+ case q_mode:
+ case q_scalar_mode:
+ case q_swap_mode:
+ case q_scalar_swap_mode:
+ shift = 3;
+ break;
+ case dqd_mode:
+ case xmm_md_mode:
+ case d_mode:
+ case d_scalar_mode:
+ case d_swap_mode:
+ case d_scalar_swap_mode:
+ shift = 2;
+ break;
+ case xmm_mw_mode:
+ shift = 1;
+ break;
+ case xmm_mb_mode:
+ shift = 0;
+ break;
+ default:
+ abort ();
+ }
+ /* Make necessary corrections to shift for modes that need it.
+ For these modes we currently have shift 4, 5 or 6 depending on
+ vex.length (it corresponds to xmmword, ymmword or zmmword
+ operand). We might want to make it 3, 4 or 5 (e.g. for
+ xmmq_mode). In case of broadcast enabled the corrections
+ aren't needed, as element size is always 32 or 64 bits. */
+ if (!vex.b
+ && (bytemode == xmmq_mode
+ || bytemode == evex_half_bcst_xmmq_mode))
+ shift -= 1;
+ else if (bytemode == xmmqd_mode)
+ shift -= 2;
+ else if (bytemode == xmmdw_mode)
+ shift -= 3;
+ else if (bytemode == ymmq_mode && vex.length == 128)
+ shift -= 1;
+ }
+ else
+ shift = 0;
USED_REX (REX_B);
if (intel_syntax)
int base, rbase;
int vindex = 0;
int scale = 0;
+ int addr32flag = !((sizeflag & AFLAG)
+ || bytemode == v_bnd_mode
+ || bytemode == bnd_mode);
+ const char **indexes64 = names64;
+ const char **indexes32 = names32;
havesib = 0;
havebase = 1;
if (base == 4)
{
havesib = 1;
- FETCH_DATA (the_info, codep + 1);
- vindex = (*codep >> 3) & 7;
- scale = (*codep >> 6) & 3;
- base = *codep & 7;
+ vindex = sib.index;
USED_REX (REX_X);
if (rex & REX_X)
vindex += 8;
- haveindex = vindex != 4;
+ switch (bytemode)
+ {
+ case vex_vsib_d_w_dq_mode:
+ case vex_vsib_d_w_d_mode:
+ case vex_vsib_q_w_dq_mode:
+ case vex_vsib_q_w_d_mode:
+ if (!need_vex)
+ abort ();
+ if (vex.evex)
+ {
+ if (!vex.v)
+ vindex += 16;
+ }
+
+ haveindex = 1;
+ switch (vex.length)
+ {
+ case 128:
+ indexes64 = indexes32 = names_xmm;
+ break;
+ case 256:
+ if (!vex.w
+ || bytemode == vex_vsib_q_w_dq_mode
+ || bytemode == vex_vsib_q_w_d_mode)
+ indexes64 = indexes32 = names_ymm;
+ else
+ indexes64 = indexes32 = names_xmm;
+ break;
+ case 512:
+ if (!vex.w
+ || bytemode == vex_vsib_q_w_dq_mode
+ || bytemode == vex_vsib_q_w_d_mode)
+ indexes64 = indexes32 = names_zmm;
+ else
+ indexes64 = indexes32 = names_ymm;
+ break;
+ default:
+ abort ();
+ }
+ break;
+ default:
+ haveindex = vindex != 4;
+ break;
+ }
+ scale = sib.scale;
+ base = sib.base;
codep++;
}
rbase = base + add;
disp = *codep++;
if ((disp & 0x80) != 0)
disp -= 0x100;
+ if (vex.evex && shift > 0)
+ disp <<= shift;
break;
case 2:
disp = get32s ();
}
}
- if (havebase || haveindex || riprel)
+ if ((havebase || haveindex || riprel)
+ && (bytemode != v_bnd_mode)
+ && (bytemode != bnd_mode))
used_prefixes |= PREFIX_ADDR;
if (havedisp || (intel_syntax && riprel))
}
*obufp = '\0';
if (havebase)
- oappend (address_mode == mode_64bit && (sizeflag & AFLAG)
+ oappend (address_mode == mode_64bit && !addr32flag
? names64[rbase] : names32[rbase]);
if (havesib)
{
*obufp = '\0';
}
if (haveindex)
- oappend (address_mode == mode_64bit
- && (sizeflag & AFLAG)
- ? names64[vindex] : names32[vindex]);
+ oappend (address_mode == mode_64bit && !addr32flag
+ ? indexes64[vindex] : indexes32[vindex]);
else
- oappend (address_mode == mode_64bit
- && (sizeflag & AFLAG)
+ oappend (address_mode == mode_64bit && !addr32flag
? index64 : index32);
*obufp++ = scale_char;
{
if (modrm.mod != 0 || base == 5)
{
- if (prefixes & (PREFIX_CS | PREFIX_SS | PREFIX_DS
- | PREFIX_ES | PREFIX_FS | PREFIX_GS))
- ;
- else
+ if (!active_seg_prefix)
{
oappend (names_seg[ds_reg - es_reg]);
oappend (":");
}
else if (intel_syntax)
{
- if (prefixes & (PREFIX_CS | PREFIX_SS | PREFIX_DS
- | PREFIX_ES | PREFIX_FS | PREFIX_GS))
- ;
- else
+ if (!active_seg_prefix)
{
oappend (names_seg[ds_reg - es_reg]);
oappend (":");
oappend (scratchbuf);
}
}
+ if (vex.evex && vex.b
+ && (bytemode == x_mode
+ || bytemode == xmmq_mode
+ || bytemode == evex_half_bcst_xmmq_mode))
+ {
+ if (vex.w
+ || bytemode == xmmq_mode
+ || bytemode == evex_half_bcst_xmmq_mode)
+ {
+ switch (vex.length)
+ {
+ case 128:
+ oappend ("{1to2}");
+ break;
+ case 256:
+ oappend ("{1to4}");
+ break;
+ case 512:
+ oappend ("{1to8}");
+ break;
+ default:
+ abort ();
+ }
+ }
+ else
+ {
+ switch (vex.length)
+ {
+ case 128:
+ oappend ("{1to4}");
+ break;
+ case 256:
+ oappend ("{1to8}");
+ break;
+ case 512:
+ oappend ("{1to16}");
+ break;
+ default:
+ abort ();
+ }
+ }
+ }
}
static void
oappend (names16[modrm.reg + add]);
break;
case d_mode:
+ case db_mode:
+ case dw_mode:
oappend (names32[modrm.reg + add]);
break;
case q_mode:
oappend (names64[modrm.reg + add]);
break;
+ case bnd_mode:
+ oappend (names_bnd[modrm.reg]);
+ break;
case v_mode:
case dq_mode:
case dqb_mode:
case dqd_mode:
case dqw_mode:
+ case dqw_swap_mode:
USED_REX (REX_W);
if (rex & REX_W)
oappend (names64[modrm.reg + add]);
else
oappend (names32[modrm.reg + add]);
break;
+ case mask_bd_mode:
+ case mask_mode:
+ oappend (names_mask[modrm.reg + add]);
+ break;
default:
oappend (INTERNAL_DISASSEMBLER_ERROR);
break;
{
const char *s;
int add;
+
+ switch (code)
+ {
+ case es_reg: case ss_reg: case cs_reg:
+ case ds_reg: case fs_reg: case gs_reg:
+ oappend (names_seg[code - es_reg]);
+ return;
+ }
+
USED_REX (REX_B);
if (rex & REX_B)
add = 8;
case sp_reg: case bp_reg: case si_reg: case di_reg:
s = names16[code - ax_reg + add];
break;
- case es_reg: case ss_reg: case cs_reg:
- case ds_reg: case fs_reg: case gs_reg:
- s = names_seg[code - es_reg + add];
- break;
case al_reg: case ah_reg: case cl_reg: case ch_reg:
case dl_reg: case dh_reg: case bl_reg: case bh_reg:
USED_REX (0);
break;
case rAX_reg: case rCX_reg: case rDX_reg: case rBX_reg:
case rSP_reg: case rBP_reg: case rSI_reg: case rDI_reg:
- if (address_mode == mode_64bit && (sizeflag & DFLAG))
+ if (address_mode == mode_64bit
+ && ((sizeflag & DFLAG) || (rex & REX_W)))
{
s = names64[code - rAX_reg + add];
break;
break;
case const_1_mode:
if (intel_syntax)
- oappend ("1");
+ oappend ("1");
return;
default:
oappend (INTERNAL_DISASSEMBLER_ERROR);
op &= mask;
scratchbuf[0] = '$';
print_operand_value (scratchbuf + 1, 1, op);
- oappend (scratchbuf + intel_syntax);
+ oappend_maybe_intel (scratchbuf);
scratchbuf[0] = '\0';
}
op &= mask;
scratchbuf[0] = '$';
print_operand_value (scratchbuf + 1, 1, op);
- oappend (scratchbuf + intel_syntax);
+ oappend_maybe_intel (scratchbuf);
scratchbuf[0] = '\0';
}
OP_sI (int bytemode, int sizeflag)
{
bfd_signed_vma op;
- bfd_signed_vma mask = -1;
switch (bytemode)
{
case b_mode:
+ case b_T_mode:
FETCH_DATA (the_info, codep + 1);
op = *codep++;
if ((op & 0x80) != 0)
op -= 0x100;
- mask = 0xffffffff;
- break;
- case v_mode:
- USED_REX (REX_W);
- if (rex & REX_W)
- op = get32s ();
+ if (bytemode == b_T_mode)
+ {
+ if (address_mode != mode_64bit
+ || !((sizeflag & DFLAG) || (rex & REX_W)))
+ {
+ /* The operand-size prefix is overridden by a REX prefix. */
+ if ((sizeflag & DFLAG) || (rex & REX_W))
+ op &= 0xffffffff;
+ else
+ op &= 0xffff;
+ }
+ }
else
{
- if (sizeflag & DFLAG)
- {
- op = get32s ();
- mask = 0xffffffff;
- }
- else
+ if (!(rex & REX_W))
{
- mask = 0xffffffff;
- op = get16 ();
- if ((op & 0x8000) != 0)
- op -= 0x10000;
+ if (sizeflag & DFLAG)
+ op &= 0xffffffff;
+ else
+ op &= 0xffff;
}
- used_prefixes |= (prefixes & PREFIX_DATA);
}
break;
- case w_mode:
- op = get16 ();
- mask = 0xffffffff;
- if ((op & 0x8000) != 0)
- op -= 0x10000;
+ case v_mode:
+ /* The operand-size prefix is overridden by a REX prefix. */
+ if ((sizeflag & DFLAG) || (rex & REX_W))
+ op = get32s ();
+ else
+ op = get16 ();
break;
default:
oappend (INTERNAL_DISASSEMBLER_ERROR);
scratchbuf[0] = '$';
print_operand_value (scratchbuf + 1, 1, op);
- oappend (scratchbuf + intel_syntax);
+ oappend_maybe_intel (scratchbuf);
}
static void
oappend (INTERNAL_DISASSEMBLER_ERROR);
return;
}
- disp = ((start_pc + codep - start_codep + disp) & mask) | segment;
+ disp = ((start_pc + (codep - start_codep) + disp) & mask) | segment;
set_op (disp, 0);
print_operand_value (scratchbuf, 1, disp);
oappend (scratchbuf);
if (intel_syntax)
{
- if (!(prefixes & (PREFIX_CS | PREFIX_SS | PREFIX_DS
- | PREFIX_ES | PREFIX_FS | PREFIX_GS)))
+ if (!active_seg_prefix)
{
oappend (names_seg[ds_reg - es_reg]);
oappend (":");
if (intel_syntax)
{
- if (!(prefixes & (PREFIX_CS | PREFIX_SS | PREFIX_DS
- | PREFIX_ES | PREFIX_FS | PREFIX_GS)))
+ if (!active_seg_prefix)
{
oappend (names_seg[ds_reg - es_reg]);
oappend (":");
intel_operand_size (b_mode, sizeflag);
}
}
- oappend ("%es:" + intel_syntax);
+ oappend_maybe_intel ("%es:");
ptr_reg (code, sizeflag);
}
intel_operand_size (b_mode, sizeflag);
}
}
- if ((prefixes
- & (PREFIX_CS
- | PREFIX_DS
- | PREFIX_SS
- | PREFIX_ES
- | PREFIX_FS
- | PREFIX_GS)) == 0)
- prefixes |= PREFIX_DS;
+ /* Set active_seg_prefix to PREFIX_DS if it is unset so that the
+ default segment register DS is printed. */
+ if (!active_seg_prefix)
+ active_seg_prefix = PREFIX_DS;
append_seg ();
ptr_reg (code, sizeflag);
}
else
add = 0;
sprintf (scratchbuf, "%%cr%d", modrm.reg + add);
- oappend (scratchbuf + intel_syntax);
+ oappend_maybe_intel (scratchbuf);
}
static void
OP_T (int dummy ATTRIBUTE_UNUSED, int sizeflag ATTRIBUTE_UNUSED)
{
sprintf (scratchbuf, "%%tr%d", modrm.reg);
- oappend (scratchbuf + intel_syntax);
+ oappend_maybe_intel (scratchbuf);
}
static void
OP_R (int bytemode, int sizeflag)
{
- if (modrm.mod == 3)
- OP_E (bytemode, sizeflag);
- else
- BadOp ();
+ /* Skip mod/rm byte. */
+ MODRM_CHECK;
+ codep++;
+ OP_E_register (bytemode, sizeflag);
}
static void
OP_MMX (int bytemode ATTRIBUTE_UNUSED, int sizeflag ATTRIBUTE_UNUSED)
{
+ int reg = modrm.reg;
+ const char **names;
+
used_prefixes |= (prefixes & PREFIX_DATA);
if (prefixes & PREFIX_DATA)
{
- int add;
+ names = names_xmm;
USED_REX (REX_R);
if (rex & REX_R)
- add = 8;
- else
- add = 0;
- sprintf (scratchbuf, "%%xmm%d", modrm.reg + add);
+ reg += 8;
}
else
- sprintf (scratchbuf, "%%mm%d", modrm.reg);
- oappend (scratchbuf + intel_syntax);
+ names = names_mm;
+ oappend (names[reg]);
}
static void
OP_XMM (int bytemode, int sizeflag ATTRIBUTE_UNUSED)
{
- int add;
+ int reg = modrm.reg;
+ const char **names;
+
USED_REX (REX_R);
if (rex & REX_R)
- add = 8;
- else
- add = 0;
- if (need_vex && bytemode != xmm_mode)
+ reg += 8;
+ if (vex.evex)
+ {
+ if (!vex.r)
+ reg += 16;
+ }
+
+ if (need_vex
+ && bytemode != xmm_mode
+ && bytemode != xmmq_mode
+ && bytemode != evex_half_bcst_xmmq_mode
+ && bytemode != ymm_mode
+ && bytemode != scalar_mode)
{
switch (vex.length)
{
case 128:
- sprintf (scratchbuf, "%%xmm%d", modrm.reg + add);
+ names = names_xmm;
+ break;
+ case 256:
+ if (vex.w
+ || (bytemode != vex_vsib_q_w_dq_mode
+ && bytemode != vex_vsib_q_w_d_mode))
+ names = names_ymm;
+ else
+ names = names_xmm;
+ break;
+ case 512:
+ names = names_zmm;
break;
+ default:
+ abort ();
+ }
+ }
+ else if (bytemode == xmmq_mode
+ || bytemode == evex_half_bcst_xmmq_mode)
+ {
+ switch (vex.length)
+ {
+ case 128:
case 256:
- sprintf (scratchbuf, "%%ymm%d", modrm.reg + add);
+ names = names_xmm;
+ break;
+ case 512:
+ names = names_ymm;
break;
default:
abort ();
}
}
+ else if (bytemode == ymm_mode)
+ names = names_ymm;
else
- sprintf (scratchbuf, "%%xmm%d", modrm.reg + add);
- oappend (scratchbuf + intel_syntax);
+ names = names_xmm;
+ oappend (names[reg]);
}
static void
OP_EM (int bytemode, int sizeflag)
{
+ int reg;
+ const char **names;
+
if (modrm.mod != 3)
{
if (intel_syntax
{
bytemode = (prefixes & PREFIX_DATA) ? x_mode : q_mode;
used_prefixes |= (prefixes & PREFIX_DATA);
- }
+ }
OP_E (bytemode, sizeflag);
return;
}
MODRM_CHECK;
codep++;
used_prefixes |= (prefixes & PREFIX_DATA);
+ reg = modrm.rm;
if (prefixes & PREFIX_DATA)
{
- int add;
-
+ names = names_xmm;
USED_REX (REX_B);
if (rex & REX_B)
- add = 8;
- else
- add = 0;
- sprintf (scratchbuf, "%%xmm%d", modrm.rm + add);
+ reg += 8;
}
else
- sprintf (scratchbuf, "%%mm%d", modrm.rm);
- oappend (scratchbuf + intel_syntax);
+ names = names_mm;
+ oappend (names[reg]);
}
/* cvt* are the only instructions in sse2 which have
{
bytemode = (prefixes & PREFIX_DATA) ? x_mode : q_mode;
used_prefixes |= (prefixes & PREFIX_DATA);
- }
+ }
OP_E (bytemode, sizeflag);
return;
}
MODRM_CHECK;
codep++;
used_prefixes |= (prefixes & PREFIX_DATA);
- sprintf (scratchbuf, "%%mm%d", modrm.rm);
- oappend (scratchbuf + intel_syntax);
+ oappend (names_mm[modrm.rm]);
}
static void
OP_MXC (int bytemode ATTRIBUTE_UNUSED, int sizeflag ATTRIBUTE_UNUSED)
{
used_prefixes |= (prefixes & PREFIX_DATA);
- sprintf (scratchbuf, "%%mm%d", modrm.reg);
- oappend (scratchbuf + intel_syntax);
+ oappend (names_mm[modrm.reg]);
}
static void
OP_EX (int bytemode, int sizeflag)
{
- int add;
+ int reg;
+ const char **names;
/* Skip mod/rm byte. */
MODRM_CHECK;
return;
}
+ reg = modrm.rm;
USED_REX (REX_B);
if (rex & REX_B)
- add = 8;
- else
- add = 0;
+ reg += 8;
+ if (vex.evex)
+ {
+ USED_REX (REX_X);
+ if ((rex & REX_X))
+ reg += 16;
+ }
if ((sizeflag & SUFFIX_ALWAYS)
&& (bytemode == x_swap_mode
|| bytemode == d_swap_mode
- || bytemode == q_swap_mode))
+ || bytemode == dqw_swap_mode
+ || bytemode == d_scalar_swap_mode
+ || bytemode == q_swap_mode
+ || bytemode == q_scalar_swap_mode))
swap_operand ();
if (need_vex
&& bytemode != xmm_mode
- && bytemode != xmmq_mode)
+ && bytemode != xmmdw_mode
+ && bytemode != xmmqd_mode
+ && bytemode != xmm_mb_mode
+ && bytemode != xmm_mw_mode
+ && bytemode != xmm_md_mode
+ && bytemode != xmm_mq_mode
+ && bytemode != xmm_mdq_mode
+ && bytemode != xmmq_mode
+ && bytemode != evex_half_bcst_xmmq_mode
+ && bytemode != ymm_mode
+ && bytemode != d_scalar_mode
+ && bytemode != d_scalar_swap_mode
+ && bytemode != q_scalar_mode
+ && bytemode != q_scalar_swap_mode
+ && bytemode != vex_scalar_w_dq_mode)
{
switch (vex.length)
{
case 128:
- sprintf (scratchbuf, "%%xmm%d", modrm.rm + add);
+ names = names_xmm;
break;
case 256:
- sprintf (scratchbuf, "%%ymm%d", modrm.rm + add);
+ names = names_ymm;
+ break;
+ case 512:
+ names = names_zmm;
+ break;
+ default:
+ abort ();
+ }
+ }
+ else if (bytemode == xmmq_mode
+ || bytemode == evex_half_bcst_xmmq_mode)
+ {
+ switch (vex.length)
+ {
+ case 128:
+ case 256:
+ names = names_xmm;
+ break;
+ case 512:
+ names = names_ymm;
break;
default:
abort ();
}
}
+ else if (bytemode == ymm_mode)
+ names = names_ymm;
else
- sprintf (scratchbuf, "%%xmm%d", modrm.rm + add);
- oappend (scratchbuf + intel_syntax);
+ names = names_xmm;
+ oappend (names[reg]);
}
static void
/* We have a reserved extension byte. Output it directly. */
scratchbuf[0] = '$';
print_operand_value (scratchbuf + 1, 1, cmp_type);
- oappend (scratchbuf + intel_syntax);
+ oappend_maybe_intel (scratchbuf);
scratchbuf[0] = '\0';
}
}
}
}
+/* For BND-prefixed instructions 0xF2 prefix should be displayed as
+ "bnd". */
+
+static void
+BND_Fixup (int bytemode ATTRIBUTE_UNUSED, int sizeflag ATTRIBUTE_UNUSED)
+{
+ if (prefixes & PREFIX_REPNZ)
+ all_prefixes[last_repnz_prefix] = BND_PREFIX;
+}
+
+/* Similar to OP_E. But the 0xf2/0xf3 prefixes should be displayed as
+ "xacquire"/"xrelease" for memory operand if there is a LOCK prefix.
+ */
+
+static void
+HLE_Fixup1 (int bytemode, int sizeflag)
+{
+ if (modrm.mod != 3
+ && (prefixes & PREFIX_LOCK) != 0)
+ {
+ if (prefixes & PREFIX_REPZ)
+ all_prefixes[last_repz_prefix] = XRELEASE_PREFIX;
+ if (prefixes & PREFIX_REPNZ)
+ all_prefixes[last_repnz_prefix] = XACQUIRE_PREFIX;
+ }
+
+ OP_E (bytemode, sizeflag);
+}
+
+/* Similar to OP_E. But the 0xf2/0xf3 prefixes should be displayed as
+ "xacquire"/"xrelease" for memory operand. No check for LOCK prefix.
+ */
+
+static void
+HLE_Fixup2 (int bytemode, int sizeflag)
+{
+ if (modrm.mod != 3)
+ {
+ if (prefixes & PREFIX_REPZ)
+ all_prefixes[last_repz_prefix] = XRELEASE_PREFIX;
+ if (prefixes & PREFIX_REPNZ)
+ all_prefixes[last_repnz_prefix] = XACQUIRE_PREFIX;
+ }
+
+ OP_E (bytemode, sizeflag);
+}
+
+/* Similar to OP_E. But the 0xf3 prefixes should be displayed as
+ "xrelease" for memory operand. No check for LOCK prefix. */
+
+static void
+HLE_Fixup3 (int bytemode, int sizeflag)
+{
+ if (modrm.mod != 3
+ && last_repz_prefix > last_repnz_prefix
+ && (prefixes & PREFIX_REPZ) != 0)
+ all_prefixes[last_repz_prefix] = XRELEASE_PREFIX;
+
+ OP_E (bytemode, sizeflag);
+}
+
static void
CMPXCHG8B_Fixup (int bytemode, int sizeflag)
{
mnemonicendp = stpcpy (p, "16b");
bytemode = o_mode;
}
+ else if ((prefixes & PREFIX_LOCK) != 0)
+ {
+ if (prefixes & PREFIX_REPZ)
+ all_prefixes[last_repz_prefix] = XRELEASE_PREFIX;
+ if (prefixes & PREFIX_REPNZ)
+ all_prefixes[last_repnz_prefix] = XACQUIRE_PREFIX;
+ }
+
OP_M (bytemode, sizeflag);
}
static void
XMM_Fixup (int reg, int sizeflag ATTRIBUTE_UNUSED)
{
+ const char **names;
+
if (need_vex)
{
switch (vex.length)
{
case 128:
- sprintf (scratchbuf, "%%xmm%d", reg);
+ names = names_xmm;
break;
case 256:
- sprintf (scratchbuf, "%%ymm%d", reg);
+ names = names_ymm;
break;
default:
abort ();
}
}
else
- sprintf (scratchbuf, "%%xmm%d", reg);
- oappend (scratchbuf + intel_syntax);
+ names = names_xmm;
+ oappend (names[reg]);
}
static void
USED_REX (REX_W);
if (rex & REX_W)
*p++ = 'q';
- else
+ else
{
if (sizeflag & DFLAG)
*p++ = 'l';
static void
OP_VEX (int bytemode, int sizeflag ATTRIBUTE_UNUSED)
{
+ int reg;
+ const char **names;
+
if (!need_vex)
abort ();
if (!need_vex_reg)
return;
+ reg = vex.register_specifier;
+ if (vex.evex)
+ {
+ if (!vex.v)
+ reg += 16;
+ }
+
+ if (bytemode == vex_scalar_mode)
+ {
+ oappend (names_xmm[reg]);
+ return;
+ }
+
switch (vex.length)
{
case 128:
{
case vex_mode:
case vex128_mode:
+ case vex_vsib_q_w_dq_mode:
+ case vex_vsib_q_w_d_mode:
+ names = names_xmm;
+ break;
+ case dq_mode:
+ if (vex.w)
+ names = names64;
+ else
+ names = names32;
+ break;
+ case mask_bd_mode:
+ case mask_mode:
+ names = names_mask;
break;
default:
abort ();
return;
}
-
- sprintf (scratchbuf, "%%xmm%d", vex.register_specifier);
break;
case 256:
switch (bytemode)
{
case vex_mode:
case vex256_mode:
+ names = names_ymm;
+ break;
+ case vex_vsib_q_w_dq_mode:
+ case vex_vsib_q_w_d_mode:
+ names = vex.w ? names_ymm : names_xmm;
+ break;
+ case mask_bd_mode:
+ case mask_mode:
+ names = names_mask;
break;
default:
abort ();
return;
}
-
- sprintf (scratchbuf, "%%ymm%d", vex.register_specifier);
+ break;
+ case 512:
+ names = names_zmm;
break;
default:
abort ();
break;
}
- oappend (scratchbuf + intel_syntax);
+ oappend (names[reg]);
}
/* Get the VEX immediate byte without moving codep. */
{
/* There are SIB/displacement bytes. */
if ((sizeflag & AFLAG) || address_mode == mode_64bit)
- {
+ {
/* 32/64 bit address mode */
- int base = modrm.rm;
+ int base = modrm.rm;
/* Check SIB byte. */
- if (base == 4)
- {
- FETCH_DATA (the_info, codep + 1);
- base = *codep & 7;
- /* When decoding the third source, don't increase
- bytes_before_imm as this has already been incremented
- by one in OP_E_memory while decoding the second
- source operand. */
- if (opnum == 0)
- bytes_before_imm++;
- }
-
- /* Don't increase bytes_before_imm when decoding the third source,
- it has already been incremented by OP_E_memory while decoding
- the second source operand. */
- if (opnum == 0)
- {
- switch (modrm.mod)
- {
- case 0:
- /* When modrm.rm == 5 or modrm.rm == 4 and base in
- SIB == 5, there is a 4 byte displacement. */
- if (base != 5)
- /* No displacement. */
- break;
- case 2:
- /* 4 byte displacement. */
- bytes_before_imm += 4;
- break;
- case 1:
- /* 1 byte displacement. */
- bytes_before_imm++;
- break;
- }
- }
- }
+ if (base == 4)
+ {
+ FETCH_DATA (the_info, codep + 1);
+ base = *codep & 7;
+ /* When decoding the third source, don't increase
+ bytes_before_imm as this has already been incremented
+ by one in OP_E_memory while decoding the second
+ source operand. */
+ if (opnum == 0)
+ bytes_before_imm++;
+ }
+
+ /* Don't increase bytes_before_imm when decoding the third source,
+ it has already been incremented by OP_E_memory while decoding
+ the second source operand. */
+ if (opnum == 0)
+ {
+ switch (modrm.mod)
+ {
+ case 0:
+ /* When modrm.rm == 5 or modrm.rm == 4 and base in
+ SIB == 5, there is a 4 byte displacement. */
+ if (base != 5)
+ /* No displacement. */
+ break;
+ case 2:
+ /* 4 byte displacement. */
+ bytes_before_imm += 4;
+ break;
+ case 1:
+ /* 1 byte displacement. */
+ bytes_before_imm++;
+ break;
+ }
+ }
+ }
else
{
/* 16 bit address mode */
- /* Don't increase bytes_before_imm when decoding the third source,
- it has already been incremented by OP_E_memory while decoding
- the second source operand. */
- if (opnum == 0)
- {
+ /* Don't increase bytes_before_imm when decoding the third source,
+ it has already been incremented by OP_E_memory while decoding
+ the second source operand. */
+ if (opnum == 0)
+ {
switch (modrm.mod)
{
case 0:
static void
OP_EX_VexReg (int bytemode, int sizeflag, int reg)
{
+ const char **names;
+
if (reg == -1 && modrm.mod != 3)
{
OP_E_memory (bytemode, sizeflag);
switch (vex.length)
{
case 128:
- sprintf (scratchbuf, "%%xmm%d", reg);
+ names = names_xmm;
break;
case 256:
- sprintf (scratchbuf, "%%ymm%d", reg);
+ names = names_ymm;
break;
default:
abort ();
}
- oappend (scratchbuf + intel_syntax);
+ oappend (names[reg]);
+}
+
+static void
+OP_EX_VexImmW (int bytemode, int sizeflag)
+{
+ int reg = -1;
+ static unsigned char vex_imm8;
+
+ if (vex_w_done == 0)
+ {
+ vex_w_done = 1;
+
+ /* Skip mod/rm byte. */
+ MODRM_CHECK;
+ codep++;
+
+ vex_imm8 = get_vex_imm8 (sizeflag, 0);
+
+ if (vex.w)
+ reg = vex_imm8 >> 4;
+
+ OP_EX_VexReg (bytemode, sizeflag, reg);
+ }
+ else if (vex_w_done == 1)
+ {
+ vex_w_done = 2;
+
+ if (!vex.w)
+ reg = vex_imm8 >> 4;
+
+ OP_EX_VexReg (bytemode, sizeflag, reg);
+ }
+ else
+ {
+ /* Output the imm8 directly. */
+ scratchbuf[0] = '$';
+ print_operand_value (scratchbuf + 1, 1, vex_imm8 & 0xf);
+ oappend_maybe_intel (scratchbuf);
+ scratchbuf[0] = '\0';
+ codep++;
+ }
}
static void
{
if (modrm.mod == 3)
{
+ int reg = modrm.rm;
USED_REX (REX_B);
- sprintf (scratchbuf, "%%xmm%d", rex & REX_B ? modrm.rm + 8 : modrm.rm);
- oappend (scratchbuf + intel_syntax);
+ if (rex & REX_B)
+ reg += 8;
+ oappend (names_xmm[reg]);
}
else
{
}
if (vex.w)
- {
- sprintf (scratchbuf, "%%xmm%d", vex.register_specifier);
- oappend (scratchbuf + intel_syntax);
- }
+ oappend (names_xmm[vex.register_specifier]);
else
OP_Vex_2src (bytemode, sizeflag);
}
if (vex.w)
OP_Vex_2src (bytemode, sizeflag);
else
- {
- sprintf (scratchbuf, "%%xmm%d", vex.register_specifier);
- oappend (scratchbuf + intel_syntax);
- }
+ oappend (names_xmm[vex.register_specifier]);
}
static void
OP_REG_VexI4 (int bytemode, int sizeflag ATTRIBUTE_UNUSED)
{
int reg;
+ const char **names;
+
FETCH_DATA (the_info, codep + 1);
reg = *codep++;
switch (vex.length)
{
case 128:
- sprintf (scratchbuf, "%%xmm%d", reg);
+ names = names_xmm;
break;
case 256:
- sprintf (scratchbuf, "%%ymm%d", reg);
+ names = names_ymm;
break;
default:
abort ();
}
- oappend (scratchbuf + intel_syntax);
+ oappend (names[reg]);
}
static void
/* We have a reserved extension byte. Output it directly. */
scratchbuf[0] = '$';
print_operand_value (scratchbuf + 1, 1, cmp_type);
- oappend (scratchbuf + intel_syntax);
+ oappend_maybe_intel (scratchbuf);
+ scratchbuf[0] = '\0';
+ }
+}
+
+static void
+VPCMP_Fixup (int bytemode ATTRIBUTE_UNUSED,
+ int sizeflag ATTRIBUTE_UNUSED)
+{
+ unsigned int cmp_type;
+
+ if (!vex.evex)
+ abort ();
+
+ FETCH_DATA (the_info, codep + 1);
+ cmp_type = *codep++ & 0xff;
+ /* There are aliases for immediates 0, 1, 2, 4, 5, 6.
+ If it's the case, print suffix, otherwise - print the immediate. */
+ if (cmp_type < ARRAY_SIZE (simd_cmp_op)
+ && cmp_type != 3
+ && cmp_type != 7)
+ {
+ char suffix [3];
+ char *p = mnemonicendp - 2;
+
+ /* vpcmp* can have both one- and two-lettered suffix. */
+ if (p[0] == 'p')
+ {
+ p++;
+ suffix[0] = p[0];
+ suffix[1] = '\0';
+ }
+ else
+ {
+ suffix[0] = p[0];
+ suffix[1] = p[1];
+ suffix[2] = '\0';
+ }
+
+ sprintf (p, "%s%s", simd_cmp_op[cmp_type].name, suffix);
+ mnemonicendp += simd_cmp_op[cmp_type].len;
+ }
+ else
+ {
+ /* We have a reserved extension byte. Output it directly. */
+ scratchbuf[0] = '$';
+ print_operand_value (scratchbuf + 1, 1, cmp_type);
+ oappend_maybe_intel (scratchbuf);
scratchbuf[0] = '\0';
}
}
break;
default:
break;
- }
+ }
if (pclmul_type < ARRAY_SIZE (pclmul_op))
{
char suffix [4];
/* We have a reserved extension byte. Output it directly. */
scratchbuf[0] = '$';
print_operand_value (scratchbuf + 1, 1, pclmul_type);
- oappend (scratchbuf + intel_syntax);
+ oappend_maybe_intel (scratchbuf);
scratchbuf[0] = '\0';
}
}
if (vex.w)
names = names64;
- else if (vex.length == 256)
- names = names32;
else
- names = names16;
+ names = names32;
reg = modrm.rm;
USED_REX (REX_B);
if (vex.w)
names = names64;
- else if (vex.length == 256)
- names = names32;
else
- names = names16;
+ names = names32;
oappend (names[vex.register_specifier]);
}
static void
-OP_LWP_I (int bytemode ATTRIBUTE_UNUSED, int sizeflag)
+OP_Mask (int bytemode, int sizeflag ATTRIBUTE_UNUSED)
{
- if (vex.w || vex.length == 256)
- OP_I (q_mode, sizeflag);
- else
- OP_I (w_mode, sizeflag);
+ if (!vex.evex
+ || (bytemode != mask_mode && bytemode != mask_bd_mode))
+ abort ();
+
+ USED_REX (REX_R);
+ if ((rex & REX_R) != 0 || !vex.r)
+ {
+ BadOp ();
+ return;
+ }
+
+ oappend (names_mask [modrm.reg]);
}
+static void
+OP_Rounding (int bytemode, int sizeflag ATTRIBUTE_UNUSED)
+{
+ if (!vex.evex
+ || (bytemode != evex_rounding_mode
+ && bytemode != evex_sae_mode))
+ abort ();
+ if (modrm.mod == 3 && vex.b)
+ switch (bytemode)
+ {
+ case evex_rounding_mode:
+ oappend (names_rounding[vex.ll]);
+ break;
+ case evex_sae_mode:
+ oappend ("{sae}");
+ break;
+ default:
+ break;
+ }
+}
projects / platform / upstream / binutils.git / blobdiff