shared-core/nouveau_drm.h

   1 /*
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  22  * OTHER DEALINGS IN THE SOFTWARE.
  23  */
  24
  25 #ifndef __NOUVEAU_DRM_H__
  26 #define __NOUVEAU_DRM_H__
  27
  28 typedef struct drm_nouveau_fifo_alloc {
  29         int          channel;
  30         uint32_t     put_base;
  31         /* FIFO control regs */
  32         drm_handle_t ctrl;
  33         int          ctrl_size;
  34         /* DMA command buffer */
  35         drm_handle_t cmdbuf;
  36         int          cmdbuf_size;
  37 }
  38 drm_nouveau_fifo_alloc_t;
  39
  40 #define NV_DMA_CONTEXT_FLAGS_PATCH_ROP_AND 0x1
  41 #define NV_DMA_CONTEXT_FLAGS_PATCH_SRCCOPY 0x2
  42 #define NV_DMA_CONTEXT_FLAGS_CLIP_ENABLE 0x4
  43 #define NV_DMA_CONTEXT_FLAGS_MONO 0x8
  44
  45 typedef struct drm_nouveau_object_init {
  46         uint32_t handle;
  47         int class;
  48         uint32_t flags;
  49         /* these are object handles */
  50         uint32_t dma0;
  51         uint32_t dma1;
  52         uint32_t dma_notifier;
  53 }
  54 drm_nouveau_object_init_t;
  55
  56 typedef struct drm_nouveau_dma_object_init {
  57         uint32_t handle;
  58         int      access;
  59         int      target;
  60         uint32_t offset;
  61         int      size;
  62 }
  63 drm_nouveau_dma_object_init_t;
  64
  65 #define NOUVEAU_MEM_FB                  0x00000001
  66 #define NOUVEAU_MEM_AGP                 0x00000002
  67 #define NOUVEAU_MEM_FB_ACCEPTABLE       0x00000004
  68 #define NOUVEAU_MEM_AGP_ACCEPTABLE      0x00000008
  69 #define NOUVEAU_MEM_PINNED              0x00000010
  70 #define NOUVEAU_MEM_USER_BACKED         0x00000020
  71 #define NOUVEAU_MEM_MAPPED              0x00000040
  72 #define NOUVEAU_MEM_INSTANCE            0x00000080 /* internal */
  73
  74 typedef struct drm_nouveau_mem_alloc {
  75         int flags;
  76         int alignment;
  77         uint64_t size;  // in bytes
  78         uint64_t region_offset;
  79 }
  80 drm_nouveau_mem_alloc_t;
  81
  82 typedef struct drm_nouveau_mem_free {
  83         int flags;
  84         uint64_t region_offset;
  85 }
  86 drm_nouveau_mem_free_t;
  87
  88 /* FIXME : maybe unify {GET,SET}PARAMs */
  89 #define NOUVEAU_GETPARAM_PCI_VENDOR      3
  90 #define NOUVEAU_GETPARAM_PCI_DEVICE      4
  91 #define NOUVEAU_GETPARAM_BUS_TYPE        5
  92 #define NOUVEAU_GETPARAM_FB_PHYSICAL     6
  93 #define NOUVEAU_GETPARAM_AGP_PHYSICAL    7
  94 typedef struct drm_nouveau_getparam {
  95         unsigned int param;
  96         uint64_t value;
  97 }
  98 drm_nouveau_getparam_t;
  99
 100 #define NOUVEAU_SETPARAM_CMDBUF_LOCATION 1
 101 #define NOUVEAU_SETPARAM_CMDBUF_SIZE     2
 102 typedef struct drm_nouveau_setparam {
 103         unsigned int param;
 104         unsigned int value;
 105 }
 106 drm_nouveau_setparam_t;
 107
 108 enum nouveau_card_type {
 109         NV_UNKNOWN =0,
 110         NV_01      =1,
 111         NV_03      =3,
 112         NV_04      =4,
 113         NV_05      =5,
 114         NV_10      =10,
 115         NV_11      =10,
 116         NV_15      =10,
 117         NV_17      =10,
 118         NV_20      =20,
 119         NV_25      =20,
 120         NV_30      =30,
 121         NV_34      =30,
 122         NV_40      =40,
 123         NV_44      =44,
 124         NV_50      =50,
 125         NV_LAST    =0xffff,
 126 };
 127
 128 enum nouveau_bus_type {
 129         NV_AGP     =0,
 130         NV_PCI     =1,
 131         NV_PCIE    =2,
 132 };
 133
 134 #define NOUVEAU_MAX_SAREA_CLIPRECTS 16
 135
 136 typedef struct drm_nouveau_sarea {
 137         /* the cliprects */
 138         drm_clip_rect_t boxes[NOUVEAU_MAX_SAREA_CLIPRECTS];
 139         unsigned int nbox;
 140 }
 141 drm_nouveau_sarea_t;
 142
 143 #define DRM_NOUVEAU_FIFO_ALLOC      0x00
 144 #define DRM_NOUVEAU_OBJECT_INIT     0x01
 145 #define DRM_NOUVEAU_DMA_OBJECT_INIT 0x02 // We don't want this eventually..
 146 #define DRM_NOUVEAU_MEM_ALLOC       0x03
 147 #define DRM_NOUVEAU_MEM_FREE        0x04
 148 #define DRM_NOUVEAU_GETPARAM        0x05
 149 #define DRM_NOUVEAU_SETPARAM        0x06
 150
 151 #endif /* __NOUVEAU_DRM_H__ */
 152