include/configs/XPEDITE1K.h

   1 /*
   2  * (C) Copyright 2002 Scott McNutt <smcnutt@artesyncp.com>
   3  *
   4  * See file CREDITS for list of people who contributed to this
   5  * project.
   6  *
   7  * This program is free software; you can redistribute it and/or
   8  * modify it under the terms of the GNU General Public License as
   9  * published by the Free Software Foundation; either version 2 of
  10  * the License, or (at your option) any later version.
  11  *
  12  * This program is distributed in the hope that it will be useful,
  13  * but WITHOUT ANY WARRANTY; without even the implied warranty of
  14  * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
  15  * GNU General Public License for more details.
  16  *
  17  * You should have received a copy of the GNU General Public License
  18  * along with this program; if not, write to the Free Software
  19  * Foundation, Inc., 59 Temple Place, Suite 330, Boston,
  20  * MA 02111-1307 USA
  21  */
  22
  23 /************************************************************************
  24  * config for XPedite1000 from XES Inc.
  25  * Ported from EBONY config by Travis B. Sawyer <tsawyer@sandburst.com>
  26  * (C) Copyright 2003 Sandburst Corporation
  27  * board/config_EBONY.h - configuration for AMCC 440GP Ref (Ebony)
  28  ***********************************************************************/
  29
  30 #ifndef __CONFIG_H
  31 #define __CONFIG_H
  32
  33 /*-----------------------------------------------------------------------
  34  * High Level Configuration Options
  35  *----------------------------------------------------------------------*/
  36 #define CONFIG_XPEDITE1K        1               /* Board is XPedite 1000 */
  37 #define CONFIG_4xx              1               /* ... PPC4xx family    */
  38 #define CONFIG_440              1
  39 #define CONFIG_440GX            1               /* 440 GX */
  40 #define CONFIG_BOARD_EARLY_INIT_F 1             /* Call board_pre_init  */
  41 #define CONFIG_SYS_CLK_FREQ     33333333        /* external freq to pll */
  42
  43
  44 /* POST support */
  45 #define CONFIG_POST             (CONFIG_SYS_POST_RTC       | \
  46                                  CONFIG_SYS_POST_I2C)
  47
  48 /*-----------------------------------------------------------------------
  49  * Base addresses -- Note these are effective addresses where the
  50  * actual resources get mapped (not physical addresses)
  51  *----------------------------------------------------------------------*/
  52 #define CONFIG_SYS_SDRAM_BASE       0x00000000          /* _must_ be 0          */
  53 #define CONFIG_SYS_FLASH_BASE       0xff000000          /* start of FLASH       */
  54
  55 #define CONFIG_SYS_MONITOR_BASE     TEXT_BASE           /* start of monitor     */
  56 #define CONFIG_SYS_PCI_MEMBASE      0x80000000          /* mapped pci memory    */
  57 #define CONFIG_SYS_PERIPHERAL_BASE 0xe0000000           /* internal peripherals */
  58 #define CONFIG_SYS_ISRAM_BASE       0xc0000000          /* internal SRAM        */
  59 #define CONFIG_SYS_PCI_BASE         0xd0000000          /* internal PCI regs    */
  60
  61 #define CONFIG_SYS_NVRAM_BASE_ADDR (CONFIG_SYS_PERIPHERAL_BASE + 0x08000000)
  62 #define CONFIG_SYS_GPIO_BASE        (CONFIG_SYS_PERIPHERAL_BASE + 0x00000700)
  63
  64 #define USR_LED0            0x00000080
  65 #define USR_LED1            0x00000100
  66 #define USR_LED2            0x00000200
  67 #define USR_LED3            0x00000400
  68
  69 #ifndef __ASSEMBLY__
  70 extern unsigned long in32(unsigned int);
  71 extern void out32(unsigned int, unsigned long);
  72
  73 #define LED0_ON() out32(CONFIG_SYS_GPIO_BASE, (in32(CONFIG_SYS_GPIO_BASE) & ~USR_LED0))
  74 #define LED1_ON() out32(CONFIG_SYS_GPIO_BASE, (in32(CONFIG_SYS_GPIO_BASE) & ~USR_LED1))
  75 #define LED2_ON() out32(CONFIG_SYS_GPIO_BASE, (in32(CONFIG_SYS_GPIO_BASE) & ~USR_LED2))
  76 #define LED3_ON() out32(CONFIG_SYS_GPIO_BASE, (in32(CONFIG_SYS_GPIO_BASE) & ~USR_LED3))
  77
  78 #define LED0_OFF() out32(CONFIG_SYS_GPIO_BASE, (in32(CONFIG_SYS_GPIO_BASE) | USR_LED0))
  79 #define LED1_OFF() out32(CONFIG_SYS_GPIO_BASE, (in32(CONFIG_SYS_GPIO_BASE) | USR_LED1))
  80 #define LED2_OFF() out32(CONFIG_SYS_GPIO_BASE, (in32(CONFIG_SYS_GPIO_BASE) | USR_LED2))
  81 #define LED3_OFF() out32(CONFIG_SYS_GPIO_BASE, (in32(CONFIG_SYS_GPIO_BASE) | USR_LED3))
  82 #endif
  83
  84 /*-----------------------------------------------------------------------
  85  * Initial RAM & stack pointer (placed in internal SRAM)
  86  *----------------------------------------------------------------------*/
  87 #define CONFIG_SYS_TEMP_STACK_OCM  1
  88 #define CONFIG_SYS_OCM_DATA_ADDR   CONFIG_SYS_ISRAM_BASE
  89 #define CONFIG_SYS_INIT_RAM_ADDR   CONFIG_SYS_ISRAM_BASE  /* Initial RAM address        */
  90 #define CONFIG_SYS_INIT_RAM_END    0x2000           /* End of used area in RAM  */
  91 #define CONFIG_SYS_GBL_DATA_SIZE   128              /* num bytes initial data   */
  92
  93
  94 #define CONFIG_SYS_GBL_DATA_OFFSET (CONFIG_SYS_INIT_RAM_END - CONFIG_SYS_GBL_DATA_SIZE)
  95 #define CONFIG_SYS_POST_WORD_ADDR  (CONFIG_SYS_GBL_DATA_OFFSET - 0x4)
  96 #define CONFIG_SYS_INIT_SP_OFFSET  CONFIG_SYS_POST_WORD_ADDR
  97
  98 #define CONFIG_SYS_MONITOR_LEN      (256 * 1024)    /* Reserve 256 kB for Mon   */
  99 #define CONFIG_SYS_MALLOC_LEN       (128 * 1024)    /* Reserve 128 kB for malloc*/
 100
 101 /*-----------------------------------------------------------------------
 102  * Serial Port
 103  *----------------------------------------------------------------------*/
 104 #undef  CONFIG_SERIAL_SOFTWARE_FIFO
 105 #define CONFIG_BAUDRATE         9600
 106
 107 #define CONFIG_SYS_BAUDRATE_TABLE  \
 108     {300, 600, 1200, 2400, 4800, 9600, 19200, 38400}
 109
 110 /*-----------------------------------------------------------------------
 111  * NVRAM/RTC
 112  *
 113  * NOTE: Upper 8 bytes of NVRAM is where the RTC registers are located.
 114  * The DS1743 code assumes this condition (i.e. -- it assumes the base
 115  * address for the RTC registers is:
 116  *
 117  *      CONFIG_SYS_NVRAM_BASE_ADDR + CONFIG_SYS_NVRAM_SIZE
 118  *
 119  *----------------------------------------------------------------------*/
 120 /* TBS:  Xpedite 1000 has STMicro M41T00 via IIC */
 121 #define CONFIG_RTC_M41T11 1
 122 #define CONFIG_SYS_I2C_RTC_ADDR 0x68
 123 #define CONFIG_SYS_M41T11_BASE_YEAR 2000
 124
 125 /*-----------------------------------------------------------------------
 126  * FLASH related
 127  *----------------------------------------------------------------------*/
 128 #define CONFIG_SYS_MAX_FLASH_BANKS      1                   /* number of banks      */
 129 #define CONFIG_SYS_FLASH_BANKS_LIST     {CONFIG_SYS_FLASH_BASE}
 130 #define CONFIG_SYS_MAX_FLASH_SECT       128                 /* sectors per device   */
 131 #define CONFIG_FLASH_CFI_DRIVER
 132 #define CONFIG_SYS_FLASH_CFI
 133 #define CONFIG_SYS_FLASH_USE_BUFFER_WRITE
 134
 135 #undef  CONFIG_SYS_FLASH_CHECKSUM
 136 #define CONFIG_SYS_FLASH_ERASE_TOUT     120000  /* Timeout for Flash Erase (in ms)      */
 137 #define CONFIG_SYS_FLASH_WRITE_TOUT     500         /* Timeout for Flash Write (in ms)  */
 138
 139 /*-----------------------------------------------------------------------
 140  * DDR SDRAM
 141  *----------------------------------------------------------------------*/
 142 #define CONFIG_SPD_EEPROM               /* Use SPD EEPROM for setup     */
 143 #define SPD_EEPROM_ADDRESS {0x54}       /* SPD i2c spd addresses        */
 144 #define CONFIG_VERY_BIG_RAM 1
 145 /*-----------------------------------------------------------------------
 146  * I2C
 147  *----------------------------------------------------------------------*/
 148 #define CONFIG_HARD_I2C         1           /* I2C with hardware support        */
 149 #undef  CONFIG_SOFT_I2C                     /* I2C bit-banged           */
 150 #define CONFIG_SYS_I2C_SPEED            400000  /* I2C speed and slave address  */
 151 #define CONFIG_SYS_I2C_SLAVE            0x7f
 152 #define CONFIG_SYS_I2C_NOPROBES {0x55,0x56,0x57,0x58,0x59,0x5a,0x5b,0x5c,0x69}  /* Don't probe these addrs */
 153
 154 /*-----------------------------------------------------------------------
 155  * Environment
 156  *----------------------------------------------------------------------*/
 157 #define CONFIG_ENV_IS_IN_EEPROM 1
 158 #define CONFIG_ENV_SIZE         0x100       /* Size of Environment vars */
 159 #define CONFIG_ENV_OFFSET               0x100
 160 #define CONFIG_SYS_I2C_EEPROM_ADDR      0x50            /* this is actually the second page of the eeprom */
 161 #define CONFIG_SYS_I2C_EEPROM_ADDR_LEN 1
 162 #define CONFIG_SYS_EEPROM_PAGE_WRITE_BITS 3
 163 #define CONFIG_SYS_EEPROM_PAGE_WRITE_DELAY_MS 10
 164
 165 #define CONFIG_BOOTARGS         "root=/dev/hda1 "
 166 #define CONFIG_BOOTCOMMAND      "bootm ffc00000"    /* autoboot command */
 167 #define CONFIG_BOOTDELAY        5                   /* disable autoboot */
 168 #define CONFIG_BAUDRATE         9600
 169
 170 #define CONFIG_LOADS_ECHO       1       /* echo on for serial download  */
 171 #define CONFIG_SYS_LOADS_BAUD_CHANGE    1       /* allow baudrate change        */
 172
 173 #define CONFIG_PPC4xx_EMAC
 174 #define CONFIG_MII                      1       /* MII PHY management           */
 175 #define CONFIG_PHY_ADDR         0       /* PHY address phy0 not populated */
 176 #define CONFIG_PHY1_ADDR        1       /* PHY address phy1 not populated */
 177 #define CONFIG_PHY2_ADDR        4       /* PHY address phy2 */
 178 #define CONFIG_PHY3_ADDR        8       /* PHY address phy3 */
 179 #define CONFIG_NET_MULTI        1
 180 #define CONFIG_PHY_GIGE         1       /* Include GbE speed/duplex detection */
 181 #define CONFIG_PHY_RESET        1       /* reset phy upon startup         */
 182 #define CONFIG_SYS_RX_ETH_BUFFER   32   /* Number of ethernet rx buffers & descriptors */
 183
 184 #define CONFIG_HAS_ETH1         1       /* add support for "eth1addr"   */
 185 #define CONFIG_HAS_ETH2         1       /* add support for "eth2addr"   */
 186 #define CONFIG_HAS_ETH3         1       /* add support for "eth3addr"   */
 187
 188
 189 /*
 190  * BOOTP options
 191  */
 192 #define CONFIG_BOOTP_BOOTFILESIZE
 193 #define CONFIG_BOOTP_BOOTPATH
 194 #define CONFIG_BOOTP_GATEWAY
 195 #define CONFIG_BOOTP_HOSTNAME
 196
 197
 198 /*
 199  * Command line configuration.
 200  */
 201 #include <config_cmd_default.h>
 202
 203 #define CONFIG_CMD_PCI
 204 #define CONFIG_CMD_IRQ
 205 #define CONFIG_CMD_I2C
 206 #define CONFIG_CMD_DATE
 207 #define CONFIG_CMD_BEDBUG
 208 #define CONFIG_CMD_EEPROM
 209 #define CONFIG_CMD_PING
 210 #define CONFIG_CMD_ELF
 211 #define CONFIG_CMD_MII
 212 #define CONFIG_CMD_DIAG
 213 #define CONFIG_CMD_FAT
 214
 215
 216 #undef CONFIG_WATCHDOG                  /* watchdog disabled            */
 217
 218 /*
 219  * Miscellaneous configurable options
 220  */
 221 #define CONFIG_SYS_LONGHELP                     /* undef to save memory         */
 222 #define CONFIG_SYS_PROMPT       "=> "           /* Monitor Command Prompt       */
 223 #if defined(CONFIG_CMD_KGDB)
 224 #define CONFIG_SYS_CBSIZE       1024            /* Console I/O Buffer Size      */
 225 #else
 226 #define CONFIG_SYS_CBSIZE       256             /* Console I/O Buffer Size      */
 227 #endif
 228 #define CONFIG_SYS_PBSIZE (CONFIG_SYS_CBSIZE+sizeof(CONFIG_SYS_PROMPT)+16) /* Print Buffer Size */
 229 #define CONFIG_SYS_MAXARGS      16              /* max number of command args   */
 230 #define CONFIG_SYS_BARGSIZE     CONFIG_SYS_CBSIZE       /* Boot Argument Buffer Size    */
 231
 232 #define CONFIG_SYS_MEMTEST_START        0x0400000       /* memtest works on     */
 233 #define CONFIG_SYS_MEMTEST_END          0x0C00000       /* 4 ... 12 MB in DRAM  */
 234
 235 #define CONFIG_SYS_LOAD_ADDR            0x100000        /* default load address */
 236 #define CONFIG_SYS_EXTBDINFO            1       /* To use extended board_into (bd_t) */
 237
 238 #define CONFIG_SYS_HZ           1000            /* decrementer freq: 1 ms ticks */
 239
 240
 241 /*-----------------------------------------------------------------------
 242  * PCI stuff
 243  *-----------------------------------------------------------------------
 244  */
 245 /* General PCI */
 246 #define CONFIG_PCI                                  /* include pci support              */
 247 #define CONFIG_PCI_PNP                          /* do pci plug-and-play         */
 248 #define CONFIG_PCI_SCAN_SHOW            /* show pci devices on startup  */
 249 #define CONFIG_SYS_PCI_TARGBASE    0x80000000   /* PCIaddr mapped to CONFIG_SYS_PCI_MEMBASE */
 250
 251 /* Board-specific PCI */
 252 #define CONFIG_SYS_PCI_TARGET_INIT                  /* let board init pci target    */
 253
 254 #define CONFIG_SYS_PCI_SUBSYS_VENDORID 0x1014   /* IBM */
 255 #define CONFIG_SYS_PCI_SUBSYS_DEVICEID 0xcafe   /* Whatever */
 256 #define CONFIG_SYS_PCI_FORCE_PCI_CONV          /* Force PCI Conventional Mode */
 257 /*
 258  * For booting Linux, the board info and command line data
 259  * have to be in the first 8 MB of memory, since this is
 260  * the maximum mapped by the Linux kernel during initialization.
 261  */
 262 #define CONFIG_SYS_BOOTMAPSZ            (8 << 20)       /* Initial Memory map for Linux */
 263
 264 /*
 265  * Internal Definitions
 266  *
 267  * Boot Flags
 268  */
 269 #define BOOTFLAG_COLD   0x01            /* Normal Power-On: Boot from FLASH     */
 270 #define BOOTFLAG_WARM   0x02            /* Software reboot                      */
 271
 272 #if defined(CONFIG_CMD_KGDB)
 273 #define CONFIG_KGDB_BAUDRATE    230400  /* speed to run kgdb serial port */
 274 #define CONFIG_KGDB_SER_INDEX   2       /* which serial port to use */
 275 #endif
 276 #endif  /* __CONFIG_H */