include/configs/CU824.h

   1 /*
   2  * (C) Copyright 2001-2005
   3  * Wolfgang Denk, DENX Software Engineering, wd@denx.de.
   4  *
   5  * See file CREDITS for list of people who contributed to this
   6  * project.
   7  *
   8  * This program is free software; you can redistribute it and/or
   9  * modify it under the terms of the GNU General Public License as
  10  * published by the Free Software Foundation; either version 2 of
  11  * the License, or (at your option) any later version.
  12  *
  13  * This program is distributed in the hope that it will be useful,
  14  * but WITHOUT ANY WARRANTY; without even the implied warranty of
  15  * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
  16  * GNU General Public License for more details.
  17  *
  18  * You should have received a copy of the GNU General Public License
  19  * along with this program; if not, write to the Free Software
  20  * Foundation, Inc., 59 Temple Place, Suite 330, Boston,
  21  * MA 02111-1307 USA
  22  */
  23
  24 /*
  25  *
  26  * Configuration settings for the CU824 board.
  27  *
  28  */
  29
  30 /* ------------------------------------------------------------------------- */
  31
  32 /*
  33  * board/config.h - configuration options, board specific
  34  */
  35
  36 #ifndef __CONFIG_H
  37 #define __CONFIG_H
  38
  39 /*
  40  * High Level Configuration Options
  41  * (easy to change)
  42  */
  43
  44 #define CONFIG_MPC824X          1
  45 #define CONFIG_MPC8240          1
  46 #define CONFIG_CU824            1
  47
  48
  49 #define CONFIG_CONS_INDEX       1
  50 #define CONFIG_BAUDRATE         9600
  51 #define CFG_BAUDRATE_TABLE      { 9600, 19200, 38400, 57600, 115200 }
  52
  53 #define CONFIG_PREBOOT  "echo;echo Type \"run flash_nfs\" to mount root filesystem over NFS;echo"
  54
  55 #define CONFIG_BOOTCOMMAND      "bootm FE020000"        /* autoboot command     */
  56 #define CONFIG_BOOTDELAY        5
  57
  58 #define CONFIG_BOOTP_MASK       (CONFIG_BOOTP_DEFAULT | CONFIG_BOOTP_BOOTFILESIZE)
  59
  60 #define CONFIG_TIMESTAMP                /* Print image info with timestamp */
  61
  62 #define CONFIG_COMMANDS       ( CONFIG_CMD_DFL  | \
  63                                 CFG_CMD_BEDBUG  | \
  64                                 0 /* CFG_CMD_DATE */    | \
  65                                 CFG_CMD_DHCP    | \
  66                                 CFG_CMD_PCI     | \
  67                                 CFG_CMD_NFS     | \
  68                                 CFG_CMD_SNTP    )
  69
  70 /* This must be included AFTER the definition of CONFIG_COMMANDS (if any)
  71  */
  72 #include <cmd_confdefs.h>
  73
  74
  75 /*
  76  * Miscellaneous configurable options
  77  */
  78 #define CFG_LONGHELP                    /* undef to save memory         */
  79 #define CFG_PROMPT      "=> "           /* Monitor Command Prompt       */
  80 #define CFG_CBSIZE      256             /* Console I/O Buffer Size      */
  81
  82 #if 1
  83 #define CFG_HUSH_PARSER         1       /* use "hush" command parser    */
  84 #endif
  85 #ifdef  CFG_HUSH_PARSER
  86 #define CFG_PROMPT_HUSH_PS2     "> "
  87 #endif
  88
  89 /* Print Buffer Size
  90  */
  91 #define CFG_PBSIZE      (CFG_CBSIZE + sizeof(CFG_PROMPT) + 16)
  92
  93 #define CFG_MAXARGS     16              /* max number of command args   */
  94 #define CFG_BARGSIZE    CFG_CBSIZE      /* Boot Argument Buffer Size    */
  95 #define CFG_LOAD_ADDR   0x00100000      /* Default load address         */
  96
  97 /*-----------------------------------------------------------------------
  98  * Start addresses for the final memory configuration
  99  * (Set up by the startup code)
 100  * Please note that CFG_SDRAM_BASE _must_ start at 0
 101  */
 102 #define CFG_SDRAM_BASE      0x00000000
 103 #define CFG_FLASH_BASE      0xFF000000
 104
 105 #define CFG_RESET_ADDRESS   0xFFF00100
 106
 107 #define CFG_EUMB_ADDR       0xFCE00000
 108
 109 #define CFG_MONITOR_BASE    TEXT_BASE
 110
 111 #define CFG_MONITOR_LEN     (256 << 10) /* Reserve 256 kB for Monitor   */
 112 #define CFG_MALLOC_LEN      (128 << 10) /* Reserve 128 kB for malloc()  */
 113
 114 #define CFG_MEMTEST_START   0x00004000  /* memtest works on             */
 115 #define CFG_MEMTEST_END     0x02000000  /* 0 ... 32 MB in DRAM          */
 116
 117         /* Maximum amount of RAM.
 118          */
 119 #define CFG_MAX_RAM_SIZE    0x10000000
 120
 121
 122 #if CFG_MONITOR_BASE >= CFG_FLASH_BASE
 123 #undef CFG_RAMBOOT
 124 #else
 125 #define CFG_RAMBOOT
 126 #endif
 127
 128
 129 /*-----------------------------------------------------------------------
 130  * Definitions for initial stack pointer and data area
 131  */
 132
 133         /* Size in bytes reserved for initial data
 134          */
 135 #define CFG_GBL_DATA_SIZE    128
 136
 137 #define CFG_INIT_RAM_ADDR     0x40000000
 138 #define CFG_INIT_RAM_END      0x1000
 139 #define CFG_GBL_DATA_OFFSET  (CFG_INIT_RAM_END - CFG_GBL_DATA_SIZE)
 140
 141 /*
 142  * NS16550 Configuration
 143  */
 144 #define CFG_NS16550
 145 #define CFG_NS16550_SERIAL
 146
 147 #define CFG_NS16550_REG_SIZE    4
 148
 149 #define CFG_NS16550_CLK         (14745600 / 2)
 150
 151 #define CFG_NS16550_COM1        0xFE800080
 152 #define CFG_NS16550_COM2        0xFE8000C0
 153
 154 /*
 155  * Low Level Configuration Settings
 156  * (address mappings, register initial values, etc.)
 157  * You should know what you are doing if you make changes here.
 158  * For the detail description refer to the MPC8240 user's manual.
 159  */
 160
 161 #define CONFIG_SYS_CLK_FREQ  33000000
 162 #define CFG_HZ               1000
 163
 164         /* Bit-field values for MCCR1.
 165          */
 166 #define CFG_ROMNAL          0
 167 #define CFG_ROMFAL          7
 168
 169         /* Bit-field values for MCCR2.
 170          */
 171 #define CFG_REFINT          430     /* Refresh interval                 */
 172
 173         /* Burst To Precharge. Bits of this value go to MCCR3 and MCCR4.
 174          */
 175 #define CFG_BSTOPRE         192
 176
 177         /* Bit-field values for MCCR3.
 178          */
 179 #define CFG_REFREC          2       /* Refresh to activate interval     */
 180 #define CFG_RDLAT           3       /* Data latancy from read command   */
 181
 182         /* Bit-field values for MCCR4.
 183          */
 184 #define CFG_PRETOACT        2       /* Precharge to activate interval   */
 185 #define CFG_ACTTOPRE        5       /* Activate to Precharge interval   */
 186 #define CFG_SDMODE_CAS_LAT  2       /* SDMODE CAS latancy               */
 187 #define CFG_SDMODE_WRAP     0       /* SDMODE wrap type                 */
 188 #define CFG_SDMODE_BURSTLEN 2       /* SDMODE Burst length              */
 189 #define CFG_ACTORW          2
 190 #define CFG_REGISTERD_TYPE_BUFFER 1
 191
 192 /* Memory bank settings.
 193  * Only bits 20-29 are actually used from these vales to set the
 194  * start/end addresses. The upper two bits will always be 0, and the lower
 195  * 20 bits will be 0x00000 for a start address, or 0xfffff for an end
 196  * address. Refer to the MPC8240 book.
 197  */
 198
 199 #define CFG_BANK0_START     0x00000000
 200 #define CFG_BANK0_END       (CFG_MAX_RAM_SIZE - 1)
 201 #define CFG_BANK0_ENABLE    1
 202 #define CFG_BANK1_START     0x3ff00000
 203 #define CFG_BANK1_END       0x3fffffff
 204 #define CFG_BANK1_ENABLE    0
 205 #define CFG_BANK2_START     0x3ff00000
 206 #define CFG_BANK2_END       0x3fffffff
 207 #define CFG_BANK2_ENABLE    0
 208 #define CFG_BANK3_START     0x3ff00000
 209 #define CFG_BANK3_END       0x3fffffff
 210 #define CFG_BANK3_ENABLE    0
 211 #define CFG_BANK4_START     0x3ff00000
 212 #define CFG_BANK4_END       0x3fffffff
 213 #define CFG_BANK4_ENABLE    0
 214 #define CFG_BANK5_START     0x3ff00000
 215 #define CFG_BANK5_END       0x3fffffff
 216 #define CFG_BANK5_ENABLE    0
 217 #define CFG_BANK6_START     0x3ff00000
 218 #define CFG_BANK6_END       0x3fffffff
 219 #define CFG_BANK6_ENABLE    0
 220 #define CFG_BANK7_START     0x3ff00000
 221 #define CFG_BANK7_END       0x3fffffff
 222 #define CFG_BANK7_ENABLE    0
 223
 224 #define CFG_ODCR            0xff
 225
 226 #define CFG_IBAT0L  (CFG_SDRAM_BASE | BATL_PP_10 | BATL_MEMCOHERENCE)
 227 #define CFG_IBAT0U  (CFG_SDRAM_BASE | BATU_BL_256M | BATU_VS | BATU_VP)
 228
 229 #define CFG_IBAT1L  (CFG_INIT_RAM_ADDR | BATL_PP_10 | BATL_MEMCOHERENCE)
 230 #define CFG_IBAT1U  (CFG_INIT_RAM_ADDR | BATU_BL_128K | BATU_VS | BATU_VP)
 231
 232 #define CFG_IBAT2L  (0x80000000 | BATL_PP_10 | BATL_CACHEINHIBIT)
 233 #define CFG_IBAT2U  (0x80000000 | BATU_BL_256M | BATU_VS | BATU_VP)
 234
 235 #define CFG_IBAT3L  (0xFC000000 | BATL_PP_10 | BATL_CACHEINHIBIT)
 236 #define CFG_IBAT3U  (0xFC000000 | BATU_BL_64M | BATU_VS | BATU_VP)
 237
 238 #define CFG_DBAT0L  CFG_IBAT0L
 239 #define CFG_DBAT0U  CFG_IBAT0U
 240 #define CFG_DBAT1L  CFG_IBAT1L
 241 #define CFG_DBAT1U  CFG_IBAT1U
 242 #define CFG_DBAT2L  CFG_IBAT2L
 243 #define CFG_DBAT2U  CFG_IBAT2U
 244 #define CFG_DBAT3L  CFG_IBAT3L
 245 #define CFG_DBAT3U  CFG_IBAT3U
 246
 247 /*
 248  * For booting Linux, the board info and command line data
 249  * have to be in the first 8 MB of memory, since this is
 250  * the maximum mapped by the Linux kernel during initialization.
 251  */
 252 #define CFG_BOOTMAPSZ       (8 << 20)   /* Initial Memory map for Linux */
 253
 254 /*-----------------------------------------------------------------------
 255  * FLASH organization
 256  */
 257 #define CFG_MAX_FLASH_BANKS     2       /* Max number of flash banks            */
 258 #define CFG_MAX_FLASH_SECT      39      /* Max number of sectors in one bank    */
 259
 260 #define CFG_FLASH_ERASE_TOUT    120000  /* Timeout for Flash Erase (in ms)      */
 261 #define CFG_FLASH_WRITE_TOUT    500     /* Timeout for Flash Write (in ms)      */
 262
 263         /* Warining: environment is not EMBEDDED in the U-Boot code.
 264          * It's stored in flash separately.
 265          */
 266 #define CFG_ENV_IS_IN_FLASH         1
 267 #if 0
 268 #define CFG_ENV_ADDR            0xFF008000
 269 #define CFG_ENV_SIZE            0x8000  /* Size of the Environment Sector       */
 270 #else
 271 #define CFG_ENV_ADDR            0xFFFC0000
 272 #define CFG_ENV_SIZE            0x4000  /* Size of the Environment              */
 273 #define CFG_ENV_OFFSET          0       /* starting right at the beginning      */
 274 #define CFG_ENV_SECT_SIZE       0x40000 /* Size of the Environment Sector       */
 275 #endif
 276
 277 /*-----------------------------------------------------------------------
 278  * Cache Configuration
 279  */
 280 #define CFG_CACHELINE_SIZE      32
 281 #if (CONFIG_COMMANDS & CFG_CMD_KGDB)
 282 #  define CFG_CACHELINE_SHIFT   5       /* log base 2 of the above value        */
 283 #endif
 284
 285 /*
 286  * Internal Definitions
 287  *
 288  * Boot Flags
 289  */
 290 #define BOOTFLAG_COLD           0x01    /* Normal Power-On: Boot from FLASH     */
 291 #define BOOTFLAG_WARM           0x02    /* Software reboot                      */
 292
 293 /*-----------------------------------------------------------------------
 294  * PCI stuff
 295  *-----------------------------------------------------------------------
 296  */
 297 #define CONFIG_PCI                      /* include pci support                  */
 298 #undef CONFIG_PCI_PNP
 299
 300 #define CONFIG_NET_MULTI                /* Multi ethernet cards support         */
 301
 302 #define CONFIG_TULIP
 303 #define CONFIG_TULIP_USE_IO
 304
 305 #define CFG_ETH_DEV_FN       0x7800
 306 #define CFG_ETH_IOBASE       0x00104000
 307
 308 #define CONFIG_EEPRO100
 309 #define CFG_RX_ETH_BUFFER       8               /* use 8 rx buffer on eepro100  */
 310 #define PCI_ENET0_IOADDR        0x00104000
 311 #define PCI_ENET0_MEMADDR       0x80000000
 312 #endif  /* __CONFIG_H */