drivers/gpu/drm/nouveau/nouveau_drv.h

   1 /*
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  23  */
  24
  25 #ifndef __NOUVEAU_DRV_H__
  26 #define __NOUVEAU_DRV_H__
  27
  28 #define DRIVER_AUTHOR           "Stephane Marchesin"
  29 #define DRIVER_EMAIL            "nouveau@lists.freedesktop.org"
  30
  31 #define DRIVER_NAME             "nouveau"
  32 #define DRIVER_DESC             "nVidia Riva/TNT/GeForce"
  33 #define DRIVER_DATE             "20120316"
  34
  35 #define DRIVER_MAJOR            1
  36 #define DRIVER_MINOR            0
  37 #define DRIVER_PATCHLEVEL       0
  38
  39 #define NOUVEAU_FAMILY   0x0000FFFF
  40 #define NOUVEAU_FLAGS    0xFFFF0000
  41
  42 #include "ttm/ttm_bo_api.h"
  43 #include "ttm/ttm_bo_driver.h"
  44 #include "ttm/ttm_placement.h"
  45 #include "ttm/ttm_memory.h"
  46 #include "ttm/ttm_module.h"
  47
  48 struct nouveau_fpriv {
  49         spinlock_t lock;
  50         struct list_head channels;
  51         struct nouveau_vm *vm;
  52 };
  53
  54 static inline struct nouveau_fpriv *
  55 nouveau_fpriv(struct drm_file *file_priv)
  56 {
  57         return file_priv ? file_priv->driver_priv : NULL;
  58 }
  59
  60 #define DRM_FILE_PAGE_OFFSET (0x100000000ULL >> PAGE_SHIFT)
  61
  62 #include "nouveau_drm.h"
  63 #include "nouveau_reg.h"
  64 #include "nouveau_bios.h"
  65 #include "nouveau_util.h"
  66
  67 struct nouveau_grctx;
  68 struct nouveau_mem;
  69 #include "nouveau_vm.h"
  70
  71 #define MAX_NUM_DCB_ENTRIES 16
  72
  73 #define NOUVEAU_MAX_CHANNEL_NR 4096
  74 #define NOUVEAU_MAX_TILE_NR 15
  75
  76 struct nouveau_mem {
  77         struct drm_device *dev;
  78
  79         struct nouveau_vma bar_vma;
  80         struct nouveau_vma vma[2];
  81         u8  page_shift;
  82
  83         struct drm_mm_node *tag;
  84         struct list_head regions;
  85         dma_addr_t *pages;
  86         u32 memtype;
  87         u64 offset;
  88         u64 size;
  89         struct sg_table *sg;
  90 };
  91
  92 struct nouveau_tile_reg {
  93         bool used;
  94         uint32_t addr;
  95         uint32_t limit;
  96         uint32_t pitch;
  97         uint32_t zcomp;
  98         struct drm_mm_node *tag_mem;
  99         struct nouveau_fence *fence;
 100 };
 101
 102 struct nouveau_bo {
 103         struct ttm_buffer_object bo;
 104         struct ttm_placement placement;
 105         u32 valid_domains;
 106         u32 placements[3];
 107         u32 busy_placements[3];
 108         struct ttm_bo_kmap_obj kmap;
 109         struct list_head head;
 110
 111         /* protected by ttm_bo_reserve() */
 112         struct drm_file *reserved_by;
 113         struct list_head entry;
 114         int pbbo_index;
 115         bool validate_mapped;
 116
 117         struct list_head vma_list;
 118         unsigned page_shift;
 119
 120         uint32_t tile_mode;
 121         uint32_t tile_flags;
 122         struct nouveau_tile_reg *tile;
 123
 124         struct drm_gem_object *gem;
 125         int pin_refcnt;
 126 };
 127
 128 #define nouveau_bo_tile_layout(nvbo)                            \
 129         ((nvbo)->tile_flags & NOUVEAU_GEM_TILE_LAYOUT_MASK)
 130
 131 static inline struct nouveau_bo *
 132 nouveau_bo(struct ttm_buffer_object *bo)
 133 {
 134         return container_of(bo, struct nouveau_bo, bo);
 135 }
 136
 137 static inline struct nouveau_bo *
 138 nouveau_gem_object(struct drm_gem_object *gem)
 139 {
 140         return gem ? gem->driver_private : NULL;
 141 }
 142
 143 /* TODO: submit equivalent to TTM generic API upstream? */
 144 static inline void __iomem *
 145 nvbo_kmap_obj_iovirtual(struct nouveau_bo *nvbo)
 146 {
 147         bool is_iomem;
 148         void __iomem *ioptr = (void __force __iomem *)ttm_kmap_obj_virtual(
 149                                                 &nvbo->kmap, &is_iomem);
 150         WARN_ON_ONCE(ioptr && !is_iomem);
 151         return ioptr;
 152 }
 153
 154 enum nouveau_flags {
 155         NV_NFORCE   = 0x10000000,
 156         NV_NFORCE2  = 0x20000000
 157 };
 158
 159 #define NVOBJ_ENGINE_SW         0
 160 #define NVOBJ_ENGINE_GR         1
 161 #define NVOBJ_ENGINE_CRYPT      2
 162 #define NVOBJ_ENGINE_COPY0      3
 163 #define NVOBJ_ENGINE_COPY1      4
 164 #define NVOBJ_ENGINE_MPEG       5
 165 #define NVOBJ_ENGINE_PPP        NVOBJ_ENGINE_MPEG
 166 #define NVOBJ_ENGINE_BSP        6
 167 #define NVOBJ_ENGINE_VP         7
 168 #define NVOBJ_ENGINE_FENCE      14
 169 #define NVOBJ_ENGINE_DISPLAY    15
 170 #define NVOBJ_ENGINE_NR         16
 171
 172 #define NVOBJ_FLAG_DONT_MAP             (1 << 0)
 173 #define NVOBJ_FLAG_ZERO_ALLOC           (1 << 1)
 174 #define NVOBJ_FLAG_ZERO_FREE            (1 << 2)
 175 #define NVOBJ_FLAG_VM                   (1 << 3)
 176 #define NVOBJ_FLAG_VM_USER              (1 << 4)
 177
 178 #define NVOBJ_CINST_GLOBAL      0xdeadbeef
 179
 180 struct nouveau_gpuobj {
 181         struct drm_device *dev;
 182         struct kref refcount;
 183         struct list_head list;
 184
 185         void *node;
 186         u32 *suspend;
 187
 188         uint32_t flags;
 189
 190         u32 size;
 191         u32 pinst;      /* PRAMIN BAR offset */
 192         u32 cinst;      /* Channel offset */
 193         u64 vinst;      /* VRAM address */
 194         u64 linst;      /* VM address */
 195
 196         uint32_t engine;
 197         uint32_t class;
 198
 199         void (*dtor)(struct drm_device *, struct nouveau_gpuobj *);
 200         void *priv;
 201 };
 202
 203 struct nouveau_page_flip_state {
 204         struct list_head head;
 205         struct drm_pending_vblank_event *event;
 206         int crtc, bpp, pitch, x, y;
 207         uint64_t offset;
 208 };
 209
 210 enum nouveau_channel_mutex_class {
 211         NOUVEAU_UCHANNEL_MUTEX,
 212         NOUVEAU_KCHANNEL_MUTEX
 213 };
 214
 215 struct nouveau_channel {
 216         struct drm_device *dev;
 217         struct list_head list;
 218         int id;
 219
 220         /* references to the channel data structure */
 221         struct kref ref;
 222         /* users of the hardware channel resources, the hardware
 223          * context will be kicked off when it reaches zero. */
 224         atomic_t users;
 225         struct mutex mutex;
 226
 227         /* owner of this fifo */
 228         struct drm_file *file_priv;
 229         /* mapping of the fifo itself */
 230         struct drm_local_map *map;
 231
 232         /* mapping of the regs controlling the fifo */
 233         void __iomem *user;
 234         uint32_t user_get;
 235         uint32_t user_get_hi;
 236         uint32_t user_put;
 237
 238         /* DMA push buffer */
 239         struct nouveau_gpuobj *pushbuf;
 240         struct nouveau_bo     *pushbuf_bo;
 241         struct nouveau_vma     pushbuf_vma;
 242         uint64_t               pushbuf_base;
 243
 244         /* Notifier memory */
 245         struct nouveau_bo *notifier_bo;
 246         struct nouveau_vma notifier_vma;
 247         struct drm_mm notifier_heap;
 248
 249         /* PFIFO context */
 250         struct nouveau_gpuobj *ramfc;
 251         struct nouveau_gpuobj *cache;
 252         void *fifo_priv;
 253
 254         /* Execution engine contexts */
 255         void *engctx[NVOBJ_ENGINE_NR];
 256
 257         /* NV50 VM */
 258         struct nouveau_vm     *vm;
 259         struct nouveau_gpuobj *vm_pd;
 260
 261         /* Objects */
 262         struct nouveau_gpuobj *ramin; /* Private instmem */
 263         struct drm_mm          ramin_heap; /* Private PRAMIN heap */
 264         struct nouveau_ramht  *ramht; /* Hash table */
 265
 266         /* GPU object info for stuff used in-kernel (mm_enabled) */
 267         uint32_t m2mf_ntfy;
 268         uint32_t vram_handle;
 269         uint32_t gart_handle;
 270         bool accel_done;
 271
 272         /* Push buffer state (only for drm's channel on !mm_enabled) */
 273         struct {
 274                 int max;
 275                 int free;
 276                 int cur;
 277                 int put;
 278                 /* access via pushbuf_bo */
 279
 280                 int ib_base;
 281                 int ib_max;
 282                 int ib_free;
 283                 int ib_put;
 284         } dma;
 285
 286         uint32_t sw_subchannel[8];
 287
 288         struct {
 289                 bool active;
 290                 char name[32];
 291                 struct drm_info_list info;
 292         } debugfs;
 293 };
 294
 295 struct nouveau_exec_engine {
 296         void (*destroy)(struct drm_device *, int engine);
 297         int  (*init)(struct drm_device *, int engine);
 298         int  (*fini)(struct drm_device *, int engine, bool suspend);
 299         int  (*context_new)(struct nouveau_channel *, int engine);
 300         void (*context_del)(struct nouveau_channel *, int engine);
 301         int  (*object_new)(struct nouveau_channel *, int engine,
 302                            u32 handle, u16 class);
 303         void (*set_tile_region)(struct drm_device *dev, int i);
 304         void (*tlb_flush)(struct drm_device *, int engine);
 305 };
 306
 307 struct nouveau_instmem_engine {
 308         void    *priv;
 309
 310         int     (*init)(struct drm_device *dev);
 311         void    (*takedown)(struct drm_device *dev);
 312         int     (*suspend)(struct drm_device *dev);
 313         void    (*resume)(struct drm_device *dev);
 314
 315         int     (*get)(struct nouveau_gpuobj *, struct nouveau_channel *,
 316                        u32 size, u32 align);
 317         void    (*put)(struct nouveau_gpuobj *);
 318         int     (*map)(struct nouveau_gpuobj *);
 319         void    (*unmap)(struct nouveau_gpuobj *);
 320
 321         void    (*flush)(struct drm_device *);
 322 };
 323
 324 struct nouveau_mc_engine {
 325         int  (*init)(struct drm_device *dev);
 326         void (*takedown)(struct drm_device *dev);
 327 };
 328
 329 struct nouveau_timer_engine {
 330         int      (*init)(struct drm_device *dev);
 331         void     (*takedown)(struct drm_device *dev);
 332         uint64_t (*read)(struct drm_device *dev);
 333 };
 334
 335 struct nouveau_fb_engine {
 336         int num_tiles;
 337         struct drm_mm tag_heap;
 338         void *priv;
 339
 340         int  (*init)(struct drm_device *dev);
 341         void (*takedown)(struct drm_device *dev);
 342
 343         void (*init_tile_region)(struct drm_device *dev, int i,
 344                                  uint32_t addr, uint32_t size,
 345                                  uint32_t pitch, uint32_t flags);
 346         void (*set_tile_region)(struct drm_device *dev, int i);
 347         void (*free_tile_region)(struct drm_device *dev, int i);
 348 };
 349
 350 struct nouveau_fifo_engine {
 351         void *priv;
 352         int  channels;
 353
 354         struct nouveau_gpuobj *playlist[2];
 355         int cur_playlist;
 356
 357         int  (*init)(struct drm_device *);
 358         void (*takedown)(struct drm_device *);
 359
 360         void (*disable)(struct drm_device *);
 361         void (*enable)(struct drm_device *);
 362         bool (*reassign)(struct drm_device *, bool enable);
 363         bool (*cache_pull)(struct drm_device *dev, bool enable);
 364
 365         int  (*channel_id)(struct drm_device *);
 366
 367         int  (*create_context)(struct nouveau_channel *);
 368         void (*destroy_context)(struct nouveau_channel *);
 369         int  (*load_context)(struct nouveau_channel *);
 370         int  (*unload_context)(struct drm_device *);
 371         void (*tlb_flush)(struct drm_device *dev);
 372 };
 373
 374 struct nouveau_display_engine {
 375         void *priv;
 376         int (*early_init)(struct drm_device *);
 377         void (*late_takedown)(struct drm_device *);
 378         int (*create)(struct drm_device *);
 379         void (*destroy)(struct drm_device *);
 380         int (*init)(struct drm_device *);
 381         void (*fini)(struct drm_device *);
 382
 383         struct drm_property *dithering_mode;
 384         struct drm_property *dithering_depth;
 385         struct drm_property *underscan_property;
 386         struct drm_property *underscan_hborder_property;
 387         struct drm_property *underscan_vborder_property;
 388         /* not really hue and saturation: */
 389         struct drm_property *vibrant_hue_property;
 390         struct drm_property *color_vibrance_property;
 391 };
 392
 393 struct nouveau_gpio_engine {
 394         spinlock_t lock;
 395         struct list_head isr;
 396         int (*init)(struct drm_device *);
 397         void (*fini)(struct drm_device *);
 398         int (*drive)(struct drm_device *, int line, int dir, int out);
 399         int (*sense)(struct drm_device *, int line);
 400         void (*irq_enable)(struct drm_device *, int line, bool);
 401 };
 402
 403 struct nouveau_pm_voltage_level {
 404         u32 voltage; /* microvolts */
 405         u8  vid;
 406 };
 407
 408 struct nouveau_pm_voltage {
 409         bool supported;
 410         u8 version;
 411         u8 vid_mask;
 412
 413         struct nouveau_pm_voltage_level *level;
 414         int nr_level;
 415 };
 416
 417 /* Exclusive upper limits */
 418 #define NV_MEM_CL_DDR2_MAX 8
 419 #define NV_MEM_WR_DDR2_MAX 9
 420 #define NV_MEM_CL_DDR3_MAX 17
 421 #define NV_MEM_WR_DDR3_MAX 17
 422 #define NV_MEM_CL_GDDR3_MAX 16
 423 #define NV_MEM_WR_GDDR3_MAX 18
 424 #define NV_MEM_CL_GDDR5_MAX 21
 425 #define NV_MEM_WR_GDDR5_MAX 20
 426
 427 struct nouveau_pm_memtiming {
 428         int id;
 429
 430         u32 reg[9];
 431         u32 mr[4];
 432
 433         u8 tCWL;
 434
 435         u8 odt;
 436         u8 drive_strength;
 437 };
 438
 439 struct nouveau_pm_tbl_header {
 440         u8 version;
 441         u8 header_len;
 442         u8 entry_cnt;
 443         u8 entry_len;
 444 };
 445
 446 struct nouveau_pm_tbl_entry {
 447         u8 tWR;
 448         u8 tWTR;
 449         u8 tCL;
 450         u8 tRC;
 451         u8 empty_4;
 452         u8 tRFC;        /* Byte 5 */
 453         u8 empty_6;
 454         u8 tRAS;        /* Byte 7 */
 455         u8 empty_8;
 456         u8 tRP;         /* Byte 9 */
 457         u8 tRCDRD;
 458         u8 tRCDWR;
 459         u8 tRRD;
 460         u8 tUNK_13;
 461         u8 RAM_FT1;             /* 14, a bitmask of random RAM features */
 462         u8 empty_15;
 463         u8 tUNK_16;
 464         u8 empty_17;
 465         u8 tUNK_18;
 466         u8 tCWL;
 467         u8 tUNK_20, tUNK_21;
 468 };
 469
 470 struct nouveau_pm_profile;
 471 struct nouveau_pm_profile_func {
 472         void (*destroy)(struct nouveau_pm_profile *);
 473         void (*init)(struct nouveau_pm_profile *);
 474         void (*fini)(struct nouveau_pm_profile *);
 475         struct nouveau_pm_level *(*select)(struct nouveau_pm_profile *);
 476 };
 477
 478 struct nouveau_pm_profile {
 479         const struct nouveau_pm_profile_func *func;
 480         struct list_head head;
 481         char name[8];
 482 };
 483
 484 #define NOUVEAU_PM_MAX_LEVEL 8
 485 struct nouveau_pm_level {
 486         struct nouveau_pm_profile profile;
 487         struct device_attribute dev_attr;
 488         char name[32];
 489         int id;
 490
 491         struct nouveau_pm_memtiming timing;
 492         u32 memory;
 493         u16 memscript;
 494
 495         u32 core;
 496         u32 shader;
 497         u32 rop;
 498         u32 copy;
 499         u32 daemon;
 500         u32 vdec;
 501         u32 dom6;
 502         u32 unka0;      /* nva3:nvc0 */
 503         u32 hub01;      /* nvc0- */
 504         u32 hub06;      /* nvc0- */
 505         u32 hub07;      /* nvc0- */
 506
 507         u32 volt_min; /* microvolts */
 508         u32 volt_max;
 509         u8  fanspeed;
 510 };
 511
 512 struct nouveau_pm_temp_sensor_constants {
 513         u16 offset_constant;
 514         s16 offset_mult;
 515         s16 offset_div;
 516         s16 slope_mult;
 517         s16 slope_div;
 518 };
 519
 520 struct nouveau_pm_threshold_temp {
 521         s16 critical;
 522         s16 down_clock;
 523         s16 fan_boost;
 524 };
 525
 526 struct nouveau_pm_fan {
 527         u32 percent;
 528         u32 min_duty;
 529         u32 max_duty;
 530         u32 pwm_freq;
 531         u32 pwm_divisor;
 532 };
 533
 534 struct nouveau_pm_engine {
 535         struct nouveau_pm_voltage voltage;
 536         struct nouveau_pm_level perflvl[NOUVEAU_PM_MAX_LEVEL];
 537         int nr_perflvl;
 538         struct nouveau_pm_temp_sensor_constants sensor_constants;
 539         struct nouveau_pm_threshold_temp threshold_temp;
 540         struct nouveau_pm_fan fan;
 541
 542         struct nouveau_pm_profile *profile_ac;
 543         struct nouveau_pm_profile *profile_dc;
 544         struct nouveau_pm_profile *profile;
 545         struct list_head profiles;
 546
 547         struct nouveau_pm_level boot;
 548         struct nouveau_pm_level *cur;
 549
 550         struct device *hwmon;
 551         struct notifier_block acpi_nb;
 552
 553         int  (*clocks_get)(struct drm_device *, struct nouveau_pm_level *);
 554         void *(*clocks_pre)(struct drm_device *, struct nouveau_pm_level *);
 555         int (*clocks_set)(struct drm_device *, void *);
 556
 557         int (*voltage_get)(struct drm_device *);
 558         int (*voltage_set)(struct drm_device *, int voltage);
 559         int (*pwm_get)(struct drm_device *, int line, u32*, u32*);
 560         int (*pwm_set)(struct drm_device *, int line, u32, u32);
 561         int (*temp_get)(struct drm_device *);
 562 };
 563
 564 struct nouveau_vram_engine {
 565         struct nouveau_mm mm;
 566
 567         int  (*init)(struct drm_device *);
 568         void (*takedown)(struct drm_device *dev);
 569         int  (*get)(struct drm_device *, u64, u32 align, u32 size_nc,
 570                     u32 type, struct nouveau_mem **);
 571         void (*put)(struct drm_device *, struct nouveau_mem **);
 572
 573         bool (*flags_valid)(struct drm_device *, u32 tile_flags);
 574 };
 575
 576 struct nouveau_engine {
 577         struct nouveau_instmem_engine instmem;
 578         struct nouveau_mc_engine      mc;
 579         struct nouveau_timer_engine   timer;
 580         struct nouveau_fb_engine      fb;
 581         struct nouveau_fifo_engine    fifo;
 582         struct nouveau_display_engine display;
 583         struct nouveau_gpio_engine    gpio;
 584         struct nouveau_pm_engine      pm;
 585         struct nouveau_vram_engine    vram;
 586 };
 587
 588 struct nouveau_pll_vals {
 589         union {
 590                 struct {
 591 #ifdef __BIG_ENDIAN
 592                         uint8_t N1, M1, N2, M2;
 593 #else
 594                         uint8_t M1, N1, M2, N2;
 595 #endif
 596                 };
 597                 struct {
 598                         uint16_t NM1, NM2;
 599                 } __attribute__((packed));
 600         };
 601         int log2P;
 602
 603         int refclk;
 604 };
 605
 606 enum nv04_fp_display_regs {
 607         FP_DISPLAY_END,
 608         FP_TOTAL,
 609         FP_CRTC,
 610         FP_SYNC_START,
 611         FP_SYNC_END,
 612         FP_VALID_START,
 613         FP_VALID_END
 614 };
 615
 616 struct nv04_crtc_reg {
 617         unsigned char MiscOutReg;
 618         uint8_t CRTC[0xa0];
 619         uint8_t CR58[0x10];
 620         uint8_t Sequencer[5];
 621         uint8_t Graphics[9];
 622         uint8_t Attribute[21];
 623         unsigned char DAC[768];
 624
 625         /* PCRTC regs */
 626         uint32_t fb_start;
 627         uint32_t crtc_cfg;
 628         uint32_t cursor_cfg;
 629         uint32_t gpio_ext;
 630         uint32_t crtc_830;
 631         uint32_t crtc_834;
 632         uint32_t crtc_850;
 633         uint32_t crtc_eng_ctrl;
 634
 635         /* PRAMDAC regs */
 636         uint32_t nv10_cursync;
 637         struct nouveau_pll_vals pllvals;
 638         uint32_t ramdac_gen_ctrl;
 639         uint32_t ramdac_630;
 640         uint32_t ramdac_634;
 641         uint32_t tv_setup;
 642         uint32_t tv_vtotal;
 643         uint32_t tv_vskew;
 644         uint32_t tv_vsync_delay;
 645         uint32_t tv_htotal;
 646         uint32_t tv_hskew;
 647         uint32_t tv_hsync_delay;
 648         uint32_t tv_hsync_delay2;
 649         uint32_t fp_horiz_regs[7];
 650         uint32_t fp_vert_regs[7];
 651         uint32_t dither;
 652         uint32_t fp_control;
 653         uint32_t dither_regs[6];
 654         uint32_t fp_debug_0;
 655         uint32_t fp_debug_1;
 656         uint32_t fp_debug_2;
 657         uint32_t fp_margin_color;
 658         uint32_t ramdac_8c0;
 659         uint32_t ramdac_a20;
 660         uint32_t ramdac_a24;
 661         uint32_t ramdac_a34;
 662         uint32_t ctv_regs[38];
 663 };
 664
 665 struct nv04_output_reg {
 666         uint32_t output;
 667         int head;
 668 };
 669
 670 struct nv04_mode_state {
 671         struct nv04_crtc_reg crtc_reg[2];
 672         uint32_t pllsel;
 673         uint32_t sel_clk;
 674 };
 675
 676 enum nouveau_card_type {
 677         NV_04      = 0x04,
 678         NV_10      = 0x10,
 679         NV_20      = 0x20,
 680         NV_30      = 0x30,
 681         NV_40      = 0x40,
 682         NV_50      = 0x50,
 683         NV_C0      = 0xc0,
 684         NV_D0      = 0xd0,
 685         NV_E0      = 0xe0,
 686 };
 687
 688 struct drm_nouveau_private {
 689         struct drm_device *dev;
 690         bool noaccel;
 691
 692         /* the card type, takes NV_* as values */
 693         enum nouveau_card_type card_type;
 694         /* exact chipset, derived from NV_PMC_BOOT_0 */
 695         int chipset;
 696         int flags;
 697         u32 crystal;
 698
 699         void __iomem *mmio;
 700
 701         spinlock_t ramin_lock;
 702         void __iomem *ramin;
 703         u32 ramin_size;
 704         u32 ramin_base;
 705         bool ramin_available;
 706         struct drm_mm ramin_heap;
 707         struct nouveau_exec_engine *eng[NVOBJ_ENGINE_NR];
 708         struct list_head gpuobj_list;
 709         struct list_head classes;
 710
 711         struct nouveau_bo *vga_ram;
 712
 713         /* interrupt handling */
 714         void (*irq_handler[32])(struct drm_device *);
 715         bool msi_enabled;
 716
 717         struct list_head vbl_waiting;
 718
 719         struct {
 720                 struct drm_global_reference mem_global_ref;
 721                 struct ttm_bo_global_ref bo_global_ref;
 722                 struct ttm_bo_device bdev;
 723                 atomic_t validate_sequence;
 724         } ttm;
 725
 726         struct {
 727                 spinlock_t lock;
 728                 struct drm_mm heap;
 729                 struct nouveau_bo *bo;
 730         } fence;
 731
 732         struct {
 733                 spinlock_t lock;
 734                 struct nouveau_channel *ptr[NOUVEAU_MAX_CHANNEL_NR];
 735         } channels;
 736
 737         struct nouveau_engine engine;
 738         struct nouveau_channel *channel;
 739
 740         /* For PFIFO and PGRAPH. */
 741         spinlock_t context_switch_lock;
 742
 743         /* VM/PRAMIN flush, legacy PRAMIN aperture */
 744         spinlock_t vm_lock;
 745
 746         /* RAMIN configuration, RAMFC, RAMHT and RAMRO offsets */
 747         struct nouveau_ramht  *ramht;
 748         struct nouveau_gpuobj *ramfc;
 749         struct nouveau_gpuobj *ramro;
 750
 751         uint32_t ramin_rsvd_vram;
 752
 753         struct {
 754                 enum {
 755                         NOUVEAU_GART_NONE = 0,
 756                         NOUVEAU_GART_AGP,       /* AGP */
 757                         NOUVEAU_GART_PDMA,      /* paged dma object */
 758                         NOUVEAU_GART_HW         /* on-chip gart/vm */
 759                 } type;
 760                 uint64_t aper_base;
 761                 uint64_t aper_size;
 762                 uint64_t aper_free;
 763
 764                 struct ttm_backend_func *func;
 765
 766                 struct {
 767                         struct page *page;
 768                         dma_addr_t   addr;
 769                 } dummy;
 770
 771                 struct nouveau_gpuobj *sg_ctxdma;
 772         } gart_info;
 773
 774         /* nv10-nv40 tiling regions */
 775         struct {
 776                 struct nouveau_tile_reg reg[NOUVEAU_MAX_TILE_NR];
 777                 spinlock_t lock;
 778         } tile;
 779
 780         /* VRAM/fb configuration */
 781         enum {
 782                 NV_MEM_TYPE_UNKNOWN = 0,
 783                 NV_MEM_TYPE_STOLEN,
 784                 NV_MEM_TYPE_SGRAM,
 785                 NV_MEM_TYPE_SDRAM,
 786                 NV_MEM_TYPE_DDR1,
 787                 NV_MEM_TYPE_DDR2,
 788                 NV_MEM_TYPE_DDR3,
 789                 NV_MEM_TYPE_GDDR2,
 790                 NV_MEM_TYPE_GDDR3,
 791                 NV_MEM_TYPE_GDDR4,
 792                 NV_MEM_TYPE_GDDR5
 793         } vram_type;
 794         uint64_t vram_size;
 795         uint64_t vram_sys_base;
 796         bool vram_rank_B;
 797
 798         uint64_t fb_available_size;
 799         uint64_t fb_mappable_pages;
 800         uint64_t fb_aper_free;
 801         int fb_mtrr;
 802
 803         /* BAR control (NV50-) */
 804         struct nouveau_vm *bar1_vm;
 805         struct nouveau_vm *bar3_vm;
 806
 807         /* G8x/G9x virtual address space */
 808         struct nouveau_vm *chan_vm;
 809
 810         struct nvbios vbios;
 811         u8 *mxms;
 812         struct list_head i2c_ports;
 813
 814         struct nv04_mode_state mode_reg;
 815         struct nv04_mode_state saved_reg;
 816         uint32_t saved_vga_font[4][16384];
 817         uint32_t crtc_owner;
 818         uint32_t dac_users[4];
 819
 820         struct backlight_device *backlight;
 821
 822         struct {
 823                 struct dentry *channel_root;
 824         } debugfs;
 825
 826         struct nouveau_fbdev *nfbdev;
 827         struct apertures_struct *apertures;
 828 };
 829
 830 static inline struct drm_nouveau_private *
 831 nouveau_private(struct drm_device *dev)
 832 {
 833         return dev->dev_private;
 834 }
 835
 836 static inline struct drm_nouveau_private *
 837 nouveau_bdev(struct ttm_bo_device *bd)
 838 {
 839         return container_of(bd, struct drm_nouveau_private, ttm.bdev);
 840 }
 841
 842 static inline int
 843 nouveau_bo_ref(struct nouveau_bo *ref, struct nouveau_bo **pnvbo)
 844 {
 845         struct nouveau_bo *prev;
 846
 847         if (!pnvbo)
 848                 return -EINVAL;
 849         prev = *pnvbo;
 850
 851         *pnvbo = ref ? nouveau_bo(ttm_bo_reference(&ref->bo)) : NULL;
 852         if (prev) {
 853                 struct ttm_buffer_object *bo = &prev->bo;
 854
 855                 ttm_bo_unref(&bo);
 856         }
 857
 858         return 0;
 859 }
 860
 861 /* nouveau_drv.c */
 862 extern int nouveau_modeset;
 863 extern int nouveau_agpmode;
 864 extern int nouveau_duallink;
 865 extern int nouveau_uscript_lvds;
 866 extern int nouveau_uscript_tmds;
 867 extern int nouveau_vram_pushbuf;
 868 extern int nouveau_vram_notify;
 869 extern char *nouveau_vram_type;
 870 extern int nouveau_fbpercrtc;
 871 extern int nouveau_tv_disable;
 872 extern char *nouveau_tv_norm;
 873 extern int nouveau_reg_debug;
 874 extern char *nouveau_vbios;
 875 extern int nouveau_ignorelid;
 876 extern int nouveau_nofbaccel;
 877 extern int nouveau_noaccel;
 878 extern int nouveau_force_post;
 879 extern int nouveau_override_conntype;
 880 extern char *nouveau_perflvl;
 881 extern int nouveau_perflvl_wr;
 882 extern int nouveau_msi;
 883 extern int nouveau_ctxfw;
 884 extern int nouveau_mxmdcb;
 885
 886 extern int nouveau_pci_suspend(struct pci_dev *pdev, pm_message_t pm_state);
 887 extern int nouveau_pci_resume(struct pci_dev *pdev);
 888
 889 /* nouveau_state.c */
 890 extern int  nouveau_open(struct drm_device *, struct drm_file *);
 891 extern void nouveau_preclose(struct drm_device *dev, struct drm_file *);
 892 extern void nouveau_postclose(struct drm_device *, struct drm_file *);
 893 extern int  nouveau_load(struct drm_device *, unsigned long flags);
 894 extern int  nouveau_firstopen(struct drm_device *);
 895 extern void nouveau_lastclose(struct drm_device *);
 896 extern int  nouveau_unload(struct drm_device *);
 897 extern int  nouveau_ioctl_getparam(struct drm_device *, void *data,
 898                                    struct drm_file *);
 899 extern int  nouveau_ioctl_setparam(struct drm_device *, void *data,
 900                                    struct drm_file *);
 901 extern bool nouveau_wait_eq(struct drm_device *, uint64_t timeout,
 902                             uint32_t reg, uint32_t mask, uint32_t val);
 903 extern bool nouveau_wait_ne(struct drm_device *, uint64_t timeout,
 904                             uint32_t reg, uint32_t mask, uint32_t val);
 905 extern bool nouveau_wait_cb(struct drm_device *, u64 timeout,
 906                             bool (*cond)(void *), void *);
 907 extern bool nouveau_wait_for_idle(struct drm_device *);
 908 extern int  nouveau_card_init(struct drm_device *);
 909
 910 /* nouveau_mem.c */
 911 extern int  nouveau_mem_vram_init(struct drm_device *);
 912 extern void nouveau_mem_vram_fini(struct drm_device *);
 913 extern int  nouveau_mem_gart_init(struct drm_device *);
 914 extern void nouveau_mem_gart_fini(struct drm_device *);
 915 extern int  nouveau_mem_init_agp(struct drm_device *);
 916 extern int  nouveau_mem_reset_agp(struct drm_device *);
 917 extern void nouveau_mem_close(struct drm_device *);
 918 extern bool nouveau_mem_flags_valid(struct drm_device *, u32 tile_flags);
 919 extern int  nouveau_mem_timing_calc(struct drm_device *, u32 freq,
 920                                     struct nouveau_pm_memtiming *);
 921 extern void nouveau_mem_timing_read(struct drm_device *,
 922                                     struct nouveau_pm_memtiming *);
 923 extern int nouveau_mem_vbios_type(struct drm_device *);
 924 extern struct nouveau_tile_reg *nv10_mem_set_tiling(
 925         struct drm_device *dev, uint32_t addr, uint32_t size,
 926         uint32_t pitch, uint32_t flags);
 927 extern void nv10_mem_put_tile_region(struct drm_device *dev,
 928                                      struct nouveau_tile_reg *tile,
 929                                      struct nouveau_fence *fence);
 930 extern const struct ttm_mem_type_manager_func nouveau_vram_manager;
 931 extern const struct ttm_mem_type_manager_func nouveau_gart_manager;
 932
 933 /* nouveau_notifier.c */
 934 extern int  nouveau_notifier_init_channel(struct nouveau_channel *);
 935 extern void nouveau_notifier_takedown_channel(struct nouveau_channel *);
 936 extern int  nouveau_notifier_alloc(struct nouveau_channel *, uint32_t handle,
 937                                    int cout, uint32_t start, uint32_t end,
 938                                    uint32_t *offset);
 939 extern int  nouveau_notifier_offset(struct nouveau_gpuobj *, uint32_t *);
 940 extern int  nouveau_ioctl_notifier_alloc(struct drm_device *, void *data,
 941                                          struct drm_file *);
 942 extern int  nouveau_ioctl_notifier_free(struct drm_device *, void *data,
 943                                         struct drm_file *);
 944
 945 /* nouveau_channel.c */
 946 extern struct drm_ioctl_desc nouveau_ioctls[];
 947 extern int nouveau_max_ioctl;
 948 extern void nouveau_channel_cleanup(struct drm_device *, struct drm_file *);
 949 extern int  nouveau_channel_alloc(struct drm_device *dev,
 950                                   struct nouveau_channel **chan,
 951                                   struct drm_file *file_priv,
 952                                   uint32_t fb_ctxdma, uint32_t tt_ctxdma);
 953 extern struct nouveau_channel *
 954 nouveau_channel_get_unlocked(struct nouveau_channel *);
 955 extern struct nouveau_channel *
 956 nouveau_channel_get(struct drm_file *, int id);
 957 extern void nouveau_channel_put_unlocked(struct nouveau_channel **);
 958 extern void nouveau_channel_put(struct nouveau_channel **);
 959 extern void nouveau_channel_ref(struct nouveau_channel *chan,
 960                                 struct nouveau_channel **pchan);
 961 extern void nouveau_channel_idle(struct nouveau_channel *chan);
 962
 963 /* nouveau_object.c */
 964 #define NVOBJ_ENGINE_ADD(d, e, p) do {                                         \
 965         struct drm_nouveau_private *dev_priv = (d)->dev_private;               \
 966         dev_priv->eng[NVOBJ_ENGINE_##e] = (p);                                 \
 967 } while (0)
 968
 969 #define NVOBJ_ENGINE_DEL(d, e) do {                                            \
 970         struct drm_nouveau_private *dev_priv = (d)->dev_private;               \
 971         dev_priv->eng[NVOBJ_ENGINE_##e] = NULL;                                \
 972 } while (0)
 973
 974 #define NVOBJ_CLASS(d, c, e) do {                                              \
 975         int ret = nouveau_gpuobj_class_new((d), (c), NVOBJ_ENGINE_##e);        \
 976         if (ret)                                                               \
 977                 return ret;                                                    \
 978 } while (0)
 979
 980 #define NVOBJ_MTHD(d, c, m, e) do {                                            \
 981         int ret = nouveau_gpuobj_mthd_new((d), (c), (m), (e));                 \
 982         if (ret)                                                               \
 983                 return ret;                                                    \
 984 } while (0)
 985
 986 extern int  nouveau_gpuobj_early_init(struct drm_device *);
 987 extern int  nouveau_gpuobj_init(struct drm_device *);
 988 extern void nouveau_gpuobj_takedown(struct drm_device *);
 989 extern int  nouveau_gpuobj_suspend(struct drm_device *dev);
 990 extern void nouveau_gpuobj_resume(struct drm_device *dev);
 991 extern int  nouveau_gpuobj_class_new(struct drm_device *, u32 class, u32 eng);
 992 extern int  nouveau_gpuobj_mthd_new(struct drm_device *, u32 class, u32 mthd,
 993                                     int (*exec)(struct nouveau_channel *,
 994                                                 u32 class, u32 mthd, u32 data));
 995 extern int  nouveau_gpuobj_mthd_call(struct nouveau_channel *, u32, u32, u32);
 996 extern int  nouveau_gpuobj_mthd_call2(struct drm_device *, int, u32, u32, u32);
 997 extern int nouveau_gpuobj_channel_init(struct nouveau_channel *,
 998                                        uint32_t vram_h, uint32_t tt_h);
 999 extern void nouveau_gpuobj_channel_takedown(struct nouveau_channel *);
1000 extern int nouveau_gpuobj_new(struct drm_device *, struct nouveau_channel *,
1001                               uint32_t size, int align, uint32_t flags,
1002                               struct nouveau_gpuobj **);
1003 extern void nouveau_gpuobj_ref(struct nouveau_gpuobj *,
1004                                struct nouveau_gpuobj **);
1005 extern int nouveau_gpuobj_new_fake(struct drm_device *, u32 pinst, u64 vinst,
1006                                    u32 size, u32 flags,
1007                                    struct nouveau_gpuobj **);
1008 extern int nouveau_gpuobj_dma_new(struct nouveau_channel *, int class,
1009                                   uint64_t offset, uint64_t size, int access,
1010                                   int target, struct nouveau_gpuobj **);
1011 extern int nouveau_gpuobj_gr_new(struct nouveau_channel *, u32 handle, int class);
1012 extern int nv50_gpuobj_dma_new(struct nouveau_channel *, int class, u64 base,
1013                                u64 size, int target, int access, u32 type,
1014                                u32 comp, struct nouveau_gpuobj **pobj);
1015 extern void nv50_gpuobj_dma_init(struct nouveau_gpuobj *, u32 offset,
1016                                  int class, u64 base, u64 size, int target,
1017                                  int access, u32 type, u32 comp);
1018 extern int nouveau_ioctl_grobj_alloc(struct drm_device *, void *data,
1019                                      struct drm_file *);
1020 extern int nouveau_ioctl_gpuobj_free(struct drm_device *, void *data,
1021                                      struct drm_file *);
1022
1023 /* nouveau_irq.c */
1024 extern int         nouveau_irq_init(struct drm_device *);
1025 extern void        nouveau_irq_fini(struct drm_device *);
1026 extern irqreturn_t nouveau_irq_handler(DRM_IRQ_ARGS);
1027 extern void        nouveau_irq_register(struct drm_device *, int status_bit,
1028                                         void (*)(struct drm_device *));
1029 extern void        nouveau_irq_unregister(struct drm_device *, int status_bit);
1030 extern void        nouveau_irq_preinstall(struct drm_device *);
1031 extern int         nouveau_irq_postinstall(struct drm_device *);
1032 extern void        nouveau_irq_uninstall(struct drm_device *);
1033
1034 /* nouveau_sgdma.c */
1035 extern int nouveau_sgdma_init(struct drm_device *);
1036 extern void nouveau_sgdma_takedown(struct drm_device *);
1037 extern uint32_t nouveau_sgdma_get_physical(struct drm_device *,
1038                                            uint32_t offset);
1039 extern struct ttm_tt *nouveau_sgdma_create_ttm(struct ttm_bo_device *bdev,
1040                                                unsigned long size,
1041                                                uint32_t page_flags,
1042                                                struct page *dummy_read_page);
1043
1044 /* nouveau_debugfs.c */
1045 #if defined(CONFIG_DRM_NOUVEAU_DEBUG)
1046 extern int  nouveau_debugfs_init(struct drm_minor *);
1047 extern void nouveau_debugfs_takedown(struct drm_minor *);
1048 extern int  nouveau_debugfs_channel_init(struct nouveau_channel *);
1049 extern void nouveau_debugfs_channel_fini(struct nouveau_channel *);
1050 #else
1051 static inline int
1052 nouveau_debugfs_init(struct drm_minor *minor)
1053 {
1054         return 0;
1055 }
1056
1057 static inline void nouveau_debugfs_takedown(struct drm_minor *minor)
1058 {
1059 }
1060
1061 static inline int
1062 nouveau_debugfs_channel_init(struct nouveau_channel *chan)
1063 {
1064         return 0;
1065 }
1066
1067 static inline void
1068 nouveau_debugfs_channel_fini(struct nouveau_channel *chan)
1069 {
1070 }
1071 #endif
1072
1073 /* nouveau_dma.c */
1074 extern void nouveau_dma_init(struct nouveau_channel *);
1075 extern int  nouveau_dma_wait(struct nouveau_channel *, int slots, int size);
1076
1077 /* nouveau_acpi.c */
1078 #define ROM_BIOS_PAGE 4096
1079 #if defined(CONFIG_ACPI)
1080 void nouveau_register_dsm_handler(void);
1081 void nouveau_unregister_dsm_handler(void);
1082 void nouveau_switcheroo_optimus_dsm(void);
1083 int nouveau_acpi_get_bios_chunk(uint8_t *bios, int offset, int len);
1084 bool nouveau_acpi_rom_supported(struct pci_dev *pdev);
1085 int nouveau_acpi_edid(struct drm_device *, struct drm_connector *);
1086 #else
1087 static inline void nouveau_register_dsm_handler(void) {}
1088 static inline void nouveau_unregister_dsm_handler(void) {}
1089 static inline void nouveau_switcheroo_optimus_dsm(void) {}
1090 static inline bool nouveau_acpi_rom_supported(struct pci_dev *pdev) { return false; }
1091 static inline int nouveau_acpi_get_bios_chunk(uint8_t *bios, int offset, int len) { return -EINVAL; }
1092 static inline int nouveau_acpi_edid(struct drm_device *dev, struct drm_connector *connector) { return -EINVAL; }
1093 #endif
1094
1095 /* nouveau_backlight.c */
1096 #ifdef CONFIG_DRM_NOUVEAU_BACKLIGHT
1097 extern int nouveau_backlight_init(struct drm_device *);
1098 extern void nouveau_backlight_exit(struct drm_device *);
1099 #else
1100 static inline int nouveau_backlight_init(struct drm_device *dev)
1101 {
1102         return 0;
1103 }
1104
1105 static inline void nouveau_backlight_exit(struct drm_device *dev) { }
1106 #endif
1107
1108 /* nouveau_bios.c */
1109 extern int nouveau_bios_init(struct drm_device *);
1110 extern void nouveau_bios_takedown(struct drm_device *dev);
1111 extern int nouveau_run_vbios_init(struct drm_device *);
1112 extern void nouveau_bios_run_init_table(struct drm_device *, uint16_t table,
1113                                         struct dcb_entry *, int crtc);
1114 extern void nouveau_bios_init_exec(struct drm_device *, uint16_t table);
1115 extern struct dcb_connector_table_entry *
1116 nouveau_bios_connector_entry(struct drm_device *, int index);
1117 extern u32 get_pll_register(struct drm_device *, enum pll_types);
1118 extern int get_pll_limits(struct drm_device *, uint32_t limit_match,
1119                           struct pll_lims *);
1120 extern int nouveau_bios_run_display_table(struct drm_device *, u16 id, int clk,
1121                                           struct dcb_entry *, int crtc);
1122 extern bool nouveau_bios_fp_mode(struct drm_device *, struct drm_display_mode *);
1123 extern uint8_t *nouveau_bios_embedded_edid(struct drm_device *);
1124 extern int nouveau_bios_parse_lvds_table(struct drm_device *, int pxclk,
1125                                          bool *dl, bool *if_is_24bit);
1126 extern int run_tmds_table(struct drm_device *, struct dcb_entry *,
1127                           int head, int pxclk);
1128 extern int call_lvds_script(struct drm_device *, struct dcb_entry *, int head,
1129                             enum LVDS_script, int pxclk);
1130 bool bios_encoder_match(struct dcb_entry *, u32 hash);
1131
1132 /* nouveau_mxm.c */
1133 int  nouveau_mxm_init(struct drm_device *dev);
1134 void nouveau_mxm_fini(struct drm_device *dev);
1135
1136 /* nouveau_ttm.c */
1137 int nouveau_ttm_global_init(struct drm_nouveau_private *);
1138 void nouveau_ttm_global_release(struct drm_nouveau_private *);
1139 int nouveau_ttm_mmap(struct file *, struct vm_area_struct *);
1140
1141 /* nouveau_hdmi.c */
1142 void nouveau_hdmi_mode_set(struct drm_encoder *, struct drm_display_mode *);
1143
1144 /* nv04_fb.c */
1145 extern int  nv04_fb_vram_init(struct drm_device *);
1146 extern int  nv04_fb_init(struct drm_device *);
1147 extern void nv04_fb_takedown(struct drm_device *);
1148
1149 /* nv10_fb.c */
1150 extern int  nv10_fb_vram_init(struct drm_device *dev);
1151 extern int  nv1a_fb_vram_init(struct drm_device *dev);
1152 extern int  nv10_fb_init(struct drm_device *);
1153 extern void nv10_fb_takedown(struct drm_device *);
1154 extern void nv10_fb_init_tile_region(struct drm_device *dev, int i,
1155                                      uint32_t addr, uint32_t size,
1156                                      uint32_t pitch, uint32_t flags);
1157 extern void nv10_fb_set_tile_region(struct drm_device *dev, int i);
1158 extern void nv10_fb_free_tile_region(struct drm_device *dev, int i);
1159
1160 /* nv20_fb.c */
1161 extern int  nv20_fb_vram_init(struct drm_device *dev);
1162 extern int  nv20_fb_init(struct drm_device *);
1163 extern void nv20_fb_takedown(struct drm_device *);
1164 extern void nv20_fb_init_tile_region(struct drm_device *dev, int i,
1165                                      uint32_t addr, uint32_t size,
1166                                      uint32_t pitch, uint32_t flags);
1167 extern void nv20_fb_set_tile_region(struct drm_device *dev, int i);
1168 extern void nv20_fb_free_tile_region(struct drm_device *dev, int i);
1169
1170 /* nv30_fb.c */
1171 extern int  nv30_fb_init(struct drm_device *);
1172 extern void nv30_fb_takedown(struct drm_device *);
1173 extern void nv30_fb_init_tile_region(struct drm_device *dev, int i,
1174                                      uint32_t addr, uint32_t size,
1175                                      uint32_t pitch, uint32_t flags);
1176 extern void nv30_fb_free_tile_region(struct drm_device *dev, int i);
1177
1178 /* nv40_fb.c */
1179 extern int  nv40_fb_vram_init(struct drm_device *dev);
1180 extern int  nv40_fb_init(struct drm_device *);
1181 extern void nv40_fb_takedown(struct drm_device *);
1182 extern void nv40_fb_set_tile_region(struct drm_device *dev, int i);
1183
1184 /* nv50_fb.c */
1185 extern int  nv50_fb_init(struct drm_device *);
1186 extern void nv50_fb_takedown(struct drm_device *);
1187 extern void nv50_fb_vm_trap(struct drm_device *, int display);
1188
1189 /* nvc0_fb.c */
1190 extern int  nvc0_fb_init(struct drm_device *);
1191 extern void nvc0_fb_takedown(struct drm_device *);
1192
1193 /* nv04_fifo.c */
1194 extern int  nv04_fifo_init(struct drm_device *);
1195 extern void nv04_fifo_fini(struct drm_device *);
1196 extern void nv04_fifo_disable(struct drm_device *);
1197 extern void nv04_fifo_enable(struct drm_device *);
1198 extern bool nv04_fifo_reassign(struct drm_device *, bool);
1199 extern bool nv04_fifo_cache_pull(struct drm_device *, bool);
1200 extern int  nv04_fifo_channel_id(struct drm_device *);
1201 extern int  nv04_fifo_create_context(struct nouveau_channel *);
1202 extern void nv04_fifo_destroy_context(struct nouveau_channel *);
1203 extern int  nv04_fifo_load_context(struct nouveau_channel *);
1204 extern int  nv04_fifo_unload_context(struct drm_device *);
1205 extern void nv04_fifo_isr(struct drm_device *);
1206
1207 /* nv10_fifo.c */
1208 extern int  nv10_fifo_init(struct drm_device *);
1209 extern int  nv10_fifo_channel_id(struct drm_device *);
1210 extern int  nv10_fifo_create_context(struct nouveau_channel *);
1211 extern int  nv10_fifo_load_context(struct nouveau_channel *);
1212 extern int  nv10_fifo_unload_context(struct drm_device *);
1213
1214 /* nv40_fifo.c */
1215 extern int  nv40_fifo_init(struct drm_device *);
1216 extern int  nv40_fifo_create_context(struct nouveau_channel *);
1217 extern int  nv40_fifo_load_context(struct nouveau_channel *);
1218 extern int  nv40_fifo_unload_context(struct drm_device *);
1219
1220 /* nv50_fifo.c */
1221 extern int  nv50_fifo_init(struct drm_device *);
1222 extern void nv50_fifo_takedown(struct drm_device *);
1223 extern int  nv50_fifo_channel_id(struct drm_device *);
1224 extern int  nv50_fifo_create_context(struct nouveau_channel *);
1225 extern void nv50_fifo_destroy_context(struct nouveau_channel *);
1226 extern int  nv50_fifo_load_context(struct nouveau_channel *);
1227 extern int  nv50_fifo_unload_context(struct drm_device *);
1228 extern void nv50_fifo_tlb_flush(struct drm_device *dev);
1229
1230 /* nvc0_fifo.c */
1231 extern int  nvc0_fifo_init(struct drm_device *);
1232 extern void nvc0_fifo_takedown(struct drm_device *);
1233 extern void nvc0_fifo_disable(struct drm_device *);
1234 extern void nvc0_fifo_enable(struct drm_device *);
1235 extern bool nvc0_fifo_reassign(struct drm_device *, bool);
1236 extern bool nvc0_fifo_cache_pull(struct drm_device *, bool);
1237 extern int  nvc0_fifo_channel_id(struct drm_device *);
1238 extern int  nvc0_fifo_create_context(struct nouveau_channel *);
1239 extern void nvc0_fifo_destroy_context(struct nouveau_channel *);
1240 extern int  nvc0_fifo_load_context(struct nouveau_channel *);
1241 extern int  nvc0_fifo_unload_context(struct drm_device *);
1242
1243 /* nve0_fifo.c */
1244 extern int  nve0_fifo_init(struct drm_device *);
1245 extern void nve0_fifo_takedown(struct drm_device *);
1246 extern int  nve0_fifo_channel_id(struct drm_device *);
1247 extern int  nve0_fifo_create_context(struct nouveau_channel *);
1248 extern void nve0_fifo_destroy_context(struct nouveau_channel *);
1249 extern int  nve0_fifo_unload_context(struct drm_device *);
1250
1251 /* nv04_graph.c */
1252 extern int  nv04_graph_create(struct drm_device *);
1253 extern int  nv04_graph_object_new(struct nouveau_channel *, int, u32, u16);
1254 extern int  nv04_graph_mthd_page_flip(struct nouveau_channel *chan,
1255                                       u32 class, u32 mthd, u32 data);
1256 extern struct nouveau_bitfield nv04_graph_nsource[];
1257
1258 /* nv10_graph.c */
1259 extern int  nv10_graph_create(struct drm_device *);
1260 extern struct nouveau_channel *nv10_graph_channel(struct drm_device *);
1261 extern struct nouveau_bitfield nv10_graph_intr[];
1262 extern struct nouveau_bitfield nv10_graph_nstatus[];
1263
1264 /* nv20_graph.c */
1265 extern int  nv20_graph_create(struct drm_device *);
1266
1267 /* nv40_graph.c */
1268 extern int  nv40_graph_create(struct drm_device *);
1269 extern void nv40_grctx_init(struct drm_device *, u32 *size);
1270 extern void nv40_grctx_fill(struct drm_device *, struct nouveau_gpuobj *);
1271
1272 /* nv50_graph.c */
1273 extern int  nv50_graph_create(struct drm_device *);
1274 extern struct nouveau_enum nv50_data_error_names[];
1275 extern int  nv50_graph_isr_chid(struct drm_device *dev, u64 inst);
1276 extern int  nv50_grctx_init(struct drm_device *, u32 *, u32, u32 *, u32 *);
1277 extern void nv50_grctx_fill(struct drm_device *, struct nouveau_gpuobj *);
1278
1279 /* nvc0_graph.c */
1280 extern int  nvc0_graph_create(struct drm_device *);
1281 extern int  nvc0_graph_isr_chid(struct drm_device *dev, u64 inst);
1282
1283 /* nve0_graph.c */
1284 extern int  nve0_graph_create(struct drm_device *);
1285
1286 /* nv84_crypt.c */
1287 extern int  nv84_crypt_create(struct drm_device *);
1288
1289 /* nv98_crypt.c */
1290 extern int  nv98_crypt_create(struct drm_device *dev);
1291
1292 /* nva3_copy.c */
1293 extern int  nva3_copy_create(struct drm_device *dev);
1294
1295 /* nvc0_copy.c */
1296 extern int  nvc0_copy_create(struct drm_device *dev, int engine);
1297
1298 /* nv31_mpeg.c */
1299 extern int  nv31_mpeg_create(struct drm_device *dev);
1300
1301 /* nv50_mpeg.c */
1302 extern int  nv50_mpeg_create(struct drm_device *dev);
1303
1304 /* nv84_bsp.c */
1305 /* nv98_bsp.c */
1306 extern int  nv84_bsp_create(struct drm_device *dev);
1307
1308 /* nv84_vp.c */
1309 /* nv98_vp.c */
1310 extern int  nv84_vp_create(struct drm_device *dev);
1311
1312 /* nv98_ppp.c */
1313 extern int  nv98_ppp_create(struct drm_device *dev);
1314
1315 /* nv04_instmem.c */
1316 extern int  nv04_instmem_init(struct drm_device *);
1317 extern void nv04_instmem_takedown(struct drm_device *);
1318 extern int  nv04_instmem_suspend(struct drm_device *);
1319 extern void nv04_instmem_resume(struct drm_device *);
1320 extern int  nv04_instmem_get(struct nouveau_gpuobj *, struct nouveau_channel *,
1321                              u32 size, u32 align);
1322 extern void nv04_instmem_put(struct nouveau_gpuobj *);
1323 extern int  nv04_instmem_map(struct nouveau_gpuobj *);
1324 extern void nv04_instmem_unmap(struct nouveau_gpuobj *);
1325 extern void nv04_instmem_flush(struct drm_device *);
1326
1327 /* nv50_instmem.c */
1328 extern int  nv50_instmem_init(struct drm_device *);
1329 extern void nv50_instmem_takedown(struct drm_device *);
1330 extern int  nv50_instmem_suspend(struct drm_device *);
1331 extern void nv50_instmem_resume(struct drm_device *);
1332 extern int  nv50_instmem_get(struct nouveau_gpuobj *, struct nouveau_channel *,
1333                              u32 size, u32 align);
1334 extern void nv50_instmem_put(struct nouveau_gpuobj *);
1335 extern int  nv50_instmem_map(struct nouveau_gpuobj *);
1336 extern void nv50_instmem_unmap(struct nouveau_gpuobj *);
1337 extern void nv50_instmem_flush(struct drm_device *);
1338 extern void nv84_instmem_flush(struct drm_device *);
1339
1340 /* nvc0_instmem.c */
1341 extern int  nvc0_instmem_init(struct drm_device *);
1342 extern void nvc0_instmem_takedown(struct drm_device *);
1343 extern int  nvc0_instmem_suspend(struct drm_device *);
1344 extern void nvc0_instmem_resume(struct drm_device *);
1345
1346 /* nv04_mc.c */
1347 extern int  nv04_mc_init(struct drm_device *);
1348 extern void nv04_mc_takedown(struct drm_device *);
1349
1350 /* nv40_mc.c */
1351 extern int  nv40_mc_init(struct drm_device *);
1352 extern void nv40_mc_takedown(struct drm_device *);
1353
1354 /* nv50_mc.c */
1355 extern int  nv50_mc_init(struct drm_device *);
1356 extern void nv50_mc_takedown(struct drm_device *);
1357
1358 /* nv04_timer.c */
1359 extern int  nv04_timer_init(struct drm_device *);
1360 extern uint64_t nv04_timer_read(struct drm_device *);
1361 extern void nv04_timer_takedown(struct drm_device *);
1362
1363 extern long nouveau_compat_ioctl(struct file *file, unsigned int cmd,
1364                                  unsigned long arg);
1365
1366 /* nv04_dac.c */
1367 extern int nv04_dac_create(struct drm_connector *, struct dcb_entry *);
1368 extern uint32_t nv17_dac_sample_load(struct drm_encoder *encoder);
1369 extern int nv04_dac_output_offset(struct drm_encoder *encoder);
1370 extern void nv04_dac_update_dacclk(struct drm_encoder *encoder, bool enable);
1371 extern bool nv04_dac_in_use(struct drm_encoder *encoder);
1372
1373 /* nv04_dfp.c */
1374 extern int nv04_dfp_create(struct drm_connector *, struct dcb_entry *);
1375 extern int nv04_dfp_get_bound_head(struct drm_device *dev, struct dcb_entry *dcbent);
1376 extern void nv04_dfp_bind_head(struct drm_device *dev, struct dcb_entry *dcbent,
1377                                int head, bool dl);
1378 extern void nv04_dfp_disable(struct drm_device *dev, int head);
1379 extern void nv04_dfp_update_fp_control(struct drm_encoder *encoder, int mode);
1380
1381 /* nv04_tv.c */
1382 extern int nv04_tv_identify(struct drm_device *dev, int i2c_index);
1383 extern int nv04_tv_create(struct drm_connector *, struct dcb_entry *);
1384
1385 /* nv17_tv.c */
1386 extern int nv17_tv_create(struct drm_connector *, struct dcb_entry *);
1387
1388 /* nv04_display.c */
1389 extern int nv04_display_early_init(struct drm_device *);
1390 extern void nv04_display_late_takedown(struct drm_device *);
1391 extern int nv04_display_create(struct drm_device *);
1392 extern void nv04_display_destroy(struct drm_device *);
1393 extern int nv04_display_init(struct drm_device *);
1394 extern void nv04_display_fini(struct drm_device *);
1395
1396 /* nvd0_display.c */
1397 extern int nvd0_display_create(struct drm_device *);
1398 extern void nvd0_display_destroy(struct drm_device *);
1399 extern int nvd0_display_init(struct drm_device *);
1400 extern void nvd0_display_fini(struct drm_device *);
1401 struct nouveau_bo *nvd0_display_crtc_sema(struct drm_device *, int crtc);
1402 void nvd0_display_flip_stop(struct drm_crtc *);
1403 int nvd0_display_flip_next(struct drm_crtc *, struct drm_framebuffer *,
1404                            struct nouveau_channel *, u32 swap_interval);
1405
1406 /* nv04_crtc.c */
1407 extern int nv04_crtc_create(struct drm_device *, int index);
1408
1409 /* nouveau_bo.c */
1410 extern struct ttm_bo_driver nouveau_bo_driver;
1411 extern int nouveau_bo_new(struct drm_device *, int size, int align,
1412                           uint32_t flags, uint32_t tile_mode,
1413                           uint32_t tile_flags,
1414                           struct sg_table *sg,
1415                           struct nouveau_bo **);
1416 extern int nouveau_bo_pin(struct nouveau_bo *, uint32_t flags);
1417 extern int nouveau_bo_unpin(struct nouveau_bo *);
1418 extern int nouveau_bo_map(struct nouveau_bo *);
1419 extern void nouveau_bo_unmap(struct nouveau_bo *);
1420 extern void nouveau_bo_placement_set(struct nouveau_bo *, uint32_t type,
1421                                      uint32_t busy);
1422 extern u16 nouveau_bo_rd16(struct nouveau_bo *nvbo, unsigned index);
1423 extern void nouveau_bo_wr16(struct nouveau_bo *nvbo, unsigned index, u16 val);
1424 extern u32 nouveau_bo_rd32(struct nouveau_bo *nvbo, unsigned index);
1425 extern void nouveau_bo_wr32(struct nouveau_bo *nvbo, unsigned index, u32 val);
1426 extern void nouveau_bo_fence(struct nouveau_bo *, struct nouveau_fence *);
1427 extern int nouveau_bo_validate(struct nouveau_bo *, bool interruptible,
1428                                bool no_wait_reserve, bool no_wait_gpu);
1429
1430 extern struct nouveau_vma *
1431 nouveau_bo_vma_find(struct nouveau_bo *, struct nouveau_vm *);
1432 extern int  nouveau_bo_vma_add(struct nouveau_bo *, struct nouveau_vm *,
1433                                struct nouveau_vma *);
1434 extern void nouveau_bo_vma_del(struct nouveau_bo *, struct nouveau_vma *);
1435
1436 /* nouveau_gem.c */
1437 extern int nouveau_gem_new(struct drm_device *, int size, int align,
1438                            uint32_t domain, uint32_t tile_mode,
1439                            uint32_t tile_flags, struct nouveau_bo **);
1440 extern int nouveau_gem_object_new(struct drm_gem_object *);
1441 extern void nouveau_gem_object_del(struct drm_gem_object *);
1442 extern int nouveau_gem_object_open(struct drm_gem_object *, struct drm_file *);
1443 extern void nouveau_gem_object_close(struct drm_gem_object *,
1444                                      struct drm_file *);
1445 extern int nouveau_gem_ioctl_new(struct drm_device *, void *,
1446                                  struct drm_file *);
1447 extern int nouveau_gem_ioctl_pushbuf(struct drm_device *, void *,
1448                                      struct drm_file *);
1449 extern int nouveau_gem_ioctl_cpu_prep(struct drm_device *, void *,
1450                                       struct drm_file *);
1451 extern int nouveau_gem_ioctl_cpu_fini(struct drm_device *, void *,
1452                                       struct drm_file *);
1453 extern int nouveau_gem_ioctl_info(struct drm_device *, void *,
1454                                   struct drm_file *);
1455
1456 extern struct dma_buf *nouveau_gem_prime_export(struct drm_device *dev,
1457                                 struct drm_gem_object *obj, int flags);
1458 extern struct drm_gem_object *nouveau_gem_prime_import(struct drm_device *dev,
1459                                 struct dma_buf *dma_buf);
1460
1461 /* nouveau_display.c */
1462 int nouveau_display_create(struct drm_device *dev);
1463 void nouveau_display_destroy(struct drm_device *dev);
1464 int nouveau_display_init(struct drm_device *dev);
1465 void nouveau_display_fini(struct drm_device *dev);
1466 int nouveau_vblank_enable(struct drm_device *dev, int crtc);
1467 void nouveau_vblank_disable(struct drm_device *dev, int crtc);
1468 int nouveau_crtc_page_flip(struct drm_crtc *crtc, struct drm_framebuffer *fb,
1469                            struct drm_pending_vblank_event *event);
1470 int nouveau_finish_page_flip(struct nouveau_channel *,
1471                              struct nouveau_page_flip_state *);
1472 int nouveau_display_dumb_create(struct drm_file *, struct drm_device *,
1473                                 struct drm_mode_create_dumb *args);
1474 int nouveau_display_dumb_map_offset(struct drm_file *, struct drm_device *,
1475                                     uint32_t handle, uint64_t *offset);
1476 int nouveau_display_dumb_destroy(struct drm_file *, struct drm_device *,
1477                                  uint32_t handle);
1478
1479 /* nv10_gpio.c */
1480 int nv10_gpio_init(struct drm_device *dev);
1481 void nv10_gpio_fini(struct drm_device *dev);
1482 int nv10_gpio_drive(struct drm_device *dev, int line, int dir, int out);
1483 int nv10_gpio_sense(struct drm_device *dev, int line);
1484 void nv10_gpio_irq_enable(struct drm_device *, int line, bool on);
1485
1486 /* nv50_gpio.c */
1487 int nv50_gpio_init(struct drm_device *dev);
1488 void nv50_gpio_fini(struct drm_device *dev);
1489 int nv50_gpio_drive(struct drm_device *dev, int line, int dir, int out);
1490 int nv50_gpio_sense(struct drm_device *dev, int line);
1491 void nv50_gpio_irq_enable(struct drm_device *, int line, bool on);
1492 int nvd0_gpio_drive(struct drm_device *dev, int line, int dir, int out);
1493 int nvd0_gpio_sense(struct drm_device *dev, int line);
1494
1495 /* nv50_calc.c */
1496 int nv50_calc_pll(struct drm_device *, struct pll_lims *, int clk,
1497                   int *N1, int *M1, int *N2, int *M2, int *P);
1498 int nva3_calc_pll(struct drm_device *, struct pll_lims *,
1499                   int clk, int *N, int *fN, int *M, int *P);
1500
1501 #ifndef ioread32_native
1502 #ifdef __BIG_ENDIAN
1503 #define ioread16_native ioread16be
1504 #define iowrite16_native iowrite16be
1505 #define ioread32_native  ioread32be
1506 #define iowrite32_native iowrite32be
1507 #else /* def __BIG_ENDIAN */
1508 #define ioread16_native ioread16
1509 #define iowrite16_native iowrite16
1510 #define ioread32_native  ioread32
1511 #define iowrite32_native iowrite32
1512 #endif /* def __BIG_ENDIAN else */
1513 #endif /* !ioread32_native */
1514
1515 /* channel control reg access */
1516 static inline u32 nvchan_rd32(struct nouveau_channel *chan, unsigned reg)
1517 {
1518         return ioread32_native(chan->user + reg);
1519 }
1520
1521 static inline void nvchan_wr32(struct nouveau_channel *chan,
1522                                                         unsigned reg, u32 val)
1523 {
1524         iowrite32_native(val, chan->user + reg);
1525 }
1526
1527 /* register access */
1528 static inline u32 nv_rd32(struct drm_device *dev, unsigned reg)
1529 {
1530         struct drm_nouveau_private *dev_priv = dev->dev_private;
1531         return ioread32_native(dev_priv->mmio + reg);
1532 }
1533
1534 static inline void nv_wr32(struct drm_device *dev, unsigned reg, u32 val)
1535 {
1536         struct drm_nouveau_private *dev_priv = dev->dev_private;
1537         iowrite32_native(val, dev_priv->mmio + reg);
1538 }
1539
1540 static inline u32 nv_mask(struct drm_device *dev, u32 reg, u32 mask, u32 val)
1541 {
1542         u32 tmp = nv_rd32(dev, reg);
1543         nv_wr32(dev, reg, (tmp & ~mask) | val);
1544         return tmp;
1545 }
1546
1547 static inline u8 nv_rd08(struct drm_device *dev, unsigned reg)
1548 {
1549         struct drm_nouveau_private *dev_priv = dev->dev_private;
1550         return ioread8(dev_priv->mmio + reg);
1551 }
1552
1553 static inline void nv_wr08(struct drm_device *dev, unsigned reg, u8 val)
1554 {
1555         struct drm_nouveau_private *dev_priv = dev->dev_private;
1556         iowrite8(val, dev_priv->mmio + reg);
1557 }
1558
1559 #define nv_wait(dev, reg, mask, val) \
1560         nouveau_wait_eq(dev, 2000000000ULL, (reg), (mask), (val))
1561 #define nv_wait_ne(dev, reg, mask, val) \
1562         nouveau_wait_ne(dev, 2000000000ULL, (reg), (mask), (val))
1563 #define nv_wait_cb(dev, func, data) \
1564         nouveau_wait_cb(dev, 2000000000ULL, (func), (data))
1565
1566 /* PRAMIN access */
1567 static inline u32 nv_ri32(struct drm_device *dev, unsigned offset)
1568 {
1569         struct drm_nouveau_private *dev_priv = dev->dev_private;
1570         return ioread32_native(dev_priv->ramin + offset);
1571 }
1572
1573 static inline void nv_wi32(struct drm_device *dev, unsigned offset, u32 val)
1574 {
1575         struct drm_nouveau_private *dev_priv = dev->dev_private;
1576         iowrite32_native(val, dev_priv->ramin + offset);
1577 }
1578
1579 /* object access */
1580 extern u32 nv_ro32(struct nouveau_gpuobj *, u32 offset);
1581 extern void nv_wo32(struct nouveau_gpuobj *, u32 offset, u32 val);
1582
1583 /*
1584  * Logging
1585  * Argument d is (struct drm_device *).
1586  */
1587 #define NV_PRINTK(level, d, fmt, arg...) \
1588         printk(level "[" DRM_NAME "] " DRIVER_NAME " %s: " fmt, \
1589                                         pci_name(d->pdev), ##arg)
1590 #ifndef NV_DEBUG_NOTRACE
1591 #define NV_DEBUG(d, fmt, arg...) do {                                          \
1592         if (drm_debug & DRM_UT_DRIVER) {                                       \
1593                 NV_PRINTK(KERN_DEBUG, d, "%s:%d - " fmt, __func__,             \
1594                           __LINE__, ##arg);                                    \
1595         }                                                                      \
1596 } while (0)
1597 #define NV_DEBUG_KMS(d, fmt, arg...) do {                                      \
1598         if (drm_debug & DRM_UT_KMS) {                                          \
1599                 NV_PRINTK(KERN_DEBUG, d, "%s:%d - " fmt, __func__,             \
1600                           __LINE__, ##arg);                                    \
1601         }                                                                      \
1602 } while (0)
1603 #else
1604 #define NV_DEBUG(d, fmt, arg...) do {                                          \
1605         if (drm_debug & DRM_UT_DRIVER)                                         \
1606                 NV_PRINTK(KERN_DEBUG, d, fmt, ##arg);                          \
1607 } while (0)
1608 #define NV_DEBUG_KMS(d, fmt, arg...) do {                                      \
1609         if (drm_debug & DRM_UT_KMS)                                            \
1610                 NV_PRINTK(KERN_DEBUG, d, fmt, ##arg);                          \
1611 } while (0)
1612 #endif
1613 #define NV_ERROR(d, fmt, arg...) NV_PRINTK(KERN_ERR, d, fmt, ##arg)
1614 #define NV_INFO(d, fmt, arg...) NV_PRINTK(KERN_INFO, d, fmt, ##arg)
1615 #define NV_TRACEWARN(d, fmt, arg...) NV_PRINTK(KERN_NOTICE, d, fmt, ##arg)
1616 #define NV_TRACE(d, fmt, arg...) NV_PRINTK(KERN_INFO, d, fmt, ##arg)
1617 #define NV_WARN(d, fmt, arg...) NV_PRINTK(KERN_WARNING, d, fmt, ##arg)
1618 #define NV_WARNONCE(d, fmt, arg...) do {                                       \
1619         static int _warned = 0;                                                \
1620         if (!_warned) {                                                        \
1621                 NV_WARN(d, fmt, ##arg);                                        \
1622                 _warned = 1;                                                   \
1623         }                                                                      \
1624 } while(0)
1625
1626 /* nouveau_reg_debug bitmask */
1627 enum {
1628         NOUVEAU_REG_DEBUG_MC             = 0x1,
1629         NOUVEAU_REG_DEBUG_VIDEO          = 0x2,
1630         NOUVEAU_REG_DEBUG_FB             = 0x4,
1631         NOUVEAU_REG_DEBUG_EXTDEV         = 0x8,
1632         NOUVEAU_REG_DEBUG_CRTC           = 0x10,
1633         NOUVEAU_REG_DEBUG_RAMDAC         = 0x20,
1634         NOUVEAU_REG_DEBUG_VGACRTC        = 0x40,
1635         NOUVEAU_REG_DEBUG_RMVIO          = 0x80,
1636         NOUVEAU_REG_DEBUG_VGAATTR        = 0x100,
1637         NOUVEAU_REG_DEBUG_EVO            = 0x200,
1638         NOUVEAU_REG_DEBUG_AUXCH          = 0x400
1639 };
1640
1641 #define NV_REG_DEBUG(type, dev, fmt, arg...) do { \
1642         if (nouveau_reg_debug & NOUVEAU_REG_DEBUG_##type) \
1643                 NV_PRINTK(KERN_DEBUG, dev, "%s: " fmt, __func__, ##arg); \
1644 } while (0)
1645
1646 static inline bool
1647 nv_two_heads(struct drm_device *dev)
1648 {
1649         struct drm_nouveau_private *dev_priv = dev->dev_private;
1650         const int impl = dev->pci_device & 0x0ff0;
1651
1652         if (dev_priv->card_type >= NV_10 && impl != 0x0100 &&
1653             impl != 0x0150 && impl != 0x01a0 && impl != 0x0200)
1654                 return true;
1655
1656         return false;
1657 }
1658
1659 static inline bool
1660 nv_gf4_disp_arch(struct drm_device *dev)
1661 {
1662         return nv_two_heads(dev) && (dev->pci_device & 0x0ff0) != 0x0110;
1663 }
1664
1665 static inline bool
1666 nv_two_reg_pll(struct drm_device *dev)
1667 {
1668         struct drm_nouveau_private *dev_priv = dev->dev_private;
1669         const int impl = dev->pci_device & 0x0ff0;
1670
1671         if (impl == 0x0310 || impl == 0x0340 || dev_priv->card_type >= NV_40)
1672                 return true;
1673         return false;
1674 }
1675
1676 static inline bool
1677 nv_match_device(struct drm_device *dev, unsigned device,
1678                 unsigned sub_vendor, unsigned sub_device)
1679 {
1680         return dev->pdev->device == device &&
1681                 dev->pdev->subsystem_vendor == sub_vendor &&
1682                 dev->pdev->subsystem_device == sub_device;
1683 }
1684
1685 static inline void *
1686 nv_engine(struct drm_device *dev, int engine)
1687 {
1688         struct drm_nouveau_private *dev_priv = dev->dev_private;
1689         return (void *)dev_priv->eng[engine];
1690 }
1691
1692 /* returns 1 if device is one of the nv4x using the 0x4497 object class,
1693  * helpful to determine a number of other hardware features
1694  */
1695 static inline int
1696 nv44_graph_class(struct drm_device *dev)
1697 {
1698         struct drm_nouveau_private *dev_priv = dev->dev_private;
1699
1700         if ((dev_priv->chipset & 0xf0) == 0x60)
1701                 return 1;
1702
1703         return !(0x0baf & (1 << (dev_priv->chipset & 0x0f)));
1704 }
1705
1706 /* memory type/access flags, do not match hardware values */
1707 #define NV_MEM_ACCESS_RO  1
1708 #define NV_MEM_ACCESS_WO  2
1709 #define NV_MEM_ACCESS_RW (NV_MEM_ACCESS_RO | NV_MEM_ACCESS_WO)
1710 #define NV_MEM_ACCESS_SYS 4
1711 #define NV_MEM_ACCESS_VM  8
1712 #define NV_MEM_ACCESS_NOSNOOP 16
1713
1714 #define NV_MEM_TARGET_VRAM        0
1715 #define NV_MEM_TARGET_PCI         1
1716 #define NV_MEM_TARGET_PCI_NOSNOOP 2
1717 #define NV_MEM_TARGET_VM          3
1718 #define NV_MEM_TARGET_GART        4
1719
1720 #define NV_MEM_TYPE_VM 0x7f
1721 #define NV_MEM_COMP_VM 0x03
1722
1723 /* FIFO methods */
1724 #define NV01_SUBCHAN_OBJECT                                          0x00000000
1725 #define NV84_SUBCHAN_SEMAPHORE_ADDRESS_HIGH                          0x00000010
1726 #define NV84_SUBCHAN_SEMAPHORE_ADDRESS_LOW                           0x00000014
1727 #define NV84_SUBCHAN_SEMAPHORE_SEQUENCE                              0x00000018
1728 #define NV84_SUBCHAN_SEMAPHORE_TRIGGER                               0x0000001c
1729 #define NV84_SUBCHAN_SEMAPHORE_TRIGGER_ACQUIRE_EQUAL                 0x00000001
1730 #define NV84_SUBCHAN_SEMAPHORE_TRIGGER_WRITE_LONG                    0x00000002
1731 #define NV84_SUBCHAN_SEMAPHORE_TRIGGER_ACQUIRE_GEQUAL                0x00000004
1732 #define NVC0_SUBCHAN_SEMAPHORE_TRIGGER_YIELD                         0x00001000
1733 #define NV84_SUBCHAN_NOTIFY_INTR                                     0x00000020
1734 #define NV84_SUBCHAN_WRCACHE_FLUSH                                   0x00000024
1735 #define NV10_SUBCHAN_REF_CNT                                         0x00000050
1736 #define NVSW_SUBCHAN_PAGE_FLIP                                       0x00000054
1737 #define NV11_SUBCHAN_DMA_SEMAPHORE                                   0x00000060
1738 #define NV11_SUBCHAN_SEMAPHORE_OFFSET                                0x00000064
1739 #define NV11_SUBCHAN_SEMAPHORE_ACQUIRE                               0x00000068
1740 #define NV11_SUBCHAN_SEMAPHORE_RELEASE                               0x0000006c
1741 #define NV40_SUBCHAN_YIELD                                           0x00000080
1742
1743 /* NV_SW object class */
1744 #define NV_SW                                                        0x0000506e
1745 #define NV_SW_DMA_VBLSEM                                             0x0000018c
1746 #define NV_SW_VBLSEM_OFFSET                                          0x00000400
1747 #define NV_SW_VBLSEM_RELEASE_VALUE                                   0x00000404
1748 #define NV_SW_VBLSEM_RELEASE                                         0x00000408
1749 #define NV_SW_PAGE_FLIP                                              0x00000500
1750
1751 #endif /* __NOUVEAU_DRV_H__ */