board/amcc/canyonlands/init.S

   1 /*
   2  * (C) Copyright 2008
   3  * Stefan Roese, DENX Software Engineering, sr@denx.de.
   4  *
   5  * See file CREDITS for list of people who contributed to this
   6  * project.
   7  *
   8  * This program is free software; you can redistribute it and/or
   9  * modify it under the terms of the GNU General Public License as
  10  * published by the Free Software Foundation; either version 2 of
  11  * the License, or (at your option) any later version.
  12  *
  13  * This program is distributed in the hope that it will be useful,
  14  * but WITHOUT ANY WARRANTY; without even the implied warranty of
  15  * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
  16  * GNU General Public License for more details.
  17  *
  18  * You should have received a copy of the GNU General Public License
  19  * along with this program; if not, write to the Free Software
  20  * Foundation, Inc., 59 Temple Place, Suite 330, Boston,
  21  * MA 02111-1307 USA
  22  */
  23
  24 #include <asm-offsets.h>
  25 #include <ppc_asm.tmpl>
  26 #include <config.h>
  27 #include <asm/mmu.h>
  28
  29 /**************************************************************************
  30  * TLB TABLE
  31  *
  32  * This table is used by the cpu boot code to setup the initial tlb
  33  * entries. Rather than make broad assumptions in the cpu source tree,
  34  * this table lets each board set things up however they like.
  35  *
  36  *  Pointer to the table is returned in r1
  37  *
  38  *************************************************************************/
  39         .section .bootpg,"ax"
  40         .globl tlbtab
  41
  42 tlbtab:
  43         tlbtab_start
  44
  45         /*
  46          * BOOT_CS (FLASH) must be first. Before relocation SA_I can be off to
  47          * use the speed up boot process. It is patched after relocation to
  48          * enable SA_I
  49          */
  50 #ifndef CONFIG_NAND_SPL
  51         tlbentry(CONFIG_SYS_BOOT_BASE_ADDR, SZ_16M, CONFIG_SYS_BOOT_BASE_ADDR, 4, AC_RWX | SA_G) /* TLB 0 */
  52 #else
  53         tlbentry(CONFIG_SYS_NAND_BOOT_SPL_SRC, SZ_4K, CONFIG_SYS_NAND_BOOT_SPL_SRC, 4, AC_RWX | SA_G)
  54         tlbentry(CONFIG_SYS_SDRAM_BASE, SZ_256M, CONFIG_SYS_SDRAM_BASE, 0, AC_RWX | SA_IG)
  55         tlbentry(256 << 20, SZ_256M, 256 << 20, 0, AC_RWX | SA_IG)
  56 #endif
  57
  58         /*
  59          * TLB entries for SDRAM are not needed on this platform.
  60          * They are dynamically generated in the SPD DDR(2) detection
  61          * routine.
  62          */
  63
  64 #ifdef CONFIG_SYS_INIT_RAM_DCACHE
  65         /* TLB-entry for init-ram in dcache (SA_I must be turned off!) */
  66         tlbentry(CONFIG_SYS_INIT_RAM_ADDR, SZ_4K, CONFIG_SYS_INIT_RAM_ADDR, 0, AC_RWX | SA_G)
  67 #endif
  68
  69         tlbentry(CONFIG_SYS_PCI_BASE, SZ_256M, 0x00000000, 0xC, AC_RW | SA_IG)
  70         tlbentry(CONFIG_SYS_PCI_MEMBASE, SZ_256M, 0x20000000, 0xC, AC_RW | SA_IG)
  71         tlbentry(CONFIG_SYS_PCIE_MEMBASE, SZ_256M, 0xB0000000, 0xD, AC_RW | SA_IG)
  72
  73         tlbentry(CONFIG_SYS_PCIE0_CFGBASE, SZ_16M, 0x00000000, 0xD, AC_RW | SA_IG)
  74         tlbentry(CONFIG_SYS_PCIE1_CFGBASE, SZ_16M, 0x20000000, 0xD, AC_RW | SA_IG)
  75         tlbentry(CONFIG_SYS_PCIE0_XCFGBASE, SZ_1K, 0x10000000, 0xD, AC_RW | SA_IG)
  76         tlbentry(CONFIG_SYS_PCIE1_XCFGBASE, SZ_1K, 0x30000000, 0xD, AC_RW | SA_IG)
  77
  78         /* PCIe UTL register */
  79         tlbentry(CONFIG_SYS_PCIE_BASE, SZ_16K, 0x08010000, 0xC, AC_RW | SA_IG)
  80
  81 #if !defined(CONFIG_ARCHES)
  82         /* TLB-entry for NAND */
  83         tlbentry(CONFIG_SYS_NAND_ADDR, SZ_1K, CONFIG_SYS_NAND_ADDR, 4, AC_RWX | SA_IG)
  84
  85         /* TLB-entry for CPLD */
  86         tlbentry(CONFIG_SYS_BCSR_BASE, SZ_1K, CONFIG_SYS_BCSR_BASE, 4, AC_RW | SA_IG)
  87 #else
  88         /* TLB-entry for FPGA */
  89         tlbentry(CONFIG_SYS_FPGA_BASE, SZ_16M, CONFIG_SYS_FPGA_BASE, 4, AC_RW | SA_IG)
  90 #endif
  91
  92         /* TLB-entry for OCM */
  93         tlbentry(CONFIG_SYS_OCM_BASE, SZ_1M, 0x00000000, 4, AC_RWX | SA_I)
  94
  95         /* TLB-entry for Local Configuration registers => peripherals */
  96         tlbentry(CONFIG_SYS_LOCAL_CONF_REGS, SZ_16M, CONFIG_SYS_LOCAL_CONF_REGS, 4, AC_RWX | SA_IG)
  97
  98         /* AHB: Internal USB Peripherals (USB, SATA) */
  99         tlbentry(CONFIG_SYS_AHB_BASE, SZ_1M, 0xbff00000, 4, AC_RWX | SA_IG)
 100
 101 #if defined(CONFIG_RAPIDIO)
 102         /* TLB-entries for RapidIO (SRIO) */
 103         tlbentry(CONFIG_SYS_SRGPL0_REG_BAR, SZ_16M, CONFIG_SYS_SRGPL0_REG_BAR,
 104                                         0xD, AC_RW | SA_IG)
 105         tlbentry(CONFIG_SYS_SRGPL0_CFG_BAR, SZ_16M, CONFIG_SYS_SRGPL0_CFG_BAR,
 106                                         0xD, AC_RW | SA_IG)
 107         tlbentry(CONFIG_SYS_SRGPL0_MNT_BAR, SZ_16M, CONFIG_SYS_SRGPL0_MNT_BAR,
 108                                         0xD, AC_RW | SA_IG)
 109         tlbentry(CONFIG_SYS_I2ODMA_BASE, SZ_1K,  0x00100000,
 110                                         0x4, AC_RW | SA_IG)
 111 #endif
 112
 113         tlbtab_end
 114
 115 #if defined(CONFIG_NAND_U_BOOT) && !defined(CONFIG_NAND_SPL)
 116         /*
 117          * For NAND booting the first TLB has to be reconfigured to full size
 118          * and with caching disabled after running from RAM!
 119          */
 120 #define TLB00   TLB0(CONFIG_SYS_BOOT_BASE_ADDR, SZ_256M)
 121 #define TLB01   TLB1(CONFIG_SYS_BOOT_BASE_ADDR, 1)
 122 #define TLB02   TLB2(AC_RWX | SA_IG)
 123
 124         .globl  reconfig_tlb0
 125 reconfig_tlb0:
 126         sync
 127         isync
 128         addi    r4,r0,0x0000            /* TLB entry #0 */
 129         lis     r5,TLB00@h
 130         ori     r5,r5,TLB00@l
 131         tlbwe   r5,r4,0x0000            /* Save it out */
 132         lis     r5,TLB01@h
 133         ori     r5,r5,TLB01@l
 134         tlbwe   r5,r4,0x0001            /* Save it out */
 135         lis     r5,TLB02@h
 136         ori     r5,r5,TLB02@l
 137         tlbwe   r5,r4,0x0002            /* Save it out */
 138         sync
 139         isync
 140         blr
 141 #endif